CN108170470A - Soc***按位写装置 - Google Patents
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Abstract
本发明提供一种SOC***按位写装置。所述装置包括:从设备接口模块、译码模块和主设备接口模块,所述从设备接口模块,用于接收总线控制器主设备接口发送的写请求,并将写请求发送到译码模块;所述译码模块,用于接收从设备接口模块发送的写请求,对写请求进行译码,将译码后的有效信息发送到主设备接口模块;所述主设备接口模块,用于接收译码模块发送的有效信息,读取目标地址中的数据,对读取的数据进行位操作,得到新的数据,向总线控制器从设备接口发送写请求,将得到的新的数据写入目标地址对应的外设寄存器中。本发明能够有效减小指令存储空间,从而减小芯片面积,节约芯片成本。
Description
技术领域
本发明涉及嵌入式***技术领域,尤其涉及一种SOC***按位写装置。
背景技术
目前,随着移动互联网的发展和SOC(System on Chip,片上***)芯片设计技术的日益成熟,市场和消费者对嵌入式***类产品提出了更高的要求。尤其是在由电池供电的便携式智能设备上,减小SOC芯片的面积显得尤为重要。
在芯片面积中存储模块所占的面积占了很大的比例,因此有效减小存储模块的面积,对架构、指令集设计及软硬件的分工提出了挑战。现有技术中,为有效减小指令存储空间,在有些SOC***中设计专门的硬件模块,对于高频使用的多条指令均采用硬件方式实现,这种方案在减小指令存储空间方面具有实用价值。
在实现本发明的过程中,发明人发现现有技术中至少存在如下技术问题:
目前SOC***中类似的硬件模块能够实现的功能单一,并且由模块内部的功能寄存器控制,当有不同位操作功能需求的情况下需要切换内部的控制寄存器,由此也会带来指令空间的开销。
发明内容
本发明提供的SOC***按位写装置,能够有效减小指令存储空间,从而减小芯片面积,节约成本。
第一方面,本发明提供一种SOC***按位写装置,所述装置与总线控制器主设备接口和总线控制器从设备接口相连,所述装置包括:从设备接口模块、译码模块和主设备接口模块,其中,
所述从设备接口模块,用于接收所述总线控制器主设备接口发送的写请求,并将所述写请求发送到译码模块,所述写请求包括映射地址和操作数;
所述译码模块,用于接收所述从设备接口模块发送的写请求,对所述写请求进行译码,将译码后的有效信息发送到所述主设备接口模块,所述译码后的有效信息包括目标地址、位选择信息和位有效数据;
所述主设备接口模块,用于接收所述译码模块发送的有效信息,读取所述目标地址中的数据,对读取的数据进行位操作,得到新的数据,向所述总线控制器从设备接口发送写请求,将得到的新的数据写入所述目标地址对应的外设寄存器中。
所述从设备接口模块,用于控制接收总线控制器的主设备接口发送的有效写请求。
可选地,所述译码模块,用于将接收到的写请求中的映射地址根据约定的映射关系转换为对应的目标地址及外设寄存器位。
可选地,所述主设备接口模块,用于根据所述位选择信息将读取到的数据的指定位修改为译码后的位有效数据,得到新的数据。
本发明实施例提供的SOC***按位写装置,从设备接口模块接收总线控制器的主设备接口发送的写请求,并将接收到的地址和数据发送到译码模块,译码模块对接收到的地址和数据信息进行译码,再将译码后的有效信息发送到主设备接口模块,主设备接口模块根据接收到的译码信息,首先发送读请求到总线控制器从接口模块,得到读数据,然后再将译码后的数据和读数据按照译码信息处理后向总线控制器从接口发送写请求,完成按位写操作功能。与现有技术相比,本发明能够直接译码出主设备写请求的地址和数据,从而将主设备的位写操作转化为一次写请求来实现,可以有效减小指令存储空间,节约芯片成本。
附图说明
图1为本发明一实施例SOC***按位写装置位于SOC***中的示意图;
图2为本发明另一实施例SOC***按位写装置与总线控制器的连接示意图;
图3为本发明一实施例SOC***按位写装置实现方案的流程图;
图4为本发明一实施例从设备接口模块的工作流程图;
图5为本发明一实施例译码模块的工作流程图;
图6为本发明一实施例主设备接口模块的工作流程图。
具体实施方式
为使本发明实施例的目的、技术方案和优点更加清楚,下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都属于本发明保护的范围。
本发明提供一种SOC***按位写装置,如图1所示,所述装置在SOC***中连接在总线上,与主设备和外设通过总线相连接,所述装置独立于总线控制器、主设备和外设,如图2所示,所述装置与总线控制器主设备接口和总线控制器从设备接口相连,所述装置包括:从设备接口模块11、译码模块12和主设备接口模块13,其中,
所述从设备接口模块11,用于接收所述总线控制器主设备接口发送的写请求,并将所述写请求发送到译码模块12,所述写请求包括映射地址和操作数;
可选地,所述从设备接口模块11,用于控制接收总线控制器的主设备接口发送的有效写请求。
所述译码模块12,用于接收所述从设备接口模块11发送的写请求,对所述写请求进行译码,将译码后的有效信息发送到所述主设备接口模块13,所述译码后的有效信息包括目标地址、位选择信息和位有效数据;
可选地,所述译码模块12,用于将接收到的写请求中的映射地址根据约定的映射关系转换为对应的目标地址及外设寄存器位。
所述主设备接口模块13,用于接收所述译码模块12发送的有效信息,读取所述目标地址中的数据,对读取的数据进行位操作,得到新的数据,向所述总线控制器从设备接口发送写请求,将得到的新的数据写入所述目标地址对应的外设寄存器中。
可选地,所述主设备接口模块13,用于根据所述位选择信息将读取到的数据的指定位修改为译码后的位有效数据,得到新的数据。
本发明提供的SOC***按位写装置是独立装置,位于主设备和总线控制器之间,该装置的位写操作与在总线内部或者主设备或者从设备内部的实现方式不同,该装置的实现方案为:对CPU发起的一次位写操作,首先将写操作发送到总线控制器;然后总线控制器将该请求发送到按位写装置;该装置再将这个写操作经译码处理,转换为对总线的位写操作。这种实现方式可以几乎不改变原总线控制器接口和内部实现方式,更方便扩展。
本发明中的SOC***按位写装置,主要应用在SOC***中软件有频繁位写操作的***中。该装置接收对应映射地址的写请求,在接收到有效请求后,再对有效请求进行译码,译码后再发起一次读请求,位操作,写请求,完成位写操作。该装置可以将读请求,位操作,写请求三个指令转化为对该装置的一次写请求来实现,因此该装置在频繁位操作的SOC***中,可以有效减小指令存储空间,从而达到节约成本的目的。
下面用具体例子对本发明提供的SOC***按位写装置进行详细说明。
如图2所示的SOC***按位写装置的示意图,该装置应用在总线控制器主设备接口和从设备接口之间,包括从设备接口模块、译码模块和主设备接口模块。如图3所示,为本发明一实施例SOC***按位写装置的实现方案的具体步骤:
步骤一、从设备接口模块通过总线控制器主设备接口接收来自主设备的一次写请求,该请求包括映射地址A和操作数据B;
从设备接口模块负责维护和控制总线控制器的主设备接口发送的有效写请求,并且接收总线控制器的主设备接口发送的写请求信息,同时负责将接收到的信息进行数据处理后发送给译码模块,完成与译码模块的数据通讯。
具体地,从设备接口模块只接收来自总线控制器主设备接口发起的一次写请求,该请求地址属于该SOC***按位写装置,对于其他地址请求由总线完成仲裁。
从设备接口模块接收到的写请求,其写控制信号中不是普通写的地址和数据信息。其中包含了写地址,位选择控制,写位数据有效位控制及位数据信息。如图4所示,为从设备接口模块的工作流程:
a1:检测是否接收到主机的有效写请求信号,如果有效跳转到步骤a2,否则继续在步骤a1;
a2:检测到有效写请求信号后,将接收到的地址和数据信号w_dt_adr发送到译码模块并且将发送到译码模块的req信号置1,跳转到步骤a3;
a3:检测是否接收到译码模块的有效应答信号ack是否为1,监测到为1后跳转到步骤a4,否则继续在步骤a3;
a4:检测到ack为1后,将req信号清0,跳转到步骤a1,如果没有监测到ack信号为1,继续在停留在步骤a3。
步骤二、译码模块对接收到的写请求进行译码,产生目标地址C和目标地址C所对应的寄存器的位D;
译码模块负责对接收到从设备接口模块的编码信息进行译码,并且将译码后的有效信息发送到主设备接口模块。该按位写装置的译码模块的实现方式相对于内部控制寄存器译码方式更具优势,因为内部控制寄存器的配置位选择控制和位有效数据,需要占用指令空间,而该装置的译码方式是由寄存器主控制接口当前请求的地址和数据直接译码出地址、位选择控制、位数据信息,该装置使用的直接译码方式相对于配置寄存器译码方式可以节省指令存储空间。如图5所示,为译码模块的工作流程:
b1:检测从设备接口模块发送的req信号是否为1,如果为1跳转到步骤b2;否则在步骤b1;
b2:根据接收到的w_dt_adr进行译码,译码得到目标地址C,位选择D,位数据B,跳转到步骤b3;
b3:译码模块将步骤b2得到的目标地址C、位选择D、位数据B发送到主设备接口模块13,并且将ym_req信号置1,跳转到步骤b4;
b4:检测是否接收到主设备接口模块的应答信号ym_ack是否为1,如果监测到ym_ack为1,跳转到步骤b5,否则继续在步骤b4;
b5:将ym_req信号清0,跳转到步骤b1。
译码模块根据约定的映射关系,将映射地址A映射成目标地址C以及目标地址C所对应的外设寄存器中的位D,根据约定的映射关系将主设备的写请求信息转换成提供给主设备接口模块的外设位操作信息。例如,译码模块12的译码方式为:
信号w_dt_adr来自有从设备接口模块接收到的地址信号w_adr和数据信号w_dt。位选择信号D来自于w_adr的低位(以32位数据宽度的总线,则来自于其低五位);位数据信号则由w_adr的低两位来决定位数据来自于w_dt的哪一位,如果w_adr的低两位为0,则来自于w_dt的位0;如果w_adr的低两位为1,则来自于w_dt的位8;如果w_adr的低两位为2,则来自于w_dt的位16;如果w_adr的低两位为3,则来自于w_dt的位24。
步骤三、主设备接口模块发起一次读取目标地址C的请求,获取数据F;
步骤四、根据译码得到对应的寄存器的位D,将数据F中的第D位修改为B,生成新的数据G;
步骤五、发起一次写目标地址C的请求,使用数据G作为写数据,将数据G写到目标地址C对应的外设寄存器中。
主设备接口模块根据接收到译码信息,首先发起读请求到总线控制器从接口,得到读数据;然后再将译码后的数据和读数据按照译码信息处理,向总线控制器从接口发送写请求,完成按位写操作功能。如图6所示,为主设备接口模块的工作流程:
c1:检测ym_req信号是否有效,如果有效,跳转到步骤c2,否则停留在步骤c1;
c2:当检测到ym_req信号为1后,根据译码得到的目标地址C,向总线发送读请求报文,得到读数据F,完成读请求后,进入步骤c3;
c3:根据译码的到的位选择D,及位数据B。将数据F中的位D用数据B替换,得到写数据G,跳转到步骤c4;
c4:向目标地址C发送写数据G的请求,到总线控制器从设备接口,完成写请求后,进入步骤c5;
c5:将应答信号ym_ack值1,跳转到步骤c1。
本发明实施例提供的SOC***按位写装置,从设备接口模块接收总线控制器的主设备接口发送的写请求,并将接收到的地址和数据发送到译码模块,译码模块对接收到的地址和数据信息进行译码,再将译码后的有效信息发送到主设备接口模块,主设备接口模块根据接收到的译码信息,首先发送读请求到总线控制器从接口模块,得到读数据,然后再将译码后的数据和读数据按照译码信息处理后向总线控制器从接口发送写请求,完成按位写操作功能。与现有技术相比,本发明能够直接译码出主设备写请求的地址和数据,从而将主设备的位写操作转化为一次写请求来实现,可以有效减小指令存储空间,节约芯片成本。
本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程,是可以通过计算机程序来指令相关的硬件来完成,所述的程序可存储于一计算机可读取存储介质中,该程序在执行时,可包括如上述各方法的实施例的流程。其中,所述的存储介质可为磁碟、光盘、只读存储记忆体(Read-Only Memory,ROM)或随机存储记忆体(Random AccessMemory,RAM)等。
以上所述,仅为本发明的具体实施方式,但本发明的保护范围并不局限于此,任何熟悉本技术领域的技术人员在本发明揭露的技术范围内,可轻易想到的变化或替换,都应涵盖在本发明的保护范围之内。因此,本发明的保护范围应该以权利要求的保护范围为准。
Claims (4)
1.一种SOC***按位写装置,其特征在于,所述装置与总线控制器主设备接口和总线控制器从设备接口相连,所述装置包括:从设备接口模块、译码模块和主设备接口模块,其中,
所述从设备接口模块,用于接收所述总线控制器主设备接口发送的写请求,并将所述写请求发送到译码模块,所述写请求包括映射地址和操作数;
所述译码模块,用于接收所述从设备接口模块发送的写请求,对所述写请求进行译码,将译码后的有效信息发送到所述主设备接口模块,所述译码后的有效信息包括目标地址、位选择信息和位有效数据;
所述主设备接口模块,用于接收所述译码模块发送的有效信息,读取所述目标地址中的数据,对读取的数据进行位操作,得到新的数据,向所述总线控制器从设备接口发送写请求,将得到的新的数据写入所述目标地址对应的外设寄存器中。
2.根据权利要求1所述的装置,其特征在于,所述从设备接口模块,用于控制接收总线控制器的主设备接口发送的有效写请求。
3.根据权利要求1所述的装置,其特征在于,所述译码模块,用于将接收到的写请求中的映射地址根据约定的映射关系转换为对应的目标地址及外设寄存器位。
4.根据权利要求1所述的装置,其特征在于,所述主设备接口模块,用于根据所述位选择信息将读取到的数据的指定位修改为译码后的位有效数据,得到新的数据。
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
RJ01 | Rejection of invention patent application after publication | ||
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Application publication date: 20180615 |