CN108110021A - 一种提高cmos图像传感器量子效率的光电二极管结构 - Google Patents

一种提高cmos图像传感器量子效率的光电二极管结构 Download PDF

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Abstract

本发明公开了一种提高CMOS图像传感器量子效率的光电二极管结构，位于轻掺杂衬底中，包括重置晶体管、传输晶体管、PN光电二极管、像素单元隔离区、P阱区和环状硅区；所述传输晶体管的两端分别连接所述重置晶体管和PN光电二极管，所述重置晶体管、传输晶体管和PN光电二极管形成的区域被环状的像素单元隔离区包围，在所述P阱区和像素单元隔离区的下方设置环状硅区，所述环状硅区的内环面积大于所述PN光电二极管面积，环状硅区和像素单元隔离区不重叠且两者掺杂类型相反。本发明可以通过增加PNP结的NP部分的反向偏压，以增加耗尽区宽度，提高长波段的量子效率，且能够避免引入带间隧穿漏电。

Description

一种提高CMOS图像传感器量子效率的光电二极管结构
技术领域
本发明涉及半导体领域，具体涉及一种提高CMOS图像传感器量子效率的光电二极管结构。
背景技术
CMOS图像传感器是一种光电转换器件，入射的光子把半导体价带中的电子激发到导带，并储存在反向PN结中，再通过一个传输MOS晶体管转移到电容上。
PN结反向偏置，即重置晶体管漏极接高电位，传输晶体管漏极悬浮，重置晶体管栅极置高压打开，传输晶体管栅极置高压打开，此时钳位光电二极管中的PN结的N区的电荷(电子)被抽取，钳位光电二极管中的PN结被置于设定的反偏电位；重置晶体管栅极置低压关闭，传输晶体管栅极置低压关闭，经过一定时间的光照，PN结充入一定量的电子后，PN结的反偏电位会降低，降低的电位幅度与光照强度与光照时间成正比；传输晶体管栅极置高压打开，PN结中储存的电子流到传输晶体管的漏极后，使传输晶体管漏极的电位降低，降低的幅度与光电二极管中储存的电荷数量及光电二极管与传输晶体管漏极的电容比例成正比。读取传输晶体管漏极在电荷传输前后电位的变化即可知在该像素单元的光照强度。扫描整个像素阵列，就可以得到入射到像素阵列表面的光照强度，即物体的图像信息。
在CMOS图像传感器工作过程中，每一次曝光之前，都需要进行PN光电二极管的重置，附图1为现有技术中的CMOS图像传感器的结构示意图，位于P型轻掺杂衬底5中，包括重置晶体管、传输晶体管、PN光电二极管和P型像素单元隔离区，重置晶体管、传输晶体管的栅极和栅氧化层位于P型轻掺杂衬底的上表面，重置晶体管、传输晶体管的源极和漏极位于P型轻掺杂衬底5中，PN光电二极管中P型区域11位于N型区域4的正上方，且N型区域4为传输晶体管的源极，传输晶体管的源极7与其栅极9之间隔着PN光电二极管的P型区域11，传输晶体管的漏极7和重置晶体管的源极7重合，重置晶体管的漏极7一侧为浅沟槽隔离1，重置晶体管、传输晶体管和PN光电二极管形成的区域被环状的P型像素单元隔离区6包围，且环状的P型像素单元隔离区6中紧邻重置晶体管的部分为浅沟槽隔离1，浅沟槽隔离1的另一侧为P型连接区8，即浅沟槽隔离以及P型像素单元隔离区6共同形成一个环绕的重置晶体管、传输晶体管和PN光电二极管的区域。以附图1所示的CMOS图像传感器为例，重置的操作时序是这样的，左边的重置晶体管打开，传输晶体管的悬浮漏极7到高电位后，传输晶体管打开，PN光电二极管里的电子就被抽走，PN光电二极管电位升高就被重置。左边的重置晶体管和传输晶体管都关掉，传输晶体管的悬浮漏极7还在高电位。PN光电二极管经过一段时间的光照后，储存了一些电子。此时传输晶体管打开，电子从PN光电二极管转移到悬浮漏极7后，PN光电二极管的电位升高，悬浮漏极7的电位下降；悬浮漏极7的电位变化和悬浮漏极7的电容二者乘积就是转移的电荷数量。
常用的3.3V的CMOS图像传感器中PN结光电二极管在重置后，N型硅区的最高电压在1.8V左右，这时其耗尽区宽度在2.1微米左右。对于700纳米的红光，耗尽区宽度要达到3微米，才可以使量子效率大于50％。
要提高长波段的量子效率，需要增加耗尽区宽度。增加耗尽区宽度有两种思路，第一可以增加电压，但是增加电压后，会引入带间隧穿(BTBT)漏电，导致暗电流增加。第二可以增加PN结N区深度，但是增加PN结N区深度之后，会增加重置后的残留电子，从而导致暗光响应效果差。
发明内容
本发明所要解决的技术问题是提供一种提高CMOS图像传感器量子效率的光电二极管结构，通过增加PNP结的NP部分的反向偏压，以增加耗尽区宽度，从而提高长波段的量子效率；并且能够避免在衬底加负偏压时，PN光电二极管的上半部因电场增大而引入带间隧穿漏电。
为了实现上述目的，本发明采用如下技术方案：一种提高CMOS图像传感器量子效率的光电二极管结构，位于轻掺杂衬底中，包括重置晶体管、传输晶体管、PN光电二极管、像素单元隔离区、P阱区和环状硅区；所述传输晶体管的两端分别连接所述重置晶体管和PN光电二极管，所述P阱区为所述重置晶体管的P阱；所述重置晶体管、传输晶体管和PN光电二极管形成的区域被环状的像素单元隔离区包围，所述像素单元隔离区中紧邻所述重置晶体管的部分为浅沟槽隔离，在所述P阱区和像素单元隔离区的下方设置环状硅区，其中，环状硅区的内环面积大于所述PN光电二极管面积，环状硅区和像素单元隔离区不重叠且两者掺杂类型相反。
进一步地，轻掺杂衬底为P型轻掺杂衬底，像素单元隔离区为P型像素单元隔离区，环状硅区为环状N型硅区，所述PN光电二极管中P型区域位于N型区域的正上方。
进一步地，所述P型像素单元隔离区和P阱区中的掺杂浓度大于P型轻掺杂衬底中的掺杂浓度。
进一步地，所述重置晶体管的漏极一侧为浅沟槽隔离，所述浅沟槽隔离的另一侧为P型连接区，所述P型连接区为P型重掺杂区域。
进一步地，所述P型连接区中的掺杂浓度大于P型轻掺杂衬底中的掺杂浓度。
进一步地，当P型轻掺杂衬底加零偏压或者负偏压，所述P型连接区、P型像素单元隔离区、P阱区和PN光电二极管中P型区域接零电位时，所述环状N型硅区与P型连接区、P型像素单元隔离区、P阱区、P型轻掺杂衬底之间形成耗尽区Ⅰ，所述PN光电二极管中N型区域与P阱区、P型轻掺杂衬底、P型像素单元隔离区之间形成耗尽区Ⅱ，所述耗尽区Ⅰ和耗尽区Ⅱ重叠。
进一步地，所述光电二极管中N型区域为所述传输晶体管的源极，且所述传输晶体管的源极与其栅极之间隔着PN光电二极管的P型区域，所述传输晶体管的漏极和所述重置晶体管的源极重合。
进一步地，所述重置晶体管漏极为N型重掺杂区域，所述重置晶体管源极为N型重掺杂区域。
进一步地，所述环状N型硅区的掺杂浓度范围为1e15/cm3-1e18/cm3。
本发明的有益效果为：在P型轻掺杂衬底中增加了环状N型硅区，环状N型硅区的内环在竖直方向上与所述PN光电二极管重合，且内环面积大于PN光电二极管面积；通过增加PNP结的NP部分的反向偏压，以增加耗尽区宽度，从而提高长波段的量子效率。同时环状N型硅区和PN光电二极管中的N型区域与其周围的P型区域形成的耗尽区Ⅰ和耗尽区Ⅱ可以在P型轻掺杂衬底加负偏压时，隔离从P型轻掺杂衬底处过来的电场，使PN光电二极管中的P型区域、P阱区和P型像素单元隔离区依旧保持在零电位，从而使PN光电二极管的上半部电压保持不变，避免在衬底加负偏压时，PN光电二极管的上半部因电场增大而引入带间隧穿漏电。
附图说明
图1为现有技术中CMOS图像传感器中PN光电二极管的结构示意图。
图2为本发明中一种提高CMOS图像传感器量子效率的光电二极管结构的剖面图及衬底零偏压时PN二极管耗尽区示意图。
图3为本发明中一种提高CMOS图像传感器量子效率的光电二极管结构的剖面图及衬底负偏压时PN二极管耗尽区示意图。
图4为本发明P型轻掺杂衬底加负偏压时，PN光电二极管耗尽区示意图。
具体实施方式
为使本发明的目的、技术方案和优点更加清楚，下面结合附图对本发明的具体实施方式做进一步的详细说明。
本发明提供的一种提高CMOS图像传感器量子效率的光电二极管结构，位于轻掺杂衬底中，包括重置晶体管、传输晶体管、PN光电二极管、像素单元隔离区和环状硅区；传输晶体管的两端分别连接重置晶体管和PN光电二极管，重置晶体管、传输晶体管和PN光电二极管形成的区域被环状的像素单元隔离区包围，环状的像素单元隔离区中紧邻重置晶体管的部分为浅沟槽隔离，在阱区和像素单元隔离区的下方设置环状硅区，环状硅区的内环在竖直方向上与PN光电二极管重合，且内环面积大于PN光电二极管面积，环状硅区和像素单元隔离区不重叠且两者掺杂类型相反。需要说明的是，本发明中轻掺杂衬底可以为P型轻掺杂衬底和N形轻掺杂衬底，当衬底不同时，像素单元隔离区、环状硅区以及本发明中所有的掺杂类型倒置过来，为了使得本发明的保护范围清楚，实施例中以P型轻掺杂衬底为例，当衬底为N型轻掺杂衬底时，只需要将本发明中CMOS图像传感器中其他器件的掺杂类型改变即可。
本发明提供的一种提高CMOS图像传感器量子效率的光电二极管结构，当轻掺杂衬底为P型轻掺杂衬底，像素单元隔离区为P型像素单元隔离区，环状硅区为环状N型硅区，PN光电二极管中P型区域位于N型区域的正上方，阱区为P阱区。本发明中传输晶体管位于PN光电二极管的侧上方，重置晶体管、传输晶体管的栅极和栅氧化层位于P型轻掺杂衬底的上表面，重置晶体管、传输晶体管的源极和漏极位于P型轻掺杂衬底中，PN光电二极管中P型区域位于N型区域的正上方，且N型区域为传输晶体管的源极，传输晶体管的源极与其栅极之间隔着PN光电二极管的P型区域，传输晶体管的漏极和重置晶体管的源极重合，重置晶体管的漏极一侧为浅沟槽隔离。其中，重置晶体管的漏极和源极均为N型重掺杂区域。
如附图2或3所示，本发明中，重置晶体管和传输晶体管包括位于N型轻掺杂衬底5上方栅极9和栅极氧化层10，所述重置晶体管还包括源极7和漏极7，传输晶体管的漏极和重置晶体管的源极重合，传输晶体管的源极为PN光电二极管的N型区域4，且与其栅极隔着一层PN光电二极管的P型区域11。本发明中重置晶体管、传输晶体管和PN光电二极管形成的区域被环状的P型像素单元隔离区6包围，且环状的P型像素单元隔离区6中紧邻重置晶体管的部分为浅沟槽隔离1，浅沟槽隔离1的另一侧为P型连接区8，即浅沟槽隔离以及P型像素单元隔离区6共同形成一个环绕的重置晶体管、传输晶体管和PN光电二极管的区域。在P型轻掺杂衬底的下方设置环状N型硅区2，所述环状N型硅区2的内环在竖直方向上与PN光电二极管重合，且内环面积大于PN光电二极管面积，环状N型硅区和P像素单元隔离区在空间上不重叠。位于重置晶体管和传输晶体管下方，且位于P型像素单元隔离区和PN光电二极管之间的P型轻掺杂衬底形成P阱区3，PN光电二极管中P型区域11采用电位钳制注入方式形成，且PN光电二极管中P型区域11中掺杂浓度大于P型轻掺杂衬底5中的掺杂浓度。本发明中以PN光电二极管中N型区域4为中心，上方的P型区域11作用是减小暗电流，下方的P型轻掺杂衬底2使耗尽区的宽度增大，即耗尽区向硅体内扩展，左侧P阱区3决定传输晶体管的电学参数，右侧P型像素单元隔离Ⅱ12提供像素之间的隔离，其中，P型像素单元隔离区6和P阱区3中的掺杂浓度大于P型轻掺杂衬底5中的掺杂浓度。
如附图2所示，图中虚线为耗尽区，本发明一种提高CMOS图像传感器量子效率的光电二极管结构，当衬底加零偏压时，其中，P型连接区8、P阱区3、PN光电二极管中P型区域11和P型像素单元隔离区6接零电位；此时环状N型硅区2与P阱区3、P型轻掺杂衬底5、P型像素单元隔离区6和P型连接区8之间形成耗尽区Ⅰ，PN光电二极管中N型区域4与P阱区3、P型轻掺杂衬底5、P型像素单元隔离区6之间形成耗尽区Ⅱ，耗尽区Ⅰ和耗尽区Ⅱ重叠。也就是说，环状N型硅区与PN光电二极管中N型区域形成的相对高电位可以阻断P阱区和P型轻掺杂衬底的连通以及P型像素单元隔离区和P型轻掺杂衬底之间的连通，使得P型轻掺杂衬底加负偏压，同时P型连接区、P阱区、P型像素单元隔离区、PN光电二极管中P型区域加零偏压成为可能。
如附图3所示，图中虚线为耗尽区，本发明一种提高CMOS图像传感器量子效率的光电二极管结构，当衬底加负偏压时，负偏压的范围为0到-3V，P型连接区8、P阱区3、P型像素单元隔离区6和PN光电二极管中P型区域11加零偏压，此时，由于，P型像素单元隔离区和P阱区中的掺杂浓度大于P型轻掺杂衬底中的掺杂浓度，耗尽区Ⅰ靠近P型连接区8、P阱区3、P型像素单元隔离区6一侧的边缘基本不增加，耗尽区Ⅰ靠近P型轻掺杂衬底5的一侧边缘增加，因此增加了耗尽区Ⅰ边缘的宽度；同时耗尽区Ⅱ靠近P阱区3和P型像素单元隔离区6一侧的边缘基本不增加，耗尽区Ⅱ靠近P型轻掺杂衬底5的一侧边缘增加，从而增加了PN光电二极管中P型区域的耗尽区宽度，即其在硅衬底中的深度，提高了量子效率。宽度增加之后的耗尽区Ⅰ和耗尽区Ⅱ可以在P型轻掺杂衬底加负偏压时，隔离从P型轻掺杂衬底处过来的电场，使PN光电二极管中的P型区域、P阱区和P型像素单元隔离区依旧保持在零电位，从而使PN光电二极管的上半部电压保持不变，避免在衬底加负偏压时，PN光电二极管的上半部因电场增大而引入带间隧穿漏电。
具体原理如附图4所示，从纵向上看，PN光电二极管中P型区域、N型区域以及其下方的P型轻掺杂衬底形成的P+/N/P-二极管可以看作P+/N1/N2/P-两个背靠背的PN二极管。增加了环状N型硅区之后，若重置后，N区最高电位为1.5V，那么N1/N2交界处为1.5V，使用本发明可以使P+/N1保持在负1.5V的同时，使得P-加负3V，那么N2/P-偏置为负4.5V，从而可以往P-即衬底的方向扩展耗尽区宽度约一倍。因此增加了PN光电二极管耗尽区边缘的宽度，提高了量子效率，同时可以减少像素单元之间的串扰。
为了达到隔离P型连接区8、P阱区3、P型像素单元隔离区6、PN光电二极管中P型区域11与P型轻掺杂衬底5之间的连通，环状N型硅区2掺杂的下限是在P型轻掺杂衬底加负偏压时不能被耗尽，如耗尽则P阱区、P型像素单元隔离区和PN光电二极管中P型区域会和P型轻掺杂衬底发生连通，从而导致P阱区、P型像素单元隔离区和PN光电二极管会有负偏压，导致传输晶体管中栅氧化层与与PN光电二极管中N型区域之间的电场增加，从而导致暗电流增加。本发明中保持环状N型硅区的掺杂浓度为1e15/cm3-1e18/cm3，环状N型硅区与P阱区、P型轻掺杂衬底和P型像素单元隔离区之间的击穿电压高于20V。
以上所述仅为本发明的优选实施例，所述实施例并非用于限制本发明的专利保护范围，因此凡是运用本发明的说明书及附图内容所作的等同结构变化，同理均应包含在本发明所附权利要求的保护范围内。

Claims (9)

1.一种提高CMOS图像传感器量子效率的光电二极管结构，位于轻掺杂衬底中，其特征在于，包括重置晶体管、传输晶体管、PN光电二极管、像素单元隔离区、阱区和环状硅区；所述传输晶体管的两端分别连接所述重置晶体管和PN光电二极管，所述阱区为所述重置晶体管的阱；所述重置晶体管、传输晶体管和PN光电二极管形成的区域被环状的像素单元隔离区包围，所述像素单元隔离区中紧邻所述重置晶体管的部分为浅沟槽隔离，在所述阱区和像素单元隔离区的下方设置环状硅区，其中，环状硅区的内环面积大于所述PN光电二极管面积，环状硅区和像素单元隔离区不重叠且两者掺杂类型相反。
2.根据权利要求1所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，轻掺杂衬底为P型轻掺杂衬底，像素单元隔离区为P型像素单元隔离区，环状硅区为环状N型硅区，所述PN光电二极管中P型区域位于N型区域的正上方，所述阱区为P阱区。
3.根据权利要求2所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，所述P型像素单元隔离区和P阱区中的掺杂浓度大于P型轻掺杂衬底中的掺杂浓度。
4.根据权利要求2所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，所述重置晶体管的漏极一侧为浅沟槽隔离，所述浅沟槽隔离的另一侧为P型连接区。
5.根据权利要求4所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，所述P型连接区为P型重掺杂区域，且P型连接区中的掺杂浓度大于P型轻掺杂衬底中的掺杂浓度。
6.根据权利要求4所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，当P型轻掺杂衬底加零偏压或者负偏压，所述P型连接区、P型像素单元隔离区、P阱区和PN光电二极管中P型区域接零电位时，所述环状N型硅区与P型连接区、P型像素单元隔离区、P阱区、P型轻掺杂衬底之间形成耗尽区Ⅰ，所述PN光电二极管中N型区域与P阱区、P型轻掺杂衬底、P型像素单元隔离区之间形成耗尽区Ⅱ，所述耗尽区Ⅰ和耗尽区Ⅱ重叠。
7.根据权利要求2所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，所述光电二极管中N型区域为所述传输晶体管的源极，且所述传输晶体管的源极与其栅极之间隔着PN光电二极管的P型区域，所述传输晶体管的漏极和所述重置晶体管的源极重合。
8.根据权利要求7所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，所述重置晶体管漏极为N型重掺杂区域，所述重置晶体管源极为N型重掺杂区域。
9.根据权利要求2所述的一种提高CMOS图像传感器量子效率的光电二极管结构，其特征在于，所述环状N型硅区的掺杂浓度范围为1e15/cm3-1e18/cm3。
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