CN107947574B - 一种改进控制模式的dc-dc开关电源 - Google Patents

一种改进控制模式的dc-dc开关电源 Download PDF

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Abstract

本发明涉及开关电源技术领域，具体涉及一种改进控制模式的DC‑DC开关电源，包括：输入电压端；输出电压端；第一开关支路，于一第一驱动信号作用下可控制地导通输入电压端和一第一参考节点；第二开关支路，于一第二驱动信号作用下可控制地导通第一参考节点和接地端；PWM信号产生单元，于一比较器的输出脉冲信号作用下产生导通时间和关断时间自适应调节的PWM信号；信号驱动单元，用于对PWM信号产生单元输出的信号进行处理后产生第一驱动信号和第二驱动信号。本发明让开关导通时间和关断时间都做自适应变化，能够提高开关电路工作的效率及稳定性，可灵活设置最大占空比，解决现有技术的恒定导通时间模式及固定关断时间模式的局限性。

Description

一种改进控制模式的DC-DC开关电源
技术领域
本发明涉及开关电源技术领域，具体涉及一种DC-DC开关电源。
背景技术
DC-DC开关电源有多种控制模式，根据采样信号，一般可以分为电压模、电流模。电压模通过采样输出电压进行负反馈，电流模通过采样输入电流和输出电压进行负反馈；常用电流模架构包括：峰值电流模(Peak-Current Mode)，平均电流模(Average-CurrentMode)和滞环电流模(Hysteretic-Current Mode)；按照占空比调制方式来分包括脉宽调制(Pulse Width Modulation，PWM)，脉冲频率调制(Pulse FrequencyModulation，PFM)，恒定导通时间模式(Constant OnTime，COT)，固定关断时间模式(Fixed OffTime，FOT)，迟滞控制(Bang-Bang)等模式。
COT模式响应速度很快，但因为固定导通时间，导致最大占空比受限，若设定主开关导通时间(TON)过大，则轻载模式下易造成很大的纹波；FOT模式的导通时间则会随着负载的加大而加长来增加占空比，缺点是固定关断时间不能设置过低，过低的话，在较轻载或者输入输出电压接近的时候，频率比较高，效率降低。
发明内容
为了解决以上技术问题，本发明旨在提供一种改进控制模式的DC-DC开关电源，具体包括：
一输入电压端(VIN)；
一输出电压端(VOUT)；
第一开关支路，于一第一驱动信号(HS)作用下可控制地导通所述输入电压端(VIN)和一第一参考节点(X1)；
第二开关支路，于一第二驱动信号(LS)作用下可控制地导通所述第一参考节点(X1)和接地端(GND)；
PWM信号产生单元，于一比较器(PWMCOMP)的输出脉冲信号作用下产生导通时间和关断时间自适应调节的PWM信号；
所述PWM信号产生单元包括第一信号产生单元(IO1)，所述第一信号产生单元(IO1)包括：
第三开关支路，于所述PWM信号的作用下可控制地导通一电源电压端(Vdd)和一第二参考节点(X2)；
第四开关支路，于所述PWM信号的作用下可控制地导通所述第二参考节点(X2)和接地端(GND)；
第一施密特触发器(I3)，用于对所述第二参考节点(X2)的信号进行施密特触发运算后作为第一施密特输出信号输出；
第五开关支路，于所述第二参考节点(X2)的作用下可控制的导通所述接地端(GND)和所述第一施密特触发器的接地端(VSS)；
第一逻辑运算部，于所述第一施密特输出信号和所述PWM信号下进行逻辑运算，产生一第一逻辑运算输出信号；
第二逻辑运算部，于所述第一逻辑运算输出信号和所述比较器的比较脉冲信号(Pulsein1)作用下进行逻辑运算以产生所述第一信号产生单元的输出信号(Pulseout1)；
信号驱动单元(PWM DRV)，与所述PWM信号产生单元连接，用于对所述PWM信号产生单元输出的信号进行处理后产生所述第一驱动信号(HS)和所述第二驱动信号(LS)。
本发明的DC-DC开关电源，所述比较器(PWMCOMP)的同相输入端连接一参考电压(Vref)，反相输入端连接一自所述输出电压端的反馈电压，所述比较器(PWMCOMP)用于对一参考电压和一自所述输出电压端的反馈电压进行比较，产生比较脉冲信号。
本发明的DC-DC开关电源，所述PWM信号产生单元包括第二信号产生单元(IO2)，所述第二信号产生单元(IO2)包括：
第二施密特触发器(I9)，用于将一第三参考节点(X3)的信号进行施密特触发运算后输出第二一施密特输出信号及第二二施密特输出信号；
第六开关支路，于所述第一信号产生单元的输出信号的反相信号作用下可切换的导通所述第三参考节点(X3)和接地端(Vss)；
第七开关支路，于所述第二二施密特输出信号的作用下可控制的导通一电源电压端(Vdd)至一第四参考节点(X4)或第四参考节点(X4)至接地端(Vss)；
第三施密特触发器(I10)，用于将所述第四参考节点(X4)的信号进行施密特触发运算后输出一第三一施密特输出信号；
第八开关支路，于所述第三一施密特输出信号的作用下可控制的导通所述第三参考节点(X3)和接地端(Vss)或所述第三参考节点(X3)和电源电压端(Vdd)；
第三逻辑运算部，用于对所述第二一施密特输出信号和所述第一信号产生单元的输出信号(Pulsein2)进行逻辑运算产生所述第二信号产生单元的输出信号(Pulseout2)。
本发明的DC-DC开关电源，所述PWM信号产生单元包括第三信号产生单元(IO3)，所述第三信号产生单元(IO3)包括：
第四施密特触发器(I33)，用于对一第五参考节点(X5)的信号进行施密特触发运算后输出一第四二施密特输出信号；
第四逻辑运算部，用于对所述第二信号产生单元的输出信号(Pulseout2)和所述第四二施密特输出信号进行逻辑运算后输出第四一输出信号和第四二输出信号；
第五逻辑运算部，用于对所述第二信号产生单元的输出信号(Pulseout2)和所述第四二输出信号进行逻辑运算后输出，作为所述第三信号产生单元的输出信号(Pulseout3)；
第九开关支路，于所述第四一输出信号的控制下可切换的导通所述电源电压端(Vdd)至所述第五参考节点(X5)或导通所述第五参考节点(X5)至接地端(Vss)。
本发明的DC-DC开关电源，所述第一参考节点(X1)和所述输出电压端(VOUT)之间连接一储能电感(L1)。
本发明的DC-DC开关电源，所述输出电压端(VOUT)与接地端(GND)之间连接一第一支路，所述第一支路上连接一第一输出电容(COUT)和与所述第一输出电容(COUT)串联的ESR电阻。
本发明的DC-DC开关电源，所述输出电压端(VOUT)与接地端之间连接一第二支路，所述第二支路为电阻分压支路，所述电阻分压支路包括预定数量且相互串联地连接于所述输出电压端(VOUT)与接地端(GND)之间的分压电阻，所述分压电阻间相连接的点形成分压节点，所述反馈电压(FB)自预定的分压节点处引出。
本发明的DC-DC开关电源，一输出电容(C0)连接于所述输出电压端(VOUT)和所述分压节点之间。
本发明的DC-DC开关电源，所述输出电压端(VOUT)与接地端(GND)之间连接负载电阻(Rload)。
有益效果：本发明使用新的开关调制信号产生方式，让开关导通时间和关断时间都做自适应变化，能够提高开关电路工作的效率(频率自适应)，提高开关电路工作的稳定性(纹波小，临界态)，提高开关电路设计的灵活性(可灵活设置最大占空比)，解决了现有技术的恒定导通时间模式及固定关断时间模式的局限性。
附图说明
图1为本发明的一种具体实施例的电路结构图；
图2为本发明的图1中主要器件的工作波形图；
图3为本发明的第一信号产生单元的结构示意图；
图4为本发明的第二信号产生单元的结构示意图；
图5为本发明的第三信号产生单元的结构示意图；
图6为本发明的第一信号产生单元的主要波形示意图；
图7为本发明的第二信号产生单元的主要波形示意图；
图8为本发明的第三信号产生单元的主要波形示意图。
具体实施方式
下方将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有作出创造性劳动的前提下所获得的所有其他实施例，都属于本发明保护的范围。
需要说明的是，在不冲突的情况下，本发明中的实施例及实施例中的特征可以相互组合。
下方结合附图和具体实施例对本发明作进一步说明，但不作为本发明的限定。
参照图1，一种改进控制模式的DC-DC开关电源，包括，
一输入电压端(VIN)；
一输出电压端(VOUT)；
第一开关支路，于一第一驱动信号(HS)作用下可控制地导通输入电压端(VIN)和一第一参考节点(X1)；
第二开关支路，于一第二驱动信号(LS)作用下可控制地导通第一参考节点(X1)和接地端(GND)；
PWM信号产生单元，于一比较器(PWMCOMP)的输出脉冲信号作用下产生导通时间和关断时间自适应调节的PWM信号；
PWM信号产生单元包括第一信号产生单元(IO1)，第一信号产生单元(IO1)包括：
第三开关支路，于PWM信号的作用下可控制地导通一电源电压端(Vdd)和一第二参考节点(X2)；
第四开关支路，于PWM信号的作用下可控制地导通第二参考节点(X2)和接地端(GND)；
第一施密特触发器(I3)，用于对第二参考节点(X2)的信号进行施密特触发运算后作为第一施密特输出信号输出；
第五开关支路，于第二参考节点(X2)的作用下可控制的导通接地端(GND)和第一施密特触发器的接地端(VSS)；
第一逻辑运算部，于第一施密特输出信号和PWM信号下进行逻辑运算，产生一第一逻辑运算输出信号；
第二逻辑运算部，于第一逻辑运算输出信号和比较器的比较脉冲信号(Pulsein1)作用下进行逻辑运算以产生第一信号产生单元的输出信号(Pulseout1)；
信号驱动单元(PWM DRV)，与PWM信号产生单元连接，用于对PWM信号产生单元输出的信号进行处理后产生第一驱动信号(HS)和第二驱动信号(LS)。
本发明区别于现有技术的恒定导通时间模式及固定关断时间模式，通过PWM信号产生单元可以实现开关导通时间和关断时间都做自适应变化，能够提高开关电路工作的效率及稳定性，可灵活设置最大占空比，实现0％-100％的连续占空比。
一种优选的实施例，上述的第一开关支路上连接一PMOS开关管(M1)，其栅极连接第一驱动信号(HS)，源极连接输入电压端(VIN)，漏极连接第一参考节点(X1)。相对应的，第二开关支路上连接一NMOS开关管(M0)，其栅极连接第二驱动信号(LS)，源极连接接地端(GND)，漏极连接第一参考节点(X1)。PMOS开关管(M1)和NMOS开关管(M0)于驱动信号(LS)的作用下交替导通。
一种优选的实施例，参照图1、图3，上述的第三开关支路上连接一第一PMOS开关管(MP1),第一PMOS开关管(MP1)的栅极连接PWM信号，源极连接电源电压端(Vdd)，漏极连接一第一受控电阻(R11)，通过受控电阻(R11)连接第二参考节点(X2)；第一受控电阻(R11)的控制端连接电源电压端(Vdd)；第四开关支路上连接一第一NMOS开关管(NM1)，第一NMOS开关管(NM1)的栅极连接PWM信号，源极连接接地端(GND)，漏极连接第二参考节点(X2)；
第五开关支路上连接第二NMOS开关管(NM2)和第三NMOS开关管(NM3)，第二NMOS开关管(NM2)和第三NMOS开关管(NM3)的源极连接接地端(GND)；第二NMOS开关管(NM2)的栅极连接第三NMOS开关管(NM3)的漏极，第三NMOS开关管(NM3)的栅极连接第二参考节点(X2)；第一逻辑运算部包括一或非门(I0)和非门(I4)，或非门(I0)的输出端连接非门(I4)的输入端；第二逻辑运算部包括一与非门(I1)和非门(I2)，与非门(I1)的输出端连接非门(I2)的输入端，非门的输出端用于输出第一信号产生单元的输出信号(Pulseout1)。如果输入的比较脉冲信号(Pulsein1)为低，那么第一信号产生单元(IO1)始终输出0，进入SKIP模式，节省电能。
结合图6说明第一信号产生单元(IO1)的工作，PWM输入端有个RC延时，后面第一施密特触发器(I3)防止误触发，输入拉低后要延时一个时间才可以输出高电平；Pulsein1为比较器的输出信号，高电平表示输出电压低，低电平表示输出电压高，不需要开关动作，一直为高的话，***工作在最大占空比模式。
本发明的DC-DC开关电源，比较器(PWMCOMP)的同相输入端连接一参考电压(Vref)，反相输入端连接一自输出电压端的反馈电压，比较器(PWMCOMP)用于对一参考电压和一自输出电压端的反馈电压进行比较，产生比较脉冲信号。本发明的比较器可以采用高速比较器。参考电压(Vref)通过一参考电压产生电路产生。
本发明的DC-DC开关电源，参照图1、图4，PWM信号产生单元包括第二信号产生单元(IO2)，第二信号产生单元(IO2)包括：
第二施密特触发器(I9)，用于将一第三参考节点(X3)的信号进行施密特触发运算后输出第二一施密特输出信号及第二二施密特输出信号；
第六开关支路，于第一信号产生单元的输出信号的反相信号作用下可切换的导通第三参考节点(X3)和接地端(Vss)；
第七开关支路，于第二二施密特输出信号的作用下可控制的导通一电源电压端(Vdd)至一第四参考节点(X4)或第四参考节点(X4)至接地端(Vss)；
第三施密特触发器(I10)，用于将第四参考节点(X4)的信号进行施密特触发运算后输出一第三一施密特输出信号；
第八开关支路，于第三一施密特输出信号的作用下可控制的导通第三参考节点(X3)和接地端(Vss)或第三参考节点(X3)和电源电压端(Vdd)；
第三逻辑运算部，用于对第二一施密特输出信号和第一信号产生单元的输出信号(Pulsein2)进行逻辑运算产生第二信号产生单元的输出信号(Pulseout2)。
一种优选的实施例，第六开关支路包括一第七NMOS开关管(NM7)和第七PMOS开关管(MP7)，第七NMOS开关管(NM7)的源极连接接地端(Vss)，第七NMOS开关管(NM7)的漏极连接第三参考节点(X3)，栅极连接一反相器(I11)的输出端，该反相器(I11)的输入端连接第一信号产生单元的输出信号；第七PMOS开关管(MP7)的栅极也连接反相器(I11)的输出端，漏极通过一第二受控电阻(R21)连接第三参考节点(X3)；第八开关支路包括一第六PMOS开关管(MP6)，第六PMOS开关管(MP6)的栅极连接第三施密特触发器(I10)的第三一施密特输出信号，源极连接电源电压端(Vdd)，漏极连接第七PMOS开关管(MP7)的源极；第八开关支路还包括一第五NMOS开关管(NM5)，第五NMOS开关管(NM5)的栅极连接第三施密特触发器(I10)的第三一施密特输出信号，源极连接接地端(Vss)，漏极连接第三参考节点(X3)；一第六NMOS开关管(NM6)的栅极连接接地端(Vss)，源极连接接地端(Vss)，漏极连接第三参考节点(X3)；一第四NMOS开关管(NM4)的栅极连接第三参考节点(X3)，漏极和源极连接接地端(Vss)；第七开关支路包括一第八PMOS管(MP8)，第八PMOS管(MP8)的栅极连接第二二施密特输出信号，源极连接电源电压端(Vdd)，漏极连接第四参考节点(X4)；第七开关支路还包括一第八NMOS管(NM8)，其源极连接接地端(Vss)，漏极通过第二二受控电阻(R22)和第二三受控电阻(R23)连接第四参考节点(X4)，栅极连接第二二施密特输出信号；
第三逻辑运算部包括一与非门(I8)和非门(I7),与非门(I8)的输出端连接非门(I7)，与非门(I8)的一个输入端连接第二一施密特输出信号，另一个输入端连接第一信号产生单元的输出信号(Pulseout1)，非门(I7)的输出端输出第二信号产生单元的输出信号(Pulseout2)。结合图7的波形图，输入端一直为高的话，超过一段设定时间(最大TON)输出必须要拉低。
本发明的DC-DC开关电源，参照图1、图5，PWM信号产生单元包括第三信号产生单元(IO3)，第三信号产生单元(IO3)包括：
第四施密特触发器(I33)，用于对一第五参考节点(X5)的信号进行施密特触发运算后输出一第四二施密特输出信号；
第四逻辑运算部，用于对第二信号产生单元的输出信号(Pulseout2)和第四二施密特输出信号进行逻辑运算后输出第四一输出信号和第四二输出信号；
第五逻辑运算部，用于对第二信号产生单元的输出信号(Pulseout2)和第四二输出信号进行逻辑运算后输出，作为第三信号产生单元的输出信号(Pulseout3)；
第九开关支路，于第四一输出信号的控制下可切换的导通电源电压端(Vdd)至第五参考节点(X5)或导通第五参考节点(X5)至接地端(Vss)。
一种优选的实施例，第四逻辑运算部包括三一或非门(I31)和三二或非门(I32)，三一或非门(I31)的输出端连接三二或非门(I32)的第一输入端，三二或非门(I32)的输出端连接三一或非门(I31)的第二输入端，三一或非门(I31)的第一输入端连接第二信号产生单元的输出信号(Pulseout2)，三二或非门(I32)的第二输入端连接第四施密特触发器(I33)的第四二施密特输出信号；
第五逻辑运算部包括一或非门(I34)和非门(I35)，或非门(I34)用于对第二信号产生单元的输出信号(Pulseout2)和第四二输出信号进行逻辑运算，其输出信号经非门(I35)进行反相处理后产生第三信号产生单元的输出信号(Pulseout3)；第九开关支路包括第三一PMOS管(MP31)，第三一NMOS管(NM31)，第三一PMOS管(MP31)的源极连接电源电压端(Vdd)，漏极通过一受控电阻(R31)连接第五参考节点(X5)，第三一NMOS管(NM31)的源极连接接地端(Vss)，漏极连接第五参考节点(X5)，第三一PMOS管(MP31)和第三一NMOS管(NM31)的栅极连接第四逻辑运算部的第四一输出信号；还包括第三二NMOS管(NM32)和第三三NMOS管(NM33)，栅极连接第五参考节点(X5)，源极和漏极连接接地端(Vss)。结合图8的波形图，输入脉冲宽度如果低于minton，那么输出的脉冲宽度会保持最小min ton之后再变低。
本发明的第一信号产生单元(IO1)、第二信号产生单元(IO2)、第三信号产生单元(IO3)共同来产生PWM信号，第一信号产生单元(IO1)用来控制最小关断时间，当输入脉冲始终为高，那么第一信号产生单元(IO1)最小关断时间始终有效；第一信号产生单元(IO1)、第二信号产生单元(IO2)决定最大占空比；第二信号产生单元(IO2)用来控制最大导通时间，如果要实现最大占空比为100％，第二信号产生单元(IO2)模块可以省略；I03用来控制最小导通时间，同时作为消隐电路。
本发明的DC-DC开关电源，第一参考节点(X1)和输出电压端(VOUT)之间连接一储能电感(L1)。
本发明的DC-DC开关电源，输出电压端(VOUT)与接地端(GND)之间连接一第一支路，第一支路上连接一第一输出电容(COUT)和与第一输出电容(COUT)串联的ESR电阻。
本发明的DC-DC开关电源，输出电压端(VOUT)与接地端之间连接一第二支路，第二支路为电阻分压支路，电阻分压支路包括预定数量且相互串联地连接于输出电压端(VOUT)与接地端(GND)之间的分压电阻，分压电阻间相连接的点形成分压节点，反馈电压(FB)自预定的分压节点处引出。
本发明的DC-DC开关电源，一输出电容(C0)连接于输出电压端(VOUT)和分压节点之间。
本发明的DC-DC开关电源，输出电压端(VOUT)与接地端(GND)之间连接负载电阻(Rload)。
本方案提供了区别于传统方案的PWM控制逻辑，参照图2，可以看出，本发明可以实现连续的占空比调节，不但是从50％占空比转到100％占空比可以连续调节，50％向下到0％(极轻载模式下)也可以实现连续调节，使得输出的电压不存在轻重载切换，输入输出电压差切换所带来的临界不稳定状态。并且基于基础型COT/FOT架构，使用新开关调制信号产生方式，让导通时间(Ton)和关断时间(Toff)都做自适应变化，彻底解决了COT/FOT的局限性。能够提高开关电路工作的效率，实现频率自适应；提高开关电路工作的稳定性，减小纹波，临界态；灵活设置最大占空比，提高开关电路设计的灵活性。
以上仅为本发明较佳的实施例，并非因此限制本发明的实施方式及保护范围，对于本领域技术人员而言，应当能够意识到凡运用本发明说明书及图示内容所作出的等同替换和显而易见的变化所得到的方案，均应当包含在本发明的保护范围内。

Claims (9)

1.一种改进控制模式的DC-DC开关电源，其特征在于，包括，
一输入电压端(VIN)；
一输出电压端(VOUT)；
第一开关支路，于一第一驱动信号(HS)作用下可控制地导通所述输入电压端(VIN)和一第一参考节点(X1)；
第二开关支路，于一第二驱动信号(LS)作用下可控制地导通所述第一参考节点(X1)和接地端(GND)；
PWM信号产生单元，于一比较器(PWMCOMP)的输出脉冲信号作用下产生导通时间和关断时间自适应调节的PWM信号；
所述PWM信号产生单元包括第一信号产生单元(IO1)，所述第一信号产生单元(IO1)包括：
第三开关支路，于所述PWM信号的作用下可控制地导通一电源电压端(Vdd)和一第二参考节点(X2)；
第四开关支路，于所述PWM信号的作用下可控制地导通所述第二参考节点(X2)和接地端(GND)；
第一施密特触发器(I3)，用于对所述第二参考节点(X2)的信号进行施密特触发运算后作为第一施密特输出信号输出；
第五开关支路，于所述第二参考节点(X2)的作用下可控制的导通所述接地端(GND)和所述第一施密特触发器的接地端(VSS)；
第一逻辑运算部，于所述第一施密特输出信号和所述PWM信号下进行逻辑运算，产生一第一逻辑运算输出信号；
第二逻辑运算部，于所述第一逻辑运算输出信号和所述比较器的比较脉冲信号(Pulsein1)作用下进行逻辑运算以产生所述第一信号产生单元的输出信号(Pulseout1)；
信号驱动单元(PWM DRV)，与所述PWM信号产生单元连接，用于对所述PWM信号产生单元输出的信号进行处理后产生所述第一驱动信号(HS)和所述第二驱动信号(LS)。
2.根据权利要求1所述的DC-DC开关电源，其特征在于，所述比较器(PWMCOMP)的同相输入端连接一参考电压(Vref)，反相输入端连接一自所述输出电压端的反馈电压，所述比较器(PWMCOMP)用于对一参考电压和一自所述输出电压端的反馈电压进行比较，产生比较脉冲信号。
3.根据权利要求1所述的DC-DC开关电源，其特征在于，所述PWM信号产生单元包括第二信号产生单元(IO2)，所述第二信号产生单元(IO2)包括：
第二施密特触发器(I9)，用于将一第三参考节点(X3)的信号进行施密特触发运算后输出第二一施密特输出信号及第二二施密特输出信号；
第六开关支路，于所述第一信号产生单元的输出信号的反相信号作用下可切换的导通所述第三参考节点(X3)和接地端(Vss)；
第七开关支路，于所述第二二施密特输出信号的作用下可控制的导通一电源电压端(Vdd)至一第四参考节点(X4)或第四参考节点(X4)至接地端(Vss)；
第三施密特触发器(I10)，用于将所述第四参考节点(X4)的信号进行施密特触发运算后输出一第三一施密特输出信号；
第八开关支路，于所述第三一施密特输出信号的作用下可控制的导通所述第三参考节点(X3)和接地端(Vss)或第三参考节点(X3)和电源电压端(Vdd)；
第三逻辑运算部，用于对所述第二一施密特输出信号和所述第一信号产生单元的输出信号(Pulsein2)进行逻辑运算产生所述第二信号产生单元的输出信号(Pulseout2)。
4.根据权利要求3所述的DC-DC开关电源，其特征在于，所述PWM信号产生单元包括第三信号产生单元(IO3)，所述第三信号产生单元(IO3)包括：
第四施密特触发器(I33)，用于对一第五参考节点(X5)的信号进行施密特触发运算后输出一第四二施密特输出信号；
第四逻辑运算部，用于对所述第二信号产生单元的输出信号(Pulseout2)和所述第四二施密特输出信号进行逻辑运算后输出第四一输出信号和第四二输出信号；
第五逻辑运算部，用于对所述第二信号产生单元的输出信号(Pulseout2)和所述第四二输出信号进行逻辑运算后输出，作为所述第三信号产生单元的输出信号(Pulseout3)；
第九开关支路，于所述第四一输出信号的控制下可切换的导通所述电源电压端(Vdd)至所述第五参考节点(X5)或导通所述第五参考节点(X5)至接地端(Vss)。
5.根据权利要求1所述的DC-DC开关电源，其特征在于，所述第一参考节点(X1)和所述输出电压端(VOUT)之间连接一储能电感(L1)。
6.根据权利要求1所述的DC-DC开关电源，其特征在于，所述输出电压端(VOUT)与接地端(GND)之间连接一第一支路，所述第一支路上连接一第一输出电容(COUT)和与所述第一输出电容(COUT)串联的ESR电阻。
7.根据权利要求2所述的DC-DC开关电源，其特征在于，所述输出电压端(VOUT)与接地端之间连接一第二支路，所述第二支路为电阻分压支路，所述电阻分压支路包括预定数量且相互串联地连接于所述输出电压端(VOUT)与接地端(GND)之间的分压电阻，所述分压电阻间相连接的点形成分压节点，所述反馈电压(FB)自预定的分压节点处引出。
8.根据权利要求7所述的DC-DC开关电源，其特征在于，一输出电容(C0)连接于所述输出电压端(VOUT)和所述分压节点之间。
9.根据权利要求1所述的DC-DC开关电源，其特征在于，所述输出电压端(VOUT)与接地端(GND)之间连接负载电阻(Rload)。
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