CN107765482A - 阵列基板及其应用的显示面板 - Google Patents
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Abstract
本申请一种阵列基板及其应用的显示面板。阵列基板包括：基板，包括显示区及布线区，多条信号线、多个主动开关与像素单元设置于显示区，多条信号线包括多条栅极线与多条源极线，每一像素单元的两子像素通过相应主动开关分别电性耦接相异的栅极线与相同的源极线，多条栅极线的多个输入接口设置于布线区；栅极驱动模块，设置于布线区，栅极驱动模块包括多个输出接口；多个连接线路，设置于多个输入接口与多个输出接口之间，使多个输入接口分别与多个输出接口电性耦接；其中，多个连接线路包括对接线组与跨接线组，对接线组与跨接线组交互设置，跨接线组的信号输出顺序与对接线组的信号输出顺序为相异。
Description
技术领域
本申请涉及布线技术领域，特别涉及一种阵列基板及其应用的显示面板。
背景技术
液晶显示设备利用液晶的电气性质及光学性质显示影像。液晶具有各向异性，例如，在分子的主轴与次轴之间折射率及介电常数存在差异。液晶的分子排列与光学性质是可轻易调节的。液晶显示设备藉由根据电场的量级改变液晶分子的排列方向以调节透过偏光板的光的透射比，来显示影像。
液晶显示设备包括液晶面板以及驱动电路，于该液晶面板中多个像素排列成矩阵的形式，该驱动电路包含用来驱动该液晶面板的栅线的栅驱动器以及用来驱动该液晶面板的数据线的数据驱动器。为了降低液晶显示设备的成本，已经考虑到藉由在维持液晶面板分辨率的同时降低数据线的数量来减少数据驱动器的输出信道数量。
在现有的技术中，半源极驱动(Half Source Driving，HSD)像素阵列的左右相邻亚像素共享一条数据线。这就使得数据线的数目相对于传统液晶驱动像素阵列的数据线数目减半，减少了生产成本。然而，由于栅极信号开启的时间减半，数据线对像素充电时间仅有正常结构的二分之一，容易导致像素充电不足。
另外，为了降低显示器的功耗，许多产品采用的交流驱动方式为列2点反转。列2点反转是列反转和点反转的合成，表现为在每一列上以两个子像素(2点)为单位正负极性反转，相邻的两列子像素则以列为单位正负极性反转。从驱动波形来看，数据驱动IC以两个寻址时间(2Hsync周期)为单位，反转驱动信号电压，波形频率介于点反转和列反转之间，所以其功耗会远远低于点反转。
当列2点反转应用到半源极驱动像素整列上时，由于同一行相邻像素2点的极性相同，数据信号在到达相邻像素的延迟存在很大差异，这就导致相邻像素的亮度会存在差异，在显示上引起垂直亮暗线的问题，从而影响了显示品质，特别是在低灰阶下这种现象尤为明显。
发明内容
为了解决上述技术问题，本申请的目的在于，提供一种阵列基板及其应用的显示面板，通过跨线设计，调整显示区线路的信号接收顺序。
本申请的目的及解决其技术问题是采用以下技术方案来实现的。依据本申请提出的一种阵列基板，所述阵列基板包括：基板，包括显示区及其***的布线区，多个主动开关、多个像素单元和多条信号线设置于所述显示区，所述多个像素单元分别耦接于所述多个主动开关，所述多个主动开关分别电性耦接所述多条信号线，所述多条信号线包括多条栅极线与多条源极线，每一像素单元包括第一子像素及第二子像素组成，所述第一子像素与所述第二子像素通过相应的主动开关电性耦接相异的栅极线，及电性耦接相同的源极线，所述多条栅极线的多个输入接口设置于所述布线区；栅极驱动模块，设置于所述布线区，所述栅极驱动模块包括多个输出接口；多个连接线路，设置于所述多个输入接口与所述多个输出接口之间，使所述多个输入接口分别与所述多个输出接口电性耦接；其中，所述多个连接线路包括多个对接线组与多个跨接线组，所述多个对接线组与所述多个跨接线组交互设置，所述多个跨接线组的信号输出顺序与所述多个对接线组的信号输出顺序为相异。
本申请解决其技术问题还可采用以下技术措施进一步实现。
在本申请的一实施例中，每一跨接线组包括一跨接线与一平接线，所述平接线为折线、直线、曲线或斜线。
在本申请的一实施例中，所述多个跨接线组包括二线路组合、三线路组合与四线路组合中至少其一者。
在本申请的一实施例中，所述栅极驱动模块将控制信号通过所述多个输出接口以第一顺序输出，所述多个输入接口的所述控制信号接收顺序是以第二顺序输入，其中，所述多个连接线路自所述多个输出接口以所述第一顺序取得所述控制信号，以所述第二顺序输出所述控制信号至所述多个输入接口。
在本申请的一实施例中，所述第一顺序与所述多个输出接口的线路排列顺序相同。
在本申请的一实施例中，所述栅极驱动模块包括栅极覆晶薄膜，压覆在所述基板的边缘，所述栅极覆晶薄膜包括所述多个输出接口。
在本申请的一实施例中，所述多个连接线路设置于所述布线区的扇出区。
在本申请的一实施例中，所述多个对接线组与所述多个跨接线组以相邻线组为相异的方式交互设置，或者所述多个对接线组以连续或局部连续的方式与所述多个跨接线组交互设置。
本申请的次一目的为一种阵列基板，其包括：基板，包括显示区及其***的布线区，多个主动开关、多个像素单元和多条信号线设置于所述显示区，所述多个像素单元分别耦接于所述多个主动开关，所述多个主动开关分别电性耦接所述多条信号线，所述多条信号线包括多条栅极线与多条源极线，每一像素单元包括第一子像素及第二子像素组成，所述第一子像素与所述第二子像素通过相应的主动开关电性耦接相异的栅极线，及电性耦接相同的源极线，所述多条栅极线的多个输入接口设置于所述布线区，所述多个输入接口包括第一输入接口与第二输入接口；栅极驱动模块，设置于所述布线区，所述栅极驱动模块包括多个输出接口，所述栅极驱动模块依据所述多个输出接口的线路排列顺序以输出控制信号，所述多个输出接口包括第一输出接口与第二输出接口；多个连接线路，设置于所述多个输入接口与所述多个输出接口之间，使所述多个输入接口分别与所述多个输出接口电性耦接；其中，所述多个连接线路包括多个对接线组与多个跨接线组，所述对接线组与所述跨接线组交互设置，所述跨接线组包括二线路组合，所述二线路组合包括第一线路与第二线路，所述第一线路连接于第一输出接口与第二输入接口之间，所述第二线路连接于第二输出接口与第一输入接口之间，所述第二线路是为折线、直线、曲线或斜线方式设置，所述第一线路是以跨线方式设置，所述二线路组合的信号输入顺序与信号输出顺序为相反，所述多个输出接口输出所述控制信号的顺序与所述多个输入接口的接收所述控制信号的顺序为相异。
本申请的次一目的为一种显示面板，其包括：对向基板；以及，阵列基板，与所述对向基板相对设置；其中，所述阵列基板包括上述任何一种实施例的技术特征的阵列基板。
本申请可以不大幅改变现有生产流程的前提，较能维持原制程需求和产品成本，通过布线设计即能改变显示区的控制信号接收顺序，借由调整信号接收顺序而达到调整像素单元的极性的目的，以此减缓显示画面的亮暗线问题。其次，此是通过布线设计即能改变显示区的控制信号接收顺序，因此不用特别调整驱动组件(如驱动IC，驱动芯片)的信号输出顺序，相对较能降低组件调节成本。其三，此是通过布线设计即能改变显示区的控制信号接收顺序，故可以适用于许多类型的显示面板，适用性相对较高。
附图说明
图1a为范例性的显示装置的架构示意图。
图1b为范例性的显示装置的扇出区的布线示意图。
图1c为范例性的显示装置的像素单元的极性示意图。
图2a为显示依据本申请的方法，一实施例的显示面板的布线示意图。
图2b为显示依据本申请的方法，一实施例的显示面板的布线示意图。
图2c为显示依据本申请的方法，一实施例半源极驱动的显示面板的像素极性示意图。
图2d为显示依据本申请的方法，一实施例的显示面板的布线示意图。
具体实施方式
以下各实施例的说明是参考附加的图式，用以例示本发明可用以实施的特定实施例。本发明所提到的方向用语，例如「上」、「下」、「前」、「后」、「左」、「右」、「内」、「外」、「侧面」等，仅是参考附加图式的方向。因此，使用的方向用语是用以说明及理解本发明，而非用以限制本发明。
附图和说明被认为在本质上是示出性的，而不是限制性的。在图中，结构相似的单元是以相同标号表示。另外，为了理解和便于描述，附图中示出的每个组件的尺寸和厚度是任意示出的，但是本发明不限于此。
在附图中，为了清晰起见，夸大了层、膜、面板、区域等的厚度，亦夸大电路的设置范围。在附图中，为了理解和便于描述，夸大了一些层和区域的厚度，亦夸大电路的设置范围。将理解的是，当例如层、膜、区域、电路或基底的组件被称作“在”另一组件“上”时，所述组件可以直接在所述另一组件上，或者也可以存在中间组件。
另外，在说明书中，除非明确地描述为相反的，否则词语“包括”将被理解为意指包括所述组件，但是不排除任何其它组件。此外，在说明书中，“在......上”意指位于目标组件上方或者下方，而不意指必须位于基于重力方向的顶部上。
为更进一步阐述本发明为达成预定发明目的所采取的技术手段及功效，以下结合附图及较佳实施例，对依据本发明提出的一种阵列基板及其应用的显示面板，其具体实施方式、结构、特征及其功效，详细说明如后。
图1a为范例性的显示装置的架构示意图。请参照图1a，一种液晶显示器，包括：控制板100，所述控制板100包括顺序控制器(Timing Controller，TCON)101；印刷电路板103，与所述控制板之间通过柔性扁平电缆(Flexible Flat Cable，FFC)102相连接；源极覆晶薄膜104和栅极覆晶薄膜105，分别与显示区106内的数据线及扫描线连接。
在一些实施例中，显示装置的驱动方式包括：***主板提供颜色(例如：R/G/B)压缩信号、控制信号及电源传输至控制板100。控制板100上的顺序控制器101处理此等信号后，连同被驱动电路处理的电源，通过如柔性扁平电缆(Flexible Flat Cable，FFC)102，一并传输至印刷电路板103的源极电路及栅极电路，通过源极覆晶薄膜104和栅极覆晶薄膜105将必要性的数据与电源传输于显示区106，从而使得显示器获得呈现画面需求的电源、信号。
图1b为范例性的显示装置的扇出区的布线示意图，请配合图1a以利于了解。如1b所绘示，覆晶薄膜上设置有对应的集成电路(IC)，在一些实施例中，集成电路的通道大体上是依据其顺序而分别与显示区106的导电线路相连接。依据集成电路的不同，所连接的导电线路亦不相同。如栅极集成电路即连接扫描线(栅极线)，如源极集成电路即连接数据线(源极线)。
如图1b所绘示，以栅极集成电路107为例，所述栅极集成电路107的通道排列顺序为g1至gn，栅极集成电路的信号输出顺序也是被调整如同据通道信号输出顺序。
图1c为范列性的半源极驱动的显示面板的像素设置示意图,请配合图1a及图1b以利于理解。请参照图1c，显示区106包括多个主动开关与多个像素单元，像素单元电性耦接主动开关，主动开关电性耦接扫描线与数据线。每一像素单元由不同颜色的第一子像素及第二子像素组成，但通过主动开关连接相异扫描线，但连接共享同一数据线。例如扫描线D1上的像素单元，其所述第一子像素及所述第二子像素通过主动开关分别连接至扫描线G1及扫描线G2，但共享一条数据线D1。如此方式设置所有像素单元，与传统的显示面板相比，数据线数目会减少约一半，但扫描线的栅极信号开启的时间减半，所以数据线对像素充电时间仅有传统结构的二分之一。
在一些实施侧中，显示面板为列2点反转的驱动方式。列2点反转是列反转和点反转的合成，表现为在每一列上以两个子像素(2点)为单位正负极性反转，相邻的两列子像素则以列为单位正负极性反转。如图1c，当列2点反转应用到半源极驱动像素整列上时，由于栅极信号开启的时间减半，数据线对像素充电时间仅有传统结构的二分之一，容易导致像素充电不足。而且，由于同一行相邻像素2点的极性相同，数据信号在到达相邻像素的延迟存在很大差异，一般而言，位于后续充电的子像素会有充电不足的现像，如此导致相邻像素的亮度会存在差异，引起显示上垂直亮暗线的问题，从而影响了显示品质，特别是在低灰阶下这种现象尤为明显。
图2a为显示依据本申请的方法，一实施例的显示面板的布线示意图。现有的显示面板组件设置请配合图1a至图1c以利于理解。请参照图2a，在本申请一实施例中，所述一种阵列基板200，包括：基板201，包括显示区106及其***的布线区108，多个主动开关、多个像素单元和多条信号线设置于所述显示区106，所述多个像素单元分别耦接于所述多个主动开关，所述多个主动开关分别电性耦接所述多条信号线，所述多条信号线包括多条栅极线210与多条源极线，每一像素单元包括第一子像素及第二子像素组成，所述第一子像素与所述第二子像素通过相应的主动开关电性耦接相异的栅极线210，及电性耦接相同的源极线，所述多条栅极线210的的多个输入接口211设置于所述布线区108；栅极驱动模块220，设置于所述布线区108，所述栅极驱动模块220包括多个输出接口222；多个连接线路230，设置于所述多个输入接口211与所述多个输出接口222之间，使所述多个输入接口211分别与所述多个输出接口222电性耦接；其中，所述多个连接线路230包括多个对接线组231与多个跨接线组232，所述多个对接线组231与所述多个跨接线组232交互设置，所述多个跨接线组232的信号输出顺序与所述多个对接线组231的信号输出顺序为相异。
在一些实施例中，每一多个跨接线组232包括一跨接线与一平接线，所述平接线为折线、直线、曲线或斜线。
在一些实施例中，所述栅极驱动模块220将控制信号通过所述多个输出接口222以第一顺序输出，所述多个输入接口211的所述控制信号接收顺序是以第二顺序输入，其中，所述多个连接线路230自所述多个输出接口222以所述第一顺序取得所述控制信号，以所述第二顺序输出所述控制信号至所述多个输入接口211。
在一些实施例中，所述第一顺序与所述多个输出接口222的线路排列顺序相异、相同或局部相同。
如图2a所绘示，在一些实施例中，所述跨接线组232包括二线路组合。所述二线路组合包括第一线路232a与第二线路232b。所述第二线路232b是以折线方式设置，所述第一线路232a是以跨线方式设置。所述第一线路232a连接于输出接口g1与输入接口G2之间，所述第二线路232b连接于输出接口g2与输入接口G1之间。假定控制信号的通过所述输出接口的顺序为(g1->g2)，所述控制信号到达所述输入接口的顺序则为(G2->G1)。
如图2b为显示依据本申请的方法，一实施例的显示面板的布线示意图。在一些实施例中，所述对接线组231为两线路设置，所述跨接线组232亦是二线路组合，彼此之间以相邻线组为相异的方式交互设置。所述第一顺序与所述多个输出接口222的线路排列顺序相同，即所述栅极驱动模块220输出控制信号的顺序为(g1->g8)，而所述多个输入接口211取得控制信号的顺序为(G1->G2->G4->G3->G5->G6->G8->G7)。
在一些实施例中，所述多个对接线组231以连续或局部连续的方式与所述多个跨接线组232交互设置。
如图2c为显示依据本申请的方法，一实施例半源极驱动的显示面板的像素极性示意图。每一像素单元由不同颜色的第一子像素及第二子像素组成，但通过相应的主动开关连接相异扫描线，但连接共享同一数据线。例如扫描线D1上的像素单元，其所述第一子像素及所述第二子像素通过主动开关分别连接至扫描线G1及扫描线G2，但共享一条数据线D1，如此方式设置所有像素单元。所述多条栅极线210中，第G3条线路及第G4条线路，还有第G7条线路及第G8条线路，会以相反顺序取得控制信号，后续线路运作方式以此类推。如此，第G2n+1条线路及第G2n+2条线路，会以相反顺序取得控制信号。即是指，第G2n+1条线路及第G2n+2条线路所连接的像素单元的充电顺序，与第G2n-1条线路及第2n条线路所连接的像素单元的充电顺序，会正好相反。虽然，列2点反转应用到半源极驱动像素整列上时，由于同一行相邻像素2点的极性相同，数据信号在到达相邻像素的延迟存在很大差异的问题仍存在，但通过调整相邻行的像素单元的充电顺序，较能将充电不足的像素单元交错分散，降低垂直亮暗线情形，以提高显示面板的显示均齐性。
图2d为显示依据本申请的方法，一实施例的显示面板的布线示意图。在一些实施例中，所述第一顺序与所述多个输出接口222的线路排列顺序并不相同，例如：栅极驱动模块220输出控制信号的顺序为(g1->g2->g4->g3->g6->g5->g7->g8)。所述对接线组231与所述跨接线组232以二线路设置，彼此之间选择性的交互设置。其中，在所述输出接口(g3，g4)与所述输入接口(G3，G4)之间设置对接线组231，在所述输出接口(g5，g6)与所述输入接口(G5，G6)之间设置跨接线组232，如此，能使所述多个输入接口211取得控制信号的顺序维持为(G1->G2->G4->G3->G5->G6->G8->G7)。如此，依据栅极驱动模块220输出控制信号的顺序，以及所述多条栅极线接收控制信号的顺序，适度的设置所述跨接线组232与所述对接线组231，令第g2n+1条线路及第g2n+2条线路所连接的像素单元的充电顺序，与第g2n-1条线路及第2n条线路所连接的像素单元的充电顺序，正好相反。
在一些实施例中，所述跨接线组232包括二线路组合、三线路组合与四线路组合中至少其一者。
在一些实施例中，所述栅极驱动模块220包括栅极覆晶薄膜105，压覆在所述基板201的边缘，所述栅极覆晶薄膜105包括所述多个输出接口221。
在一些实施例中，所述多个连接线路230设置于所述布线区108的扇出区。
在本申请一实施例中，本申请的一种阵列基板200，其包括：基板201，包括显示区106及其***的布线区108，多个主动开关、多个像素单元和多条信号线设置于所述显示区106，所述多个像素单元分别耦接于所述多个主动开关，所述多个主动开关分别电性耦接所述多条信号线，所述多条信号线包括多条栅极线210与多条源极线，每一像素单元包括第一子像素及第二子像素组成，所述第一子像素与所述第二子像素通过相应的主动开关电性耦接相异的栅极线210，及电性耦接相同的源极线，所述多条栅极线210的多个输入接口211设置于所述布线区106，所述多个输入接口211包括输入接口G1与输入接口G2；栅极驱动模块220，设置于所述布线区108，所述栅极驱动模块220包括多个输出接口222，所述栅极驱动模块220依据所述多个输出接口222的线路排列顺序以输出控制信号，所述多个输出接口222包括输出接口g1与输出接口g2；多个连接线路230，设置于所述多个输入接口211与所述多个输出接口222之间，使所述多个输入接口211分别与所述多个输出接口222电性耦接；其中，所述多个连接线路230包括多个对接线组231与多个跨接线组232，所述对接线组231与所述跨接线组232交互设置，所述跨接线组232包括二线路组合，所述二线路组合包括第一线路232a与第二线路232b，所述第一线路232a连接于输出接口g1与输入接口G2之间，所述第二线路232b连接于输出接口g2与输入接口G1之间，所述第二线路232b是为折线、直线、曲线或斜线方式设置，所述第一线路232a是以跨线方式设置，所述二线路组合的信号输入顺序与信号输出顺序为相反，所述多个输出接口222输出所述控制信号的顺序，与所述多个输入接口211的接收所述控制信号的顺序为相异。
在本申请一实施例中，本申请的一种显示面板，其包括：相对设置的阵列基板与对向基板；其中，所述阵列基板包括前述各实施例中的任一种阵列基板200。
在一些实施例中，所述阵列基板更包括先前所述任一种实施方式。
在某些实施例中，本申请所述显示面板可例如为液晶显示面板，然不限于此，其亦可为OLED显示面板，W-OLED显示面板，QLED显示面板，等离子体显示面板，曲面型显示面板或其他类型显示面板。
本申请可以不大幅改变现有生产流程的前提，较能维持原制程需求和产品成本，通过布线设计即能改变显示区的控制信号接收顺序，借由调整信号接收顺序而达到调整像素单元的极性的目的，以此减缓显示画面的亮暗线问题。其次，此是通过布线设计即能改变显示区的控制信号接收顺序，因此不用特别调整驱动组件(如驱动IC，驱动芯片)的信号输出顺序，相对较能降低组件调节成本。其三，此是通过布线设计即能改变显示区的控制信号接收顺序，故可以适用于许多类型的显示面板，适用性相对较高。
“在一些实施例中”及“在各种实施例中”等用语被重复地使用。此用语通常不是指相同的实施例；但它也可以是指相同的实施例。“包含”、“具有”及“包括”等用词是同义词，除非其前后文意显示出其它意思。
以上所述，仅是本申请的具体实施例而已，并非对本申请作任何形式上的限制，虽然本申请已以具体实施例揭露如上，然而并非用以限定本申请，任何熟悉本专业的技术人员，在不脱离本申请技术方案范围内，当可利用上述揭示的技术内容作出些许更动或修饰为等同变化的等效实施例，但凡是未脱离本申请技术方案的内容，依据本申请的技术实质对以上实施例所作的任何简单修改、等同变化与修饰，均仍属于本申请技术方案的范围内。
Claims (10)
1.一种阵列基板，其特征在于，包括：
基板，包括显示区及其***的布线区，多个主动开关、多个像素单元和多条信号线设置于所述显示区，所述多个像素单元分别耦接于所述多个主动开关，所述多个主动开关分别电性耦接所述多条信号线，所述多条信号线包括多条栅极线与多条源极线，每一像素单元包括第一子像素及第二子像素组成，所述第一子像素与所述第二子像素通过相应的主动开关电性耦接相异的栅极线，及电性耦接相同的源极线，所述多条栅极线的多个输入接口设置于所述布线区；
栅极驱动模块，设置于所述布线区，所述栅极驱动模块包括多个输出接口；
多个连接线路，设置于所述多个输入接口与所述多个输出接口之间，使所述多个输入接口分别与所述多个输出接口电性耦接；
其中，所述多个连接线路包括多个对接线组与多个跨接线组，所述多个对接线组与所述多个跨接线组交互设置，所述多个跨接线组的信号输出顺序与所述多个对接线组的信号输出顺序为相异。
2.如权利要求1所述的阵列基板，其特征在于，每一跨接线组包括一跨接线与一平接线，所述平接线为折线、直线、曲线或斜线。
3.如权利要求1所述的阵列基板，其特征在于，所述多个跨接线组包括二线路组合、三线路组合与四线路组合中至少其一者。
4.如权利要求1所述的阵列基板，其特征在于，所述栅极驱动模块将控制信号通过所述多个输出接口以第一顺序输出，所述多个输入接口的所述控制信号接收顺序是以第二顺序输入，其中，所述多个连接线路自所述多个输出接口以所述第一顺序取得所述控制信号，以所述第二顺序输出所述控制信号至所述多个输入接口。
5.如权利要求4所述的阵列基板，其特征在于，所述第一顺序与所述多个输出接口的线路排列顺序相异、相同或局部相同。
6.如权利要求1所述的阵列基板，其特征在于，所述栅极驱动模块包括栅极覆晶薄膜，压覆在所述基板的边缘，所述栅极覆晶薄膜包括所述多个输出接口。
7.如权利要求1所述的阵列基板，其特征在于，所述多个连接线路设置于所述布线区的扇出区。
8.如权利要求1所述的阵列基板，其特征在于，所述多个对接线组与所述多个跨接线组以相邻线组为相异的方式交互设置，或者所述多个对接线组以连续或局部连续的方式与所述多个跨接线组交互设置。
9.一种阵列基板，其特征在于，包括：
基板，包括显示区及其***的布线区，多个主动开关、多个像素单元和多条信号线设置于所述显示区，所述多个像素单元分别耦接于所述多个主动开关，所述多个主动开关分别电性耦接所述多条信号线，所述多条信号线包括多条栅极线与多条源极线，每一像素单元包括第一子像素及第二子像素组成，所述第一子像素与所述第二子像素通过相应的主动开关电性耦接相异的栅极线，及电性耦接相同的源极线，所述多条栅极线的多个输入接口设置于所述布线区，所述多个输入接口包括第一输入接口与第二输入接口；
栅极驱动模块，设置于所述布线区，所述栅极驱动模块包括多个输出接口，所述栅极驱动模块依据所述多个输出接口的线路排列顺序以输出控制信号，所述多个输出接口包括第一输出接口与第二输出接口；
多个连接线路，设置于所述多个输入接口与所述多个输出接口之间，使所述多个输入接口分别与所述多个输出接口电性耦接；
其中，所述多个连接线路包括多个对接线组与多个跨接线组，所述对接线组与所述跨接线组交互设置，所述跨接线组包括二线路组合，所述二线路组合包括第一线路与第二线路，所述第一线路连接于第一输出接口与第二输入接口之间，所述第二线路连接于第二输出接口与第一输入接口之间，所述第二线路是为折线、直线、曲线或斜线方式设置，所述第一线路是以跨线方式设置，所述二线路组合的信号输入顺序与信号输出顺序为相反，所述多个输出接口输出所述控制信号的顺序与所述多个输入接口的接收所述控制信号的顺序为相异。
10.一种显示面板，其特征在于，包括：
对向基板；以及
阵列基板，与所述对向基板相对设置；
其中所述阵列基板如权利要求1-8所述的阵列基板。
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