CN107633815B - 驱动电路的补偿结构、驱动电路模块和显示面板 - Google Patents
驱动电路的补偿结构、驱动电路模块和显示面板 Download PDFInfo
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Abstract
本发明属于显示技术领域,具体涉及一种驱动电路的补偿结构、驱动电路模块和显示面板。该驱动电路的补偿结构,包括电流放大电路和跨组放大电路,所述电流放大电路连接于所述驱动电路的输出端,用于将驱动电路输出的驱动电流放大设定倍数;所述跨组放大电路连接于所述电流放大电路的输出端,用于对驱动电路中的不同通道以及不同薄膜晶体管的电阻进行匹配,并将驱动电流转换为对应的驱动电压。该补偿结构直接感测显示面板中像素数据的驱动电流,避免了电压信号在走线过程中容易受到干扰的问题,提高了感测精度,缩短了感测时间;同时采用跨组放大电路,通过熔丝技术微调使所有跨组放大器电阻一致,从而实现校准功能,避免了出现工艺偏差的问题。
Description
技术领域
本发明属于显示技术领域,具体涉及一种驱动电路的补偿结构、驱动电路模块和显示面板。
背景技术
LCD(Liquid Crystal Display,液晶显示)和OLED(Organic Light-EmittingDiode:有机发光二极管)显示装置已成为当今流行的平板显示装置。尤其是有源矩阵有机发光二极管(Active Matrix OLED,简称AMOLED)由于具有超轻薄、高色域、高对比度、宽视角、快速响应等诸多优点,已被应用于高端电视和移动设备产品中。
AMOLED是电流型(Current mode)主动式驱动,其中包括用于驱动的薄膜晶体管(Thin Film Transistor,简称TFT),由于TFT工艺的偏差,各驱动管的阈值电压和电子迁移率等参数可能不完全一致,会造成较严重的显示非均匀性,同时显示面板(Panel)上的压降(IR Drop),导致OLED驱动电压的非均匀性均会反映到Vds的差异,影响显示均匀性。因此,在基于AMOLED的像素设计中,需要采用补偿技术去弥补工艺上的非理想特性。在现有技术中,补偿方式包括内部补偿(internal compensation)方式和外部补偿(externalcompensation)方式。内部补偿即在像素内部利用TFT构建子电路进行补偿;外部补偿即将TFT或者AMOLED信息抽取到显示面板外部,在通过应用型专用集成电路(ASIC)进行补偿。
内部补偿由于在内部补偿的像素结构和驱动方式都较为复杂,且仅对TFT阈值电压非均匀性和IR有补偿效果,并不能解决残像等问题;同时,在大尺寸高分辨率的显示应用中,内部补偿的方式会造成开口率低、驱动速度慢。相对而言,外部补偿被认为是较佳的补偿方式。目前采用的外部补偿大都是电压型外部补偿,即通过某种方式将像素电压抽取出来,并转化为数字信号进行处理,从而实现补偿。这种电压型外部补偿方式虽然具有驱动速度快、补偿效果好的优点,但是电压信号容易受到干扰;此外,随着尺寸增大、分辨率提高,显示面板的寄生电容越来越大,固定时间内的感测(sense)像素电压值变低,而对模数转换精度要求越来越高。
如何对驱动电路进行补偿,并提高补偿精度成为目前亟待解决的技术问题。
发明内容
本发明所要解决的技术问题是针对现有技术中上述不足,提供一种驱动电路的补偿结构、驱动电路模块和显示面板,该补偿结能对驱动电路进行有效补偿,并保证补偿精度。
解决本发明技术问题所采用的技术方案是该驱动电路的补偿结构,用于为驱动电路提供补偿电流,其包括电流放大电路和跨组放大电路,其中:
所述电流放大电路,连接于所述驱动电路的输出端,用于将驱动电路输出的驱动电流放大设定倍数;
所述跨组放大电路,连接于所述电流放大电路的输出端,用于对补偿结构中的电阻进行匹配,并将驱动电流转换为对应的驱动电压。
优选的是,所述电流放大电路包括第一电流镜和第二电流镜,所述第一电流镜的输入端连接所述第二电流镜的输出端,输出端连接所述跨组放大电路的输入端;所述第二电流镜的输入端连接所述驱动电路的输出端。
优选的是,所述第一电流镜包括第一晶体管、第二晶体管、第三晶体管、第四晶体管和第一运算放大器,其中:
所述第一晶体管,控制极连接所述第二晶体管的控制极,第一极连接模拟电源,第二极连接所述第一运算放大器的正输入端和所述第三晶体管的第一极;
所述第二晶体管,第一极连接模拟电源,第二极连接所述第一运算放大器的负输入端和所述第四晶体管的第一极;
所述第三晶体管,控制极连接其第二极和所述第一晶体管的控制极,第二极还连接所述第二电源镜的输入端;
所述第四晶体管,控制极连接所述第一运算放大器的输出端,第二极连接所述跨组放大电路。
优选的是,所述第一晶体管、所述第二晶体管、所述第三晶体管、所述第四晶体管为P型晶体管,所述第二晶体管的宽长比为所述第一晶体管的宽长比的N倍。
优选的是,所述第二电流镜包括第五晶体管、第六晶体管、第七晶体管、第八晶体管、第九晶体管、第十晶体管和第二运算放大器,其中:
所述第五晶体管,控制极连接所述第六晶体管的控制极,第一极连接所述第二运算放大器的正输入端和所述第七晶体管的第二极,第二极连接参考地;
所述第六晶体管,第一极连接所述第二运算放大器的负输入端和所述第八晶体管的第二极,第二极连接参考地;
所述第七晶体管,控制极连接其第一极和所述第九晶体管的二极;
所述第八晶体管,控制极连接所述第二运算放大器的输出端,第一极连接所述第十晶体管的第二极;
所述第九晶体管,其控制极连接开启信号,第一极连接所述驱动电路的输出端,第二极还连接所述第五晶体管的控制极;
所述第十晶体管,其控制极连接开启信号,第一极连接所述第一电流源镜的输入端,第二极连接所述第八晶体管的第一极。
优选的是,所述第五晶体管、所述第六晶体管、所述第七晶体管、所述第八晶体管为N型晶体管,所述第六晶体管的宽长比为所述第五晶体管的宽长比的M倍;所述第九晶体管和所述第十晶体管为N型晶体管或P型晶体管。
优选的是,所述跨组放大电路包括第三运算放大器和匹配结构,其中:
所述匹配结构,包括基准电流源和调节电阻单元,所述调节电阻单元的调节电阻分别连接于所述第三运算放大器的负输入端和输出端,用于使得不同所述跨组放大电路的阻抗匹配;
所述第三运算放大器,其正输入端连接参考电压,负输入端还与所述基准电流源或所述电流放大电路的输出端择一连接,所述输出端用于输出与所述电流放大电路的驱动电流对应的驱动电压。
优选的是,所述基准电流源用于为选择匹配的所述调节电阻提供参考电流,所述调节电阻单元包括多组选通模块和与所述选通模块对应的多组输出模块,其中:
每一所述选通模块包括第一选通选通晶体管、第二选通晶体管、配置电阻和熔丝,所述第一选通晶体管的控制极连接第一选通电压,第二极接地,第一极连接所述配置电阻的一端;所述第二选通晶体管的控制极接地,第一极连接第二选通电压,第二极连接所述熔丝的一端,所述熔丝的另一端连接所述配置电阻的另一端;
所述输出模块包括反相器、输出晶体管和输出电阻,所述反相器连接所述熔丝和所述配置电阻的连接端,所述反相器的输出端或者所述熔丝和所述配置电阻的连接端连接所述输出晶体管的控制极;所述输出晶体管的第一极和第二极分别连接所述输出电阻的两端,多个所述输出电阻串联连接;
根据所述选通模块中所述配置电阻与所述熔丝的电位,选通所述输出模块中相应的所述输出电阻,被选通的多个所述输出电阻的阻值之和即连接于所述第三运算放大器的负输入端和输出端之间的所述调节电阻的大小。
优选的是,所述第一选通晶体管、所述输出晶体管为N型晶体管,所述第二选通晶体管为P型晶体管;
多个所述输出电阻以2n大小顺序串联连接。
一种驱动电路模块,包括驱动电路,还包括上述的驱动电路的补偿结构。
一种显示面板,还包括上述的驱动电路模块。
本发明的有益效果是:该驱动电路的补偿结构,直接感测显示面板中像素数据的驱动电流,避免了电压信号在走线过程中容易受到干扰的问题,克服了感测电压降低的不足,提高了感测精度,缩短了感测时间;同时采用跨组放大电路,通过熔丝技术微调使所有跨组放大器电阻一致,从而实现校准功能,避免了出现工艺偏差的问题。
附图说明
图1为本发明实施例1中驱动电路的补偿结构示意图;
图2为本发明实施例1中匹配结构原理图;
图3为熔丝匹配参照图;
图4为本发明实施例2中电流型外电路补偿电路示意图;
附图标识中:
1-电流放大电路;11-第一电流镜;12-第二电流镜;
2-跨组放大电路;21-匹配结构;211-选通模块;212-输出模块;
3-驱动电路;
4-模数转换器;
5-时序控制器。
具体实施方式
为使本领域技术人员更好地理解本发明的技术方案,下面结合附图和具体实施方式对本发明驱动电路的补偿结构、驱动电路模块和显示面板作进一步详细描述。
实施例1:
本实施例针对电压型外部补偿存在的问题,提供一种电流型驱动电路的补偿结构,该补偿结能对驱动电路进行有效补偿,并保证补偿精度。
该驱动电路的补偿结构,用于为驱动电路提供补偿电流,如图1所示,其包括电流放大电路1和跨组放大电路2,其中:
电流放大电路1,连接于驱动电路的输出端,用于将驱动电路输出的驱动电流放大设定倍数;
跨组放大电路2,连接于电流放大电路1的输出端,用于对补偿结构中的电阻进行匹配,并将驱动电流转换为对应的驱动电压。通常情况下,输入为电流信号、输出为电压信号的运放即定义为跨组放大电路。
其中,电流放大电路1经过高精电流镜,用电流镜直接感测像素电流(即像素数据导致的电流)并放大像素电流而非电压,从而克服感测电压的不足,实现精确放大感测像素电流。该电流放大电路1包括第一电流镜11和第二电流镜12,第一电流镜11的输入端连接第二电流镜12的输出端,输出端连接跨组放大电路2的输入端;第二电流镜12的输入端连接驱动电路的输出端。
图1中,第二电流镜12包括第五晶体管MN0、第六晶体管MN1、第七晶体管MN2、第八晶体管MN3、第九晶体管MN4、第十晶体管MN5和第二运算放大器A2,其中:
第五晶体管MN0,控制极连接第六晶体管MN1的控制极,第一极连接第二运算放大器A2的正输入端和第七晶体管MN2的第二极,第二极连接参考地;
第六晶体管MN1,第一极连接第二运算放大器A2的负输入端和第八晶体管MN3的第二极,第二极连接参考地;
第七晶体管MN2,控制极连接其第一极和第九晶体管MN4的二极;
第八晶体管MN3,控制极连接第二运算放大器A2的输出端,第一极连接第十晶体管MN5的第二极;
第九晶体管MN4,其控制极连接开启信号,第一极连接驱动电路的输出端,第二极还连接第五晶体管MN0的控制极;
第十晶体管MN5,其控制极连接开启信号,第一极连接第一电流源镜的输入端,第二极连接第八晶体管MN3的第一极。
MP4和MP5是开关管,二者的控制极(即栅极)都接SW1,漏极分别接MN2和MN3的漏极,MN0、MN1、MN2、MN3组成一个共源共栅(cascode)电流镜,其中MN1的W/L分别是MN0和的W/L的M倍,输出阻抗为ro1gm3ro3,为了进一步提高输出阻抗,实现电流精确放大,加入一个运算放大器输入分别接MN0和MN1的漏极,输出接MN1的栅极,则输出阻抗提升为Aro1gm3ro3,其中A为运算放大器的增益,gm为晶体管的跨导,ro为其内阻,这样电流的失配降低为单管电流的1/Agm3ro3倍。
优选的是,第五晶体管MN0、第六晶体管MN1、第七晶体管MN2、第八晶体管MN3为N型晶体管,第六晶体管MN1的宽长比为第五晶体管MN0的宽长比的M倍。第九晶体管和第十晶体管为N型晶体管或P型晶体管,选用不同型的晶体管时,只需SW1给出的信号相反即可,本实施例以N型晶体管第九晶体管MN4和第十晶体管MN5作为示意。
图1中,第一电流镜11包括第一晶体管MP0、第二晶体管MP1、第三晶体管MP2、第四晶体管MP3和第一运算放大器A1,其中:
第一晶体管MP0,控制极连接第二晶体管MP1的控制极,第一极连接模拟电源AVDD,第二极连接第一运算放大器A1的正输入端和第三晶体管MP2的第一极;
第二晶体管MP1,第一极连接模拟电源AVDD,第二极连接第一运算放大器A1的负输入端和第四晶体管MP3的第一极;
第三晶体管MP2,控制极连接其第二极和第一晶体管MP0的控制极,第二极还连接第二电源镜的输入端;
第四晶体管MP3,控制极连接第一运算放大器A1的输出端,第二极连接跨组放大电路2。
MP0、MP1、MP2、MP3和第一运算放大器组成一个新的电流镜,原理同第一电流镜。优选的是,第一晶体管MP0、第二晶体管MP1、第三晶体管MP2、第四晶体管MP3为P型晶体管,第二晶体管MP1的宽长比为第一晶体管MP0的宽长比的N倍,于是驱动电流被精确放大了M*N倍。
本实施例采用跨组放大电路,能极大缩短感测像素电流时间。图1中,跨组放大电路2包括第三运算放大器A3和匹配结构21,其中:
匹配结构21,包括基准电流源和调节电阻单元,调节电阻单元的调节电阻R0分别连接于第三运算放大器A3的负输入端和输出端,用于使得不同跨组放大电路2的阻抗匹配;
第三运算放大器A3,其正输入端连接参考电压Vref,负输入端还与基准电流源或电流放大电路1的输出端择一(通过SW2)连接,输出端用于输出与电流放大电路1的驱动电流对应的驱动电压。
运算放大器的正输入端接一个参考电压Vref,负输入端接一个精准的参考电流Iref,负输入端及输出端分别接一个电阻R0的两端,输出电压为Vout=Vref-IR0,其中I为经过放大后的像素电流,为了克服因工艺偏差导致的电阻值波动,对电阻R0进行熔丝调节,如图2所示。
基准电流源用于为选择匹配的调节电阻提供参考电流,图2所示的调节电阻单元包括多组选通模块211和与选通模块211对应的多组输出模块212,其中:
每一选通模块211包括第一选通选通晶体管、第二选通晶体管、配置电阻和熔丝,第一选通晶体管的控制极连接第一选通电压Vb,第二极接地,第一极连接配置电阻的一端;第二选通晶体管的控制极接地,第一极连接第二选通电压,第二极连接熔丝的一端,熔丝的另一端连接配置电阻的另一端;
输出模块212包括反相器、输出晶体管和输出电阻,反相器连接熔丝和配置电阻的连接端,反相器的输出端或者熔丝和配置电阻的连接端连接输出晶体管的控制极;输出晶体管的第一极和第二极分别连接输出电阻的两端,多个输出电阻串联连接;
根据选通模块211中配置电阻与熔丝的电位,选通输出模块212中相应的输出电阻,被选通的多个输出电阻的阻值之和即连接于第三运算放大器A3的负输入端和输出端之间的调节电阻的大小,即图2中对应着A-B之间的电阻之和。
本实施例中的驱动电路的补偿结构,可以实现芯片封装,便于后续使用。这里,熔丝并非数字电路中可擦写的熔丝,而是可烧断的一次性熔丝。利用该熔丝,可以将每一个芯片的目标电阻都调成相同阻值R0,如果发现电阻由于工艺的原因比RO偏小或者偏大,则通过烧熔丝方式去调大或者调小。一旦烧断,不可再恢复。图2中,与熔丝Fu0-Fu7连接的配置电阻都是r1,熔丝自身电阻可以忽略不计。
优选的是,第一选通晶体管、输出晶体管为N型晶体管,第二选通晶体管为P型晶体管;并且,多个输出电阻以2n大小顺序串联连接。
这里应该理解的是,对于N型晶体管,其第一极可以是漏极,第二极可以是源极;或者,对于P型晶体管,其第一极可以是源极,第二极可以是漏极。在具体选用晶体管时并不限定固定型的晶体管,只需同时将选定类型的晶体管的端口极性按本实施例中晶体管的端口极性在连接上做相应的对应即可,这里不再详述。
本实施例的驱动电路的补偿结构,跨组放大器的电流充电阻速度很快,输出很快稳定。相比电容积分器结构,用相同大小电流对电容充电,速度会慢很多,即输出电压达到稳定时间较长。因此采用跨组放大电路来代替电容积分器,大大降低感测像素电流的时间;而且,在校准时,外部提供一路基准电流源,采用熔丝技术对调节电阻进行微调,使得不同通道(channel)间和不同芯片间的输出电压一致,从而保证校准的准确性。
根据图2可知,R0初始值设定为12R,并且设计为双向可调,可调范围为8R-15.97R范围,最小步长为1/32R,精度为0.26%。熔丝连接状态为0,断开为1。在正常工作前,可以对调节电阻R0(由多个输出电阻串联而成)进行校准。校准方式为将开关SW2连接到一路外部给定的基准电流,同时测量所有跨组放大电路上的输出电压,根据电压公式Vout=Vref-Iref*R0测出R0的实际值,最后根据(12R/R0)-1算出电阻变化率,最后依据图3(仅为局部)示例的熔丝匹配参照表图决定FU0-FU7各个熔丝的烧断与否,从而克服工艺偏差实现校准。其中,根据图3的匹配熔丝根据不同的电路设计,可以快速查找与之匹配的电阻值,提高速度和效率。
根据调节范围的不同,可以在输出模块对应的输出电阻前设置反相器,以获得不同的向上调节或向下调节的电阻范围。本实施例以仅在对应着4R的输出电阻设置反相器作为示例进行说明,这种调节方式下,向上调节和向下调节的范围相同,调节幅度为约4R。图2中,只有与FU7连接的这组输出模块设置反相器,该组输出模块控制的输出电阻的阻值为4R;后面的七组输出模块直接连接熔丝和配置电阻的连接端,这七组输出模块控制的输出电阻加起来为3.968R(近似为4R)。初始状态下,因为反相器存在,4R电阻被短路,AB之间的电阻R0最大值为(8+3.968)R,如果需要调小阻值,可以根据需要烧断选通模块中的熔丝FU0-FU6,最小值可以为8R;如果需要调大阻值,可以烧断FU7,此时4R电阻加入到整个电阻串中,调修范围变成12R-(12+3.968)R,所以正是这个反相器存在,使得R0的阻值可以在12R基础上实现双向调节、且调节幅度相当,上至15.968R,下至8R。当然,要获得上述的调节模式,也可以在对应着4R的输出电阻前不设置反相器,而在2R-1/32R这七个输出电阻前设置反相器,在具体实施过程中可灵活选择,这里不做限定。
在对调节电阻R0完成校准后,将SW2与Iref断开(即将SW2不接Iref而接到电流镜电路,具体为MP3的漏极),并与前面的电源镜电路连接。根据跨导放大的原理,将输入电流转化为电压输出,进行后续的驱动处理。
在实施过程中,驱动电路和补偿结构可以不是一对一的,可以是多个通道分时共用一个补偿电路,对于独立于像素的驱动电路的外部补偿结构(该补偿结构可以配置在芯片内部),通常将10-20个补偿结构做在一个芯片内,可以应对960个通道(channel),每一通道对应一个像素。
本实施例中的驱动电路的补偿结构,直接感测显示面板中像素数据的驱动电流,避免了电压信号在走线过程中容易受到干扰的问题,克服了感测电压降低的不足,提高了感测精度,缩短了感测时间;同时采用跨组放大电路,通过熔丝技术微调使所有跨组放大器电阻一致,从而实现校准功能,避免了出现工艺偏差的问题。可见,本实施例中驱动电路的补偿结构,能克服工艺偏差带来的失配,同时兼具电流型补偿效果好,并利于更大尺寸化及更高分辨的实现,特别适用于AMOLED电流外补偿方法及***。
实施例2:
本实施例提供一种驱动电路模块,包括驱动电路,还包括实施例1的驱动电路的补偿结构,具有较好的驱动效果。
该驱动电路模块中,对于其中的驱动电路结构不做限制。作为一种示例,如图4所示,其中的驱动电路3是常见的2T1C像素电路,T1是扫描开关管,负责逐行把驱动电压数据(Data)写入驱动管T2的栅极;T2是驱动管,将电压信号转化为电流提供给OLED器件。T1的栅极接行扫描信号,源极接Data数据;T2的栅极接T1的漏极,源极接OVDD,漏极接OLED的阳极,OLED器件的阳极接T2的漏极,阴极接地。
采用了实施例1的电流型外部补偿结构时,该补偿结构包括一个高精电流放大电路1,一个跨组放大电路2。为了弥补像素电流值较小对信号处理带来的挑战,在感测像素电流的时间阶段,将像素电路中电流经过一个高精度电流放大器,将驱动电流放大一定倍数,再输入到积分运算放大器;由于不同TFT驱动管的电流不同,因此固定时间内跨组放大电路输出电压也不相同,输出电压再经过模数转换器4(ADC),将输出电压信号转为N bit数据信号传递给时序控制器5(T-CON),时序控制器5中的FPGA将含有电流像素数据信息集合到需要输出的数据线上,针对不同驱动电流提供微调后的数据驱动,从而实现电流型补偿。
此外,由于其采用的驱动电路的补偿结构针对多款芯片由于工艺差带来的电阻失配,通过熔丝技术匹配调节电阻R0进行校准,因此实现精确校准,完成校准后,将SW2与Iref断开,并与前面的镜像电路连接。根据跨导放大的原理,将输入电流转化为电压输出,将输出经过ADC转为数字信号,送到T-CON板进行处理,对data数据进行微调,从而达到补偿效果。
可见,基于驱动电路的补偿结构,该驱动电路模块各路的驱动电流得到了精确的放大,而且保持了较好的均一性。
实施例3:
本实施例提供一种显示面板,还包括实施例2的驱动电路的补偿结构。
该显示面板可以为:台式电脑、平板电脑、笔记本电脑、手机、PDA、GPS、车载显示、投影显示、摄像机、数码相机、电子手表、计算器、电子仪器、仪表、液晶面板、电子纸、电视机、显示器、数码相框、导航仪等任何具有显示功能的产品或部件,可应用于公共显示和虚幻显示等多个领域。
可以理解的是,以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式,然而本发明并不局限于此。对于本领域内的普通技术人员而言,在不脱离本发明的精神和实质的情况下,可以做出各种变型和改进,这些变型和改进也视为本发明的保护范围。
Claims (10)
1.一种驱动电路的补偿结构,用于为驱动电路提供补偿电流,其特征在于,包括电流放大电路和跨组放大电路,其中:
所述电流放大电路,连接于所述驱动电路的输出端,用于将驱动电路输出的驱动电流放大设定倍数;
所述跨组放大电路,连接于所述电流放大电路的输出端,用于对补偿结构中的电阻进行匹配,并将驱动电流转换为对应的驱动电压;
所述跨组放大电路包括第三运算放大器和匹配结构,其中:
所述匹配结构,包括基准电流源和调节电阻单元,所述调节电阻单元的调节电阻分别连接于所述第三运算放大器的负输入端和输出端,用于使得不同所述跨组放大电路的阻抗匹配;
所述第三运算放大器,其正输入端连接参考电压,负输入端还与所述基准电流源或所述电流放大电路的输出端择一连接,所述输出端用于输出与所述电流放大电路的驱动电流对应的驱动电压。
2.根据权利要求1所述的补偿结构,其特征在于,所述电流放大电路包括第一电流镜和第二电流镜,所述第一电流镜的输入端连接所述第二电流镜的输出端,输出端连接所述跨组放大电路的输入端;所述第二电流镜的输入端连接所述驱动电路的输出端。
3.根据权利要求2所述的补偿结构,其特征在于,所述第一电流镜包括第一晶体管、第二晶体管、第三晶体管、第四晶体管和第一运算放大器,其中:
所述第一晶体管,控制极连接所述第二晶体管的控制极,第一极连接模拟电源,第二极连接所述第一运算放大器的正输入端和所述第三晶体管的第一极;
所述第二晶体管,第一极连接模拟电源,第二极连接所述第一运算放大器的负输入端和所述第四晶体管的第一极;
所述第三晶体管,控制极连接其第二极和所述第一晶体管的控制极,第二极还连接所述第二电源镜的输入端;
所述第四晶体管,控制极连接所述第一运算放大器的输出端,第二极连接所述跨组放大电路。
4.根据权利要求3所述的补偿结构,其特征在于,所述第一晶体管、所述第二晶体管、所述第三晶体管、所述第四晶体管为P型晶体管,所述第二晶体管的宽长比为所述第一晶体管的宽长比的N倍。
5.根据权利要求2所述的补偿结构,其特征在于,所述第二电流镜包括第五晶体管、第六晶体管、第七晶体管、第八晶体管、第九晶体管、第十晶体管和第二运算放大器,其中:
所述第五晶体管,控制极连接所述第六晶体管的控制极,第一极连接所述第二运算放大器的正输入端和所述第七晶体管的第二极,第二极连接参考地;
所述第六晶体管,第一极连接所述第二运算放大器的负输入端和所述第八晶体管的第二极,第二极连接参考地;
所述第七晶体管,控制极连接其第一极和所述第九晶体管的二极;
所述第八晶体管,控制极连接所述第二运算放大器的输出端,第一极连接所述第十晶体管的第二极;
所述第九晶体管,其控制极连接开启信号,第一极连接所述驱动电路的输出端,第二极还连接所述第五晶体管的控制极;
所述第十晶体管,其控制极连接开启信号,第一极连接所述第一电流源镜的输入端,第二极连接所述第八晶体管的第一极。
6.根据权利要求5所述的补偿结构,其特征在于,所述第五晶体管、所述第六晶体管、所述第七晶体管、所述第八晶体管、为N型晶体管,所述第六晶体管的宽长比为所述第五晶体管的宽长比的M倍;所述第九晶体管和所述第十晶体管为N型晶体管或P型晶体管。
7.根据权利要求1所述的补偿结构,其特征在于,
所述基准电流源用于为选择匹配的所述调节电阻提供参考电流,所述调节电阻单元包括多组选通模块和与所述选通模块对应的多组输出模块,其中:
每一所述选通模块包括第一选通选通晶体管、第二选通晶体管、配置电阻和熔丝,所述第一选通晶体管的控制极连接第一选通电压,第二极接地,第一极连接所述配置电阻的一端;所述第二选通晶体管的控制极接地,第一极连接第二选通电压,第二极连接所述熔丝的一端,所述熔丝的另一端连接所述配置电阻的另一端;
所述输出模块包括反相器、输出晶体管和输出电阻,所述反相器连接所述熔丝和所述配置电阻的连接端,所述反相器的输出端或者所述熔丝和所述配置电阻的连接端连接所述输出晶体管的控制极;所述输出晶体管的第一极和第二极分别连接所述输出电阻的两端,多个所述输出电阻串联连接;
根据所述选通模块中所述配置电阻与所述熔丝的电位,选通所述输出模块中相应的所述输出电阻,被选通的多个所述输出电阻的阻值之和即连接于所述第三运算放大器的负输入端和输出端之间的所述调节电阻的大小。
8.根据权利要求7所述的补偿结构,其特征在于,所述第一选通晶体管、所述输出晶体管为N型晶体管,所述第二选通晶体管为P型晶体管;
多个所述输出电阻以大小顺序串联连接。
9.一种驱动电路模块,包括驱动电路,其特征在于,还包括权利要求1-8任一项所述的驱动电路的补偿结构。
10.一种显示面板,其特征在于,还包括权利要求9所述的驱动电路模块。
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