CN103928306B - 双金属栅极结构的形成方法及cmos晶体管 - Google Patents
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Abstract
本发明提供了一种双金属栅极结构的形成方法和CMOS晶体管。本发明在半导体衬底上的蚀刻阻挡层形成后,在所述蚀刻阻挡层表面形成一层蚀刻阻挡层的氧化物层,之后再沉积一层第一金属层。所述蚀刻阻挡层的氧化物层可有效阻止第一金属层与所述蚀刻阻挡层间出现原子扩散等相互作用,不仅确保在无需采取过度蚀刻方式便可除尽位于第二区域部分的第一金属层,简化蚀刻步骤同时,在后续形成的PMOS和NMOS金属栅极中,确保蚀刻阻挡层的厚度,减小金属栅离子渗入高K介电质层甚至衬底的晶体管FET区域的可能性,保证集成电路电学性能。
Description
技术领域
本发明涉及半导体制造技术领域,特别涉及一种应用在CMOS晶体管中双金属栅极结构的形成方法及利用该方法形成的CMOS晶体管。
背景技术
随着集成电路(简称IC)制造技术的飞速发展,尤其是进入亚微特征尺寸领域后,传统集成电路尺寸不断缩小,而如MOS晶体管中沟道长度和栅氧化物(一般为SiO2)厚度按比例缩小后,加剧了多晶硅的损耗、高的栅电阻,以及掺杂物(例如硼)渗透到器件的沟道区域而引起栅极漏电流增加等缺陷。为此某些高K(介电常数)电介质材料取代传统的SiO2可有效减小栅极泄露,但多晶硅与高K电介质材料不兼容,因此现在的集成电路中大多采用金属栅电极取代多晶硅栅电极,并取得良好的效果。
在双金属栅极结构中,NMOS和PMOS一般采用不同的金属栅极,PMOS采用具有接近于硅的价带的功函数的金属(简称PMOS功函数金属),而NMOS采用具有接近于硅的导带的功函数的金属(简称NMOS功函数金属)。在双金属栅极结构制备过程中,一般在沉积完高K介质层后,覆盖一层蚀刻阻挡层再依次进行PMOS功函数金属沉积、蚀刻、NMOS功函数金属沉积,以形成NMOS栅极和PMOS栅极。如国际公开号为WO2004/095527、中国专利公开号为CN101661904A的申请文件均介绍了不同的双金属栅极结构的形成工艺。
在实际操作工艺中,如在PMOS功函数金属沉积完成后,为了确保完全去除衬底NMOS区域上的PMOS功函数金属,在对于衬底NMOS区域上的PMOS功函数金属蚀刻过程中,大多采用过度蚀刻工艺,这样直接降低了蚀刻阻挡层厚度,从而可能导致NMOS功函数金属离子的渗入高K介电层中,甚至渗入晶体管FET区域中,从而致使栅极漏电流和功耗增加。
为此,一般选择与PMOS功函数金属和NMOS功函数金属蚀刻选择比较大的金属氮化物作为它们底部的蚀刻阻挡层,以确保蚀刻阻挡层的完整性。然而,在实际生产中发现即便采用类似的蚀刻阻挡层仍难以保证器件的性能,比如仍经常发生栅极漏电流过大的缺陷。
发明内容
为了解决上述问题,本发明提供了一种双金属栅极结构的形成方法以及COMS晶体管,其可有效减小半导体器件栅极漏电流增大缺陷,从而提高半导体器件的电学性质。
本发明所提供的一种双金属栅极结构的形成方法,包括:
提供具有第一区域和第二区域的半导体衬底,在所述半导体衬底上由下至上依次覆盖高K介电质层和蚀刻阻挡层;
在所述蚀刻阻挡层表面形成蚀刻阻挡层的氧化物层;
在所述蚀刻阻挡层的氧化物层上沉积第一金属层;
去除位于所述第二区域的所述第一金属层;
在剩余的所述第一金属层以及第二区域上沉积第二金属层。
可选地,所述第一区域为PMOS区域,所述第二区域为NMOS区域。
可选地,所述蚀刻阻挡层为TaN层或TaSiN层。
可选地,所述蚀刻阻挡层的厚度为10~50埃。
可选地,所述第一金属层为PMOS功函数金属层。
可选地,所述PMOS功函数金属层为TiN层、TiAlN层或TiSiN层。
可选地,所述第一金属层的厚度为10~100埃。
可选地,形成所述蚀刻阻挡层的氧化物层包括,采用臭氧溶液或是双氧水溶液清洗所述蚀刻阻挡层表面,以氧化所述蚀刻阻挡层表面形成所述蚀刻阻挡层的氧化物层。
可选地,所述臭氧溶液或是双氧水溶液的浓度为20~100ppm。
可选地,采用所述臭氧溶液或双氧水溶液持续清洗所述蚀刻阻挡层10~100s。
可选地,采用所述臭氧溶液或是双氧水溶液在20℃~100℃温度下清洗所述蚀刻阻挡层。
可选地,所述蚀刻阻挡层的氧化物层的厚度为1~6埃。
可选地,采用湿法化学蚀刻法去除位于所述第二区域的所述第一金属层。
可选地,采用NH3.H2O和H2O2的混合溶液实施所述湿法化学蚀刻。
可选地,所述混合溶液中,V(NH3.H2O):V(H2O2):V(H2O)为1:2:50至1:1:5。
可选地,所述湿法化学蚀刻在25℃~100℃下进行。
本发明又提供了一种CMOS晶体管,包括:建立于同一衬底上的PMOS晶体管和NMOS晶体管;
所述PMOS晶体管由下至上依次包括高K介电质层、蚀刻阻挡层、位于所述蚀刻阻挡层表面的蚀刻阻挡层的氧化物层、PMOS功函数金属层;
所述NMOS晶体管由下至上依次包括高K介电质层、蚀刻阻挡层、位于所述蚀刻阻挡层表面的蚀刻阻挡层的氧化物层、NMOS功函数金属层。
可选地,所述蚀刻阻挡层为TaN层或TaSiN层。
可选地,所述PMOS功函数金属层为TiN层、TiAlN层或TiSiN层。
可选地,所述PMOS功函数金属层的厚度为10~100埃;所述蚀刻阻挡层的氧化物层的厚度为1~6埃。
与现有技术相比,本发明主要具有以下优点:
本发明一种双金属栅极结构的形成方法在所述蚀刻阻挡层形成后,在所述蚀刻阻挡层表面形成一层蚀刻阻挡层的氧化物层,之后再沉积一层第一金属层,所述蚀刻阻挡层的氧化物层可有效阻止第一金属层与所述蚀刻阻挡层间出现原子扩散等相互作用,不仅确保在无需采取过度蚀刻方式便可除尽位于第二区域部分的第一金属层,简化蚀刻步骤同时,在后续形成的PMOS和NMOS金属栅极中,确保蚀刻阻挡层的厚度,减小金属栅离子渗入高K介电质层甚至衬底的晶体管FET区域的可能性,并导致制成集成电路漏电流和功耗急剧增加的缺陷,保证集成电路电学性能。
而本发明提供的CMOS晶体管中,位于蚀刻阻挡层与PMOS/NMOS功函数金属层之间的蚀刻阻挡层的氧化物层可有效阻止PMOS/NMOS功函数金属层中的金属栅离子渗透于高K介电质层甚至衬底的晶体管FET区域的可能性、制成集成电路漏电流功耗急剧增加的缺陷,保证集成电路电学性能。
附图说明
通过附图中所示的本发明的优选实施例的更具体说明,本发明的上述及其它目的、特征和优势将更加清晰。在全部附图中相同的附图标记指示相同的部分。并未刻意按实际尺寸等比例缩放绘制附图,重点在于示出本发明的主旨。
图1为现有的一种双金属栅极结构的形成方法的流程示意图;
图2a~2d是本发明的实施例双金属栅极结构的形成方法的流程示意图;
图3为本发明的实施例双金属栅极结构的形成方法形成的双金属栅极结构的电容(C)~电压(V)测试图;
图4为本发明的实施例双金属栅极结构的形成方法形成的双金属栅极结构的电流(A)~电压(V)测试图;
图5为本发明的CMOS晶体管实施例的结构示意图。
具体实施方式
由背景技术可知,在半导体金属制备工艺中,即使选择与PMOS功函数金属和NMOS功函数金属蚀刻选择比较大的金属氮化物作为它们底部的蚀刻阻挡层,如常见的,以TiN为PMOS功函数金属时,TaN或TaSiN则是常用的蚀刻阻挡层材料,以求确保PMOS功函数金属和NMOS功函数金属蚀刻后保留足够厚度的蚀刻阻挡层,仍然能难以避免发生栅极漏电流过大的现象出现,从而造成半导体器件的电学性能的缺陷。
发明人经深入研究后发现,在半导体制备工艺中,PMOS功函数金属(和NMOS功函数金属)易与金属氮化物作用,并在两者界面间形成金属的掺杂层。其具体地可参考图1的举例所示,在半导体衬底10上依次形成高K介电层11和TaN层12,并在TaN层12覆盖作为PMOS功函数金属的TiN层13后,在TiN层13和TaN层12层叠交界面上易出现原子扩散现象,形成金属掺杂层14(TaTiN层)。而在去除半导体衬底NMOS区域部分的PMOS功函数金属以沉积NOMS功函数金属层15时,所述金属掺杂层14与所述PMOS功函数金属的蚀刻选择比较小,其会被完全清除,在实际蚀刻工艺中并无法阻止蚀刻的进行。因而实际上同样减小了作为蚀刻阻挡层的TaN层12厚度。而且在后续PMOS和NMOS金属栅极形成后,金属栅极中的PMOS和NMOS栅极中的功函数金属在其与蚀刻阻挡层的交界面继续发生相互作用而减小了蚀刻阻挡层厚度,并因此出现PMOS和NMOS功函数金属离子渗入高K介电质层甚至衬底的晶体管FET区域内,导致漏电流和集成电路功函数急剧增加,并导致集成电路的电学性能缺陷。
针对上述缺陷,本发明提供了一种双金属栅极结构的形成方法。参考图2a~2d所示,所述双金属栅极结构的形成方法包括,先提供一半导体衬底100,所述半导体衬底100可以是硅衬底、含硅衬底或绝缘体上的硅衬底。在所述半导体衬底100的表面预定义用于形成PMOS晶体管和NMOS晶体管的第一区域和第二区域,在所述半导体衬底内,位于所述第一区域和第二区域对应位置之间形成用于电性隔离第一区域和第二区域的浅沟槽(STI)101。为了便于描述,现将所述第一区域定义为后续制成的PMOS晶体管对应的PMOS区域,而第二区域为对应的NMOS区域。
在所述半导体衬底100上,由下至上依次覆盖高K介电质层110和蚀刻阻挡层120。之后,采用适当浓度的如臭氧溶液或是双氧水溶液等氧化剂溶液氧化所述蚀刻阻挡层120,以在所述蚀刻阻挡层120表面形成一层蚀刻阻挡层的氧化物层121。并在所述蚀刻阻挡层的氧化物层121表面沉积一层PMOS功函数金属(即第一功函数金属)。然后再采用蚀刻等工艺去除NMOS区域的PMOS功函数金属后,在NMOS区域沉积NMOS功函数金属(即第二功函数金属)。之后再进行如对PMOS功函数金属、NMOS功函数金属进一步蚀刻,以及PMOS、NMOS栅极的侧墙制备等后续工序以完成PMOS、NMOS栅极制备。
所述的高K介电质层11可包括三氧化二铝(Al2O3)、钛酸钡锶(BST)、锆钛酸铅(PZT)、ZrSiO2、HfSiO2、HfSiON、TaO2和HfO2等具有较高介电常数的材料。所述的PMOS功函数金属层包括具有接近于硅的价带的功函数的,如铪、锆、钽、钛等金属离子的材料;NMOS功函数金属层包括具有接近于硅的导带的功函数的,如铂、镍、钌、铛、铝以及其组合等金属离子的材料。在双金属栅极制的现有制备工艺中,所述蚀刻阻挡层设置于所述PMOS功函数金属层和NMOS功函数金属层下方,所述蚀刻阻挡层材料与PMOS功函数金属层和NMOS功函数金属层具有较高的蚀刻比,如TiN是现今普遍使用的PMOS功函数金属层材料,而NH3.H2O和H2O2的混合溶液则是常用的湿法蚀刻剂,而对应的与TiN具有较大蚀刻比的TaN则是最常用的蚀刻阻挡层材料(在常温下,以NH3.H2O和H2O2的混合溶液为蚀刻剂,TiN和TaN的蚀刻速率比超过30倍),在蚀刻PMOS功函数金属层和NMOS功函数金属层完成后,蚀刻阻挡层可阻止所使用的蚀刻剂进一步渗透蚀刻,从而过度蚀刻PMOS功函数金属层和NMOS功函数金属层下方的各层结构,破坏集成电路芯片结构破坏。
然而实际使用中,在PMOS功函数金属层中金属离子(如TiN中钛离子)和蚀刻阻挡层中金属离子(如TaN中的钽离子)在TiN层和TaN层的结合界面间相互作用而形成金属的掺杂层。而在NMOS功函数金属层沉积前,在NMOS区域去除该PMOS功函数金属层时,需要过量蚀刻以除尽该部分的PMOS功函数金属(而且所述金属的掺杂层的蚀刻速率的确也很大,其无法阻挡蚀刻工艺进行)。这样直接减小了蚀刻阻挡层的厚度。而且在PMOS区域的PMOS功函数金属层与蚀刻阻挡层交界面同样形成金属的掺杂层,其同样减小了蚀刻阻挡层厚度,因而可能导致PMOS和NMOS晶体管的PMOS功函数金属及NMOS功函数金属的离子的渗入高K介电层中,甚至渗入晶体管FET区域中,从而致使栅极泄露电流和功耗增加。而本发明中,在所述蚀刻阻挡层表面形成一层蚀刻阻挡层的氧化物层后,可有效阻止在PMOS功函数金属层和NMOS功函数金属层与所述蚀刻阻挡层间出现原子扩散等相互作用,不仅确保在无需采取过度蚀刻方式便可除尽如在NOMS区域部分的PMOS金属功函数,简化蚀刻步骤同时,在后续形成的PMOS和NMOS金属栅极中,确保蚀刻阻挡层的厚度,减小PMOS和NMOS功函数金属渗入高K介电质层甚至衬底的晶体管FET区域的可能性,从而克服因此造成的集成电路漏电流和功耗急剧增加的缺陷,保证集成电路电学性能。
为使本发明的上述目的、特征和优点能够更加明显易懂,下面结合附图对本发明的具体实施方式做详细的说明。在下面的描述中阐述了很多具体细节以便于充分理解本发明。但是本发明能够以很多不同于在此描述的其它方式来实施,本领域技术人员可以在不违背本发明内涵的情况下做类似推广,因此本发明不受下面公开的具体实施的限制。
其次,本发明利用示意图进行详细描述,在详述本发明实施例时,为便于说明,表示器件结构的剖面图会不依一般比例作局部放大,而且所述示意图只是实例,其在此不应限制本发明保护的范围。此外,在实际制作中应包含长度、宽度及深度的三维空间尺寸。
为便于描述,本实施例中以PMOS区域作为第一区域,NMOS区域作为第二区域,而相应的PMOS功函数金属层作为第一金属层,而NMOS功函数金属层作为第二金属层。而实际操作中,也可以NMOS区域作为第一区域,PMOS区域作为第二区域,而相应的PMOS功函数金属层作为第二金属层,而NMOS功函数金属层作为第一金属层,这些简单的改变均在本发明的保护范围内。
双金属栅极结构的形成过程:
参考图2a所示,本实施例一种双金属栅极结构的形成方法包括:
步骤S1,先提供具有PMOS区域和NMOS区域的半导体衬底100,并在所述半导体衬底100上由下至上依次覆盖一层高K介电质层110和蚀刻阻挡层120。
所述高K介电层110包括三氧化二铝(Al2O3)、钛酸钡锶(BST)、锆钛酸铅(PZT)、ZrSiO2、HfSiO2、HfSiON、TaO2和HfO2中的任一种。所述蚀刻阻挡层120优选采用TaN。所述作为蚀刻阻挡层的TaN的厚度为10~50埃。如10埃、15埃、20埃、30埃、40埃、50埃。若所述TaN层过厚,其会影响集成电路的尺寸,而若所述TaN层过薄,则无法有效起到阻挡蚀刻以及后续阻止PMOS以及NMOS功函数金属渗透入所述高K介电质层110的功效。至于其具体大小,可根据工艺实际需要确定。
步骤S2,结合参考图2a所示,以氧化剂清洗所述蚀刻阻挡层120表面,氧化所述蚀刻阻挡层120,以在所述蚀刻阻挡层120表面形成一层蚀刻阻挡层的氧化物层121。
具体地,以浓度为20~100ppm的臭氧(O3)溶液在20℃~100℃温度下清洗所述蚀刻阻挡层120表面10~100秒(s),从而形成厚度为1~6埃的蚀刻阻挡层的氧化物层121(TaON层),如1埃、2埃、3埃、4埃、5埃和6埃。
若所述TaN120被过度氧化,则形成的蚀刻阻挡层的氧化物层121过厚,相应的减小了TaN层120厚度,若氧化力度不够,则无法形成合适厚度的TaON层121以有效阻止TaN层与TiN层间的相互作用。实际操作过程中,氧化剂的浓度、清洗的温度以及清洗时间相对应。所述臭氧溶液的浓度具体为20、25、30、35……90、95、100ppm等20~100ppm范围内的数值,温度包括20、25、30、35……90、95、100℃等20~100℃范围内的数值,而清洗的时间也可为如10、20、30……100s等10~100s任一点。实际操作中,如在相同的温度下,若氧化剂浓度较高,其清洗时间则相应减小;相同浓度的氧化剂使用中,清洗温度较高,则清洗时间相应减小;相同的清洗时间设定下,清洗温度较高,则选用的氧化剂浓度相应减小。
步骤S3,结合参考图2b所示,在所述蚀刻阻挡层的氧化物层121上沉积PMOS功函数金属层130。所述PMOS功函数金属层130同时覆盖所述PMOS区域和NMOS区域。
具体地,所述PMOS功函数金属层130为TiN层,其可通过采用如化学气相沉积(CVD)、物理气相沉积(PVD)、原子沉积(ALD)或是旋涂电介质工艺(SOD)等适合的工艺在所述蚀刻阻挡层的氧化物层121上形成TiN层。所述TiN层的厚度为10~100埃,如10、15、20、25、30……90、95,100埃。
步骤S4,结合参考图2c所示,去除所有位于所述NMOS区域部分的所述PMOS功函数金属层。
具体地,可在所述PMOS功函数金属层130上方形成一层遮掩层150,如PR(photo resist,光敏抗蚀剂)并以其为掩模进行蚀刻,保留位于所述PMOS区域的所述PMOS功函数金属层1301,去除位于所述NMOS区域部分的所述PMOS功函数金属层。而蚀刻工艺优选采用以NH3.H2O和H2O2的混合溶液为蚀刻剂,在25℃~100℃温度下进行湿法化学蚀刻工艺,以去除位于所述NMOS区域部分的所述PMOS功函数金属层,直至露出位于所述NMOS区域部分的所述蚀刻阻挡层的氧化物层121。
NH3.H2O和H2O2的混合溶液中,V(NH3.H2O):V(H2O2):V(H2O)间于1:2:50~1:1:5之间,如1:1:5、1:1:10、1:1:30、1:1.3:5、1:1.5:10、1:1.8:10、1:2:20、1:2:40、1:2:45、1:2:50等。经实验证明,采用上述条件的蚀刻工艺中,所述蚀刻阻挡层的氧化物层121(TaON)与所述PMOS功函数金属层130对于上述浓度配比的NH3.H2O和H2O2的混合溶液具有很高的蚀刻选择比,因而在蚀刻工艺中,确保所述NMOS区域部分的所述PMOS功函数金属层完全去除的同时,不必担忧过度蚀刻的问题,其完整地保留了所述蚀刻阻挡层的氧化物层121(TaON)(如图2c所示)其同样保护了位于所述蚀刻阻挡层的氧化物层121下方的蚀刻阻挡层120的厚度。
步骤S5,结合参考图2d所示,在除尽所述NMOS区域部分的所述PMOS功函数金属层后,去除位于剩余的PMOS功函数金属层1301上方的遮掩层150,并在剩余的所述PMOS功函数金属层(即位于所述PMOS区域部分的所述PMOS功函数金属层1301)上方以及NMOS区域上沉积一层NMOS功函数金属层160。
所述NMOS功函数金属层160的材料具体可为AlTi。而所述沉积工艺同样可采用如化学气相沉积(CVD)、物理气相沉积(PVD)、原子沉积(ALD)或是旋涂电介质工艺(SOD)等适合的工艺实现。
在所述NMOS功函数金属层160沉积完成后,再次采用湿法蚀刻等工艺根据需要蚀刻去除多余的所述PMOS功函数金属层1301以及NMOS功函数金属层160形成PMOS晶体管栅极图案和NMOS晶体管栅极图案,并进行栅极侧墙建立工艺,以形成对应的PMOS栅极和NMOS栅极。这些后续工艺均可采用现有工艺实现,在此不再赘述。
CMOS晶体管实例
本发明还提供了一种包括上述双金属栅极结构的CMOS晶体管,其具体实施例结构可结合参考图5所示。
所述CMOS晶体管包括建立于同一半导体衬底100上的PMOS晶体管200和NMOS晶体管300。
所述PMOS晶体管200由下至上依次包括高K介电质层201、蚀刻阻挡层202、位于所述蚀刻阻挡层202表面的蚀刻阻挡层的氧化物层203和PMOS功函数金属层204。所述NMOS晶体管300由下至上依次包括高K介电质层301、蚀刻阻挡层302、位于所述蚀刻阻挡层302表面的蚀刻阻挡层的氧化物层303、NMOS功函数金属层304。
所述高K介电质层201和202可以为三氧化二铝(Al2O3)、钛酸钡锶(BST)、锆钛酸铅(PZT)、ZrSiO2、HfSiO2、HfSiON、TaO2和HfO2中的任一种,且所述高K介电质层201和高K介电质层202可以是同种材料也可以使不同中材料。所述PMOS功函数金属与NMOS功函数金属采用不同的材料制成,所述PMOS功函数金属优选采用TiN,而所述NMOS功函数金属可采用AlTiN、AlTi等材料。所述PMOS功函数金属层204和NMOS功函数金属层304的厚度为10~100埃。
而所述蚀刻阻挡层202和302优选与PMOS功函数金属以及NMOS功函数金属采用蚀刻选择比较大的金属氮化物,其中特别优选为TaN。此时,所述PMOS晶体管200和NMOS晶体管300的蚀刻阻挡层的氧化物层203和303则为TaN的氧化物层(TaON),其厚度为1~6埃,如1埃、2埃、3埃、4埃、5埃和6埃。
PMOS晶体管200和NMOS晶体管300的所述蚀刻阻挡层的氧化物层203和303可采用氧化剂在特定的条件(温度和清洗时间)下清洗所述蚀刻阻挡层从而获得,该步骤已在上述“双金属栅极结构的形成过程”着重描述,在此不再赘述。
本实施例提供的所述CMOS晶体管在PMOS功函数金属以及NMOS功函数金属与各自的蚀刻阻挡层202和302之间的蚀刻阻挡层的氧化物层203和303可有效阻隔PMOS功函数金属以及NMOS功函数金属的金属离子渗透入位于各自下方的高K介电质层201和301,以及衬底的晶体管FET区域中的可能性,并从而抑制集成电路漏电流和功耗的增加,保证集成电路电学性能。值得注意的是,所述PMOS和NMOS晶体管还包括栅极侧墙、各自对应的源、漏极结构和阱区结构等,这些结构都是本领域的熟知技术,在此不再赘述。
形成的双金属栅极结构的性能测试:
实施例:采用上述“双金属栅极结构的形成过程”制备的包括了蚀刻阻挡层的氧化物层的双金属栅极结构。
对比例:包括与上述实施例相同的衬底、高K介电质层、PMOS功函数金属层和NMOS功函数金属层以及相同制备工艺,但不包括上述蚀刻阻挡层的氧化物层的双金属栅极结构。
在相同的实验条件下,进行电容(C)~电压(V)以及漏电流(A)~电压(V)的测试,其测试图像如参考图3和图4所示,(其中三角形数据(w/o03treatment)为对比例的数据曲线,菱形数据(w/i 03treatment)为实施例的数据曲线)其数据结果参考表1所示。
表1.电容(C)~电压(V)、漏电流(A)~电压(V)的测试结果
实施例 | 对比例 | |
EOT(A) | 8.70 | 11.56 |
Leakage(A/um2)@-1V | 4.31E-11 | 2.16E-10 |
测试条件:测试电压:-2~+1v;频率:1兆赫
EOT(A):等效氧化层厚度,全称:equipment oxide thickness,单位A:埃
Leakage(A)@-1V:漏电流-电压,单位:电流A/um2:安培;电压V:伏
由表1可知,本实施例中,在所述PMOS功函数金属(NMOS功函数金属)以及蚀刻阻挡层间形成蚀刻阻挡层的氧化物层后,可有效减小漏电流现象出现,分析其原因主要是:蚀刻阻挡层的氧化物层有效减小了PMOS功函数金属(NMOS功函数金属)中金属离子向下扩散进入所述高K介电质层以及衬底的晶体管FET区域,从而有效减小了栅极漏电流现象。
在常规的技术中,可通过增加蚀刻阻挡层厚度,(此时EOT升高,后果是增加工艺复杂度以及增加了集成电路尺度)以减小了PMOS功函数金属(NMOS功函数金属)中金属离子向下扩散。但由表1可知,相比于对比例,本实施例在减小漏电流现象出现同时,还有效降低了EOT数值。因而其对于漏电流的防护以及半导体制备尺寸缩小化均具有重要意义。
值得注意的是,在上述实施例中,以TiN为PMOS功函数金属,TaN为蚀刻阻挡层材料,且以臭氧溶液为氧化剂,其具有较为典型的效果,因而可更好地阐述本发明的技术方案,并非对本发明作任何形式上的限制。本发明中,所述PMOS功函数金属并不局限于TiN,如还有TiAlN、TiSiN等,而蚀刻阻挡层也并不局限于TaN,还如TaSiN等。任何熟悉本领域的技术人员,在不脱离本发明技术方案范围情况下,都可利用上述揭示的方法和技术内容对本发明技术方案作出许多可能的变动和修饰,或修改为等同变化的等效实施例。因此,凡是未脱离本发明技术方案的内容,依据本发明的技术实质对以上实施例所做的任何简单修改、等同变化及修饰,均仍属于本发明技术方案保护的范围内。
Claims (20)
1.一种双金属栅极结构的形成方法,其特征在于,包括:
提供具有第一区域和第二区域的半导体衬底,在所述半导体衬底上由下至上依次覆盖高K介电质层和蚀刻阻挡层;
在所述蚀刻阻挡层表面形成蚀刻阻挡层的氧化物层;
在所述蚀刻阻挡层的氧化物层上沉积第一金属层;
去除位于所述第二区域的所述第一金属层;
在剩余的所述第一金属层以及第二区域上沉积第二金属层。
2.根据权利要求1所述的双金属栅极结构的形成方法,其特征在于,所述第一区域为PMOS区域,所述第二区域为NMOS区域。
3.根据权利要求1所述的双金属栅极结构的形成方法,其特征在于,所述蚀刻阻挡层为TaN层或TaSiN层。
4.根据权利要求1所述的双金属栅极结构的形成方法,其特征在于,所述蚀刻阻挡层的厚度为10~50埃。
5.根据权利要求2所述的双金属栅极结构的形成方法,其特征在于,所述第一金属层为PMOS功函数金属层。
6.根据权利要求5所述的双金属栅极结构的形成方法,其特征在于,所述PMOS功函数金属层为TiN层、TiAlN层或TiSiN层。
7.根据权利要求1所述的双金属栅极结构的形成方法,其特征在于,所述第一金属层的厚度为10~100埃。
8.根据权利要求1所述的双金属栅极结构的形成方法,其特征在于,形成所述蚀刻阻挡层的氧化物层包括,采用臭氧溶液或是双氧水溶液清洗所述蚀刻阻挡层表面,以氧化所述蚀刻阻挡层表面形成所述蚀刻阻挡层的氧化物层。
9.根据权利要求8所述的双金属栅极结构的形成方法,其特征在于,所述臭氧溶液或双氧水溶液的浓度为20~100ppm。
10.根据权利要求9所述的双金属栅极结构的形成方法,其特征在于,采用所述臭氧溶液或是双氧水溶液持续清洗所述蚀刻阻挡层10~100s。
11.根据权利要求10所述的双金属栅极结构的形成方法,其特征在于,采用所述臭氧溶液或是双氧水溶液在20℃~100℃温度下清洗所述蚀刻阻挡层。
12.根据权利要求11所述的双金属栅极结构的形成方法,其特征在于,所述蚀刻阻挡层的氧化物层的厚度为1~6埃。
13.根据权利要求1所述的双金属栅极结构的形成方法,其特征在于,采用湿法化学蚀刻法去除位于所述第二区域的所述第一金属层。
14.根据权利要求13所述的双金属栅极结构的形成方法,其特征在于,采用NH3.H2O和H2O2的混合溶液实施所述湿法化学蚀刻。
15.根据权利要求14所述的双金属栅极结构的形成方法,其特征在于,所述混合溶液中,V(NH3.H2O):V(H2O2):V(H2O)为1:2:50至1:1:5。
16.根据权利要求15所述的双金属栅极结构的形成方法,其特征在于,所述湿法化学蚀刻在25℃~100℃下进行。
17.一种CMOS晶体管,其特征在于,包括建立于同一衬底上的PMOS晶体管和NMOS晶体管;
所述PMOS晶体管由下至上依次包括高K介电质层、蚀刻阻挡层、位于所述蚀刻阻挡层表面的蚀刻阻挡层的氧化物层、PMOS功函数金属层;
所述NMOS晶体管由下至上依次包括高K介电质层、蚀刻阻挡层、位于所述蚀刻阻挡层表面的蚀刻阻挡层的氧化物层、NMOS功函数金属层。
18.根据权利要求17所述的CMOS晶体管,其特征在于,所述蚀刻阻挡层为TaN层或TaSiN层。
19.根据权利要求17所述的CMOS晶体管,其特征在于,所述PMOS功函数金属层为TiN层、TiAlN层或TiSiN层。
20.根据权利要求17所述的CMOS晶体管,其特征在于,所述PMOS功函数金属层的厚度为10~100埃;所述蚀刻阻挡层的氧化物层的厚度为1~6埃。
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PB01 | Publication | ||
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C14 | Grant of patent or utility model | ||
GR01 | Patent grant |