CN103426415B - 一种液晶显示面板的驱动电路及波形驱动方法 - Google Patents
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Abstract
本发明提供一种液晶显示面板的驱动电路及其波形驱动电路，其包括：位于液晶显示面板的像素区域外的第一信号线和第二信号线、芯片接脚连接线、均与芯片接脚连接线的第一开关装置和第二开关装置、以及第一、第二扫描线，所述第一开关装置的栅极与第二开关装置的栅极均连接至芯片接脚连接线，所述第一开关装置的源极连接至第一信号线，第一开关装置的漏极连接至第一扫描线，所述第二开关装置的源极连接至第二信号线，第二开关装置的漏极连接至第二扫描线。
Description
技术领域
本发明涉及一种液晶显示面板的驱动电路及波形驱动方法。
背景技术
图1为现有一般液晶显示器的电路驱动示意图，液晶显示器包括：液晶面板组件(PANEL)10、连接到液晶面板组件10的数据驱动器(DataDriveIC)20和栅极驱动器(ScanDriveIC)30、连接到数据驱动器20的灰度电压生成器（GammaVoltageGenerator）40、用于控制栅极驱动器30和数据驱动器20的时序控制器（TCON）50、以及为液晶显示器提供电源的直流转直流电源(DC/DC)60。液晶面板组件10包括相互对应的下显示面板和上显示面板、以及夹设在上显示面板和下显示面板之间的液晶。
假定液晶显示器在垂直方向有m条数据线、水平方向有n条扫描线，组合成一个m*n像素的液晶显示器，扫描线与数据线交叉限定多个像素单元，每个像素单元均包括三个子像素单元PX。每个子像素单元PX包括一TFT开关装置、液晶电容和存储电容，TFT开关装置包括与扫描线一起形成的栅极（Gate）、与数据线连接的源极（Source）、以及与像素电极连接的漏极（Drain），存储电容平行地连接到开关装置。
上述图1为一般液晶显示器的电路驱动示意图，现有还有一种公知DualGate像素结构的液晶显示器，图2所示为现有DualGate像素结构的液晶显示器的示意图，与上述图1的液晶显示器相比，DualGate像素结构的液晶显示器增加了一倍的扫描线G，公共电极线Cs与上述图1的公共电极线数量相同，并在每两根数据线S之间设有两个子像素单元1、2，每个子像素单元均包括一TFT开关装置11、21和像素电极12、22，每个TFT开关装置的栅极与对应的扫描线G连接。
DualGate像素结构的液晶显示器可以节省一半数目的源极驱动器，但是需增加一倍的栅极驱动器，由于栅极驱动器成本较低，所以采用Dualgate的液晶面板，较之传统架构，降低了面板成本。
发明内容
本发明涉及一种可以将栅极驱动器和/或源极驱动器降低的液晶显示面板的驱动电路及波形驱动方法。
本发明提供一种液晶显示面板的驱动电路，其包括：位于液晶显示面板的像素区域外、且电位相反的第一信号线和第二信号线、与芯片接脚连接的芯片接脚连接线、均与芯片接脚连接线的第一开关装置和第二开关装置、以及第一、第二扫描线，每个开关装置均包括栅极、源极和漏极，所述第一开关装置的栅极与第二开关装置的栅极均连接至芯片接脚连接线，所述第一开关装置的源极连接至第一信号线，第一开关装置的漏极连接至第一扫描线，所述第二开关装置的源极连接至第二信号线，第二开关装置的漏极连接至第二扫描线。
本发明又提供一种液晶显示面板的驱动电路，其包括：位于液晶显示面板的像素区域外、且电位相反的第一信号线、第二信号线和第三信号线、与芯片接脚连接的芯片接脚连接线、均与芯片接脚连接线的第一开关装置、第二开关装置和第三开关装置、以及第一、第二、第三扫描线，每个开关装置均包括栅极、源极和漏极，所述第一开关装置的栅极、第二开关装置的栅极和第三开关装置的栅极均连接至芯片接脚连接线，所述第一开关装置的源极连接至第一信号线，第一开关装置的漏极连接至第一扫描线，所述第二开关装置的源极连接至第二信号线，第二开关装置的漏极连接至第二扫描线，所述第三开关装置的源极连接至第三信号线，第三开关装置的漏极连接至第三扫描线。
本发明又提供一种波形驱动方法，当芯片接脚连接线输入高电位的前三分之一内，第一信号线也同样高电位，第二和第三信号线输入低电位，第一开关装置打开，从而第一扫描线输出栅极打开信号；第二和第三开关装置也打开，但第二和第三扫描线输出栅极关闭信号；当芯片接脚连接线输入高电位的三分之一至三分之二的时间内，第二信号线输入高电位，第一和第三信号线输入低电位，第二开关装置打开，从而第二扫描线输出栅极打开信号；第一和第三开关装置也打开，但第一和第三扫描线输出栅极关闭信号；当芯片接脚连接线输入高电位的后三分之一的时间内，第三信号线输入高电位，第一和第二信号线输入低电位，第三开关装置打开，从而第三扫描线输出栅极打开信号；第一和第二开关装置也打开，但第一和第二扫描线输出栅极关闭信号。
本发明又提供一种液晶显示面板的驱动电路，液晶显示面板包括相对设置的第一基板和第二基板、以及夹设在第一基板和第二基板之间的液晶，第二基板设有彩膜电极，第一基板包括：位于液晶显示面板的像素区域内、且电位相反的第一信号线、第二信号线和第三信号线、纵横交错的扫描线和数据线、以及与扫描线平行的公共电极线，公共电极线与相应的子像素单元之间形成存储电容，彩膜电极与相应的子像素单元之间形成液晶电容，所述扫描线与数据线交叉限定若干像素单元，每个像素单元包括若干子像素单元，每个子像素单元包括第一子像素单元和第二子像素单元，所述第一子像素单元内设有第一、第二开关装置和第一像素电极，所述第二子像素单元内设有第三、第四开关装置和第二像素电极，每个开关装置均设有栅极、源极和漏极，所述第一开关装置的栅极连接第二开关装置的漏极，第三开关装置的漏极连接至所述第四开关装置的栅极。
本发明又提供一种液晶显示面板的驱动电路，液晶显示面板包括相对设置的第一基板和第二基板、以及夹设在第一基板和第二基板之间的液晶，第二基板设有彩膜电极，第一基板包括：位于液晶显示面板的像素区域内、且电位相反的第一信号线、第二信号线和第三信号线、以及纵横交错的扫描线和数据线，信号线与相应的子像素单元之间形成存储电容，液晶与相应的子像素单元之间形成液晶电容，所述扫描线与数据线交叉限定若干像素单元，每个像素单元包括若干子像素单元，每个子像素单元包括第一子像素单元和第二子像素单元，所述第一子像素单元内设有第一、第二开关装置和第一像素电极，所述第二子像素单元内设有第三、第四开关装置和第二像素电极，每个开关装置均设有栅极、源极和漏极，所述第一开关装置的栅极连接第二开关装置的漏极，第三开关装置的漏极连接至所述第四开关装置的栅极。
本发明又提供一种波形驱动方法，当扫描线为高电平的前半段时间内，第一信号线同为高电平，第二信号线为低电平，第一子像素单元的第二开关装置打开，同时驱动第一开关装置打开，从而为第一子像素单元的第一像素电极充电；当扫描线为高电平的后半段时间内，第二信号线同为高电平，第一信号线为低电平，第三子像素单元的第三开关装置关闭，同时驱动第四开关装置打开，从而为第二子像素单元的第二像素电极充电；当扫描线为低电平时，第一、第二子像素电极电压为维持状态。
本发明又提供一种液晶显示面板的驱动电路，液晶显示面板包括相对设置的第一基板和第二基板、以及夹设在第一基板和第二基板之间的液晶，第二基板上设有彩膜电极，本驱动电路设置于第一基板上，所述驱动电路的像素区域外包括：与芯片接脚连接的芯片接脚连接线、第一信号线和第二信号线、分别与芯片接脚连接线连接的第一开关装置和第二开关装置；本驱动电路的像素区域内包括：纵横交错的扫描线、数据线、以及与数据线平行并位于数据线两侧的第三信号线和第四信号线，由所述相邻两扫描线、第三信号线、第四信号线、以及第三信号线和第四信号线之间的一数据线交叉限定了第一至第四的四个子像素单元，每个子像素单元内均设有两个开关装置和相应的子像素电极，定义位于第一子像素单元内设有第三、第四开关装置和第一子像素电极，定义位于第二子像素单元内设有第五、第六开关装置和第二子像素电极，定义位于第三子像素单元内设有第七、第八开关装置和第三子像素电极，定义位于第四子像素单元内设有第九、第十开关装置和第四子像素电极，所述第一子像素单元的第四开关装置由第三开关装置控制，所述第二子像素单元的第六开关装置由第五开关装置控制，所述第三子像素单元的第八开关装置由第七开关装置控制，所述第四子像素单元的第十开关装置由第九开关装置控制。
本发明又提供一种波形驱动方法，当芯片接脚连接线为高电平的前半段时间内，第一信号线也为高电平，第二信号线为低电平，与第一、第三、第五开关装置的栅极连接的扫描线输入栅极打开信号，与第二、第五、第九开关装置的栅极连接的扫描线输入栅极关闭信号；当第三信号线在芯片接脚连接线为高电平的前四分之一的时间内为高电平，此时第四信号线为低电平，第一子像素单元的第三开关装置控制第四开关装置打开，从而为第一子像素单元的像素电极充电；当第四信号线在芯片接脚连接线为高电平的四分之一至二分之一的时间内为高电平，此时第三信号线为低电平，第二子像素单元的第五开关装置控制第六开关装置打开，从而为第二子像素单元的像素电极充电；当第三信号线在芯片接脚连接线为高电平的二分之一至四分之三的时间内为高电平，此时第四信号线为低电平，第三子像素单元的第七开关装置控制第八开关装置打开，从而为第三子像素单元的像素电极充电；当第四信号线在芯片接脚连接线为高电平的后四分之一的时间内为高电平，此时第三信号线为低电平，第四子像素单元的第九开关装置控制第十开关装置打开，从而为第四子像素单元的像素电极充电。
本发明通过在液晶显示面板的像素区外和/或像素区域内增加一组反相的信号线、及开关装置等组成的驱动电路，将由栅极驱动器产生的脉冲信号一分为二或一分为三、或一分为四，形成两个或三个或四个依次打开的栅极脉冲信号，如此可以将栅极驱动器和/或源极驱动器数目降低，如此大幅度降低面板成本。
附图说明
图1为现有一般液晶显示器的电路驱动示意图；
图2为现有DualGate像素结构的液晶显示器的示意图；
图3为本发明第一实施例液晶显示面板驱动电路的等效电路的示意图；
图4为图3所述驱动电路的波形示意图；
图5为图3所示驱动电路的实际模拟结果图；
图6为本发明第二实施例液晶显示面板驱动电路的等效电路的示意图；
图7为图6所述驱动电路的波形示意图；
图8为本发明第三实施例液晶显示面板驱动电路的等效电路的示意图；
图9为图8所述驱动电路的波形示意图；
图10为图8所示驱动电路的实际模拟结果图；
图11为本发明第四实施例液晶显示面板驱动电路的等效电路的示意图；
图12为本发明第五实施例液晶显示面板驱动电路的等效电路的示意图；
图13为图12的局部放大图；
图14为图12所述驱动电路的波形示意图；
图15为本发明第六实施例液晶显示面板驱动电路的等效电路的示意图；
图16为图15的局部放大图。
具体实施方式
下面结合附图和具体实施例，进一步阐明本发明，应理解这些实施例仅用于说明本发明而不用于限制本发明的范围，在阅读了本发明之后，本领域技术人员对本发明的各种等价形式的修改均落于本申请所附权利要求所限定的范围。
图3为本发明第一实施例液晶显示面板驱动电路的等效电路的示意图，本驱动电路包括第一、第二扫描线41、42（G1-G4）、位于液晶显示面板像素区域外一组反相的第一信号线CLK1和第二信号线CLK2、以及第一开关装置31和第二开关装置32，反相的意思是电压相反，比如：如果第一信号线CLK1输入高电位Vgh，那么第二信号线CLK2输入的低电位Vgl，也即第一信号线CLK1的电位和第二信号线CLK2的电位相反。所述第一、第二扫描线41、42通过同一根芯片接脚连接线21（G12、G34）连接至栅极驱动器（图未示）的同一芯片接脚20（ICpin），且第一信号线CLK1和第二信号线CLK2在空间上均与芯片接脚连接线21垂直。
图3仅示意了两个芯片接脚20（ICpin1和ICpin2），每个芯片接脚20通过芯片接脚连接线21（G12）连接至第一开关装置31和第二开关装置32,所述第一开关装置31的第一栅极G连接至芯片接脚连接线21，第一开关装置31的第一源极S连接至第一信号线CLK1，第一开关装置31的第一漏极D连接至第一扫描线41（G1、G3）；所述第二开关装置32的第二栅极G也连接至芯片接脚连接线21（G34），第二开关装置32的第二源极S连接至第二信号线CLK2，第二开关装置32的第二漏极D连接至第二扫描线42（G2、G4）。
图4为图3所示驱动电路的波形示意图，G12与G34为栅极驱动器的输入信号、CLK1与CLK2为信号线输入信号，G1和G3为第一扫描线41的输出信号，G3和G4为第二扫描线42的输出信号，且G1、G2、G3、G4为实际驱动像素区的栅极信号。
当栅极驱动器的芯片接脚连接线G12输入栅极打开信号的前半段时间内，第一信号线CLK1也同样输入栅极打开信号，第二信号线CLK2输入栅极关闭信号，也即：栅极驱动器的芯片接脚连接线G12输入高电位Vgh的前半段时间内，第一信号线CLK1也同样高电位Vgh，第二信号线CLK2输入低电位Vgl。
与芯片接脚连接线G12连接的第一开关装置31打开，由于第一信号线CLK1输入高电位Vgh，故输出给第一开关装置31的源极也是高电位，故第一扫描线G1输出栅极打开信号，即高电位Vgh；与芯片接脚连接线G12连接的第二开关装置32也打开，由于第二信号线CLK2输入低电位Vgl，故输出给第二开关装置32的源极也是低电位，故第二扫描线G2输出栅极关闭信号，即：低电位Vgl。
当栅极驱动器的芯片接脚连接线G12输入栅极打开信号的后半段时间内，第二信号线CLK2同样输入栅极打开信号，第一信号线CLK1输入栅极关闭信号，也即：栅极驱动器的芯片接脚连接线G12输入高电位Vgh的后半段时间内，第二信号线CLK2输入高电位Vgh，第一信号线CLK1输入低电位Vgl，与芯片接脚连接线G12连接的第二开关装置32打开，从而第二扫描线G2输出栅极打开信号，即：高电位；与芯片接脚连接线G12连接的第一开关装置31也打开，但第一扫描线G1输出栅极关闭信号，即：低电位。
然后依序输入栅极驱动器的芯片接脚连接线G34输入栅极打开信号或高电位Vgh，其结果与上述相同，依次输出扫描线G3和G4信号，就不重复叙述。
本发明第一实施例通过增加一组反相第一信号线CLK1和第二信号线CLK2，将栅极驱动器产生的脉冲信号一分为二，形成两个依次打开栅极的脉冲信号。
图5为图3所示驱动电路的实际模拟结果图，经过图3所示的等效电路，可以产生理想的G1和G2脉冲信号。
通过栅极驱动器产生的如G12和G34脉冲信号，经由信号线CLK1、CLK2，转换为如G1-G4扫描信号，且G1-G4为实际驱动像素区的栅极信号，也就将栅极驱动器产生的脉冲信号一分为二，从而可以减少半数的栅极驱动器，节省了液晶显示面板成本。
图6为本发明第二实施例液晶显示面板驱动电路的等效电路的示意图，与上述第一实施例区别的是：位于液晶显示面板像素区域外的信号线有三根：第一信号线CLK1、第二信号线CLK2、以及第三信号线CLK3，该三根信号线的电位不同；开关装置也有三个：第一开关装置31、第二开关装置32、以及第三开关装置33；扫描线也是三根41、42、43通过同一芯片接脚连接线21（G123、G456）连接至栅极驱动器（图未示）的同一芯片接脚20（ICpin）。
所述第一开关装置31的第一栅极G连接至芯片接脚连接线21（G123），第一开关装置31的第一源极S连接至第一信号线CLK1，第一开关装置31的第一漏极D连接至第一扫描线41（G1、G4）；所述第二开关装置32的第二栅极G也连接至芯片接脚连接线21（G456），第二开关装置32的第二源极S连接至第二信号线CLK2，第二开关装置32的第二漏极D连接至第二扫描线42（G2、G5）；所述第二开关装置33的第三栅极G也连接至芯片接脚连接线21（G456），第三开关装置33的第三源极S连接至第三信号线CLK3，第三开关装置33的第三漏极D连接至第三扫描线43（G3、G6）。
图7为图6所示驱动电路的波形示意图，当栅极驱动器的芯片接脚连接线G123输入栅极打开信号的前三分之一时间内，第一信号线CLK1也同样输入栅极打开信号，第二信号线CLK2和第二信号线CLK3输入栅极关闭信号，也即：栅极驱动器的芯片接脚连接线G12输入高电位Vgh的前三分之一时间内，第一信号线CLK1也同样高电位Vgh，第二信号线CLK2和第二信号线CLK3输入低电位Vgl，与芯片接脚连接线G123连接的第一开关装置31打开，从而第一扫描线G1输出栅极打开信号，即：高电位；与芯片接脚连接线G123连接的第二开关装置32和第三开关装置33也打开，但第二扫描线G2和第三扫描线G3输出栅极关闭信号，即：低电位。
当栅极驱动器的芯片接脚连接线G123输入栅极打开信号的三分之一至三分之二时间内，第二信号线CLK2同样输入栅极打开信号，第一信号线CLK1和第三信号线CLK3输入栅极关闭信号，也即：栅极驱动器的芯片接脚连接线G123输入高电位Vgh的三分之一至三分之二时间内，第二信号线CLK2输入高电位Vgh，第一信号线CLK1和第三信号线CLK3输入低电位Vgl，与芯片接脚连接线G123连接的第二开关装置32打开，从而第二扫描线G2输出栅极打开信号，即：高电位；与芯片接脚连接线G12连接的第一开关装置31和第三开关装置33也打开，但第一扫描线G1和第三扫描线G3输出栅极关闭信号，即：低电位。
当栅极驱动器的芯片接脚连接线G123输入栅极打开信号的后三分之一时间内，第三信号线CLK3同样输入栅极打开信号，第一信号线CLK1和第二信号线CLK2输入栅极关闭信号，也即：栅极驱动器的芯片接脚连接线G123输入高电位Vgh的后三分之一时间内，第三信号线CLK3输入高电位Vgh，第一信号线CLK1和第二信号线CLK2输入低电位Vgl，与芯片接脚连接线G123连接的第三开关装置33打开，从而第三扫描线G3输出栅极打开信号，即：高电位；与芯片接脚连接线G123连接的第一开关装置31和第二开关装置32也打开，但第一扫描线G1和第二扫描线G2输出栅极关闭信号，即：低电位。
然后依序输入栅极驱动器的芯片接脚连接线G456输入栅极打开信号或高电位Vgh，其结果与上述相同，依次输出扫描线G4、G5和G6信号，就不重复叙述。
通过将栅极驱动器产生的脉冲再一分为三，形成三个依次打开的扫描线的脉冲信号，从而可以将栅极驱动器减少为三分之一，节省了液晶显示面板成本。
第一与第二实施例只是在像素区域外的信号线的根数不同，但实际基本原理都是将栅极驱动器减少，其具有共同的特定技术特征“在像素区域外设置信号线”，故第一与第二实施例之间具有单一性。
图8为本发明第三实施例液晶显示面板驱动电路的等效电路的示意图，与上述两实施例不同的是：图8所示的驱动电路是位于液晶显示面板像素区域内的,本发明液晶显示面板包括相对设置的第一基板和第二基板、以及夹设在第一基板和第二基板之间的液晶，在本实施例中，第一基板为阵列基板，第二基板为彩膜基板，第二基板上设有彩膜电极。
阵列基板包括：纵横交错的扫描线Gn30和数据线S1/S250、以及与扫描线平行的公共电极线CS70（图8示意了两根数据线、第n跟扫描线和两根公共电极线）、以及一组反相的第一信号线K161和第二信号线K262，该第一信号线K161和第二信号线K262相互平行且均与扫描线30平行。
所述扫描线30与数据线50交叉限定若干像素单元，每个像素单元包括若干子像素单元（一般为三个子像素单元，分别为R子像素单元、G子像素单元和B子像素单元），每个子像素单元包括第一子像素单元和第二子像素单元，所述第一子像素单元内设有第一、第二开关装置71、72和第一像素电极，所述第二子像素单元内设有第三、第四开关装置73、74和第二像素电极。
公共电极线70通过固定电压与相应的子像素单元之间形成存储电容Cst，一般公共电极线3连接公共电压Vcom、或接地、或其他固定电压，且公共电极线70与第一像素电极之间形成第一存储电容Cst1，公共电极线70与第二像素电极之间形成第二存储电容Cst2；彩膜电极与相应的子像素单元之间形成液晶电容CLC，一般液晶电容CLC连接公共电压Vcom、或接地、或其他固定电压，且彩膜电极与第一像素电极之间形成第一液晶电容CLC1，彩膜电极与第二像素电极之间形成第一液晶电容CLC2。
所述第一开关装置71的第一栅极连接第二开关装置72的第二漏极，第一开关装置71的第一源极连接相应的数据线50，第一开关装置71的第一漏极连接第一子像素电极，且公共电极线70与第一像素电极之间形成第一存储电容Cst1，彩膜电极与第一像素电极之间形成第一液晶电容CLC1；所述第二开关装置72的第二栅极连接至相应的扫描线30，第二开关装置72的第二源极连接至第一信号线K161，第二开关装置72的第二漏极连接至所述第一开关装置71的第一栅极。
所述第三开关装置73的第三栅极连接至与第二开关装置72的第二栅极相同的扫描线30，第三开关装置73的第三源极连接至第二信号线K262，第三开关装置73的第三漏极连接至所述第四开关装置74的第四栅极；所述第四开关装置74的第四栅极连接第三开关装置73的第三漏极，第四开关装置74的第四源极连接相应的数据线50，第四开关装置74的第四漏极连接第二子像素电极，且公共电极线70与第二子像素电极之间形成第二存储电容Cst2，彩膜电极与第二子像素电极之间形成第二液晶电容CLC2。
根据上述的描述，也就是：第一开关装置71与第四开关装置74呈对称状态，第二开关装置72和第三开关装置73呈对称状态；且第一开关装置71由第二开关装置72驱动控制，第四开关装置74由第三开关装置73驱动控制。
当扫描线Gn与第一信号线K161同为高电平Vgh时，第一子像素单元的第二开关装置72打开，同时驱动第一开关装置71打开，从而为第一子像素单元的第一像素电极充电；当扫描线Gn与第二信号线K262同为高电平Vgl时，第三子像素单元的第三开关装置73打开，同时驱动第四开关装置74打开，从而为第二子像素单元的第二像素电极充电。
图9为图8所示驱动电路的波形示意图，公共电极线CS70为直流电压DC，当扫描线Gn为高电平Vgh的前半段时间内，第一信号线K161同为高电平Vgh，第二信号线K262为低电平Vgl，第一子像素单元的第二开关装置72打开，同时驱动第一开关装置71打开，从而为第一子像素单元的第一像素电极充电；当扫描线Gn为高电平Vgh的后半段时间内，第二信号线K262同为高电平Vgh，第一信号线K161为低电平Vgl，第三子像素单元的第三开关装置73打开，同时驱动第四开关装置74打开，从而为第二子像素单元的第二像素电极充电；当扫描线Gn为低电平Vgl时，上下两行子像素电极电压为维持状态。
图10为图8所示驱动电路的实际模拟结果图，经过图10所示的等效电路，像素电极可以被充入理想的电压。
本第三实施例通过增加一组反相的信号线K1、K2，从而将IC输入的脉冲信号一分为二，形成两个依次打开的栅极脉冲信号，进而将栅极驱动器的IC数目降为一半数量。
图11为本发明第四实施例液晶显示面板驱动电路的等效电路的示意图，与上述第三实施例不同的是：本第四实施例省去了公共电极线CS，通过相应的子像素电极与第一信号线K161或第二信号线K262形成存储电容Cst，从而可增大像素开口率。
由于省去了公共电极线CS，第一开关装置71的第一漏极连接第一子像素电极，且第一信号线K161与第一像素电极之间形成第二存储电容Cst1，彩膜电极与第一像素电极之间形成第一液晶电容CLC1。
第四开关装置74的第四漏极连接第二子像素电极，且第二信号线K262与第二像素电极之间形成第二存储电容Cst2，彩膜电极与第二像素电极之间形成第二液晶电容CLC2。
本第四实施例的像素开口率高于传统像素，且由于信号线K1\K2为高频方波电压，所以并不会影响像素电压及画面显示。
以上第三和第四实施例的开关装置就是现有的薄膜晶体管TFT，其沟道层均采用氧化物半导体。
第一、第二实施例与第三、第四实施例都是设置信号线，只是第一、第二实施例的信号线设置在像素区域外，第三、第四实施例的信号线设置在像素区域内，但第一、第二实施例与第三、第四实施例达到的目的都是将栅极驱动器的数量较少，故第一、第二实施例与第三、第四实施例之间具有特定的共同技术特征“信号线”，故第一、第二实施例与第三、第四实施例之间具有单一性。
第三与第四实施例只是在像素区域外的信号线的根数不同，但实际基本原理都是将栅极驱动器减少，其具有共同的特定技术特征“在像素区域外设置信号线”，故第一与第二实施例之间具有单一性。
图12为本发明第五实施例液晶显示面板驱动电路的等效电路的示意图，本第五实施例相当于将前述四个实施例的两个方案合并在一起，即：通过在液晶显示面板的像素区域外和像素区域内均设置相应的信号线及开关装置组成的驱动电路，这样设计的驱动电路，将栅极驱动器及源极驱动器数目同时降低一半，如此大幅度降低面板成本。
同时参阅图13，图13为图12的局部放大图，定义位于像素区域外的信号线分别为第一信号线CLK1101和第二信号线CLK2102，定义位于像素区域内的信号线分别为第三信号线K1401和第四信号线K2402。
本第五实施例的驱动电路的像素区域外包括：与芯片接脚（图未示）连接的芯片接脚连接线201、第一信号线CLK1101和第二信号线CLK2102、分别与芯片接脚连接线（图12示意了两根芯片接脚连接线G12和G34）201连接的第一开关装置301和第二开关装置302。
本驱动电路的像素区域内包括：纵横交错的扫描线G（图12示意了G1-G4，其中扫描线G1为501、扫描线G2为502）、数据线S601（图12示意了数据线S1和数据线S2）、以及与数据线平行并位于数据线两侧的第三信号线K1401和第四信号线K2402，由所述相邻两扫描线G1/G2、第三信号线K1、第四信号线K2、以及第三信号线K1和第四信号线K2之间的一数据线S1交叉限定了四个子像素单元，分别定义为第一子像素单元（图12和图13中标注的是①）、第二子像素单元（图12和图13中标注的是②）、第三子像素单元（图12和图13中标注的是③）、以及第四子像素单元（图12和图13中标注的是④），每个子像素单元内均设有两个开关装置和相应的子像素电极，定义位于第一子像素单元内设有第三和第四开关装置303、304和第一子像素电极，定义位于第二子像素单元内设有第五和第六开关装置305、306和第二子像素电极，定义位于第三子像素单元内设有第七和第八开关装置307、308和第三子像素电极，定义位于第四子像素单元内设有第九和第十开关装置309、310和第四子像素电极。
第三信号线K1和第四信号线K2通过固定电压与相应的子像素单元之间形成存储电容Cst，彩膜电极通过固定电压与相应的子像素单元之间形成液晶电容CL C。
本驱动电路的连接关系为：所述第一开关装置301的第一栅极连接芯片接脚连接线201，第一开关装置301的第一源极连接第一信号线CLK1101，第一开关装置301的第一漏极连接扫描线G1501；所述第二开关装置302的第二栅极与第一开关装置301的第一栅极均连接同一芯片接脚连接线201，第二开关装置302的第二源极连接第二信号线CLK2102，第二开关装置302的第二漏极连接扫描线G2502，扫描线G1与扫描线G2为相邻的两条扫描线。
第一子像素单元内的第三开关装置303的第三栅极连接扫描线G1501，也即：第三开关装置303的第三栅极与第一开关装置301的第一漏极连接同一扫描线；第三开关装置303的第三源极连接第三信号线K1401，第三开关装置303的第三漏极连接第四开关装置304的第四栅极；第四开关装置304的第四栅极连接第三开关装置的第三漏极，第四开关装置304的第四源极连接数据线S1601，第四开关装置304的第四漏极连接第一子像素电极，且第三信号线K1401与第一子像素电极之间形成第一存储电容Cst1，彩膜电极与第一子像素电极之间形成第一液晶电容CLC2。
通过上述说明，第一子像素单元的第四开关装置304由第三开关装置303控制。
第二子像素单元内的第五开关装置305的第五栅极连接扫描线G1501，也即：第五开关装置305的第五栅极与第三开关装置303的第三栅极、第一开关装置301的第一漏极均连接同一扫描线；第五开关装置305的第五源极连接第四信号线K2402，第五开关装置305的第五漏极连接第六开关装置306的第五栅极；第六开关装置306的第六栅极连接第五开关装置305的第五漏极，第六开关装置306的第六源极连接数据线S1601，第六开关装置306的第六漏极连接第二子像素电极，且第二信号线K1402与第二子像素电极之间形成第二存储电容Cst2，彩膜电极与第二子像素电极之间形成第二液晶电容CLC3。通过上述说明，第二子像素单元的第六开关装置306由第五开关装置305控制。
第三子像素单元内的第七开关装置307的第七栅极连接扫描线G2502，也即：第七开关装置307的第七栅极与第二开关装置302的第二栅极均连接同一扫描线；第七开关装置307的第七源极连接第三信号线K1401，第七开关装置307的第七漏极连接第八开关装置308的第八栅极；第八开关装置308的第八栅极连接第七开关装置307的第七漏极，第八开关装置308的第八源极连接数据线S1601，第八开关装置308的第八漏极连接第三子像素电极，且第三信号线K1401与第三子像素电极之间形成第三存储电容Cst3，彩膜电极与第三子像素电极之间形成第三液晶电容CLC3。
通过上述说明，第三子像素单元的第八开关装置308由第七开关装置305控制。
第四子像素单元内的第九开关装置309的第九栅极连接扫描线G2502，也即：第九开关装置309的第九栅极与第七开关装置307的第七栅极、第二开关装置302的第二漏极均连接同一扫描线；第九开关装置309的第九源极连接第四信号线K2402，第九开关装置309的第九漏极连接第十开关装置310的第十栅极；第十开关装置310的第十栅极连接第九开关装置309的第九漏极，第十开关装置310的第十源极连接数据线S1601，第十开关装置310的第十漏极连接第一子像素电极，且第四信号线K1402与第四子像素电极之间形成第四存储电容Cst4，彩膜电极与第四子像素电极之间形成第四液晶电容CLC4。
通过上述说明，第四子像素单元的第十开关装置310由第九开关装置309控制。
图14为图13所示驱动电路的波形示意图，像素电极充电顺序第一子像素单元的像素电极、第二子像素单元的像素电极、第三子像素单元的像素电极、以及第四子像素单元的像素电极。
当芯片接脚连接线G12为高电平Vgh的前半段时间内，第一信号线CLK1101也为高电平Vgh，第二信号线CLK2102为低电平，从而扫描线G1输出栅线打开信号，扫描线G2输出栅极关闭信号。
当第三信号线K1401在芯片接脚连接线G12为高电平Vgh的前四分之一的时间内为高电平Vgh，此时第四信号线K2402为低电平Vgl，第一子像素单元的第三开关装置303打开，该第三开关装置303同时驱动控制第四开关装置304打开，从而为第一子像素单元的像素电极充电；当第四信号线K2402在芯片接脚连接线G12为高电平Vgh的四分之一至二分之一的时间内为高电平Vgh，此时第三信号线K1401为低电平Vgl，第二子像素单元的第五开关装置305打开，该第五开关装置306同时驱动控制第六开关装置306打开，从而为第二子像素单元的像素电极充电；当第三信号线K1401在芯片接脚连接线G12为高电平Vgh的二分之一至四分之三的时间内为高电平Vgh，此时第四信号线K2402为低电平Vgl，第三子像素单元的第七开关装置307打开，该第七开关装置307同时控制第八开关装置308打开，从而为第三子像素单元的像素电极充电；当第四信号线K2402在芯片接脚连接线G12为高电平Vgh的后四分之一的时间内为高电平Vgh，此时第三信号线K1401为低电平Vgl，第四子像素单元的第九开关装置309打开，该第九开关装置309同时驱动控制第十开关装置310打开，从而为第四子像素单元的像素电极充电。
图15为本发明第六实施例液晶显示面板驱动电路的等效电路的示意图，图16为图15的局部放大图，本第六实施例与上述第五实施例区别是：第三信号线K1和第四信号线K2与开关装置的连接方式不同：第三、第五、第七、第九开关装置303、305、307、309的栅极仍连接相应的扫描线，第三、第五、第七、第九开关装置303、305、307、309的源极改连接数据线S1，第三、第五、第七、第九开关装置303、305、307、309的漏极改连接相应的第四、第六、第八、第十开关装置304、306、308、310的源极；第四和第八开关装置304、308的栅极连接的第三信号线K1，第六和第十开关装置306、310的栅极连接第四信号线K2，第四、第六、第八、第十开关装置304、306、308、310的源极改连接相应的第三、第五、第七、第九开关装置303、305、307、309的漏极，第四和第八开关装置304、308的漏极连接相应的子像素电极。
本第六实施例的驱动电路的波形示意图与上述第五实施例的波形示意图相同，都是通过在液晶显示面板的像素区域外和像素区域内均设置相应的信号线及开关装置组成的驱动电路，这样设计的驱动电路，将栅极驱动器及源极驱动器数目同时降低一半，如此大幅度降低面板成本。
第五、第六实施例将上述第一、第二与第三、第四实施例融合在一起，由于第一、第二与第三、第四实施例之间具有单一性、故第一至第六实施例之间各自具有单一性。
本发明通过在液晶显示面板的像素区外和/或像素区域内增加一组反相的信号线、及开关装置等组成的驱动电路，将由栅极驱动器产生的脉冲信号一分为二或一分为三、或一分为四，形成两个或三个或四个依次打开的栅极脉冲信号，如此可以将栅极驱动器和/或源极驱动器数目降低，如此大幅度降低面板成本。
Claims (3)
1.一种液晶显示面板的驱动电路，液晶显示面板包括相对设置的第一基板和第二基板、以及夹设在第一基板和第二基板之间的液晶，第二基板设有彩膜电极，其特征在于：本驱动电路位于第一基板上，所述驱动电路的像素区域外包括：第一信号线、第二信号线、与芯片接脚连接的芯片接脚连接线、分别与芯片接脚连接线连接的第一开关装置和第二开关装置；本驱动电路的像素区域内包括：纵横交错的扫描线、数据线、以及与数据线平行并位于数据线两侧的第三信号线和第四信号线，由相邻两扫描线、第三信号线、第四信号线、以及第三信号线和第四信号线之间的一数据线交叉限定了第一至第四的四个子像素单元，定义位于第一子像素单元内设有第三、第四开关装置和第一子像素电极，定义位于第二子像素单元内设有第五开关装置、第六开关装置和第二子像素电极，定义位于第三子像素单元内设有第七开关装置、第八开关装置和第三子像素电极，定义位于第四子像素单元内设有第九开关装置、第十开关装置和第四子像素电极，所述第一子像素单元的第四开关装置由第三开关装置控制，所述第二子像素单元的第六开关装置由第五开关装置控制，所述第三子像素单元的第八开关装置由第七开关装置控制，所述第四子像素单元的第十开关装置由第九开关装置控制；第三信号线、第四信号线与对应的子像素电极之间形成存储电容，彩膜电极与对应的子像素电极形成相应的液晶电容，每个开关装置均设有栅极、源极和漏极，所述第一开关装置的栅极连接芯片接脚连接线，第一开关装置的源极连接第一信号线，第一开关装置的漏极连接扫描线；所述第二开关装置的栅极与第一开关装置的栅极均连接同一芯片接脚连接线，第二开关装置的源极连接第二信号线，第二开关装置的漏极连接扫描线；第三开关装置的栅极连接扫描线；第三开关装置的源极连接第三信号线，第三开关装置的漏极连接第四开关装置的栅极；第四开关装置的源极连接数据线，第四开关装置的漏极连接第一子像素电极；第五开关装置的栅极连接扫描线，且第五开关装置的栅极与第三开关装置的栅极、第一开关装置的漏极均连接同一扫描线，第五开关装置的源极连接第四信号线，第五开关装置的漏极连接第六开关装置的栅极；第六开关装置的源极连接数据线，第六开关装置的漏极连接第二子像素电极；第七开关装置的栅极连接扫描线；第七开关装置的源极连接第三信号线，第七开关装置的漏极连接第八开关装置的栅极；第八开关装置的源极连接数据线，第八开关装置的漏极连接第三子像素电极；第九开关装置的栅极连接扫描线，且第九开关装置的栅极与第七开关装置的栅极、第二开关装置的漏极均连接同一扫描线，该第九开关装置的栅极、第七开关装置的栅极、第二开关装置的漏极均连接的扫描线与第五开关装置的栅极、第三开关装置的栅极、第一开关装置的漏极均连接的扫描线为相邻的两条扫描线；第九开关装置的源极连接第四信号线，第九开关装置的漏极连接第十开关装置的栅极；第十开关装置的源极连接数据线，第十开关装置的漏极连接第四子像素电极。
2.一种液晶显示面板的驱动电路，液晶显示面板包括相对设置的第一基板和第二基板、以及夹设在第一基板和第二基板之间的液晶，第二基板设有彩膜电极，其特征在于：本驱动电路位于第一基板上，所述驱动电路的像素区域外包括：第一信号线、第二信号线、与芯片接脚连接的芯片接脚连接线、分别与芯片接脚连接线连接的第一开关装置和第二开关装置；本驱动电路的像素区域内包括：纵横交错的扫描线、数据线、以及与数据线平行并位于数据线两侧的第三信号线和第四信号线，由相邻两扫描线、第三信号线、第四信号线、以及第三信号线和第四信号线之间的一数据线交叉限定了第一至第四的四个子像素单元，定义位于第一子像素单元内设有第三、第四开关装置和第一子像素电极，定义位于第二子像素单元内设有第五开关装置、第六开关装置和第二子像素电极，定义位于第三子像素单元内设有第七开关装置、第八开关装置和第三子像素电极，定义位于第四子像素单元内设有第九开关装置、第十开关装置和第四子像素电极，所述第一子像素单元的第四开关装置由第三开关装置控制，所述第二子像素单元的第六开关装置由第五开关装置控制，所述第三子像素单元的第八开关装置由第七开关装置控制，所述第四子像素单元的第十开关装置由第九开关装置控制；第三信号线、第四信号线与对应的子像素电极之间形成存储电容，彩膜电极与对应的子像素电极形成相应的液晶电容，每个开关装置均设有栅极、源极和漏极，所述第一开关装置的栅极连接芯片接脚连接线，第一开关装置的源极连接第一信号线，第一开关装置的漏极连接扫描线；所述第二开关装置的栅极与第一开关装置的栅极均连接同一芯片接脚连接线，第二开关装置的源极连接第二信号线，第二开关装置的漏极连接扫描线；第三开关装置的栅极连接扫描线；第三开关装置的源极连接数据线，第三开关装置的漏极连接第四开关装置的源极；第四开关装置的栅极连接第三信号线，第四开关装置的漏极连接第一子像素电极；第五开关装置的栅极连接扫描线，且第五开关装置的栅极与第三开关装置的栅极、第一开关装置的漏极均连接同一扫描线，第五开关装置的源极连接数据线，第五开关装置的漏极连接第六开关装置的源极；第六开关装置的栅极连接第四信号线，第六开关装置的漏极连接第二子像素电极；第七开关装置的栅极连接扫描线；第七开关装置的源极连接数据线，第七开关装置的漏极连接第八开关装置的源极；第八开关装置的栅极连接第三信号线，第八开关装置的漏极连接第三子像素电极；第九开关装置的栅极连接扫描线，且第九开关装置的栅极与第七开关装置的栅极、第二开关装置的漏极均连接同一扫描线，该第九开关装置的栅极、第七开关装置的栅极、第二开关装置的漏极均连接的扫描线与第五开关装置的栅极、第三开关装置的栅极、第一开关装置的漏极均连接的扫描线为相邻的两条扫描线；第九开关装置的源极连接数据线，第九开关装置的漏极连接第十开关装置的源极；第十开关装置的栅极连接数据线，第十开关装置的漏极连接第四子像素电极。
3.根据权利要求1或2所述驱动电路的波形驱动方法，其特征在于：当芯片接脚连接线为高电平的前半段时间内，第一信号线也为高电平，第二信号线为低电平，与第五开关装置的栅极、第三开关装置的栅极、第一开关装置的漏极均连接的扫描线输入栅极打开信号，与第九开关装置的栅极、第七开关装置的栅极、第二开关装置的漏极均连接的扫描线输入栅极关闭信号；当第三信号线在芯片接脚连接线为高电平的前四分之一的时间内为高电平，此时第四信号线为低电平，第一子像素单元的第三开关装置控制第四开关装置打开，从而为第一子像素单元的像素电极充电；当第四信号线在芯片接脚连接线为高电平的四分之一至二分之一的时间内为高电平，此时第三信号线为低电平，第二子像素单元的第五开关装置控制第六开关装置打开，从而为第二子像素单元的像素电极充电；当第三信号线在芯片接脚连接线为高电平的二分之一至四分之三的时间内为高电平，此时第四信号线为低电平，第三子像素单元的第七开关装置控制第八开关装置打开，从而为第三子像素单元的像素电极充电；当第四信号线在芯片接脚连接线为高电平的后四分之一的时间内为高电平，此时第三信号线为低电平，第四子像素单元的第九开关装置控制第十开关装置打开，从而为第四子像素单元的像素电极充电；当芯片接脚连接线为高电平的后半段时间内，第一信号线为低电平，第二信号线为高电平。
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