CN103091920A - 一种阵列基板及其驱动方法、显示装置 - Google Patents

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Abstract

本发明实施例提供一种阵列基板及其驱动方法、显示装置，涉及显示技术领域，可以避免水平线不良，提高显示装置产品的良率。阵列基板包括：以矩阵形式排列的多个像素组、与各像素组对应的横向排列的多行栅线、纵向排列的多列第一数据线和多列第二数据线，每个像素组包括第一像素单元和第二像素单元，第一像素单元和第二像素单元位于相邻的两行；栅线分别连接于所对应的像素组中的第一像素单元以及第二像素单元，第一数据线连接所对应的像素组中第一像素单元以向该第一像素单元提供数据信号，第二数据线连接所对应的像素组中第二像素单元以向该第二像素单元提供数据信号；其中，位于像素单元***的所述栅线由同一层金属形成。

Description

一种阵列基板及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种阵列基板及其驱动方法、显示装置。
背景技术
目前，窄边框显示装置已逐渐成为显示产品发展的主流，得到具有更窄边框的显示装置的关键在于降低阵列基板中位于显示区域四周的栅线或数据线电路的范围。
现有阵列基板可以如图1所示，包括由横纵交叉的栅线11和数据线12分割成的多个像素单元13，每一个像素单元13内具有TFT(Thin Film Transistor，薄膜晶体管)区域14，栅线11和数据线12通过TFT区域14内的TFT驱动该像素单元13工作。在现有的阵列基板中，位于像素单元13所在区域内部的栅线可以全部是由同一层金属形成，而在像素单元13的***，由于封装区域宽度的限制，为了进一步降低栅线11的电阻，像素单元13***的栅线通常采用不同层金属形成，例如，在实际显示装置产品中，奇数行的栅线输入的栅极驱动信号可以是从左侧进入像素区的，偶数行的栅线输入的栅极驱动信号可以是从右侧进入像素区的，其中，相邻两奇数行栅线的***引线111a与111b由不同层金属形成，相邻两偶数行栅线的***引线112a与112b同样由不同层金属形成。这样一种结构的阵列基板的不足之处在于，像素单元13***的线路通常较长，且不同层的金属之间会出现比较大的电阻差异，尤其是对于线宽较细的栅线而言，相邻两行栅线之间所表现出的电阻差异整体偏大，在显示装置进行显示的过程中容易出现行与行之间显示的差异，造成水平线(H-line)不良，这对产品的良率有很大的影响。
发明内容
本发明的实施例提供一种阵列基板及其驱动方法、显示装置，可以避免水平线不良，提高显示装置产品的良率。
为达到上述目的，本发明的实施例采用如下技术方案：
本发明实施例的一方面，提供一种阵列基板，其特征在于，包括：以矩阵形式排列的多个像素组、与各所述像素组对应的横向排列的多行栅线、纵向排列的多列第一数据线和多列第二数据线，
每个所述像素组包括第一像素单元和第二像素单元，所述第一像素单元和所述第二像素单元位于相邻的两行；
所述栅线分别连接于所对应的像素组中的第一像素单元以及第二像素单元，所述第一数据线连接所对应的像素组中第一像素单元以向该第一像素单元提供数据信号，所述第二数据线连接所对应的像素组中第二像素单元以向该第二像素单元提供数据信号；
其中，位于所述像素单元***的所述栅线由同一层金属形成。
本发明实施例的另一方面，提供一种显示装置，包括如上所述的阵列基板。
本发明实施例的又一方面，提供一种用于如权利要求1所述的阵列基板的驱动方法，其特征在于，所述方法包括以下述顺序执行的步骤：
第一当前行栅线输入行驱动信号，控制与其对应的像素组中的第一像素单元以及第二像素单元打开；
第一数据线输入第一控制信号，以使得对应于该行栅线的所述第一像素单元进行充电；
第二数据线输入第二控制信号，以使得对应于该行栅线的所述第二像素单元进行充电；
当前行栅线停止输入行驱动信号，对下一行栅线输入行驱动信号。
本发明实施例提供的阵列基板及其驱动方法、显示装置，通过一条栅线控制与其相邻的相邻两行的第一像素单元以及第二像素单元，采用第一数据线向所述第一像素单元进行充电，第二数据线向所述第二像素单元进行充电，通过第一数据线和第二数据线依次向第一像素单元和第二像素单元输出信号从而实现阵列基板的逐行扫描，其中，位于所述像素单元***的相邻的两条栅线由同一层金属形成。这样一来，可以有效的降低了栅线的布线数量，实现了栅线的单层金属布线，由于可以采用同一掩模工艺形成，从而降低了相邻两行栅线之间的电阻差异，避免了显示装置水平线不良现象的发生，提高了显示装置产品的良率。
附图说明
为了更清楚地说明本发明实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为现有技术中一种阵列基板的结构示意图；
图2为本发明实施例提供的一种阵列基板的结构示意图；
图3为本发明实施例提供的另一阵列基板的结构示意图；
图4为本发明实施例提供的阵列基板中多级输出单元的结构示意图；
图5为本发明实施例提供的阵列基板中多级输出单元的电路连接示意图；
图6为驱动本发明实施例所提供的阵列基板的控制信号的波形示意图；
图7为本发明实施例提供的一种阵列基板驱动方法的流程示意图。
具体实施方式
下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员所获得的所有其他实施例，都属于本发明保护的范围。
本发明实施例提供的阵列基板，如图2所示，包括：以矩阵形式排列的多个像素组21、与各像素组21对应的横向排列的多行栅线22、纵向排列的多列第一数据线231和多列第二数据线232。
每个像素组21包括第一像素单元211和第二像素单元212，该第一像素单元211和第二像素单元212位于相邻的两行。
栅线22分别连接于所对应的像素组21中的第一像素单元211以及第二像素单元212，第一数据线231连接所对应的像素组21中第一像素单元211以向该第一像素单元211提供数据信号，第二数据线232连接所对应的像素组21中第二像素单元212以向该第二像素单元212提供数据信号；
其中，位于像素单元***的栅线22由同一层金属形成。
本发明实施例提供的阵列基板，通过一条栅线控制与其相邻的相邻两行的第一像素单元以及第二像素单元，采用第一数据线向所述第一像素单元进行充电，第二数据线向所述第二像素单元进行充电，通过第一数据线和第二数据线依次向第一像素单元和第二像素单元输出信号从而实现阵列基板的逐行扫描，其中，位于所述像素单元***的相邻的两条栅线由同一层金属形成。这样一来，可以有效的降低了栅线的布线数量，实现了栅线的单层金属布线，由于可以采用同一掩模工艺形成，从而降低了相邻两行栅线之间的电阻差异，避免了显示装置水平线不良现象的发生，提高了显示装置产品的良率。
需要说明的是，第一数据线231与第二数据线232可以相互平行地设置于像素区域内的任意位置。在如图2所示的液晶显示面板中，第一数据线231和第二数据线232分别位于像素组21的两侧。这样一来，位于当前像素组21的第二数据线232与相邻像素区域的第一数据线231紧密相邻，从而无需额外增加黑矩阵结构以遮挡第二数据线232，保证了液晶显示面板的开口率。
进一步地，当用一行栅线控制两行像素时，会遇到一个问题，即，栅线为高电平时，这两行像素都处于打开的状态。如果使用不同的数据线在这个时段同时充电，则因为数据信号不同，需要数据线加倍，这样数据线驱动电路(例如为数据线驱动集成电路(IC))的成本提高。而如果使用相同数量的数据线在不同的时段分别充电，则会遇到当在第一行像素充电完成，对第二行像素充电时，第一行像素发生漏电的问题。本发明通过设置多级输出单元，尤其是通过增加保持电容的方式，解决了这个问题。如图3所示，阵列基板还可以包括至少一个多级输出单元24。
该多级输出单元24可以将数据线23驱动电路输出的信号分解为分别由第一数据线231和第二数据线232输出的数据信号。
通过在阵列基板上增加多级输出单元24的设计，一条数据线可以分别向第一数据线和第二数据线输出数据信号，实现一条数据线的双源输出。从而，相比于使用双倍的数据线同时输入的方式，本发明有效减少了阵列基板上数据线的布线数量，进一步降低了显示装置的生产成本。
具体的，如图4所示，多级输出单元24可以包括：
第一输出模块41，其将数据线23驱动电路输出的信号转换为由第一数据线231输出的第一数据信号。
第二输出模块42，其将数据线23驱动电路输出的信号转换为由第二数据线232输出的第二数据信号。
进一步地，如图5所示，第一输出模块41可以包括：
第一晶体管T1，其源极连接第一数据线231，栅极连接第一开关信号Switch 1，漏极连接数据线23。
第一电容C1，其一端连接第一数据线231，另一端接地。
第二输出模块42可以包括：
第二晶体管T2，其源极连接第二数据线232，栅极连接第二开关信号Switch 2，漏极连接数据线23。
第二电容C2，其一端连接第二数据线232，另一端接地。
其中，当第一开关信号Switch 1控制第一晶体管T1导通时，第二开关信号Switch 2控制第二晶体管T2关闭；当第二开关信号Switch2控制所述第二晶体管T2导通时，第一开关信号Switch 1控制第一晶体管T1关闭。
采用这样一种结构的多级输出单元，通过开关信号的控制可以实现一列数据信号变成两列数据信号分别输出，其中，由于在第一数据线和第二数据线分别输出的过程中，栅线始终控制其相邻两行的像素单元处于开启状态，通过在第一数据线和第二数据线的输出端增加用于保持电压的电容，当一行像素单元进行扫描时，另一行像素单元可以不受栅线持续打开的影响，从而提高了显示装置产品的质量。
需要说明的是，本发明实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件，由于这里采用的晶体管的源极、漏极是对称的，所以其源极、漏极是没有区别的。在本发明实施例中，为区分晶体管除栅极之外的两极，将其中一极称为源极，另一极称为漏极。此外，按照晶体管的特性区分可以将晶体管分为N型和P型，本发明实施例均以N型晶体管为例进行说明，可以想到的是在采用P型晶体管实现时是本领域技术人员可在没有做出创造性劳动前提下轻易想到的，因此也是在本发明的实施例保护范围内的。
具体的，可以采用如图6所示的控制信号驱动如上所述的阵列基板。其中，Gate 1和Gate 2分别表示第一行栅线和第二行栅线输出的信号，Switch 1和Switch 2分别表示第一开关信号和第二开关信号，DATA表示数据线输入的信号，DATA 1表示由第一数据线输出的第一控制信号，DATA 2则表示由第二数据线输出的第二控制信号。以下对本发明实施例提供的阵列基板的驱动方法进行详细说明。
第①阶段，Gate 1为高电平，从而使得第一行像素单元和第二行像素单元打开，同时Switch 1为高电平，Switch 2为低电平，DATA 1输出数据信号，从而使得第一行像素充电。
第②阶段，Gate 1保持为高电平，Switch 1和Switch 2均为低电平，第一电容C1存储有与第①阶段中的数据信号电平相同的电压，从而可以避免Gate 1持续打开对DATA 1输出的影响，完成对第一行像素单元的扫描。
第③阶段，Gate 1保持为高电平，同时Switch 1为低电平，Switch2为高电平，DATA 2输出数据信号，从而使得第二行像素充电。
第④阶段，Gate 1保持为高电平，Switch 1和Switch 2均为低电平，第一电容C2存储有与第③阶段中的数据信号电平相同的电压，从而可以避免Gate 1持续打开对DATA 2输出的影响，完成对第一行像素单元的扫描。
第⑤阶段，Gate 1为低电平，Gate 2为高电平，同时Switch 1为高电平，Switch 2为低电平，DATA 1输出数据信号，从而使得第三行像素充电。
以此类推，重复上述过程即可以实现阵列基板的逐行扫描。
本发明实施例提供的阵列基板，通过一条栅线控制与其相邻的相邻两行的第一像素单元以及第二像素单元，采用第一数据线向所述第一像素单元进行充电，第二数据线向所述第二像素单元进行充电，通过第一数据线和第二数据线依次向第一像素单元和第二像素单元输出信号从而实现阵列基板的逐行扫描，其中，位于所述像素单元***的相邻的两条栅线由同一层金属形成。这样一来，可以有效的降低了栅线的布线数量，实现了栅线的单层金属布线，由于可以采用同一掩模工艺形成，从而降低了相邻两行栅线之间的电阻差异，避免了显示装置水平线不良现象的发生，提高了显示装置产品的良率。
本发明实施例提供一种显示装置，其包括上述任一种阵列基板，该显示装置可以为液晶显示器、液晶电视、数码相框、手机、平板电脑等具有任何显示功能的产品或者部件。
其中，阵列基板的结构在前述实施例中已做了详细的描述，此处不做赘述。
本发明实施例提供的显示装置，包括阵列基板，该阵列基板通过一条栅线控制与其相邻的相邻两行的第一像素单元以及第二像素单元，采用第一数据线向所述第一像素单元进行充电，第二数据线向所述第二像素单元进行充电，通过第一数据线和第二数据线依次向第一像素单元和第二像素单元输出信号从而实现阵列基板的逐行扫描，其中，位于所述像素单元***的相邻的两条栅线由同一层金属形成。这样一来，可以有效的降低了栅线的布线数量，实现了栅线的单层金属布线，由于可以采用同一掩模工艺形成，从而降低了相邻两行栅线之间的电阻差异，避免了显示装置水平线不良现象的发生，提高了显示装置产品的良率。
本发明实施例还提供一种阵列基板的驱动方法，如图7所示，包括：
S701、当前行栅线输入行驱动信号，控制与其对应的像素组中的第一像素单元以及第二像素单元打开。
S702、第一数据线输入第一控制信号，以使得对应于该行栅线的第一像素单元进行充电。
S703、第二数据线输入第二控制信号，以使得对应于该行栅线的第二像素单元进行充电。
S704、对当前行栅线停止输入行驱动信号，对下一行栅线输入行驱动信号。
其中，位于所述像素单元***的相邻的两条栅线由同一层金属形成。
本发明实施例提供的阵列基板，通过一条栅线控制与其相邻的相邻两行的第一像素单元以及第二像素单元，采用第一数据线向所述第一像素单元进行充电，第二数据线向所述第二像素单元进行充电，通过第一数据线和第二数据线依次向第一像素单元和第二像素单元输出信号从而实现阵列基板的逐行扫描，其中，位于所述像素单元***的相邻的两条栅线由同一层金属形成。这样一来，可以有效的降低了栅线的布线数量，实现了栅线的单层金属布线，由于可以采用同一掩模工艺形成，从而降低了相邻两行栅线之间的电阻差异，避免了显示装置水平线不良现象的发生，提高了显示装置产品的良率。
本发明实施例提供的阵列基板驱动方法可以用于驱动如图2所示的阵列基板。进一步地，在如图3所示的阵列基板中，还可以包括至少一个多级输出单元。相应的，如图7所示，本发明实施例提供的阵列基板驱动方法还可以包括：
数据线输出的信号通过多级输出单元得到第一数据线和第二数据线输出的控制信号。
通过在阵列基板上增加多级输出单元的设计，一条数据线可以分别向第一数据线和第二数据线输出数据信号，实现一条数据线的双源输出。从而，相比于使用双倍的数据线同时输入的方式，本发明有效减少了阵列基板上数据线的布线数量，进一步降低了显示装置的生产成本。
具体的，数据线输出的信号通过多级输出单元得到第一数据线和第二数据线输出的控制信号的步骤可以包括：
数据线输出的信号通过第一输出模块得到第一数据线输出的第一控制信号。
例如，可以通过第一开关信号控制第一晶体管导通，第二开关信号控制第二晶体管关闭，数据线通过第一晶体管向第一数据线输出第一控制信号。
数据线输出的信号通过第二输出模块得到第二数据线输出的第二控制信号。
例如，第一开关信号控制第一晶体管关闭，第二开关信号控制第二晶体管导通，所述数据线通过所述第二晶体管向所述第一数据线输出第一控制信号。
需要说明的是，本发明实施例提供的阵列基板驱动方法可以用于驱动如图3所示的阵列基板。其中，第一输出模块的结构可以如图5所示，包括：第一晶体管和第一电容。第二输出模块同样可以如图5所示，包括：第二晶体管和第二电容。
采用这样一种结构的多级输出单元，通过开关信号的控制可以实现一列数据信号变成两列数据信号分别输出，其中，由于在第一数据线和第二数据线分别输出的过程中，栅线始终控制其相邻两行的像素单元处于开启状态，通过在第一数据线和第二数据线的输出端增加用于保持电压的电容，当一行像素单元进行扫描时，另一行像素单元可以不受栅线持续打开的影响，从而提高了显示装置产品的质量。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (8)

1.一种阵列基板，其特征在于，包括：以矩阵形式排列的多个像素组、与各所述像素组对应的横向排列的多行栅线、纵向排列的多列第一数据线和多列第二数据线，
每个所述像素组包括第一像素单元和第二像素单元，所述第一像素单元和所述第二像素单元位于相邻的两行；
所述栅线分别连接于所对应的像素组中的第一像素单元以及第二像素单元，所述第一数据线连接所对应的像素组中第一像素单元以向该第一像素单元提供数据信号，所述第二数据线连接所对应的像素组中第二像素单元以向该第二像素单元提供数据信号；
其中，位于所述像素单元***的所述栅线由同一层金属形成。
2.根据权利要求1所述的阵列基板，其特征在于，所述第一数据线和所述第二数据线分置于所述像素组的两侧。
3.根据权利要求1或2所述的阵列基板，其特征在于，所述阵列基板还包括至少一个多级输出单元；
所述多级输出单元将数据线驱动电路输出的信号分解为分别由所述第一数据线和所述第二数据线输出的数据信号。
4.根据权利要求3所述的阵列基板，其特征在于，所述多级输出单元包括：
第一输出模块，其将所述数据线驱动电路输出的信号转换为由所述第一数据线输出的第一数据信号；
第二输出模块，其将所述数据线驱动电路输出的信号转换为由所述第二数据线输出的第二数据信号。
5.根据权利要求4所述的阵列基板，其特征在于，所述第一输出模块包括：
第一晶体管，其源极连接所述第一数据线，栅极连接第一开关信号，漏极连接所述数据线；
第一电容，其一端连接所述第一数据线，另一端接地；
所述第二输出模块包括：
第二晶体管，其源极连接所述第二数据线，栅极连接第二开关信号，漏极连接所述数据线；
第二电容，其一端连接所述第二数据线，另一端接地。
6.一种显示装置，其特征在于，包括如权利要求1至5中任一所述的阵列基板。
7.一种用于如权利要求1所述的阵列基板的驱动方法，其特征在于，所述方法包括以下述顺序执行的步骤：
当前行栅线输入行驱动信号，控制与其对应的像素组中的第一像素单元以及第二像素单元打开；
第一数据线输入第一控制信号，以使得对应于该行栅线的所述第一像素单元进行充电；
第二数据线输入第二控制信号，以使得对应于该行栅线的所述第二像素单元进行充电；
对当前行栅线停止输入行驱动信号，对下一行栅线输入行驱动信号。
8.根据权利要求7所述的方法，其特征在于，所述阵列基板包括如权利要求5所述的第一晶体管和第二晶体管，所述方法包括：
第一开关信号控制第一晶体管导通，第二开关信号控制第二晶体管关闭，所述数据线通过所述第一晶体管向所述第一数据线输出第一控制信号；以及
第一开关信号控制第一晶体管关闭，第二开关信号控制第二晶体管导通，所述数据线通过所述第二晶体管向所述第二数据线输出第二控制信号。
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