CN102545598A - 用于降压-升压转换器的时钟移相器 - Google Patents

用于降压-升压转换器的时钟移相器 Download PDF

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Abstract

降压-升压转换器响应于输入电压和切换控制信号生成经调节的输出电压。切换控制电路响应于经调节的输出电压、最大占空比信号和模式信号产生切换控制信号。模式控制电路响应于降压PWM信号和升压PWM信号、第一时钟信号和与第一时钟信号具有一固定可编程量的相移的第二时钟信号来产生最大占空比信号和模式信号。移相器响应于基准电压和同步信号来产生第一时钟信号和第二时钟信号。

Description

用于降压-升压转换器的时钟移相器
关联申请的交叉引用
本申请要求2011年3月14日提交的题为“CLOCK PHASE SHIFTER FOR USEWITH BB CONVERTER(用于BB转换器的时钟移相器)”的美国专利申请No.13/047,424的优先权，前一专利申请要求2010年11月2日提交的题为“CLOCKPHASE SHIFTER FOR USE WITH BUCK-BOOST CONVERTER(用于降压-升压转换器的时钟移相器)”的美国临时申请No.61/409,176的权益，这两篇申请的说明书全篇地援引包含于此。
技术领域
本发明涉及用于电压转换器的时钟移相器，更具体地涉及提供可调相移以控制降压-升压转换器内的占空比切换的降压-升压时钟移相器。
背景
降压-升压转换器响应于输入电压产生经调节的输出电压。输入电压可能高于或低于经调节的输出电压。在降压工作模式中，经调节的输出电压低于输入电压。在升压工作模式中，经调节的输出电压高于输入电压。降压-升压转换器的工作模式受占空比控制器控制。如果降压-升压转换器的切换节点的占空比高于所选的值(例如90％)，则降压-升压转换器的占空比控制切换操作从降压工作模式至升压工作模式，或从升压工作模式至降压工作模式。通过采用用于产生具有可调相移的时钟信号的控制方案，降压-升压转换器中的占空比切换操作可得到更好的控制。
概述
如本文披露和描述的那样，本发明在其一个实施例中包括一种装置，该装置包括响应于输入电压和切换控制信号产生经调节的输出电压的降压-升压转换器。切换控制电路响应于经调节的输出电压、最大占空比信号和模式信号产生切换控制信号。模式控制电路响应于降压PWM信号和升压PWM信号、第一时钟信号和与第一时钟信号相移达一固定可编程量的第二时钟信号来产生最大占空比信号和模式信号。移相器响应于基准电压和同步信号来产生第一时钟信号和第二时钟信号。
附图说明
为了更全面地理解，现参照下面结合附图进行的描述，在附图中：
图1是非反相降压-升压转换器的方框图；
图2是用于降压-升压转换器的可调时钟移相器电路的方框图；
图3是示出当不存在同步时钟或同步频率低于默认频率时可调时钟移相器的操作的时序图；
图4是示出当同步时钟频率高于默认频率时时钟移相器电路的操作的时序图；以及
图5是示出图4中从被同步到较高同步频率变换至默认频率的逆变换的时序图。
具体实施方式
现在参考附图，其中在全部附图中相同的附图标记用来指代相同的元件，解说和描述了用于降压-升压转换器的时钟移相器的多个视图和实施例，还描述了其它可能的实施例。这些附图不一定是按比例绘制的，而且仅为说明目的，在某些实例中有几处已将附图放大和/或简化。本领域普通技术人员将理解基于以下可行实施例的示例的许多可能的应用和变型。
降压-升压变换器用于响应于输入电压产生经调节的输出电压。输入电压可能高于或低于经调节的输出电压。当处于降压工作模式时，经调节的输出电压低于输入电压。当处于升压工作模式时，经调节的输出电压高于输入电压。降压-升压转换器的工作模式受占空比控制器控制。如果降压-升压转换器的切换节点的占空比高于所选的值(例如90％)，则占空比控制器将降压-升压转换器的操作从降压工作模式切换至升压工作模式或从升压工作模式切换至降压工作模式。通过采用用于产生具有可调相移的时钟信号的控制方案，降压-升压转换器中的占空比切换操作可得到更好的控制。
现参考附图，更具体地参考图1，图中示出了非反相降压-升压转换器的示意方框图。非反相降压-升压转换器在降压工作模式下使用峰值电流控制方法，并在升压工作模式下使用谷值电流控制方法。输入电压VIN被施加于输入电压节点102。P沟道开关晶体管104的漏极/源极路径连接在节点102和节点106之间。N沟道开关晶体管108的漏极/源极路径连接在节点106和地面之间。电感器110连接在节点106和节点112之间。N沟道晶体管114的源极/漏极路径连接在节点116和节点112之间。节点116包括输出电压节点，从该输出电压节点提供经调节的输出电压VOUT。P沟道开关晶体管118连接在节点112和地面之间。
在降压工作模式下，开关晶体管114、118的栅极接地，同时开关晶体管104、108响应于从降压模式控制逻辑和驱动器120接收的HD_BUCK和LD_BUCK控制信号轮流导通和截止。同样，当降压-升压转换器处于升压工作模式时，开关晶体管104、108的栅极接地，同时开关晶体管114、118响应于从升压模式控制逻辑和驱动器122接收的控制信号HD_BOOST和LD_BOOST轮流地开和关。电容器124连接在节点116和地面之间。电阻器126在节点116和地面之间与电容器124并联。
电流传感器128监测输入电压节点102处的输入电流并响应于此产生电压信号ISNS。ISNS信号被分别施加于混合电路130、132。混合电路130将检测到的电流感测信号ISNS与斜率补偿信号与降压模式偏移信号相加。混合电路132将ISNS信号与斜率补偿信号和升压模式偏移信号相加。混合电路130的输出包括VSUM_BUCK信号，而混合电路132的输出包括VSUM_BOOST信号。VSUM_BUCK和VSUM_BOOST信号作为输入被提供给多路复用器134。多路复用器134基于从模式选择逻辑166提供的模式控制信号“模式”来选择VSUM_BUCK和VSUM_BOOST信号中的一个，模式选择逻辑166将在下文中更全面地描述。模式信号提供降压-升压转换器是处于降压工作模式还是升压工作模式的指示。当转换器处于降压工作模式时，模式控制信号选择VSUM_BUCK信号，而当转换器处于升压工作模式时，其选择VSUM_BOOST信号。
如前所述，多路复用器的输出VSUM是输入电流ISNS、降压或升压模式偏移和斜率补偿信号之和。基于全周期内的最大斜率补偿来选择降压和升压工作模式下的不同偏移值。一般，不同的偏移值是最大斜率补偿电压的两倍。例如，如果斜率补偿为1V/us并且切换频率为1MHz，则不同的偏移值是1V/us*1us*2，也就是2V。因此如果降压模式下的偏移是Vos，则升压模式的偏移为Vos+2V。以这种方式工作的***提供在轻载和重载两种状态下均较优的线路瞬变(linetransient)。当输出电压接近输入电压时，电压脉动也小。该控制方法只需要单个集成的电流传感器和逐周期检测。
多路复用器134的输出被提供给PWM比较器136的反相输入。PWM比较器136的非反相输入被连接以接收误差电压信号VCOMP。从误差放大器138提供误差电压信号VCOMP。误差放大器138的非反相输入连接于基准电压VREF。误差放大器138的反相输入连接于分压器电路，该分压器电路由连接在输出电压节点116和节点142之间的电阻器140和连接在节点142和地面之间的电阻器144构成。由串联于电阻器148的电容器146构成的补偿电路连接在误差放大器138的输出和地面之间。
PWM比较器136响应于误差电压VCOMP和来自多路复用器134的VSUM信号而产生PWM控制信号VCOMP_OUT。来自PWM比较器136的VCOMP_OUT信号被提供给反相器150的输入并被提供给AND门152的一个输入。反相器150的输出被提供给OR门154的第一输入。OR门154的另一输入被连接以接收MAX_D控制信号。OR门154的输出连接于SR锁存器156的R输入。SR锁存器156的S输入接收时钟信号CLK1。SR锁存器156的输出提供PWM_BUCK信号，该PWM_BUCK信号被提供给降压模式控制逻辑和驱动器120。降压模式控制逻辑和驱动器120也从模式选择逻辑166接收模式信号。降压模式控制逻辑和驱动器120产生被提供给开关晶体管104的栅极的HD_BUCK控制信号以及被提供给开关晶体管108的栅极的LD_BUCK控制信号。
除了接收PWM比较器136的输出，AND门152还从反相器158接收经反相的MAX_D信号。反相器158的输入被连接以接收MAX_D信号，并且反相器的输出被提供给AND门152的输入之一。AND门152的输出连接于反相器160，该反相器在将信号提供给SR锁存器162的S输入前将AND门152的输出反相。SR锁存器162的R输入接收时钟信号CLK1。SR锁存器162的输出包括PWM_BOOST信号，该PWM_BOOST信号作为升压模式控制逻辑和驱动器122的输入提供。升压模式控制逻辑和驱动器122也从模式选择逻辑166接收模式信号。升压模式控制逻辑和驱动器122产生HD_BOOST信号，该HD_BOOST信号被提供给开关晶体管114的栅极以控制其操作，并产生LD_BOOST控制信号，该LD_BOOST控制信号被提供给开关晶体管118的栅极以控制晶体管118的操作。
来自SR锁存器156的PWM_BUCK控制信号以及来自SR锁存器162的PWM_BOOST信号也作为输入提供给最大占空比检测电路164。最大占空比检测电路164也接收CLK1和CLK2时钟信号，这两个时钟信号彼此之间具有固定的相位差，如下面结合图2更详细描述的那样。响应于这些信号，最大占空比检测电路164产生MAX_D控制信号。MAX_D控制信号指示降压-升压转换器电路中的最大占空比状态。MAX_D控制信号作为控制输入被提供给反相器158的输入，并如前所述地被提供至OR门154的输入。最大占空比状态发生在Vcompout比CLK2更晚触发时。MAX_D控制信号也被输入到模式选择逻辑166，该模式选择逻辑166确定降压-升压转换器的工作模式，即降压或升压，并产生模式控制信号，该模式控制信号被提供给多路复用器134的输入并被提供给降压模式控制逻辑和驱动器120以及升压模式控制逻辑和驱动器122中的每一个。模式信号提供降压-升压转换器是处于降压工作模式还是升压工作模式的指示。
现在参见图2，图2示出用于图1的降压-升压转换器的可编程时钟移相器的示意性方框图。该可编程时钟移相器产生一对时钟信号CLK1、CLK2，其中CLK2信号与CLK1信号具有一预定量的相移。CLK1和CLK2时钟信号用来产生MAX_D控制信号，该MAX_D控制信号是通过图1的最大占空比检测电路164产生的。可编程时钟移相器200包括振荡器202，该振荡器202响应于施加于其上的基准电压VREF来产生处于默认频率下的RAMP信号。振荡器202响应于基准电压VREF产生数个信号。这些信号包括VPK信号、RAMP信号、TIMER_RDY(定时器就绪)信号和TIMER_DONE(定时器完成)信号。振荡器202也响应于从同步逻辑206产生的CLK1信号。VPK信号包括产生在斜坡输出线路204上的斜坡信号RAMP的峰值。TIMER_RDY信号提供何时将斜坡输出线路204上产生的RAMP信号拉低至接地电位并且可编程移相器电路对下个周期就绪的指示。当RAMP信号达到基准电压VREF时，TIMER_DONE信号被触发。
TIMER_RDY和TIMER_DONE信号各自与SYNC信号一起被提供给同步逻辑电路206。SYNC信号从外部引脚提供并确定降压-升压转换器的切换频率。同步逻辑206产生CLK1信号，该CLK1信号作为输出被提供给最大占空比电路164并也作为信号被提供给振荡器202。
从振荡器电路202提供到线路204上的RAMP信号被提供给比较器208的非反相输入。第二信号VC被提供给比较器208的反相输入。信号VC包括在振荡器202处检测到的信号VPK的成比例版本。指示RAMP信号的峰值电压的VPK信号被提供给缓冲器电路210。缓冲器电路210的输出被提供给分压器电路，该分压器电路由缓冲器210的输出和节点214之间的电阻器212以及节点214和地面之间的电阻器216构成。电阻器212具有大小R，而电阻器216是具有值KR的可变电阻器。比较器208的输出包括与CLK1信号偏移一个值的CLK2时钟信号，可响应于电阻器216的选定值对该值编程。当RAMP信号基本等于电压VC时，比较器208在其输出处产生逻辑LOW至逻辑HIGH变换。
现在参见图3，图中示出当没有同步时钟信号(SYNC信号)提供给同步逻辑206时可编程时钟移相器的操作。图3所示的波形展示当没有同步时钟信号提供给同步逻辑206或当SYNC信号频率低于振荡器202的频率时可编程时钟移相器的操作。RAMP信号302包括由振荡器202产生的斜坡电压信号。VC信号304包括被提供给比较器208的反相输入的电压电平，它是从振荡器202提供的VPK信号306的成比例版本。VPK信号306包括通过振荡器202提供的RAMP信号302的峰值电压电平。当RAMP信号302到达VPK电平时，TIMER_DONE信号308提供脉冲。当RAMP信号被复位至接地时，TIMER_RDY信号310提供脉冲。
当RAMP信号302在时间T1达到VC信号304电压电平时，比较器208的输出变高并发起CLK2信号的时钟脉冲。RAMP信号302继续增大，直到它在时间T2到达VPK(VREF)电压电平为止。当RAMP信号302到达VPK(VREF)电平时，从振荡器202产生TIME_DONE脉冲。这使RAMP信号302被拉低至接地电位。响应于RAMP信号被拉低至接地电位，在时间T2产生TIMER_RDY脉冲310，它指示振荡器202已对下一时钟周期就绪。基本在时间T2，CLK2的时钟脉冲终止。响应于TIMER_DONE脉冲308和TIMER_RDY信号310脉冲，同步逻辑206在时间T2产生CLK1信号312脉冲。RAMP信号则从时间T2至时间T3开始增大，其中前述过程重复。
TIMER_RDY信号使CLK1脉冲在同步逻辑202的输出处产生。振荡器电路202中的采样和保持电路保存RAMP信号302的峰值作为与图3电路中的VREF相等的信号VPK。VPK信号使用由电阻器212和电阻器216构成的电阻分压器分压，以产生经分压的信号VC。经分压的信号VC用作基准电压以响应于与RAMP信号302的比较在比较器208的输出处形成CLK2信号。CLK2信号将使最大占空比检测电路164处的MAX_D信号被设置在大约90％(或任何其它要求的值)。通过调整电阻器216的K值，可经由调整MAX_D信号的位置而调整最大占空比。在一集成电路中，电阻匹配可在1％以内实现，因此MAX_D以及可编程相位调整器电路的CLK2和CLK1信号之间的相位差的精确度很高。
现在参照图4，图中示出当施加于同步逻辑206的SYNC信号402的同步时钟频率高于振荡器电路202中的振荡器默认频率时可编程时钟移相器电路的操作。RAMP信号302在时间T1与VC信号304电平相交，且如前所述地在时间T1产生CLK2时钟信号300时钟脉冲。RAMP信号302继续增大，直到它在时间T2到达VPK信号306电平为止。在图4中，VPK和VREF从时间T1至时间T5再次相等。在时间T5，基准电压VREF404保持相同，同时VPK信号306减小。当产生TIMER_RDY信号脉冲310时，由于RAMP信号302在达到VREF值前在时间T5被复位，因此VPK 306减小。当RAMP信号302在时间T2达到VPK信号电平时，TIMER_DONE信号308在时间T2产生脉冲并且RAMP信号302被拉低至接地电位。响应于RAMP信号302被拉低至接地电位，TIMER_RDY信号310在时间T2产生一时钟脉冲。响应于TIMER_RDY信号310和同步脉冲402，CLK1信号312在时间T2产生另一脉冲。RAMP信号302然后开始增大直到时间T3，此时该过程重复。
在时间T4之后，SYNC信号402的脉冲频率增大至高于振荡器电路202中的振荡器的默认频率的水平。同步逻辑206将在时间T5和时间T6的TIMER_RDY信号脉冲310之后但在接收到另一TIMER_DONE信号脉冲308之前在时间T5和时间T6接收两个SYNC脉冲。因此，同步逻辑206将响应于新同步脉冲在时间T5和T6产生CLK1脉冲，并且振荡器202响应于新同步脉冲大致在时间T5和T6将使RAMP信号302复位至其起始电平。由于RAMP信号302在到达VREF信号404前复位至其起始电平，因此VPK在时间T5和T6的值将减小至表征SYNC信号402使RAMP信号302复位所在的点的值。由于VPK 306在RAMP信号302复位前基于减小的最大斜坡值而减小，因此VC值304也将相应地减小，因为VC 304的值是根据等式(VPK×K/(1+K))基于VPK 306的值确定的。因此，VPK 306和VC 304的值在时间T5和T6减小。CLK2300将仍然大约为VPK 306的0.9倍并从最大占空比检测电路164提供基本相同的MAX_D值。
现在参见图5，图中示出图4的逆变换，其示出从被同步到较高同步频率变换至可编程时钟移相器200的默认频率。该同步频率必须高于电路(图2的电路)的默认频率以正确地工作。从时间T1至时间T2，移相器工作，其中RAMP信号302增大，直到它在时间T3和时间T5与VPK信号306相交为止。当到达VPK信号306时，斜坡302被复位至接地电位，这使得在时间T3和时间T5产生TIMER_RDY信号310脉冲并在时间T3和时间T5产生CLK1脉冲。在时间T2和T4响应于与VC信号304相等的RAMP信号302产生CLK2脉冲。
在时间T5，同步脉冲402的频率开始减小。因此，同步逻辑206在接收TIMER_RDY信号脉冲310之后和在接收TIMER_DONE脉冲308之前不接收任何同步脉冲402。在时间T5和时间T7的同步脉冲之间，同步周期增大并且RAMP信号302将继续增大，直至在时间T7到达基准电压404为止。当斜坡302与VPK 306相交时，由于没有接收到同步脉冲，因此不会提早发生复位。一旦在时间T7达到基准电压404，RAMP信号302被拉低，这使得TIMER_DONE脉冲308、TIMER_RDY脉冲310和CLK1脉冲312发生。由于RAMP信号302的峰值一路增大至基准值404，因此VPK306的值将在时间T8增大至等于基准电压。当VPK 306增大时，VC 304的值也将在时间T8增大，因为VC基于VPK的值。因此，在时间T9，当斜坡302在时间T9与VC信号电平相交时产生CLK2脉冲，而当RAMP信号302在时间T10与VREF相交时产生CLK1脉冲。在时间T8，VPK 306和VC 304的值变回其默认值。CLK2信号300将仍然保持0.9VPK并且MAX_D值将不改变。
所描述的电路和方法提供用于设定降压-升压转换器中的最大占空比的方式。所描述的***提供一种降压-升压转换器的解决方案，以使其以可编程的最大占空比工作。它避免了复杂的锁相环电路的使用并具有对外部同步时钟的快速响应时间，并且最大占空比易于使用I2C或微调进行控制。因此，该电路提供的主要优势是：具有通过微调或通过I2C数字接口经由编程来调整最大占空比的能力、快速响应时间、实时相移、无需等待稳定、没有复杂的PLL电路以及对电阻匹配的依赖以取得相移精确性。
已从本公开获益的本领域内技术人员应当理解，提供用于降压-升压转换器的可编程时钟移相器。应当理解的是，本文中的附图和详细描述应被认为是解说性而不是限制性的，而且不旨在受限于所公开的特定形式和示例。反之，如所附权利要求所限定地，在不背离本发明的精神和范围的情况下，包括的是对本领域的普通技术人员而言显而易见的任何进一步修改、变化、重新排列、替换、替代物、设计选择以及实施例。因此，旨在使所附权利要求被解释为涵盖所有这些进一步修改、变化、重新排列、替换、替代物、设计选择以及实施例。

Claims (21)

1.一种装置，包括：
降压-升压转换器，用于响应于输入电压和切换控制信号生成经调节的输出电压；
切换控制电路，用于响应于经调节的输出电压、最大占空比信号和模式信号产生切换控制信号；
模式控制电路，用于响应于降压PWM信号和升压PWM信号、第一时钟信号和与所述第一时钟信号具有一固定可编程量的相移的第二时钟信号来产生最大占空比信号和模式信号；以及
移相器，用于响应于基准电压和同步信号来产生所述第一时钟信号和所述第二时钟信号。
2.如权利要求1所述的装置，其特征在于，所述移相器还包括：
振荡器，用于产生斜坡电压信号；
第一控制电路，用于响应于所述斜坡电压信号来产生所述第一时钟信号；以及
第二控制电路，用于响应于所述斜坡电压信号和所述斜坡电压信号的斜坡峰值来产生所述第二时钟信号，其中所述第二控制电路建立所述第一时钟信号和所述第二时钟信号之间的相移。
3.如权利要求2所述的装置，其特征在于，所述振荡器产生指示所述斜坡电压信号已到达基准电压的定时器完成(timer done)控制信号以及响应于所述斜坡电压信号复位的定时器就绪(timer ready)控制信号。
4.如权利要求3所述的装置，其特征在于，所述第一控制电路还包括同步控制电路，用于响应于定时器完成控制信号、定时器就绪控制信号和同步信号产生所述第一时钟信号。
5.如权利要求2所述的装置，其特征在于，所述振荡器响应于所述斜坡电压信号的峰值产生所述斜坡峰值。
6.如权利要求5所述的装置，其特征在于，所述第二控制电路还包括：
分压器电路，用于产生与所述斜坡峰值成比例的值，其中所述分压器电路被编程以设定所述第一时钟信号和所述第二时钟信号之间的相移；以及
比较器，用于将所述斜坡电压信号同与所述斜坡峰值成比例的值比较并响应于此产生所述第二时钟信号。
7.如权利要求6所述的装置，其特征在于，所述分压器电路还包括：
第一电阻器；以及
与所述第一电阻器串联的可变电阻器，其中所述可变电阻器和第一电阻器之比建立所述第一时钟信号和所述第二时钟信号之间的相移。
8.如权利要求6所述的装置，其特征在于，所述斜坡峰值以及与所述斜坡峰值成比例的值响应于所述同步信号、所述定时器完成控制信号、所述定时器就绪控制信号以及所述斜坡信号彼此按比例地改变。
9.一种用于DC/DC电压转换器的移相器，包括：
振荡器，用于产生斜坡电压信号；
第一控制电路，用于响应于斜坡电压信号来产生第一时钟信号；以及
第二控制电路，用于响应于所述斜坡电压信号和所述斜坡电压信号的斜坡峰值来产生第二时钟信号，其中所述第二控制电路建立所述第一时钟信号和所述第二时钟信号之间的固定相移。
10.如权利要求9所述的装置，其特征在于，所述振荡器产生指示所述斜坡电压信号已到达基准电压的定时器完成控制信号以及响应于所述斜坡电压信号复位的定时器就绪控制信号。
11.如权利要求10所述的装置，其特征在于，所述第一控制电路还包括同步控制电路，用于响应于定时器完成控制信号、定时器就绪控制信号和同步信号产生所述第一时钟信号。
12.如权利要求9所述的装置，其特征在于，所述振荡器响应于所述斜坡电压信号的峰值产生所述斜坡峰值。
13.如权利要求12所述的装置，其特征在于，所述第二控制逻辑还包括：
分压器电路，用于产生与所述斜坡峰值成比例的值，其中所述分压器电路被编程以设定所述第一时钟信号和所述第二时钟信号之间的固定相移；以及
比较器，用于将所述斜坡电压信号同与所述斜坡峰值成比例的值比较并响应于此产生所述第二时钟信号。
14.如权利要求6所述的装置，其特征在于，所述分压器电路还包括：
第一电阻器；以及
与所述第一电阻器串联的可变电阻器，其中所述可变电阻器和第一电阻器之比建立所述第一时钟信号和所述第二时钟信号之间的固定相移。
15.如权利要求6所述的装置，其特征在于，所述斜坡峰值以及与所述斜坡峰值成比例的值响应于所述同步信号、所述定时器完成控制信号、所述定时器就绪控制信号以及所述斜坡信号彼此按比例地改变。
16.一种建立用于DC/DC电压转换器的第一时钟信号和第二时钟信号之间的固定相移的方法，所述方法包括以下步骤：
响应于输入电压和切换控制信号生成经调节的输出电压；
响应于经调节的输出电压、最大占空比信号和模式信号产生切换控制信号；
响应于降压PWM信号、升压PWM信号以及第一和第二时钟信号来产生所述最大占空比信号和所述模式信号；以及
响应于基准电压和同步信号来产生所述第一时钟信号以及与所述第一时钟信号具有固定的可编程量的相移的第二时钟信号。
17.如权利要求16所述的方法，其特征在于，所述产生第一时钟信号和第二时钟信号的步骤还包括以下步骤：
产生斜坡电压信号；
响应于所述斜坡电压信号产生所述第一时钟信号；
设定所述第一时钟信号和所述第二时钟信号之间的相移；以及
响应于所述斜坡电压信号和所述斜坡电压信号的斜坡峰值来产生所述第二时钟信号。
18.如权利要求17所述的方法，其特征在于，所述产生所述第一时钟信号的步骤还包括以下步骤：
产生指示所述斜坡电压信号已达到所述基准电压的定时器完成控制信号；
响应于所述斜坡电压信号被复位而产生定时器就绪控制信号；
响应于所述定时器完成控制信号、所述定时器就绪控制信号和所述同步信号来产生所述第一时钟信号。
19.如权利要求17所述的方法，其特征在于，所述产生所述第二时钟信号的步骤还包括以下步骤：
响应于所述斜坡电压信号的峰值来产生斜坡峰值；
产生与所述斜坡峰值成比例的值；
将所述斜坡电压信号同与所述斜坡峰值成比例的值比较；以及
响应于所述斜坡电压信号同与所述斜坡峰值成比例的值的比较来产生所述第二时钟信号。
20.如权利要求16所述的方法，其特征在于，所述设定步骤还包括步骤：建立电阻分压器电路中的可变电阻器的值。
21.一种从输入电压产生经调节的输出电压的DC/DC转换器，包括：
至少一个受控的开关；
时钟电路，所述时钟电路为所述DC/DC转换器提供标称切换频率；
控制电路，所述控制电路响应于所述输出电压、所述时钟电路和基准电压产生用于所述开关的控制信号，所述控制信号具有预定最大值的占空比；
使所述时钟电路与高于所述标称切换频率的外部频率同步的装置；以及
与使时钟同步的外部频率无关地维持所述占空比的预定最大值的装置。
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