CN102402086A - 液晶显示器 - Google Patents
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Abstract
本发明公开一种液晶显示器,包含多个由栅极线与资料线定义的像素区及多个像素单元。每一像素单元包含晶体管、像素电极、公共电极至少一衔接部,所述像素电极连接晶体管的漏极;所述公共电极连接一对应的公共线且与所述像素电极重叠,所述衔接部与所述公共电极于同一平面上并连接所述公共电极,且绝缘地通过闸极线而连接相邻像素区的像素单元的公共电极。通过上述结构配置,本发明的液晶显示器能提供较佳的开口率和穿透率。
Description
【技术领域】
本发明是有关于一种液晶显示器,特别是有关于一种提供较佳的开口率和穿透率的液晶显示器。
【背景技术】
请参考图1所示,图1是现有液晶显示器的像素单元的平面示意图。所述像素单元是配置于栅极线90与资料线92所定义的像素区内,并包含公共线91、一晶体管、一像素电极94及一公共电极95。所述公共线91是平行所述栅极线90。所述晶体管包含栅极、半导体层93、源极921及漏极922,其中所述栅极即是所述栅极线90,所述半导体层93设置于所述栅极线90上,所述源极921从所述资料线92延伸出而设于所述半导体层93上。所述漏极922设于半导体层93且一侧边与所述源极921呈平行。所述像素电极94设于所述像素区内并通过一穿孔920连接所述漏极922,且具有多个狭缝940。所述公共电极95与所述像素电极94重叠,并连接所述公共线91。再者,所述公共电极95在所述像素区角落通过一跨桥单元96绝缘地跨过所述栅极线90而对应连接相邻像素区的公共电极,其中所述公共线91与所述栅极线90上会先设置一绝缘层,再于绝缘层上对应所述像素区的角落成形一过孔960,所述跨桥单元96再通过所述过孔960连接所述公共线91。
上述通过跨桥单元96串接公共线91可使整个像素阵列的公共线构成一网形(Mesh)配置,此网形配置可降低公共线的电位的浮动,而有助于减少串扰效应(Crosstalk)。
然而,由于上述网形配置是在所述像素区成形过孔960,再利用跨桥单元96连接公共线91,因此会导致像素区的开口率降低。
故,有必要提供一种液晶显示器,以解决现有技术所存在的问题。
【发明内容】
有鉴于现有技术的缺点,本发明的主要目的在于提供一种液晶显示器,以解决现有具网孔设计的像素结构的液晶显示器的开口率不佳的问题。
为达成本发明的前述目的,本发明提供一种液晶显示器,其包含:
多条栅极线;
多条资料线,与所述栅极线交错而定义多个像素区;
多条公共线,与所述资料线交错,且与所述栅极线互相平行;
多个像素单元,分别位于所述多个像素区内,每一像素单元包含晶体管、像素电极、公共电极及至少一衔接部,所述像素电极位于所述像素区内,并连接所述晶体管的漏极且具有多个狭缝;所述公共电极连接一对应的公共线且与所述像素电极重叠;所述衔接部与所述公共电极位于同一平面上并连接所述公共电极,且绝缘地通过闸极线而连接相邻像素区的像素单元的公共电极。
在本发明的一实施例中,所述晶体管包含栅极、半导体层、源极及漏极,所述栅极为其中一栅极线,所述半导体层设置于所述栅极上,所述源极自其中一资料线延伸出而位于所述半导体层上,所述漏极设于所述半导体层上。
在本发明的一实施例中,所述栅极线对应一像素区而具有两个第一导体层及一第二导体层,所述两第一导体层相隔一间距,所述第二导体层的两端分别连接所述第一导体层,所述衔接部绝缘地延伸于所述两第一导体层的相对端之间及所述第二导体层的下方。
在本发明的一实施例中,所述两个第一导体层与所述衔接部的表面设有一绝缘层,所述绝缘层对应所述两第一导体层的相对端形成穿孔,所述第二导体层的两端通过所述穿孔分别连接所述两第一导体层的相对端。
在本发明的一实施例中,所述像素电极的狭缝呈平行排列。
在本发明的一实施例中,所述衔接部与所述公共电极的材料是透明导电材,所述衔接部是所述公共电极的延伸部份。
在本发明的一实施例中,所述衔接部与所述公共电极的材料是铟锡氧化物。
本发明主要是在形成公共电极的平面上进一步也形成衔接相邻公共电极的衔接部,如此可解决像现有技术在像素区形成开孔而导致开口率不佳的缺点。
【附图说明】
图1是现有液晶显示器的像素单元的平面示意图。
图2是本发明液晶显示器一较佳实施例的像素单元的平面示意图。
图3是图2沿A-A线的剖视图。
【具体实施方式】
为让本发明上述目的、特征及优点更明显易懂,下文特举本发明较佳实施例,并配合附图,作详细说明如下。再者,本发明所提到的方向用语,例如「上」、「下」、「前」、「后」、「左」、「右」、「内」、「外」、「侧面」等,仅是参考附加图式的方向。因此,使用的方向用语是用以说明及理解本发明,而非用以限制本发明。
请参考图2所示,图2为本发明液晶显示器一较佳实施例的像素单元的平面示意图。所述液晶显示器包含多个由多条栅极线20、多条资料线50、多条公共线22及多个像素单元。所述栅极线20与所述资料线50交错而定义多个像素区。所述公共线22与所述资料线50交错,且与所述栅极线20互相平行。所述像素单元分别位于所述多个像素区内,每一像素单元包含晶体管、像素电极40、公共电极30及至少一衔接部31。
所述像素电极40位于所述像素区内,并连接所述晶体管的漏极52且具有多个狭缝41,其中所述像素电极40是通过一绝缘层的通孔500而连接所述漏极52的一延伸部。本实施例中,所述像素电极40的狭缝41优选是呈平行排列。
所述公共电极30连接一对应的公共线22且与所述像素电极40重叠。
所述衔接部31与所述公共电极30位于同一平面上并连接所述公共电极30,且绝缘地通过闸极线20而连接相邻像素区的像素单元的公共电极30。在本实施例中,所述衔接部31与所述公共电极30的材料是透明导电材,且优选是铟锡氧化物。所述衔接部31优选是所述公共电极30的延伸部份。
所述晶体管包含栅极、半导体层60、源极52及漏极51。所述栅极即为其中一栅极线20,所述半导体层60设置于所述栅极上,所述源极52自其中一资料线50延伸出而位于所述半导体层60上,所述漏极52设于所述半导体层60上。
进一步参考图3所示,图3是图2沿A-A线的剖视图。所述栅极线20对应一像素区而具有两个第一导体层20a及一第二导体层20b,所述两第一导体层20a相隔一间距,所述第二导体层20b的两端分别连接所述第一导体层20a,所述衔接部31绝缘地延伸于所述两第一导体层20a的相对端之间及所述第二导体层20b的下方。更详细地,所述两个第一导体层20a与所述衔接部31的表面设有一绝缘层100,所述绝缘层100对应所述两第一导体层20a的相对端形成穿孔210,所述第二导体层20b的两端通过所述穿孔210分别连接所述两第一导体层20a的相对端。如此,本发明可通过所述衔接部31连接相邻的公共电极30,连接公共电极30的公共线22可因此构成网形配置,同样可达到降低公共线22的电位的浮动,而有助于减少串扰效应(Crosstalk)。
相较于现有液晶显示器的公共线的网形配置必须在像素区成形过孔,来利用跨桥单元跨过栅极线顶部来连接公共线,而造成开口率下降的问题,本发明的液晶显示器令像素电极底部的公共电极的一侧延伸出衔接部来绝缘地通过栅极线下方,可不必在像素区成形过孔,进而有助于提升像素区的开口率和液晶面板的穿透率,更进一步地降低了液晶显示器的能耗。
本发明已由上述相关实施例加以描述,然而上述实施例仅为实施本发明的范例。必需指出的是,已公开的实施例并未限制本发明的范围。相反地,包含于权利要求书的精神及范围的修改及均等设置均包括于本发明的范围内。
Claims (7)
1.一种液晶显示器,其特征在于:所述液晶显示器包含:
多条栅极线;
多条资料线,与所述栅极线交错而定义多个像素区;
多条公共线,与所述资料线交错,且与所述栅极线互相平行;
多个像素单元,分别位于所述多个像素区内,每一像素单元包含晶体管、像素电极、公共电极及至少一衔接部,所述像素电极位于所述像素区内,并连接所述晶体管的漏极且具有多个狭缝;所述公共电极连接一对应的公共线且与所述像素电极重叠;所述衔接部与所述公共电极位于同一平面上并连接所述公共电极,且绝缘地通过闸极线而连接相邻像素区的像素单元的公共电极。
2.如权利要求1所述的液晶显示器,其特征在于:所述晶体管包含栅极、半导体层、源极及漏极,所述栅极为其中一栅极线,所述半导体层设置于所述栅极上,所述源极自其中一资料线延伸出而位于所述半导体层上,所述漏极设于所述半导体层上。
3.如权利要求1所述的液晶显示器,其特征在于:所述栅极线对应一像素区而具有两个第一导体层及一第二导体层,所述两第一导体层相隔一间距,所述第二导体层的两端分别连接所述第一导体层,所述衔接部绝缘地延伸于所述两第一导体层的相对端之间及所述第二导体层的下方。
4.如权利要求3所述的液晶显示器,其特征在于:所述两个第一导体层与所述衔接部的表面设有一绝缘层,所述绝缘层对应所述两第一导体层的相对端形成穿孔,所述第二导体层的两端通过所述穿孔分别连接所述两第一导体层的相对端。
5.如权利要求1所述的液晶显示器,其特征在于:所述像素电极的狭缝呈平行排列。
6.如权利要求1所述的液晶显示器,其特征在于:所述衔接部与所述公共电极的材料是透明导电材,所述衔接部是所述公共电极的延伸部份。
7.如权利要求6所述的液晶显示器,其特征在于:所述衔接部与所述公共电极的材料是铟锡氧化物。
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C12 | Rejection of a patent application after its publication | ||
RJ01 | Rejection of invention patent application after publication |
Application publication date: 20120404 |