TW201530318A - 可傳輸多形式資料之儲存裝置及其插設之連接座 - Google Patents
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Abstract
本發明提供一種符合於CFast硬體標準規範之儲存裝置及其插設之連接座，儲存裝置包括一連接器，連接器包括一第一連接埠及一第二連接埠，連接座設置在一電子設備之中，連接座包括一第一連接端及一第二連接端，當儲存裝置透過連接器插設在電子設備之連接座時，第一連接埠插接在第一連接端上以傳輸一第一形式資料，而第二連接埠插接在第二連接端上以傳輸至少一第二形式資料，在此，儲存裝置與電子設備只要採用單一個連接器及連接座相互插接，即可傳輸多種傳輸協定規範形式之資料。
Description
本發明有關於一種可傳輸多形式資料之儲存裝置及其插設之連接座，尤指一種符合於CFast硬體標準規範並可以傳輸多種形式資料之儲存裝置及連接座。
隨著資料的存取需求，一般電子設備都會設置有可供儲存器(如記憶卡或隨身碟)插設之連接端，以使電子設備可以對於***的儲存器進行資料的存取。
目前市面上的快閃儲存器之硬體標準規範眾多，如SD、MMC、MS、CF、CFast等等硬體標準規範之記憶卡或USB硬體標準規範之隨身碟，且每一硬體標準規範之儲存器對於資料的存取都會制定有單一特定的傳輸協定規範，如SD、MMC、MS、SATA或USB。此外，以往每一儲存器都會各自製作成一單體結構，其擁有自己的包裝殼體並配置一連接器，致使以透過各自的連接器插接於電子設備之中而與電子設備進行資料的傳輸。
再者，以往電子設備為了可以存取不同傳輸協定規範的儲存器，於電子設備的電路板上設置有各式各樣的硬體標準規範之連接座，以供各個儲存器的連接器進行插設。然而，於電子設備之中設置多種硬體標準規範之連接座，不僅會增加連接座的設置成本，電子設備若為一可攜式電子設備(如平板電腦或通訊裝置)時，此多數量之連接端將會讓可攜式電子設備無法達到薄型化外觀之目的。
目前市面上的快閃儲存器之硬體標準規範眾多，如SD、MMC、MS、CF、CFast等等硬體標準規範之記憶卡或USB硬體標準規範之隨身碟，且每一硬體標準規範之儲存器對於資料的存取都會制定有單一特定的傳輸協定規範，如SD、MMC、MS、SATA或USB。此外，以往每一儲存器都會各自製作成一單體結構，其擁有自己的包裝殼體並配置一連接器，致使以透過各自的連接器插接於電子設備之中而與電子設備進行資料的傳輸。
再者，以往電子設備為了可以存取不同傳輸協定規範的儲存器，於電子設備的電路板上設置有各式各樣的硬體標準規範之連接座，以供各個儲存器的連接器進行插設。然而，於電子設備之中設置多種硬體標準規範之連接座，不僅會增加連接座的設置成本，電子設備若為一可攜式電子設備(如平板電腦或通訊裝置)時，此多數量之連接端將會讓可攜式電子設備無法達到薄型化外觀之目的。
本發明之一目的，在於提供一種多形式資料之儲存裝置及其插設之連接座，儲存裝置及連接器皆符合於CFast卡硬體標準規範，其中儲存裝置包括有一可以插接在連接座上的連接器，連接器及連接座被定義可以傳輸一第一形式資料及至少一第二形式資料，當儲存裝置透過連接器插設在電子設備的連接座時，電子設備與儲存裝置之間將可以傳輸第一形式及第二形式的資料，如此，儲存裝置與電子設備只要採用單一連接器及連接座相互插接，即可傳輸多種傳輸協定規範形式之資料，藉以降低連接器及連接座的設置數量及安裝空間。
為了達到上述目的，本發明提供一種可傳輸多形式資料之儲存裝置，其外觀尺寸符合於CFast硬體標準規範，包括：一控制器；一儲存單元，連接控制器，用以儲存資料；及一連接器，其連接控制器，包括：一第一連接埠及一第二連接埠，利用第一連接埠以傳輸一第一形式資料，以及利用第二連接埠以傳輸至少一第二形式資料。
本發明一實施例中，其中第一形式資料或第二形式資料為符合於SATA、USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
本發明一實施例中，其中第一形式資料及第二形式資料分別為不同傳輸協定規範之資料。
本發明一實施例中，其中第一形式資料及第二形式資料為相同傳輸協定規範之資料。
本發明一實施例中，其中連接器為一CFA(Compact Flash Association)協會所定義的CFast硬體標準規範之連接器，第一連接埠之腳位數量為七，而第二連接埠之腳位數量為十七。
本發明一實施例中，其中儲存單元包括一第一儲存器及至少一第二儲存器，控制器對於第一儲存器存取第一形式資料及對於第二儲存器存取第二形式資料。
本發明一實施例中，其中第一連接埠及第二連接埠分別包括複數個腳位，從第一連接埠之腳位中定義出複數個用以傳輸第一形式資料之資料腳位，從第二連接埠之腳位中定義出複數個用以傳輸第二形式資料之資料腳位。
本發明又提供一種連接座，用以插設一符合於CFast硬體標準規範之儲存裝置，儲存裝置包括一連接器，連接器包括一第一連接埠及一第二連接埠，連接座包括：一第一連接端；及一第二連接端，連接器之第一連接埠插接在連接座之第一連接端上，利用第一連接埠與第一連接端以傳輸一第一形式資料，連接器之第二連接埠插接在連接座之第二連接端上，利用第二連接埠與第二連接端以傳輸一第二形式資料。
本發明一實施例中，其中連接座為一CFA(Compact Flash Association)協會所定義的CFast硬體標準規範之連接座，第一連接端之腳位數量為七，而第二連接端之腳位數量為十七。
本發明一實施例中，其中第一連接端及第二連接端分別包括複數個腳位，從第一連接端之腳位中定義出複數個用以傳輸第一形式資料之資料腳位，從第二連接端之腳位中定義出複數個用以傳輸第二形式資料之資料腳位。
為了達到上述目的，本發明提供一種可傳輸多形式資料之儲存裝置，其外觀尺寸符合於CFast硬體標準規範，包括：一控制器；一儲存單元，連接控制器，用以儲存資料；及一連接器，其連接控制器，包括：一第一連接埠及一第二連接埠，利用第一連接埠以傳輸一第一形式資料，以及利用第二連接埠以傳輸至少一第二形式資料。
本發明一實施例中，其中第一形式資料或第二形式資料為符合於SATA、USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
本發明一實施例中，其中第一形式資料及第二形式資料分別為不同傳輸協定規範之資料。
本發明一實施例中，其中第一形式資料及第二形式資料為相同傳輸協定規範之資料。
本發明一實施例中，其中連接器為一CFA(Compact Flash Association)協會所定義的CFast硬體標準規範之連接器，第一連接埠之腳位數量為七，而第二連接埠之腳位數量為十七。
本發明一實施例中，其中儲存單元包括一第一儲存器及至少一第二儲存器，控制器對於第一儲存器存取第一形式資料及對於第二儲存器存取第二形式資料。
本發明一實施例中，其中第一連接埠及第二連接埠分別包括複數個腳位，從第一連接埠之腳位中定義出複數個用以傳輸第一形式資料之資料腳位，從第二連接埠之腳位中定義出複數個用以傳輸第二形式資料之資料腳位。
本發明又提供一種連接座，用以插設一符合於CFast硬體標準規範之儲存裝置，儲存裝置包括一連接器，連接器包括一第一連接埠及一第二連接埠，連接座包括：一第一連接端；及一第二連接端，連接器之第一連接埠插接在連接座之第一連接端上，利用第一連接埠與第一連接端以傳輸一第一形式資料，連接器之第二連接埠插接在連接座之第二連接端上，利用第二連接埠與第二連接端以傳輸一第二形式資料。
本發明一實施例中，其中連接座為一CFA(Compact Flash Association)協會所定義的CFast硬體標準規範之連接座，第一連接端之腳位數量為七，而第二連接端之腳位數量為十七。
本發明一實施例中，其中第一連接端及第二連接端分別包括複數個腳位，從第一連接端之腳位中定義出複數個用以傳輸第一形式資料之資料腳位，從第二連接端之腳位中定義出複數個用以傳輸第二形式資料之資料腳位。
10‧‧‧儲存裝置
11‧‧‧控制器
13‧‧‧儲存單元
131‧‧‧第一儲存器
133‧‧‧第二儲存器
20‧‧‧連接器
205‧‧‧定位件
21‧‧‧第一連接埠
211‧‧‧腳位
23‧‧‧第二連接埠
231‧‧‧腳位
30‧‧‧連接座
301‧‧‧基部
302‧‧‧卡體容置區
303‧‧‧臂部
305‧‧‧導槽部
31‧‧‧第一連接端
311‧‧‧腳位
33‧‧‧第二連接端
331‧‧‧腳位
41‧‧‧第一耦合電容
43‧‧‧第二耦合電容
50‧‧‧主機板
51‧‧‧微處理器
11‧‧‧控制器
13‧‧‧儲存單元
131‧‧‧第一儲存器
133‧‧‧第二儲存器
20‧‧‧連接器
205‧‧‧定位件
21‧‧‧第一連接埠
211‧‧‧腳位
23‧‧‧第二連接埠
231‧‧‧腳位
30‧‧‧連接座
301‧‧‧基部
302‧‧‧卡體容置區
303‧‧‧臂部
305‧‧‧導槽部
31‧‧‧第一連接端
311‧‧‧腳位
33‧‧‧第二連接端
331‧‧‧腳位
41‧‧‧第一耦合電容
43‧‧‧第二耦合電容
50‧‧‧主機板
51‧‧‧微處理器
第１圖：本發明儲存裝置及其插設之連接座一較佳實施例之平面構造示意圖。
第２圖：本發明電子設備與儲存裝置一較佳實施例之電路結構示意圖。
第３圖：本發明連接器及連接座一實施例之腳位定義圖表。
第４圖：本發明在控制器與連接器間及在微處理器及連接座間設置耦合電容之電路結構示意圖。
第２圖：本發明電子設備與儲存裝置一較佳實施例之電路結構示意圖。
第３圖：本發明連接器及連接座一實施例之腳位定義圖表。
第４圖：本發明在控制器與連接器間及在微處理器及連接座間設置耦合電容之電路結構示意圖。
請同時參閱第１圖及第２圖，分別為本發明儲存裝置及其插設之連接座一較佳實施例之平面構造示意圖及電子設備與儲存裝置一較佳實施例之電路結構示意圖。如圖所示，本發明儲存裝置10及連接座30之外觀尺寸符合於CFast 2.0硬體標準規範。
其中，儲存裝置10包括一控制器11、一儲存單元13及一連接器20。控制器11分別電性連接儲存單元13及連接器20。儲存單元13係以快閃記憶體作為基本的組成元件，用以儲存資料。控制器11利用連接器20以傳輸儲存單元13所儲存之資料。
連接器20為CFA(Compact Flash Association)協會所定義的CFast 2.0硬體標準規範之連接器，其包括一第一連接埠21及一第二連接埠23。第一連接埠21包括有七個腳位211，而第二連接埠23包括有十七個腳位231。第一連接埠21被定義用以傳輸一第一形式資料，而第二連接埠23被定義用以傳輸至少一第二形式資料。
同樣的，連接座30也為CFA(Compact Flash Association)協會所定義的CFast 2.0硬體標準規範之連接座，其包括一第一連接端31及一第二連接端33。第一連接端31包括有七個腳位311，而第二連接端33包括有十七個腳位331。當連接器20之第一連接埠21及第二連接埠23分別插接在連接座30之第一連接端31及第二連接端33時，第一連接埠21及第一連接端31間將可以傳輸第一形式資料，而第二連接埠23及第二連接埠33間將可以傳輸第二形式資料。
進一步參閱第３圖，為本發明連接器及連接座一實施例之腳位定義圖表。如圖表所示，連接器20之第一連接埠21之腳位211及連接座30之第一連接端31之腳位311包括有S1~S7，而連接器20之第二連接埠23之腳位231及連接座30之第二連接端33之腳位331包括有PC1~PC17。
本發明連接器20及連接座30為符合CFast 2.0 標準規範之連接器及連接座，因此，在連接器20及連接座30中絕大部分的腳位211、231、311、331仍依照原本CFast 2.0 的標準規範進行相對的定義，例如：S1、S4、S7、PC2、PC7、PC15~PC16定義為接地腳位，S13、S14定義為電源腳位，PC8、PC9定義為LED輸出訊號腳位，PC1、PC17定義為檢測腳位，而S2、S3、S5、S6定義為資料腳位。
在本發明中，第一連接埠21及第一連接端31之S2、S3、S5、S6腳位211、311將被定義作為傳輸第一形式資料(A1+、A1-、A2-、A2+)之資料腳位。此外，第二連接埠23及第二連接端33之中尚包括有複數個閒置腳位231、331，例如：PC3~PC6、PC10~12腳位，部分的閒置腳位231、331將被定義作為傳輸第二形式資料(B1+、B1-、B2-、B2+)之資料腳位，例如：PC4、PC5、PC10、PC11腳位。則，連接器20及連接座30將可以透過第一連接埠21及第一連接端31之資料腳位(S2、S3、S5、S6)211、311傳輸第一形式資料以及透過第二連接埠23及第二連接端33之資料腳位(PC4、PC5、PC10、PC11)231、331傳輸第二形式資料。
接續，本發明一實施例中，連接器20與連接座30所傳輸的第一形式資料及第二形式資料分別為不同傳輸協定規範之資料，例如：第一形式資料為符合於SATA傳輸協定規範之資料，而第二形式資料為符合於USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
或者，本發明又一實施例中，連接器20與連接座30所傳輸的第一形式資料及第二形式資料可以為相同傳輸協定規範之資料，例如：第一形式資料及第二形式資料皆符合於SATA、USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
再度參閱第２圖，本發明連接座30將會設置在一電子設備之主機板50之上。主機板50包括有一微處理器51，該連接座30電性連接微處理器51。當儲存裝置10之連接器20插接在連接座30時，主機板50之微處理器51即可對於儲存裝置10存取第一形式資料及/或第二形式資料。在此，電子設備與儲存裝置10之間只要採用單一個連接器20及連接座30進行插接，電子設備即可對於儲存裝置10存取多種傳輸協定規範形式之資料，以降低連接器10及連接座30的設置數量及安裝空間。
又，本發明儲存裝置10之儲存單元13包括有一第一儲存器131及一第二儲存器133。連接器20之資料腳位(S2、S3、S5、S6)211將作為第一儲存器131專屬的資料腳位，其用以傳輸第一儲存器131所存取的第一形式資料(A1+、A1-、A2-、A2+)。另外，連接器20之資料腳位(PC4、PC5、PC10、PC11)231將作為第二儲存器133專屬的資料腳位，其用以傳輸第二儲存器133所存取的第二形式資料(B1+、B1-、B2-、B2+)。在此，本發明將多個不同傳輸協定規範或相同傳輸協定規範之儲存器131、133整合至儲存裝置10之中，其相較於以往各自包裝的單體構件形式，可以有效降低整體的單位體積。
本發明上述實施例中，第一連接埠21及其插設的第一連接端31與第二連接埠23及其插設的第二連接端33皆被設定為可以傳輸資料的介面，例如：第一連接埠21及第一連接端31之S2、S3、S5、S6腳位被設定為傳輸資料之腳位，第二連接埠23及第二連接端33之PC4、PC5、PC10、PC11腳位也被設定為傳輸資料之腳位。當然，本發明又一實施例中，也可以只選擇將第二連接埠23及其插設的第二連接端33設定為可以傳輸資料之介面，而第一連接埠21及其插設的第一連接端31未被設定有傳輸資料之功效，例如：第一連接埠21及第一連接端31之S2、S3、S5、S6腳位未設定成資料腳位而是改作為其他用途。請參閱第４圖為本發明在控制器與連接器間及在微處理器及連接座間設置耦合電容之電路結構示意圖。如圖所示，本發明一實施例中，在控制器11與連接器20間尚設置有一對第一耦合電容41及在微處理器51與連接座30間尚設置有一對第二耦合電容43。
以往為了降低資料在傳輸途徑中受到電磁干擾(EMI)之影響，因此，一般都會採用差動訊號方式進行儲存裝置10與電子設備之間的資料傳輸。然而，控制器11或微處理器51內部電路中所形成的直流偏壓(VDC )仍會反應在所傳輸的差動資料訊號之上，以致該傳輸的差動資料訊號往往包含有直流偏壓(VDC )成分。該包含有直流偏壓成分的差動資料訊號不僅會影響到資料存取上之正確性，且亦可能超出控制器11或微處理器51可容許的電壓範圍而造成儲存裝置10或電子設備之內部電路的損壞。
本發明藉由第一耦合電容41及第二耦合電容43的設置，將可有效隔離控制器11或微處理器51內部電路中所形成的直流偏壓(VDC )雜訊，避免直流偏壓(VDC )雜訊跟隨著差動資料訊號從連接器20及連接座30傳輸至微處理器51或從連接座30及連接器20傳輸至控制器11而影響到資料的存取或電路的運作。
此外，當儲存裝置10之連接器20誤插於不同資料傳輸協定規範的電子設備之連接座30時(例如：連接器20之第二連接埠23被定義符合於USB資料傳輸協定規範，然而，其對應插設的連接座30之第二連接端32另被定義符合於PCI-E資料傳輸協定規範)，該第一耦合電容41及該第二耦合電容43也可以產生防插錯的保護作用，避免不同資料傳輸規範之訊號壓差造成電子設備或儲存裝置10的電路損壞。
承上所述，本發明連接器20及連接座30為符合於CFast標準規範之連接元件，因此，在連接器20及連接座30之中定義有多個檢測腳位PC1、PC17 (CDI、CDO)，這些檢測腳位PC1、PC17 (CDI、CDO)將用以檢測連接器20是否正確電性插接在連接座30之中，如第３圖表所示。
又，再度參閱第１圖，本發明符合CFast 2.0標準規範之連接座30之座體構造包括一基部301及兩臂部303。兩臂部303分別設置在基部301之兩側，基部301與兩臂部303間形成有一卡體容置區302，第一連接端31及第二連接端32固定在基部301之上且突設在卡體容置區302之中，而第一連接端31及第二連接端32與兩側的臂部303之間的空隙分別形成為一導槽部305。
另，本發明儲存裝置10之前緣中央處分別設置第一連接埠21及第二連接埠23，第一連接埠21及第二連接埠23之兩側分別設置有一定位件205。在此，第一連接埠21、第二連接埠23及兩側的定位件205將構成為該符合CFast 2.0標準規範之連接器20。
當儲存裝置10從卡體容置區302進入連接座30內部時，連接器20之第一連接埠21及第二連接埠23係可以電性插接於連接座30之第一連接端31及第二連接端33之上，且連接器20之定位件205也會同時嵌固在導槽部305之中。則，透過導槽部305與定位件205間的定位嵌合，將使得連接器20可以更穩固地電性插接在連接座30之上。
在此，藉由CFast 2.0標準所制定的檢測腳位(CDI、CDO)及導槽定位結構等等兩項規範，將可以確保本發明連接器20可以穩固正確地插設在連接座30之中，其相較於採用其他標準規範(如SD、MMC、MS或USB)將具有更高的可靠度連接，致使以提高電子設備與儲存裝置10間資料存取上的穩定性。
以上所述者，僅為本發明之一較佳實施例而已，並非用來限定本發明實施之範圍，即凡依本發明申請專利範圍所述之形狀、構造、特徵及精神所為之均等變化與修飾，均應包括於本發明之申請專利範圍內。
其中，儲存裝置10包括一控制器11、一儲存單元13及一連接器20。控制器11分別電性連接儲存單元13及連接器20。儲存單元13係以快閃記憶體作為基本的組成元件，用以儲存資料。控制器11利用連接器20以傳輸儲存單元13所儲存之資料。
連接器20為CFA(Compact Flash Association)協會所定義的CFast 2.0硬體標準規範之連接器，其包括一第一連接埠21及一第二連接埠23。第一連接埠21包括有七個腳位211，而第二連接埠23包括有十七個腳位231。第一連接埠21被定義用以傳輸一第一形式資料，而第二連接埠23被定義用以傳輸至少一第二形式資料。
同樣的，連接座30也為CFA(Compact Flash Association)協會所定義的CFast 2.0硬體標準規範之連接座，其包括一第一連接端31及一第二連接端33。第一連接端31包括有七個腳位311，而第二連接端33包括有十七個腳位331。當連接器20之第一連接埠21及第二連接埠23分別插接在連接座30之第一連接端31及第二連接端33時，第一連接埠21及第一連接端31間將可以傳輸第一形式資料，而第二連接埠23及第二連接埠33間將可以傳輸第二形式資料。
進一步參閱第３圖，為本發明連接器及連接座一實施例之腳位定義圖表。如圖表所示，連接器20之第一連接埠21之腳位211及連接座30之第一連接端31之腳位311包括有S1~S7，而連接器20之第二連接埠23之腳位231及連接座30之第二連接端33之腳位331包括有PC1~PC17。
本發明連接器20及連接座30為符合CFast 2.0 標準規範之連接器及連接座，因此，在連接器20及連接座30中絕大部分的腳位211、231、311、331仍依照原本CFast 2.0 的標準規範進行相對的定義，例如：S1、S4、S7、PC2、PC7、PC15~PC16定義為接地腳位，S13、S14定義為電源腳位，PC8、PC9定義為LED輸出訊號腳位，PC1、PC17定義為檢測腳位，而S2、S3、S5、S6定義為資料腳位。
在本發明中，第一連接埠21及第一連接端31之S2、S3、S5、S6腳位211、311將被定義作為傳輸第一形式資料(A1+、A1-、A2-、A2+)之資料腳位。此外，第二連接埠23及第二連接端33之中尚包括有複數個閒置腳位231、331，例如：PC3~PC6、PC10~12腳位，部分的閒置腳位231、331將被定義作為傳輸第二形式資料(B1+、B1-、B2-、B2+)之資料腳位，例如：PC4、PC5、PC10、PC11腳位。則，連接器20及連接座30將可以透過第一連接埠21及第一連接端31之資料腳位(S2、S3、S5、S6)211、311傳輸第一形式資料以及透過第二連接埠23及第二連接端33之資料腳位(PC4、PC5、PC10、PC11)231、331傳輸第二形式資料。
接續，本發明一實施例中，連接器20與連接座30所傳輸的第一形式資料及第二形式資料分別為不同傳輸協定規範之資料，例如：第一形式資料為符合於SATA傳輸協定規範之資料，而第二形式資料為符合於USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
或者，本發明又一實施例中，連接器20與連接座30所傳輸的第一形式資料及第二形式資料可以為相同傳輸協定規範之資料，例如：第一形式資料及第二形式資料皆符合於SATA、USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
再度參閱第２圖，本發明連接座30將會設置在一電子設備之主機板50之上。主機板50包括有一微處理器51，該連接座30電性連接微處理器51。當儲存裝置10之連接器20插接在連接座30時，主機板50之微處理器51即可對於儲存裝置10存取第一形式資料及/或第二形式資料。在此，電子設備與儲存裝置10之間只要採用單一個連接器20及連接座30進行插接，電子設備即可對於儲存裝置10存取多種傳輸協定規範形式之資料，以降低連接器10及連接座30的設置數量及安裝空間。
又，本發明儲存裝置10之儲存單元13包括有一第一儲存器131及一第二儲存器133。連接器20之資料腳位(S2、S3、S5、S6)211將作為第一儲存器131專屬的資料腳位，其用以傳輸第一儲存器131所存取的第一形式資料(A1+、A1-、A2-、A2+)。另外，連接器20之資料腳位(PC4、PC5、PC10、PC11)231將作為第二儲存器133專屬的資料腳位，其用以傳輸第二儲存器133所存取的第二形式資料(B1+、B1-、B2-、B2+)。在此，本發明將多個不同傳輸協定規範或相同傳輸協定規範之儲存器131、133整合至儲存裝置10之中，其相較於以往各自包裝的單體構件形式，可以有效降低整體的單位體積。
本發明上述實施例中，第一連接埠21及其插設的第一連接端31與第二連接埠23及其插設的第二連接端33皆被設定為可以傳輸資料的介面，例如：第一連接埠21及第一連接端31之S2、S3、S5、S6腳位被設定為傳輸資料之腳位，第二連接埠23及第二連接端33之PC4、PC5、PC10、PC11腳位也被設定為傳輸資料之腳位。當然，本發明又一實施例中，也可以只選擇將第二連接埠23及其插設的第二連接端33設定為可以傳輸資料之介面，而第一連接埠21及其插設的第一連接端31未被設定有傳輸資料之功效，例如：第一連接埠21及第一連接端31之S2、S3、S5、S6腳位未設定成資料腳位而是改作為其他用途。請參閱第４圖為本發明在控制器與連接器間及在微處理器及連接座間設置耦合電容之電路結構示意圖。如圖所示，本發明一實施例中，在控制器11與連接器20間尚設置有一對第一耦合電容41及在微處理器51與連接座30間尚設置有一對第二耦合電容43。
以往為了降低資料在傳輸途徑中受到電磁干擾(EMI)之影響，因此，一般都會採用差動訊號方式進行儲存裝置10與電子設備之間的資料傳輸。然而，控制器11或微處理器51內部電路中所形成的直流偏壓(VDC )仍會反應在所傳輸的差動資料訊號之上，以致該傳輸的差動資料訊號往往包含有直流偏壓(VDC )成分。該包含有直流偏壓成分的差動資料訊號不僅會影響到資料存取上之正確性，且亦可能超出控制器11或微處理器51可容許的電壓範圍而造成儲存裝置10或電子設備之內部電路的損壞。
本發明藉由第一耦合電容41及第二耦合電容43的設置，將可有效隔離控制器11或微處理器51內部電路中所形成的直流偏壓(VDC )雜訊，避免直流偏壓(VDC )雜訊跟隨著差動資料訊號從連接器20及連接座30傳輸至微處理器51或從連接座30及連接器20傳輸至控制器11而影響到資料的存取或電路的運作。
此外，當儲存裝置10之連接器20誤插於不同資料傳輸協定規範的電子設備之連接座30時(例如：連接器20之第二連接埠23被定義符合於USB資料傳輸協定規範，然而，其對應插設的連接座30之第二連接端32另被定義符合於PCI-E資料傳輸協定規範)，該第一耦合電容41及該第二耦合電容43也可以產生防插錯的保護作用，避免不同資料傳輸規範之訊號壓差造成電子設備或儲存裝置10的電路損壞。
承上所述，本發明連接器20及連接座30為符合於CFast標準規範之連接元件，因此，在連接器20及連接座30之中定義有多個檢測腳位PC1、PC17 (CDI、CDO)，這些檢測腳位PC1、PC17 (CDI、CDO)將用以檢測連接器20是否正確電性插接在連接座30之中，如第３圖表所示。
又，再度參閱第１圖，本發明符合CFast 2.0標準規範之連接座30之座體構造包括一基部301及兩臂部303。兩臂部303分別設置在基部301之兩側，基部301與兩臂部303間形成有一卡體容置區302，第一連接端31及第二連接端32固定在基部301之上且突設在卡體容置區302之中，而第一連接端31及第二連接端32與兩側的臂部303之間的空隙分別形成為一導槽部305。
另，本發明儲存裝置10之前緣中央處分別設置第一連接埠21及第二連接埠23，第一連接埠21及第二連接埠23之兩側分別設置有一定位件205。在此，第一連接埠21、第二連接埠23及兩側的定位件205將構成為該符合CFast 2.0標準規範之連接器20。
當儲存裝置10從卡體容置區302進入連接座30內部時，連接器20之第一連接埠21及第二連接埠23係可以電性插接於連接座30之第一連接端31及第二連接端33之上，且連接器20之定位件205也會同時嵌固在導槽部305之中。則，透過導槽部305與定位件205間的定位嵌合，將使得連接器20可以更穩固地電性插接在連接座30之上。
在此，藉由CFast 2.0標準所制定的檢測腳位(CDI、CDO)及導槽定位結構等等兩項規範，將可以確保本發明連接器20可以穩固正確地插設在連接座30之中，其相較於採用其他標準規範(如SD、MMC、MS或USB)將具有更高的可靠度連接，致使以提高電子設備與儲存裝置10間資料存取上的穩定性。
以上所述者，僅為本發明之一較佳實施例而已，並非用來限定本發明實施之範圍，即凡依本發明申請專利範圍所述之形狀、構造、特徵及精神所為之均等變化與修飾，均應包括於本發明之申請專利範圍內。
10‧‧‧儲存裝置
11‧‧‧控制器
13‧‧‧儲存單元
131‧‧‧第一儲存器
133‧‧‧第二儲存器
20‧‧‧連接器
21‧‧‧第一連接埠
23‧‧‧第二連接埠
30‧‧‧連接座
31‧‧‧第一連接端
33‧‧‧第二連接端
50‧‧‧主機板
51‧‧‧微處理器
Claims (1)
- 一種可傳輸多形式資料之儲存裝置，其外觀尺寸符合於CFast硬體標準規範，包括：一控制器；一儲存單元，連接控制器，用以儲存資料；及一連接器，其連接控制器，包括：一第一連接埠及一第二連接埠，利用第一連接埠以傳輸一第一形式資料，以及利用第二連接埠以傳輸至少一第二形式資料。
2.如申請專利範圍第1項所述之儲存裝置，其中該第一形式資料或該第二形式資料為符合於SATA、USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
3.如申請專利範圍第1項所述之儲存裝置，其中該第一形式資料及該第二形式資料分別為不同傳輸協定規範之資料。
4.如申請專利範圍第1項所述之儲存裝置，其中該第一形式資料及該第二形式資料為相同傳輸協定規範之資料。
5.如申請專利範圍第1項所述之儲存裝置，其中該連接器為一CFA(Compact Flash Association)協會所定義的CFast硬體標準規範之連接器，該第一連接埠之腳位數量為七，而該第二連接埠之腳位數量為十七。
6.如申請專利範圍第1項所述之儲存裝置，其中該儲存單元包括一第一儲存器及至少一第二儲存器，該控制器對於該第一儲存器存取該第一形式資料及對於該第二儲存器存取該第二形式資料。
7.如申請專利範圍第1項所述之儲存裝置，其中該第一連接埠及該第二連接埠分別包括複數個腳位，從該第一連接埠之腳位中定義出複數個用以傳輸該第一形式資料之資料腳位，從該第二連接埠之腳位中定義出複數個用以傳輸該第二形式資料之資料腳位。
8.一種連接座，用以插設一符合於CFast硬體標準規範之儲存裝置，儲存裝置包括一連接器，連接器包括一第一連接埠及一第二連接埠，連接座包括：一第一連接端；及一第二連接端，連接器之第一連接埠插接在連接座之第一連接端之上，利用第一連接埠與第一連接端以傳輸一第一形式資料，連接器之第二連接埠插接在連接座之第二連接端之上，利用第二連接埠與第二連接端以傳輸一第二形式資料。
9.如申請專利範圍第8項所述之連接座，其中該第一形式資料或該第二形式資料為符合於SATA、USB、PCI-E、SD、MMC、MS或eMMC傳輸協定規範之資料。
10.如申請專利範圍第8項所述之連接座，其中該第一形式資料及該第二形式資料分別為不同傳輸協定規範之資料。
11.如申請專利範圍第8項所述之連接座，其中該第一形式資料及該第二形式資料為相同傳輸協定規範之資料。
12.如申請專利範圍第8項所述之連接座，其中該連接座為一CFA(Compact Flash Association)協會所定義的CFast硬體標準規範之連接座，該第一連接端之腳位數量為七，而該第二連接端之腳位數量為十七。
13.如申請專利範圍第8項所述之連接座，其中該第一連接端及該第二連接端分別包括複數個腳位，從該第一連接端之腳位中定義出複數個用以傳輸該第一形式資料之資料腳位，從該第二連接端之腳位中定義出複數個用以傳輸該第二形式資料之資料腳位。
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