KR890007455Y1 - Network resistor indicator - Google Patents
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Abstract
내용 없음.No content.
Description
제1도는 네트워크 저항의 외형과 내부회로도.1 is an external circuit diagram and an external circuit diagram of a network resistor.
제2도는 본 고안의 회로구성도이다.2 is a circuit diagram of the present invention.
* 도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
1 : 네트워크저항체 2 : 기준저항지정부1: network resistor 2: reference resistor
3 : 오저항검출부 4 : 오아게이트3: Ohmic resistance detection unit 4: Oagate
5 : 표시부 31 : 오차검출회로5 display unit 31 error detection circuit
32 : 배율지정회로 33 : 배율증폭회로32: magnification designation circuit 33: magnification amplification circuit
34 : 판별회로 Vref : 기준전압34: discrimination circuit Vref: reference voltage
R1-Rn-1: 네트워크저항 VR1-VRn-1: 가변저항R 1 -R n-1 : Network resistance VR 1 -VR n-1 : Variable resistor
J1-Jn: 접속점J 1 -J n : connection point
본 고안은 송수신 임피던스 매칭용등으로 사용되는 네트워크 저항의 불량여부를 판정하기 위한 네트워크 저항판별기에 관한 것이다.The present invention relates to a network resistance discriminator for determining whether or not the network resistance used for transmission and reception impedance matching.
종래 네트워크 저항의 양, 불량을 판정하고자 할 때는 통상의 저항측정기를 사용하여 네트워크 저항의 각 단자에 나타나는 저항값을 측정한 후에 이 저항값들이 허용오차 범위내에 있는가, 허용오차 범위를 초과하고 있는가에 따라 판별하였다. 그런데, 네트워크 저항은 제1도에 도시된 바와 같이 1개의 네트워크 저항체(1)내에 여러개의 네트워크 저항(R1-Rn-1)을 갖고 있고, 네트워크 저항(R1-Rn-1) 각각에 대한 단자(J1-Jn)를 갖고 있으며, 형태가 작고 내부 저항값이 표준화되어 있지 않기 때문에 네트워크 저항(R1-Rn-1)의 값을 측정해 봐야 하고 전술한 바와 같이 저항측정기를 사용하는 경우 각 단자(J1-Jn-1)마다 일일이 검사해야 하는 불편과 그에 따른 네트워크 저항 측정에 소요되는 많은 시간을 필요로 하게 된다.When determining the quantity or failure of the conventional network resistance, use a conventional resistance measuring instrument to measure the resistance value at each terminal of the network resistance, and then check whether the resistance values are within the tolerance range or exceed the tolerance range. Discrimination was made accordingly. By the way, the network resistance has several network resistances R 1 -R n-1 in one network resistor 1, as shown in FIG. 1 , and each of the network resistances R 1 -R n-1 . Because it has terminals (J 1 -J n ) for, and its shape is small and the internal resistance value is not standardized, it is necessary to measure the value of the network resistance (R 1 -R n-1 ). In the case of using, the inconvenience of having to inspect each terminal (J 1 -J n-1 ) requires a lot of time to measure the network resistance.
이에 본 고안은 상기한 실정에 비추어, 네트워크 저항의 대량생산시 그 저항값에 따른 양, 불량 판별을 짧은 시간에 간단하게 할 수 있도록 된 네트워크 저항판별기를 제공하고자 하는 것으로, 이를 첨부도면에 의거하여 상세히 설명하면 다음과 같다.In view of the above circumstances, the present invention aims to provide a network resistance discriminator which makes it easy to discriminate quantity and defects in accordance with the resistance value in a short time in mass production of network resistance. It will be described in detail as follows.
본 고안은 네트워크 저항체(1)의 각 단자(J1-Jn-1)에 네트워크 저항(R1-Rn-1)의 기준저항 값으로 조정되어 각각 연결되는 가변저항(VR1-VRn-1)으로 구성되는 기준 저항지정부(2)와, 네트워크 저항체(1)와 기준 저항지정부(2)의 각 접속점(J1-Jn-1)에 연결되어 네트워크 저항체(1)내의 각 저항(R1-Rn-1)이 허용호차를 초과하는지의 여부를 검출하는 오저항검출부(3)와, 상기 각 접속점(J1-Jn-1)에 연결되는 오저항검출부(3)의 출력중 적어도 하나이상 오정항을 검출했을 때 그에 대한 신호를 출력시키는 오아게이트(4)와, 오아게이트(4)의 출력 신호에 따라 네트워크 저항체(1)의 합격과 불합격 여부를 외부에 표시하는 표시부(5)로 구성되어 있다.The present invention is a variable resistor (VR 1- VR n ) is connected to each terminal (J 1 -J n-1 ) of the network resistor ( 1 ) adjusted to the reference resistance value of the network resistor (R 1 -R n-1 ) The resistance in the network resistor 1 connected to the reference resistance point 2 composed of -1 ) and each connection point J 1 -J n-1 of the network resistor 1 and the reference resistance point 2. Incorrect resistance detection unit 3 for detecting whether resistance R 1 -R n-1 exceeds the tolerance, and inferior resistance detection unit 3 connected to each connection point J 1 -J n-1 . The OA gate 4 outputs a signal corresponding to at least one of the outputs of the outputs of the outputs of the outputs and an external display indicating whether the network resistor 1 passes or fails in accordance with the output signal of the OA gates 4. It consists of the display part 5.
여기서 네트워크 저항체(1)와 기준 저항지정부(2)는 핀커넥터등을 이용하여 일체로 접속시킬 수 있도록하며, 그 접속점에는 오저항검출부(3)를 각각 연결하게 되는데, 오저항검출부(3)는 네트워크 저항(R1-Rn-1)과 가변저항(VR1-VRn-1)에 의한 기준 저항값과의 오차를 기준전압 Vref에 의해 검출하는 오차검출회로(31)와, 오차범위를 지정하는 배율지정회로(32)에 의해 오차검출회로(31)의 출력전압을 증폭하는 배율증폭회로(33)와, 기준전압 Vref에 따라 배율증폭회로(33)의 출력전압을 비교하여 오저항을 판별해 내는 판별회로(34)를 구비히여 구성된다. 이하 구체적인 예를 들어 본 고안의 작용을 설명하자면, B전원을 2V라 하고, 기준전압 Vref를 전원의 1/2로 하여 1V라 하며, 네트워크 저항체(1)내의 어느 한 저항(R1)의 저항값이 100Ω이고 허용오차를 ±5%라 할때, 네트워크 저항체(1)의 단자(J1-Jn-1)에다 기준 저항지정부(2)의 각 가변저항(VR1-VRn)을 통상의 커넥터를 이용해 접속시키고 가변저항(VR1)의 저항값을 100Ω으로 정확하게 지정해 놓는다. 다음에 허용오차가 5%이므로 배율지정부(32)에서는 1/오차=1/0.05=20으로 배율증폭부(33)에 배율을 지정한다. 만일 저항(R1)의 값이 정확히 100Ω이라고 가정하면, 접속점(J1)에서의 전압은 B전압×R1/(R1+VR1)=2×100/(100+100)=1(V)로 되며, 이것은 기준전압 Vref과 같은 값이므로 오차검출회로(31)와 판별회로(34)의 출력은 0(V)가 된다.Here, the network resistor 1 and the reference resistance designator 2 can be integrally connected by using a pin connector or the like. The resistance resistors 3 are connected to the connection points, respectively. An error detection circuit 31 for detecting an error between the reference resistance value of the network resistors R 1 -R n-1 and the variable resistors VR 1- VR n-1 by the reference voltage Vref, and an error range. A magnification resistance circuit 33 that amplifies the output voltage of the error detection circuit 31 by a magnification designation circuit 32 specifying? And an output resistance of the magnification amplifier circuit 33 are compared with the output voltage of the magnification amplification circuit 33 according to the reference voltage Vref. And a judging circuit 34 for judging. To explain the operation of the present invention with a specific example below, the B power supply is 2V, the reference voltage Vref is 1/2 of the power supply is 1V, the resistance of any one resistor (R 1 ) in the network resistor (1) When the value is 100Ω and the tolerance is ± 5%, connect each variable resistor (VR 1 -VR n ) of the reference resistor (2) to the terminal (J 1 -J n-1 ) of the network resistor (1). Connect using a normal connector and set the resistance value of the variable resistor (VR 1 ) to 100Ω correctly. Next, since the tolerance is 5%, the magnification designator 32 designates the magnification in the magnification amplifier 33 with 1 / error = 1 / 0.05 = 20. If we assume that the value of resistor R 1 is exactly 100 Ω, then the voltage at junction J 1 is B voltage × R 1 / (R 1 + VR 1 ) = 2 × 100 / (100 + 100) = 1 ( V), which is the same value as the reference voltage Vref, so that the outputs of the error detection circuit 31 and the discrimination circuit 34 become 0 (V).
저항(R1)의 값이 95(Ω), 즉 5%의 오차를 가지고 있다면 접속점(J1)의 전압은 2×95/(100+95)≒0.9744(V)로 된다. 여기서 배율증폭회로(33)의 동작을 살펴보면, 배율증폭회로(33)는 배율지정회로(32)로 부터 허용오차의 역수로 배율이 지정되지만, 배율증폭회로(33) 내부에소는 접속점(J1)의 전압이 1(V)보다 클때는 지정배율×2+1의 배율로, 1(V)보다 작거나 같을 때는 지정배율×2-1의 배율로 증폭동작을 한다. 따라서 위 예에서 접속점(J1) 전압이 0.9744(V)이므로 배율증폭회로(33)의 증폭동작은 20×2-1=39의 배율로 행해진다.If the value of the resistor R 1 has an error of 95 (Ω), that is, 5%, the voltage at the connection point J 1 becomes 2 × 95 / (100 + 95) ≒ 0.9744 (V). Referring to the operation of the magnification amplification circuit 33, the magnification amplification circuit 33 is designated by the inverse of the tolerance from the magnification designation circuit 32, but the inside of the magnification amplification circuit 33 is a connection point (J). When the voltage of 1) is greater than 1 (V), the amplification operation is performed at the magnification of 2x1 specified magnification and at magnification of 2x1 -1 specified magnification. Therefore, in the above example, since the connection point J 1 voltage is 0.9744 (V), the amplification operation of the magnification amplifier circuit 33 is performed at a magnification of 20 × 2-1 = 39.
따라서 배율증폭회로(33)의 출력은 오차전압×배율=(1-0.9744)×39=1(V)로 된다. 이 값은 기준전압 1(V)와 같은 값이므로 판별회로(34)의 출력은 로우레벨이 된다.Therefore, the output of the magnification amplifier circuit 33 becomes error voltage x magnification = (1-0.9744) x 39 = 1 (V). Since this value is equal to the reference voltage 1 (V), the output of the discrimination circuit 34 is at a low level.
저항(R1)의 값이 105(Ω)이라면 전술한 바와 같이 접속점(J1)의 전압은 2×105/(100+105)=1.0244V로 되고 배율증폭회로(33)의 배율은 20×2+1=41의 배율로 된다. 따라서 배율증폭회로(23)의 출력은 (1.0244-1)×41=1(V)로 되며, 이 역시 판별회로(34)를 통해서는 로우레벨이 나타나게 된다.If the value of the resistor R 1 is 105 (Ω), as described above, the voltage at the connection point J 1 becomes 2 × 105 / (100 + 105) = 1.0244V and the magnification of the magnification amplifier 33 is 20 ×. The magnification is 2 + 1 = 41. Therefore, the output of the magnification amplification circuit 23 becomes (1.0244-1) x 41 = 1 (V), and this also shows a low level through the discriminating circuit 34.
만일 저항(R1)의 값이 허용오차범위를 벗어나 94(Ω) 또는 106(Ω)이라고 가정하면, 94Ω인 경우의 배율증폭회로(33)의 출력은 (1-94/(100+94)×2)×(1/0.05×2-1)=1.2(V)로 되고, 또 106(Ω)인 경우의 배율증폭회로(33)의 출력은 (1-106/(100+106)×2)×(1/0.05×2+1)=1.2(V)로 되며 이들 경우의 판별회로(34)의 출력은 하이레벨이 된다.If the value of the resistor R 1 is outside the tolerance range of 94 (Ω) or 106 (Ω), the output of the multiplier amplifier circuit 33 in the case of 94Ω is (1-94 / (100 + 94) X 2) x (1 / 0.05 x 2-1) = 1.2 (V), and the output of the magnification amplification circuit 33 when 106 (Ω) is (1-106 / (100 + 106) x 2 X (1 / 0.05 x 2 + 1) = 1.2 (V), and the output of the discriminating circuit 34 in these cases becomes a high level.
이와 같이 네트워크 저항(R1-Rn-1)의 값이 허용오차 범위내에 존재하는지의 여부를 각각 검출하여 오아게이트(4)에 입력시키게 되는데, 네트워크 저항(R1-Rn-1)이 모두 허용오차 범위내의 정확한 값일때는 오아게이트(4)의 출력은 로우레벨이 되어 표시부(5)를 통해서 합격상태를 표시하고, 네트워크 저항(R1-Rn-1)중 어느 한 저항이라도 허용오차 범위를 벗어난 것이 있으면 오아게이트(4)의 출력은 하이레벨로 되어 표시부(6)를 통해 불합격상태를 표시한다.In this way, whether the value of the network resistance (R 1 -R n-1 ) is within the tolerance range is detected and input to the oragate (4), the network resistance (R 1 -R n-1 ) is When all of the values are within the tolerance range, the output of the oar gate 4 is at a low level, indicating the pass state through the display unit 5, and allowing any of the network resistances R 1 -R n -1 . If something is out of the error range, the output of the oragate 4 is at a high level, and the display unit 6 indicates a failing state.
이와 같이 하여 네트워크 저항체(1)를 기준 저항지정부(2)에 연결시키기만 하므로써 네트워크 저항(R1-Rn-1)의 양, 불량 여부를 판별하게 되어 간단하고 빠르게 검사할 수 있게 되며, 저항뿐만 아니라 콘덴서나 코일등 다른 부품에 대해서도 본 고안의 회로를 적용하여 검사할 수 있다.By simply connecting the network resistor 1 to the reference resistor 2 in this manner, it is possible to determine the quantity and failure of the network resistors R 1 -R n-1 , thereby enabling a simple and quick inspection. In addition to the resistors, other components such as capacitors and coils can be inspected by applying the circuit of the present invention.
상기한 바와 같이 본 고안은 네트워크 저항의 단자를 일일이 측정하는 번거로움과 실수등을 방지할 수 있고, 특히 다량의 네트워크 저항 검사시 검사시간을 단축시킬 수 있어 생산성 향상을 도모할 수 있는 효과가 있다.As described above, the present invention can prevent the hassle and mistakes of measuring the terminals of the network resistance, and in particular, it is possible to shorten the inspection time when inspecting a large amount of network resistance, thereby improving productivity. .
Claims (2)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR2019870010606U KR890007455Y1 (en) | 1987-06-30 | 1987-06-30 | Network resistor indicator |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR2019870010606U KR890007455Y1 (en) | 1987-06-30 | 1987-06-30 | Network resistor indicator |
Publications (2)
Publication Number | Publication Date |
---|---|
KR890001215U KR890001215U (en) | 1989-03-17 |
KR890007455Y1 true KR890007455Y1 (en) | 1989-10-26 |
Family
ID=19264697
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR2019870010606U KR890007455Y1 (en) | 1987-06-30 | 1987-06-30 | Network resistor indicator |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR890007455Y1 (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101938757B1 (en) * | 2018-05-15 | 2019-01-16 | 김동현 | Patch panel having the function of connection position indication of patch cord |
-
1987
- 1987-06-30 KR KR2019870010606U patent/KR890007455Y1/en not_active IP Right Cessation
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101938757B1 (en) * | 2018-05-15 | 2019-01-16 | 김동현 | Patch panel having the function of connection position indication of patch cord |
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KR890001215U (en) | 1989-03-17 |
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