KR850003009A - 다수의 메모리판을 제어하기 위한 장치 및 방법 - Google Patents

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KR850003009A KR1019840005557A KR840005557A KR850003009A KR 850003009 A KR850003009 A KR 850003009A KR 1019840005557 A KR1019840005557 A KR 1019840005557A KR 840005557 A KR840005557 A KR 840005557A KR 850003009 A KR850003009 A KR 850003009A
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Abstract

내용 없음

Description

다수의 메모리판을 제어하기 위한 장치 및 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3a 및 3b도는 제2a 및 2b도에 표시된 장치의 상세한 블록도. 제5도는 제3a 및 3b도에 표시된 장치의 처리절차의 플로우챠트.

Claims (11)

  1. 그래픽 시스템의 디스플레이 제어장치에서의 쓰기 동작시에 다수의 메모리판을 제어하기 위한 방법에 있어서, 상기 방법인 인터페이스 유니트를 사용함으로써 다수의 상기 메모리판을 데이타 버스에 선택적으로 접속시키는 단계; 와 판 표시유니트로부터 상기 메모리판으로 쓰기 인에이블 신호를 선택적으로 적용시키는 단계; 와 중앙처리장치로부터 상기 데이타 버스로 데이타가 쓰여지도록 적용시키는 단계; 와 상기 쓰기 인에이블 신호가 적용되었고 상기 데이타 버스에 연결되어 있는 상기 메모리판으로 상기 데이타를 쓰는 단계; 및 상기 쓰기 인에이블신호가 적용되었으나 상기 데이타 버스에 연결되어 있지 않는 상기 메모리판으로 소정의 고정 데이타를 쓰는 단계를 포함하는 것을 특징으로 하는 방법.
  2. 제1항에 있어서, 상기 메모리판으로의 상기 쓰기가 상기 쓰기인에이블 신호에 의해 제어되는 것을 특징으로 하는 방법.
  3. 그래픽시스템의 디스플레이 제어장치에서의 쓰기동작시에 다수의 메모리판을 제어하기 위한 장치에 있어서, 상기 장치가 CPU로부터 전승된 동일한 어드레스신호에 의해 색상 데이타를 기억하기 위한 다수의 메모리판; 과 쓰기 인에이블 신호를 상기 메모리판으로 선택적으로 적용시키기 위해 상기 메모리판에 대응하는 다수의 판 표시유니트; 와 상기 메모리판을 대응 데이타 버스에 선택적으로 적용시키기 위해 상기 메모리판에 대응하는 다수의 인터페이스 유니트; 및 대응 인터페이스 유니트의 온(on) 또는 오프(off)를 제어하기 위한 다수의 인터페이스 제어유니트로 구성되며, 상기 다수의 메모리판이 대응 판표시유니트로 부터 전송된 쓰기 인에이블 신호에 의해 쓰기 인에이블 상태로 동시에 세트되고 상기 쓰기 데이타가 한개 이상의 메모리판으로 쓰여질때 다른 메모리판이 상기 인터페이스 유니트로부터 분리 되고 상기 인터페이스 유니트로부터 전송된 소정의 고정 데이타를 그곳에 쓰는 것을 특징으로 하는 장치.
  4. 제3항에 있어서, 상기 메모리판이 3색 데이타와 광도의 명암데이타로 구성되는 것을 특징으로 하는 장치.
  5. 제3항에 있어서, 상기 판 표시유니트가 0바이트 신호를 래치하기 위한 판 표시 플립플롭회로 및 상기 쓰기 인에이블 신호를 발생시키기 위한 AND게이트 회로로 각각 구성되는 것을 특징으로 하는 장치.
  6. 제3항에 있어서, 상기 인터페이스 유니트가 상기 쓰기 데이타를 온 또는 오프시키기 위한 3상태 게이트 회로 및 소정의 고정 데이타를 발생시키기 위한 수단으로 각각 구성되는 것을 특징으로 하는 장치.
  7. 제6항에 있어서, 상기 수단이 폴다운 저항으로 구성되는 것을 특징으로 하는 장치.
  8. 제3항에 있어서, 상기 인터페이스 제어유니트가 뱅크선택신호를 래치시키기 위한 플리플롭회로로 각각구성되는 것을 특징으로 하는 장치.
  9. 제3항에 있어서, 상기 메모리판과 판 표시유니트가 상기 중앙처리장치와 직렬로 연결되는 것을 특징으로 하는 장치.
  10. 제3항에 있어서, 상기 메모리판과 인터페이스 유니트가 상기 중앙처리장치와 직렬로 연결되는 것을 특징으로 하는 장치.
  11. 제3항에 있어서, 상기 인터페이스 제어유니트가 상기 인터페이스 유니트와 상기 중앙처리장치 사이에 각각 연결되어지는 것을 특징으로 하는 장치.
    ※ 참고사항:최초출원 내용에 의하여 공개하는 것임.
KR8405557A 1983-09-21 1984-09-12 Display control apparatus for controlling to write image data to a plurality of memory planes KR890005003B1 (en)

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Families Citing this family (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2500858B2 (ja) * 1986-04-11 1996-05-29 インターナショナル・ビジネス・マシーンズ・コーポレーション 拡張ラスタ演算回路を有する表示システム
JPS63167393A (ja) * 1986-12-29 1988-07-11 横河電機株式会社 Crt表示装置
US5146592A (en) 1987-09-14 1992-09-08 Visual Information Technologies, Inc. High speed image processing computer with overlapping windows-div
US4947477A (en) * 1988-03-04 1990-08-07 Dallas Semiconductor Corporation Partitionable embedded program and data memory for a central processing unit
US5276804A (en) * 1988-04-27 1994-01-04 Mitsubishi Denki Kabushiki Kaisha Display control system with memory access timing based on display mode
US5046025A (en) * 1988-07-27 1991-09-03 Bmc Software, Inc. Data transmission optimizer including multi-pass symbol buffer optimization, trial generation feature and MDT reset voting feature
US4947257A (en) * 1988-10-04 1990-08-07 Bell Communications Research, Inc. Raster assembly processor
JP2628079B2 (ja) * 1988-11-25 1997-07-09 三菱電機株式会社 マルチプロセサシステムにおけるダイレクト・メモリ・アクセス制御装置
GB2248322B (en) * 1990-09-25 1994-04-06 Sony Broadcast & Communication Memory apparatus
US5303350A (en) * 1990-12-20 1994-04-12 Acer Incorporated Circuit for initializing registers using two input signals for writing default value into D-latch after a reset operation
JPH04301886A (ja) * 1991-03-29 1992-10-26 Nec Corp ディスプレイ制御回路
JPH09114591A (ja) * 1995-10-12 1997-05-02 Semiconductor Energy Lab Co Ltd 液晶表示装置及びその表示方法
US9805802B2 (en) 2015-09-14 2017-10-31 Samsung Electronics Co., Ltd. Memory device, memory module, and memory system
CN114780457B (zh) * 2022-03-16 2024-07-23 长江存储科技有限责任公司 存储器及其操作方法、存储器***

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS559742B2 (ko) * 1974-06-20 1980-03-12
US3978470A (en) * 1974-07-10 1976-08-31 Midwest Analog And Digital, Inc. Multi-channel data color display apparatus
US4092728A (en) * 1976-11-29 1978-05-30 Rca Corporation Parallel access memory system
US4094000A (en) * 1976-12-16 1978-06-06 Atex, Incorporated Graphics display unit
JPS55112644A (en) * 1979-02-23 1980-08-30 Universal:Kk Data write-in system in graphic display
FR2465281A1 (fr) * 1979-09-12 1981-03-20 Telediffusion Fse Dispositif de transmission numerique et d'affichage de graphismes et/ou de caracteres sur un ecran
US4490797A (en) * 1982-01-18 1984-12-25 Honeywell Inc. Method and apparatus for controlling the display of a computer generated raster graphic system
US4509043A (en) * 1982-04-12 1985-04-02 Tektronix, Inc. Method and apparatus for displaying images
US4484187A (en) * 1982-06-25 1984-11-20 At&T Bell Laboratories Video overlay system having interactive color addressing
JPS5960488A (ja) * 1982-09-29 1984-04-06 フアナツク株式会社 カラ−グラフイツクメモリのデ−タ書き込み装置
US4598384A (en) * 1983-04-22 1986-07-01 International Business Machines Corp. Graphics display with improved window organization

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Publication number Publication date
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DE3483873D1 (de) 1991-02-07
EP0141521A2 (en) 1985-05-15

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