KR100560186B1 - 시프트 레지스터 및 그를 구비한 표시장치 - Google Patents
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Abstract
Description
Claims (54)
- 복수단으로 이루어지는 플립플롭을 구비하고, 최종단을 포함하는 복수의 플립플롭의 리세트를, 최종단의 플립플롭으로부터의 출력신호를 각 플립플롭에 입력함으로써 행하는 시프트 레지스터에 있어서,상기 최종단의 플립플롭의 리세트가, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭 중 최종단의 플립플롭을 제외한 다른 플립플롭의 리세트와 동시, 또는 상기 다른 플립플롭의 리세트보다 후에 행해지고,최종단의 플립플롭에 있어서의 상기 출력신호의 출력단자와, 최종단의 플립플롭에 있어서의 상기 출력신호의 입력단자를 접속하는 배선에는, 상기 출력신호의 상기 입력단자로의 입력을 지연시키는 지연 수단을 구비하고 있는 시프트 레지스터.
- 제1항에 있어서, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭의 수가 최종단도 포함하여 N개일 때, 상기 복수단으로 이루어지는 플립플롭 중, 상기 N개의 플립플롭을 제외한 플립플롭의 리세트는, 각각 자단보다 (N-1)개 후단의 플립플롭으로부터의 출력신호가 입력됨으로써 행해지는 시프트 레지스터.
- 삭제
- 제1항에 있어서, 상기 지연 수단은 CMOS 인버터이고, 상기 CMOS 인버터에 있어서의 트랜지스터의 채널 폭 및 채널 길이 중, 적어도 어느 하나에 기초하여, 지연 시간을 설정하는 시프트 레지스터.
- 제1항에 있어서, 상기 지연 수단은 배선 용량이고, 상기 배선 용량의 값에 기초하여 지연 시간을 설정하는 시프트 레지스터.
- 제1항에 있어서, 상기 지연 수단은 배선 저항이고, 상기 배선 저항 값에 기초하여 지연 시간을 설정하는 시프트 레지스터.
- 복수단으로 이루어지는 플립플롭을 구비하고, 최종단을 포함하는 복수의 플립플롭의 리세트는, 최종단의 플립플롭으로부터의 출력신호를 각 플립플롭에 입력함으로써 행하는 시프트 레지스터에 있어서,동일한 플립플롭을 사용한 양 방향 주사가 가능하고,상기 복수단의 플립플롭 중, 출력신호를 외부로 출력하지 않는 플립플롭이, 자신을 동작시키지 않기 위한 정지 수단을 포함하며,각 주사방향에 있어서, 최종단의 플립플롭의 리세트가, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭 중 최종단의 플립플롭을 제외한 다른 플립플롭의 리세트와 동시, 또는 상기 다른 플립플롭의 리세트보다 후에 행해지고,최종단의 플립플롭에 있어서의 상기 출력신호의 출력단자와, 최종단의 플립플롭에 있어서의 상기 출력신호의 입력단자를 접속하는 배선에는, 상기 출력신호의 상기 입력단자로의 입력을 지연시키는 지연 수단을 구비하고 있는 시프트 레지스터.
- 삭제
- 제7항에 있어서, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭의 수가 최종단도 포함하여 N개일 때, 상기 복수단으로 이루어지는 플립플롭 중, 상기 N개의 플립플롭을 제외한 플립플롭의 리세트는, 각각 자단보다 (N-1)개 후단의 플립플롭으로부터의 출력신호가 입력됨으로써 행해지는 시프트 레지스터.
- 삭제
- 제7항에 있어서, 상기 지연 수단은 CMOS 인버터이고, 상기 CMOS 인버터에 있어서의 트랜지스터의 채널 폭 및 채널 길이 중, 적어도 어느 하나에 기초하여, 지연 시간을 설정하는 시프트 레지스터.
- 제7항에 있어서, 상기 지연 수단은 배선 용량이고, 상기 배선 용량의 값에 기초하여 지연 시간을 설정하는 시프트 레지스터.
- 제7항에 있어서, 상기 지연 수단은 배선 저항이고, 상기 배선 저항의 값에 기초하여 지연 시간을 설정하는 시프트 레지스터.
- 제7항에 있어서, 상기 정지 수단은, 상기 출력신호를 외부로 출력하지 않는 플립플롭의 세트 단자에 입력되는 세트 신호를 비액티브로, 리세트 단자에 입력되는 리세트 신호를 액티브로 하기 위해, 상기 세트 신호 및 리세트 신호를 각각 소정의 전위로 고정하는 전원인 시프트 레지스터.
- 제7항에 있어서, 각 플립플롭은, 주사방향을 절환하기 위한 주사방향 절환수단을 구비하고 있는 시프트 레지스터.
- 복수단으로 이루어지는 플립플롭을 구비하고, 최종단의 플립플롭의 리세트와 최종단보다 하나 전단의 플립플롭의 리세트를, 최종단의 플립플롭으로부터의 출력신호를 각 플립플롭에 입력함으로써 행하는 시프트 레지스터에 있어서,상기 최종단의 플립플롭의 리세트가, 최종단보다 하나 전단의 플립플롭의 리세트와 동시, 또는 최종단보다 하나 전단의 플립플롭의 리세트보다 후에 행해지고,최종단의 플립플롭에 있어서의 상기 출력신호의 출력단자와, 최종단의 플립플롭에 있어서의 상기 출력신호의 입력단자를 접속하는 배선에는, 상기 출력신호의 상기 입력단자로의 입력을 지연시키는 지연 수단을 구비하고 있는 시프트 레지스터.
- 삭제
- 제16항에 있어서, 상기 지연 수단은 CMOS 인버터이고, 상기 CMOS 인버터에 있어서의 트랜지스터의 채널 폭 및 채널 길이 중, 적어도 어느 하나에 기초하여, 지연 시간을 설정하는 시프트 레지스터.
- 제16항에 있어서, 상기 지연 수단은 배선 용량이고, 상기 배선 용량의 값에 기초하여 지연 시간을 설정하는 시프트 레지스터.
- 제16항에 있어서, 상기 지연 수단은 배선 저항이고, 상기 배선 저항의 값에 기초하여 지연 시간을 설정하는 시프트 레지스터.
- 제16항에 있어서, 상기 복수단으로 이루어지는 플립플롭 중, 최종단의 플립플롭을 제외한 플립플롭의 리세트는, 각각의 다음 단의 플립플롭으로부터의 출력신호가 입력됨으로써 행해지는 시프트 레지스터.
- 복수의 게이트 라인과, 상기 게이트 라인과 직교하도록 배치된 복수의 데이터 라인과, 각 화소에 대응하도록, 상기 게이트 라인과 상기 데이터 라인과의 교차부 부근에 제공된 스위칭 소자와, 화소를 구동하기 위한 주사 신호를 상기 게이트 라인에 공급하는 게이트 구동회로와, 각 화소에 대한 데이터 신호를 상기 데이터 라인에 공급하는 데이터 구동회로를 구비하고,상기 게이트 구동회로 및 상기 데이터 구동회로 중, 적어도 일방의 구동회로는,복수단으로 이루어지는 플립플롭을 구비하고, 최종단을 포함하는 복수의 플립플롭의 리세트를, 최종단의 플립플롭으로부터의 출력신호를 각 플립플롭에 입력함으로써 행하는 시프트 레지스터에 있어서, 상기 최종단의 플립플롭의 리세트가, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭 중 최종단의 플립플롭을 제외한 다른 플립플롭의 리세트와 동시, 또는 상기 다른 플립플롭의 리세트보다 후에 행해지고, 최종단의 플립플롭에 있어서의 상기 출력신호의 출력단자와, 최종단의 플립플롭에 있어서의 상기 출력신호의 입력단자를 접속하는 배선에는, 상기 출력신호의 상기 입력단자로의 입력을 지연시키는 지연 수단을 구비하고 있는 시프트 레지스터를 포함하는 표시장치.
- 제22항에 있어서, 상기 시프트 레지스터는, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭의 수가 최종단도 포함하여 N개일 때, 상기 복수단으로 이루어지는 플립플롭 중, 상기 N개의 플립플롭을 제외한 플립플롭의 리세트는, 각각 자단보다 (N-1)개 후단의 플립플롭으로부터의 출력신호가 입력됨으로써 행해지는 표시장치.
- 삭제
- 제22항에 있어서, 상기 지연 수단은 CMOS 인버터이고, 상기 CMOS 인버터에 있어서의 트랜지스터의 채널 폭 및 채널 길이 중, 적어도 어느 하나에 기초하여, 지연 시간을 설정하는 표시장치.
- 제22항에 있어서, 상기 지연 수단은 배선 용량이고, 상기 배선 용량의 값에 기초하여 지연 시간을 설정하는 표시장치.
- 제22항에 있어서, 상기 지연 수단은 배선 저항이고, 상기 배선 저항의 값에 기초하여 지연 시간을 설정하는 표시장치.
- 제22항에 있어서, 상기 양 구동회로 중 적어도 일방의 구동회로, 및 상기 스위칭 소자는, 동일 기판상에 형성되어 있는 표시장치.
- 제28항에 있어서, 상기 기판은, 유리로 이루어지는 유리 기판인 표시장치.
- 제22항에 있어서, 상기 스위칭 소자는, 다결정 실리콘으로 이루어지는 표시장치.
- 제22항에 있어서, 상기 스위칭 소자는, 600℃ 이하의 프로세스 온도에서 형성되는 표시장치.
- 복수의 게이트 라인과, 상기 게이트 라인과 직교하도록 배치된 복수의 데이터 라인과, 각 화소에 대응하도록, 상기 게이트 라인과 상기 데이터 라인과의 교차부 부근에 제공된 스위칭 소자와, 화소를 구동하기 위한 주사 신호를 상기 게이트 라인에 공급하는 게이트 구동회로와, 각 화소에 대한 데이터 신호를 상기 데이터 라인에 공급하는 데이터 구동회로를 구비하고,상기 게이트 구동회로 및 상기 데이터 구동회로 중, 적어도 일방의 구동회로는,복수단으로 이루어지는 플립플롭을 구비하고, 최종단을 포함하는 복수의 플립플롭의 리세트는, 최종단의 플립플롭으로부터의 출력신호를 각 플립플롭에 입력함으로써 행하는 행하는 시프트 레지스터에 있어서, 동일한 플립플롭을 사용한 양 방향 주사가 가능하고, 상기 복수단의 플립플롭 중, 출력신호를 외부로 출력하지 않는 플립플롭이, 자신을 동작시키지 않기 위한 정지 수단을 구비하고,상기 시프트 레지스터는, 각 주사방향에 있어서, 최종단의 플립플롭의 리세트가, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭 중 최종단의 플립플롭을 제외한 다른 플립플롭의 리세트와 동시, 또는 상기 다른 플립플롭의 리세트보다 후에 행해지며,최종단의 플립플롭에 있어서의 상기 출력신호의 출력단자와, 최종단의 플립플롭에 있어서의 상기 출력신호의 입력단자를 접속하는 배선에는, 상기 출력신호의 상기 입력단자로의 입력을 지연시키는 지연 수단을 구비하고 있는 시프트 레지스터를 포함하는 표시장치.
- 삭제
- 제32항에 있어서, 상기 시프트 레지스터는, 최종단의 플립플롭으로부터의 출력신호에 의해 리세트되는 플립플롭의 수가 최종단도 포함하여 N개일 때, 상기 복수단으로 이루어지는 플립플롭 중, 상기 N개의 플립플롭을 제외한 플립플롭의 리세트는, 각각 자단보다 (N-1)개 후단의 플립플롭으로부터의 출력신호가 입력됨으로써 행해지는 표시장치.
- 삭제
- 제32항에 있어서, 상기 지연 수단은 CMOS 인버터이고, 상기 CMOS 인버터에 있어서의 트랜지스터의 채널 폭 및 채널 길이 중, 적어도 어느 하나에 기초하여, 지연 시간을 설정하는 표시장치.
- 제32항에 있어서, 상기 지연 수단은 배선 용량이고, 상기 배선 용량의 값에 기초하여 지연 시간을 설정하는 표시장치.
- 제32항에 있어서, 상기 지연 수단은 배선 저항이고, 상기 배선 저항의 값에 기초하여 지연 시간을 설정하는 표시장치.
- 제32항에 있어서, 상기 정지 수단은, 상기 출력신호를 외부로 출력하지 않는 플립플롭의 세트단자에 입력되는 세트 신호를 비액티브로, 리세트 단자에 입력되는 리세트 신호를 액티브로 하기 위해, 상기 세트 신호 및 리세트 신호를 각각 소정의 전위로 고정하는 전원인 표시장치.
- 제32항에 있어서, 각 플립플롭은, 주사방향을 절환하기 위한 주사방향 절환수단을 구비하고 있는 표시장치.
- 제32항에 있어서, 상기 양 구동회로 중 적어도 일방의 구동회로, 및 상기 스위칭 소자는, 동일 기판상에 형성되어 있는 표시장치.
- 제41항에 있어서, 상기 기판은, 유리로 이루어지는 유리 기판인 표시장치.
- 제32항에 있어서, 상기 스위칭 소자는, 다결정 실리콘으로 이루어지는 표시장치.
- 제32항에 있어서, 상기 스위칭 소자는, 600℃ 이하의 프로세스 온도에서 형성되는 표시장치.
- 복수의 게이트 라인과, 상기 게이트 라인과 직교하도록 배치된 복수의 데이터 라인과, 각 화소에 대응하도록, 상기 게이트 라인과 상기 데이터 라인과의 교차부 부근에 제공된 스위칭 소자와, 화소를 구동하기 위한 주사 신호를 상기 게이트 라인에 공급하는 게이트 구동회로와, 각 화소에 대한 데이터 신호를 상기 데이터 라인에 공급하는 데이터 구동회로를 구비하고,상기 게이트 구동회로 및 상기 데이터 구동회로 중, 적어도 일방의 구동회로는,복수단으로 이루어지는 플립플롭을 구비하고, 최종단의 플립플롭의 리세트와 최종단보다 하나 전단의 플립플롭의 리세트를, 최종단의 플립플롭으로부터의 출력신호를 각 플립플롭에 입력함으로써 행하는 시프트 레지스터에 있어서, 상기 최종단의 플립플롭의 리세트가, 최종단보다 하나 전단의 플립플롭의 리세트와 동시, 또는 최종단보다 하나 전단의 플립플롭의 리세트보다 후에 행해지고, 최종단의 플립플롭에 있어서의 상기 출력신호의 출력단자와, 최종단의 플립플롭에 있어서의 상기 출력신호의 입력단자를 접속하는 배선에는, 상기 출력신호의 상기 입력단자로의 입력을 지연시키는 지연 수단을 구비하고 있는 시프트 레지스터를 포함하는 표시장치.
- 삭제
- 제45항에 있어서, 상기 지연 수단은 CMOS 인버터이고, 상기 CMOS 인버터에 있어서의 트랜지스터의 채널 폭 및 채널 길이 중, 적어도 어느 하나에 기초하여, 지연 시간을 설정하는 표시장치.
- 제45항에 있어서, 상기 지연 수단은 배선 용량이고, 상기 배선 용량의 값에 기초하여 지연 시간을 설정하는 표시장치.
- 제45항에 있어서, 상기 지연 수단은 배선 저항이고, 상기 배선 저항의 값에 기초하여 지연 시간을 설정하는 표시장치.
- 제45항에 있어서, 상기 복수단으로 이루어지는 플립플롭 중, 최종단의 플립플롭을 제외한 플립플롭의 리세트는, 각각의 다음 단의 플립플롭으로부터의 출력신호가 입력됨으로써 행해지는 표시장치.
- 제45항에 있어서, 상기 양 구동회로 중 적어도 일방의 구동회로, 및 상기 스위칭 소자는, 동일 기판상에 형성되어 있는 표시장치.
- 제51항에 있어서, 상기 기판은, 유리로 이루어지는 유리 기판인 표시장치.
- 제45항에 있어서, 상기 스위칭 소자는, 다결정 실리콘으로 이루어지는 표시장치.
- 제45항에 있어서, 상기 스위칭 소자는, 600℃ 이하의 프로세스 온도에서 형성되는 표시장치.
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