JPWO2006126460A1 - アクティブマトリクス基板、表示装置および画素欠陥修正方法 - Google Patents
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Abstract
Description
1a 副画素電極
1b 副画素電極
2 走査信号線
3 データ信号線
4,4a,4b アクティブ素子(TFT)
5 ゲート電極
6 ソース電極(低抵抗半導体層)
6a,6b,16a,16b ドレイン電極(低抵抗半導体層)
7a,7b,7c ドレイン引出し配線分岐部(第1導電層)
7d ドレイン引出し配線共通部(第1導電層)
8 コンタクトホール
9 修正用接続電極(第2導電層)
9a 電極(修正用電極(第2導電層)含む)
11 ゲート絶縁膜(絶縁層)
21 保持容量上電極
22 保持容量配線(保持容量配線用導電層)
30 電極スリット
83 除去部
84 遮光膜
95 迂回経路
96a レーザ照射箇所(導通部)
97a,97b レーザ照射箇所(切断箇所)
99 欠陥
100 アクティブマトリクス基板
500 Y/C分離回路
501 ビデオクロマ回路
502 A/Dコンバータ
503 液晶コントローラ
504 液晶パネル
505 蛍光管駆動回路
506 バックライト
507 マイコン
508 階調回路
600 チューナ部
501 表示装置
〔実施形態1〕
本発明の実施の一形態である実施形態1について、図1から図7に基づいて以下に説明する。図1から図3は、実施形態1のアクティブマトリクス基板100の一画素の構成を示す平面模式図である。そして、図1は画素欠陥修正が施されない画素の構成、図2,3は画素欠陥修正が施された画素の構成を示すものである。また、図4は図1のA1−A2断面構成、図5は図1のB1−B2断面構成を示す。図6は本実施形態のアクティブマトリクス基板を用いた表示装置の構成、図7には図6の表示装置を用いたテレビジョン受像機の構成を示す。
〔実施形態2〕
本発明の実施の一形態である実施形態2について、図8から図10に基づいて以下に説明する。図8から図10は、実施形態2のアクティブマトリクス基板100の一画素の構成を示す平面模式図である。そして、図8は画素欠陥修正が施されない画素の構成、図9、10は画素欠陥修正が施された画素の構成を示すものである。
〔実施形態3〕
本発明の実施の一形態である実施形態3について、図11から図14に基づいて以下に説明する。図11から図14は、実施形態3のアクティブマトリクス基板100の一画素の構成を示す平面模式図である。そして、図11は画素欠陥修正が施されない画素の構成、図12,13及び14は画素欠陥修正が施された画素の構成を示すものである。図11から図14に示す構成では、1つのTFTに二つのソース電極6a、6b及び三つのドレイン電極16a、16b、16cを備えており、ソース電極6aに対しては二つのドレイン電極16a、16bが、ソース電極6bに対しては二つのドレイン電極16b、16cが対応している。
〔実施形態4〕
本発明の実施の一形態である実施形態4について、図15から図17に基づいて以下に説明する。図15は、実施形態4のアクティブマトリクス基板100の一画素の構成の平面模式図である。そして図15は画素欠陥修正が施されていない画素の構成、図16及び図17は画素欠陥修正が施された画素の構成を示すものである。
〔実施形態5〕
本発明の実施のその他の形態である実施形態5について、図19から図24に基づいて以下に説明する。なお、説明の便宜上、前述の実施の形態1〜5で用いた部材と同じ機能を有する部材には同じ符号を付して説明を省略する。
〔実施形態6〕
本発明の実施のその他の形態である実施形態6について、図25から図29に基づいて以下に説明する。なお、説明の便宜上、前述の実施の形態1〜6で用いた部材と同じ機能を有する部材には同じ符号を付して説明を省略する。
〔実施形態7〕
本発明の実施のその他の形態である実施形態7について、図30に基づいて以下に説明する。なお、説明の便宜上、前述の実施の形態1〜6で用いた部材と同じ機能を有する部材には同じ符号を付して説明を省略する。
Claims (30)
- アクティブ素子が、少なくとも1つ以上のソース電極と2つ以上のドレイン電極とを備えて2つ以上のチャネルを有し、
前記2つ以上のドレイン電極の少なくとも1つが配線部を介して画素電極と電気的に接続され、
前記配線部が、画素電極に繋がる共通部及び該共通部から前記2つ以上のドレイン電極のそれぞれに対応して分岐した分岐部を含む第1導電パターン部を備え、
さらに、絶縁層を介して前記第1導電パターン部の分岐部と重なる部分を有すると共に、前記絶縁層を貫通させて導通することにより前記分岐部の複数と電気的接続が可能な第2導電パターン部が設けられたこと特徴とするアクティブマトリクス基板。 - 前記ソース電極の1つに対して前記ドレイン電極が複数備えられていることを特徴とする請求項1に記載のアクティブマトリクス基板。
- 前記ドレイン電極の1つに対して前記ソース電極が複数備えられていることを特徴とする請求項1に記載のアクティブマトリクス基板。
- 前記第2導電パターン部は、少なくとも1つの導電層から前記アクティブ素子のゲート電極用導電層を電気的に分離して形成されたことを特徴する請求項1に記載のアクティブマトリクス基板。
- 前記第2導電パターン部は、少なくとも1つの導電層から保持容量配線用導電層を電気的に分離可能なようにして形成されたことを特徴する請求項1に記載のアクティブマトリクス基板。
- 前記第2導電パターン部は、アクティブ素子1つに対して複数設けられていることを特徴とする請求項1に記載のアクティブマトリクス基板。
- アクティブ素子1つに対して前記ドレイン電極が3つ以上設けられると共に、各ドレイン電極に対応して前記分岐部が3つ以上設けられており、
前記複数の第2導電パターン部が、全ての前記分岐部と電気的接続が可能に設けられた第2導電パターンA部と、2つ以上の前記分岐部と電気的接続が可能に設けられた第2導電パターンB部とを含むことを特徴とする請求項6に記載のアクティブマトリクス基板。 - 前記第2導電パターンB部は、前記第1導電パターン部における線長が最も長い分岐部と重なる部分を有し、該線長が最も長い分岐部を他の分岐部に電気的接続し得るように設けられていることを特徴とする請求項7に記載のアクティブマトリクス基板。
- 画素が複数の副画素から構成され、該複数の副画素の各々のアクティブ素子に対して前記第2導電パターン部を備えたことを特徴とする請求項1に記載のアクティブマトリクス基板。
- 前記複数の副画素のうちの少なくとも2つは輝度が互いに異なることを特徴とする請求項9に記載のアクティブマトリクス基板。
- 前記第2導電パターン部が絶縁層を介して第1導電パターン部の分岐部と重なる部分の領域の面積が25μm2以上であることを特徴とする請求項1に記載のアクティブマトリクス基板。
- 前記第2導電パターン部は、Al、Cr、Ta、Ti、W、Mo及びCuからなる群より選択される少なくとも1種を含む材料により形成されたものであることを特徴とする請求項1に記載のアクティブマトリクス基板。
- 前記第2導電パターン部は、液晶分子の配向制御用突起又は電極スリットと重なる部分を有することを特徴とする請求項1に記載のアクティブマトリクス基板。
- 前記画素電極は、画素電極材料が除去された除去部を備え、
該除去部は、前記分岐部と重なる部分を有することを特徴とする請求項1に記載のアクティブマトリクス基板。 - 前記除去部は、前記第2導電パターン部の配置位置に対応して設けられていることを特徴とする請求項14に記載のアクティブマトリクス基板。
- 前記除去部は、前記分岐部を切断する際の切断位置に対応して設けられていることを特徴とする請求項14に記載のアクティブマトリクス基板。
- 前記除去部は、前記第2導電パターン部の配置位置及び前記分岐部を切断する際の切断位置に対応して設けられていることを特徴とする請求項14に記載のアクティブマトリクス基板。
- 前記除去部は、前記画素電極に形成された液晶分子の配向制御用電極スリットの一部であることを特徴とする請求項14に記載のアクティブマトリクス基板。
- 前記除去部を遮光する遮光膜を備えることを特徴とする請求項14に記載のアクティブマトリクス基板。
- 請求項1に記載のアクティブマトリクス基板を備えてなることを特徴とする表示装置。
- 請求項14に記載のアクティブマトリクス基板を備えると共に、該アクティブマトリクス基板における前記除去部を遮光する遮光膜を備えることを特徴とする表示装置。
- 請求項20又は21に記載の表示装置と、テレビジョン放送を受信するチューナ部とを備えたテレビジョン受像機。
- アクティブ素子が、少なくとも1つ以上のソース電極と2つ以上のドレイン電極とを備えて2つ以上のチャネルを有し、前記2つ以上のドレイン電極の少なくとも1つが配線部を介して画素電極と電気的に接続され、前記配線部が、画素電極に繋がる共通部及び該共通部から前記2つ以上のドレイン電極のそれぞれに対応して分岐した分岐部を含む第1導電パターン部を備え、さらに、絶縁層を介して前記第1導電パターン部の分岐部と重なる部分を有すると共に、前記絶縁層を貫通させて導通することにより前記分岐部の複数と電気的接続が可能な第2導電パターン部が設けられたアクティブマトリクス基板の画素欠陥修正方法であって、
画素欠陥のある画素について、前記複数の分岐部のうちの少なくも1つを、前記第2導電パターン部が重なる部分と前記共通部との間で切断することを特徴とする画素欠陥修正方法。 - 前記分岐部の切断により画素欠陥が修正されなければ、前記切断された分岐部の切断箇所よりドレイン電極側と前記共通部とを電気的接続するように、前記絶縁層を貫通して前記第2導電パターン部を導通させて前記切断された分岐部と他の分岐部とを電気的接続し、かつ前記切断された分岐部以外の他の分岐部のうちの少なくとも1つを切断することを特徴とする請求項23に記載の画素欠陥修正方法。
- アクティブ素子が、少なくとも1つ以上のソース電極と2つ以上のドレイン電極とを備えて2つ以上のチャネルを有し、前記2つ以上のドレイン電極の少なくとも1つが配線部を介して画素電極と電気的に接続され、前記配線部が、画素電極に繋がる共通部及び該共通部から前記2つ以上のドレイン電極のそれぞれに対応して分岐した分岐部を含む第1導電パターン部を備え、さらに、絶縁層を介して前記第1導電パターン部の分岐部と重なる部分を有すると共に、前記絶縁層を貫通させて導通することにより前記分岐部の複数と電気的接続が可能な第2導電パターン部が設けられたアクティブマトリクス基板の画素欠陥修正方法であって、
画素欠陥のある画素について、前記複数の分岐部のうちの1つを、前記第2導電パターン部が重なる部分と前記共通部との間で切断する第1ステップと、
前記分岐部の切断により画素欠陥が修正されたか否かを検査する第2ステップと、
前記分岐部の切断により画素欠陥が修正されていなければ、前記絶縁層を貫通して前記第2導電パターン部を前記切断された分岐部と他の分岐部とに導通させて、前記切断された分岐部の切断箇所よりドレイン電極側と前記共通部とを電気的に接続させる一方、前記切断された分岐部以外の他の分岐部を1つ切断する第3ステップとを有し、
第2ステップにて画素欠陥が修正されたことが検出されるまで、前記第2〜第3のステップを繰り返すことを特徴とするアクティブマトリクス基板の画素欠陥修正方法。 - 前記絶縁層を貫通して前記第2導電パターン部を導通させるのに、前記第2導電パターン部と前記第1導電パターン部の分岐部とが重なる領域にレーザ照射して、前記第2導電パターン部か前記分岐部かの少なくとも何れか一方を溶融することを特徴とする請求項23、24又は25に記載の画素欠陥修正方法。
- アクティブ素子が、少なくとも1つ以上のソース電極と2つ以上のドレイン電極とを備えて2つ以上のチャネルを有し、前記2つ以上のドレイン電極の少なくとも1つが配線部を介して画素電極と電気的に接続され、前記配線部が、画素電極に繋がる共通部及び該共通部から前記2つ以上のドレイン電極のそれぞれに対応して分岐した分岐部を含む第1導電パターン部を備え、さらに、絶縁層を介して前記第1導電パターン部の分岐部と重なる部分を有すると共に、前記絶縁層を貫通させて導通することにより前記分岐部の複数と電気的接続が可能な第2導電パターン部が設けられたアクティブマトリクス基板の製造方法であって、
画素欠陥のある画素について、前記複数の分岐部のうちの少なくも1つを、前記第2導電パターン部が重なる部分と前記共通部との間で切断して、画素欠陥修正を行うことを特徴とするアクティブマトリクス基板の製造方法。 - アクティブ素子が、少なくとも1つ以上のソース電極と2つ以上のドレイン電極とを備えて2つ以上のチャネルを有し、前記2つ以上のドレイン電極の少なくとも1つが配線部を介して画素電極と電気的に接続され、前記配線部が、画素電極に繋がる共通部及び該共通部から前記2つ以上のドレイン電極のそれぞれに対応して分岐した分岐部を含む第1導電パターン部を備え、さらに、絶縁層を介して前記第1導電パターン部の分岐部と重なる部分を有すると共に、前記絶縁層を貫通させて導通することにより前記分岐部の複数と電気的接続が可能な第2導電パターン部が設けられたアクティブマトリクス基板の製造方法であって、
画素欠陥のある画素を修正する修正ステップを有しており、
該修正ステップにおいては、
画素欠陥のある画素について、前記複数の分岐部のうちの1つを、前記第2導電パターン部が重なる部分と前記共通部との間で切断する第1ステップと、
前記分岐部の切断により画素欠陥が修正されたか否かを検査する第2ステップと、
前記分岐部の切断により画素欠陥が修正されていなければ、前記絶縁層を貫通して前記第2導電パターン部を前記切断された分岐部と他の分岐部とに導通させて、前記切断された分岐部の切断箇所よりドレイン電極側と前記共通部とを電気的に接続させる一方、前記切断された分岐部以外の他の分岐部を1つ切断する第3ステップとを含み、
第2ステップにて画素欠陥が修正されたことが検出されるまで第2〜第3ステップを繰り返すことを特徴とするアクティブマトリクス基板の製造方法。 - 少なくとも1つの導電層から保持容量配線用導電層を電気的に分離して、前記第2導電パターン部を形成するステップを有することを特徴する請求項27又は28に記載のアクティブマトリクス基板の製造方法。
- 請求項23〜26の何れか1項に記載の画素欠陥修正方法又は請求項27〜29の何れか1項に記載のアクティブマトリクス基板の製造方法を用いた表示装置の製造方法。
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