JPS63206028A - Pllシンセサイザ回路 - Google Patents
Pllシンセサイザ回路Info
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- JPS63206028A JPS63206028A JP62038801A JP3880187A JPS63206028A JP S63206028 A JPS63206028 A JP S63206028A JP 62038801 A JP62038801 A JP 62038801A JP 3880187 A JP3880187 A JP 3880187A JP S63206028 A JPS63206028 A JP S63206028A
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- JP
- Japan
- Prior art keywords
- circuit
- buffer amplifier
- output
- reception
- circuits
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- Granted
Links
- 230000010355 oscillation Effects 0.000 claims abstract description 13
- 238000010397 one-hybrid screening Methods 0.000 claims description 2
- 230000005540 biological transmission Effects 0.000 abstract description 15
- 231100000989 no adverse effect Toxicity 0.000 abstract 1
- 230000002238 attenuated effect Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 206010067482 No adverse event Diseases 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02T—CLIMATE CHANGE MITIGATION TECHNOLOGIES RELATED TO TRANSPORTATION
- Y02T10/00—Road transport of goods or passengers
- Y02T10/10—Internal combustion engine [ICE] based vehicles
- Y02T10/12—Improving ICE efficiencies
Landscapes
- Transceivers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
「産業上の利用分野」
本発明は単信方式(プレストーク方式)の無線機におい
て、送信用と受信用の2つの電圧制御発振回路を具備し
たPLLシンセサイザ回路に関するものである。
て、送信用と受信用の2つの電圧制御発振回路を具備し
たPLLシンセサイザ回路に関するものである。
「従来の技術」
従来、この種の回路は第2図に示すように、送信局部発
振用電圧制御発振回路(以下送信用vCOという)(1
)と、受信局部発振用電圧制御発振回路(以下受信用v
COという)(2)とはそれぞれバッファアンプ(3)
(4)を介してアイソレータ(5) (6)に結合さ
れ、さらに、このアイソレータ(5) (6)の出力側
をカプラ(7) (8)によって分岐して、送信側は送
信PLLシンセサイザ出力端子(9)とプリスケーラ(
10)に結合され、受信側は受信PLLシンセサイザ出
力端子(11)と前記プリスケーラ(10)に結合され
、また、このプリスケーラ(10)には位相比較器と可
変分周器を含んだPLL用IC(12)が結合され、こ
のPLL用IC(12)の入力側には分周回路(13)
を介して基準発振回路(14)が結合され、出力側には
切換回路(15)を介して送信用ループフィルタ(16
)と受信用ループフィルタ(17)が結合され、送信用
ループフィルタ(16)は前記送信用vCO(1)に結
合され、受信用ループフィルタ(17)は前記受信用V
CO(2)に結合されて構成されていた。
振用電圧制御発振回路(以下送信用vCOという)(1
)と、受信局部発振用電圧制御発振回路(以下受信用v
COという)(2)とはそれぞれバッファアンプ(3)
(4)を介してアイソレータ(5) (6)に結合さ
れ、さらに、このアイソレータ(5) (6)の出力側
をカプラ(7) (8)によって分岐して、送信側は送
信PLLシンセサイザ出力端子(9)とプリスケーラ(
10)に結合され、受信側は受信PLLシンセサイザ出
力端子(11)と前記プリスケーラ(10)に結合され
、また、このプリスケーラ(10)には位相比較器と可
変分周器を含んだPLL用IC(12)が結合され、こ
のPLL用IC(12)の入力側には分周回路(13)
を介して基準発振回路(14)が結合され、出力側には
切換回路(15)を介して送信用ループフィルタ(16
)と受信用ループフィルタ(17)が結合され、送信用
ループフィルタ(16)は前記送信用vCO(1)に結
合され、受信用ループフィルタ(17)は前記受信用V
CO(2)に結合されて構成されていた。
[発明が解決しようとする問題点」
第2図に示すような従来の回路では、送信用VC○と受
信用vC○との後に、それぞれアイソレータやカプラな
どの特殊な部品を必要として高価になるという問題があ
った。
信用vC○との後に、それぞれアイソレータやカプラな
どの特殊な部品を必要として高価になるという問題があ
った。
r問題点を解決するための手段」
本発明は上述のような問題点を解決するためになされた
もので、プレストーク方式の無線機であって、送信局部
発振用と受信局部発振用の2つの電圧制御発振回路を有
し、1つのPLL用ICで送信と受信の周波数を制御す
るようにしたPLLシンセサイザ回路において、前記2
つの電圧制御発振回路の出力側に、それぞれバッファア
ンプを介して1つのハイブリット回路の入力側に結合し
、このハイブリット回路の出力側をPLLシンセサイザ
出力端子とプリスケーラ入力端子に結合してなるもので
ある。
もので、プレストーク方式の無線機であって、送信局部
発振用と受信局部発振用の2つの電圧制御発振回路を有
し、1つのPLL用ICで送信と受信の周波数を制御す
るようにしたPLLシンセサイザ回路において、前記2
つの電圧制御発振回路の出力側に、それぞれバッファア
ンプを介して1つのハイブリット回路の入力側に結合し
、このハイブリット回路の出力側をPLLシンセサイザ
出力端子とプリスケーラ入力端子に結合してなるもので
ある。
「作用」
ハイブリット回路のすべてのポートがこれに接続されて
いる回路と整合がとれているものとすると、ハイブリッ
ト回路の性質によりバッファアンプの出力は所定値だけ
減衰されて2つのポートに分岐される。分岐された後段
の回路の入力端子で反射した信号は送信時は受信用バッ
ファアンプで、また受信時は送信用バッファアンプで吸
収され、他方のバッファアンプへの反射はなく、電圧制
御発振回路への悪影響を及ぼさない。
いる回路と整合がとれているものとすると、ハイブリッ
ト回路の性質によりバッファアンプの出力は所定値だけ
減衰されて2つのポートに分岐される。分岐された後段
の回路の入力端子で反射した信号は送信時は受信用バッ
ファアンプで、また受信時は送信用バッファアンプで吸
収され、他方のバッファアンプへの反射はなく、電圧制
御発振回路への悪影響を及ぼさない。
「実施例」
以下、本発明の一実施例を図面に基づき説明する。
本発明では、第1図に示すように、第2図の従来回路に
おける2個のアイソレータ(5) (6)と2個のカプ
ラ(7)(8)を省き、ブランチライン形の3dBハイ
ブリット回路(18)を用いたものである。すなわち、
送信用vC○(1)には送信用バッファアンプ(3)を
介して前記ハイブリット回路(18)の一方の入力端子
(19)に結合され、同様に、受信用vCQ(2)には
受信用バッファアンプ(4)を介してハイブリット回路
(18)の他方の入力端子(20)に結合され、このハ
イブリット回路(18)の一方の出力端子(21)は切
換回路(23)の共通端子(24)に結合され。
おける2個のアイソレータ(5) (6)と2個のカプ
ラ(7)(8)を省き、ブランチライン形の3dBハイ
ブリット回路(18)を用いたものである。すなわち、
送信用vC○(1)には送信用バッファアンプ(3)を
介して前記ハイブリット回路(18)の一方の入力端子
(19)に結合され、同様に、受信用vCQ(2)には
受信用バッファアンプ(4)を介してハイブリット回路
(18)の他方の入力端子(20)に結合され、このハ
イブリット回路(18)の一方の出力端子(21)は切
換回路(23)の共通端子(24)に結合され。
他方の出力端子(22)はプリスケーラ(10)に結合
される。前記切換回路(23)は切換回路(15)と連
動して切換えられる。その他の構成は第2図の従来回路
と変りはない。
される。前記切換回路(23)は切換回路(15)と連
動して切換えられる。その他の構成は第2図の従来回路
と変りはない。
以上のような構成において、送信時には切換回路(23
) (15)を送信側へ切換える。
) (15)を送信側へ切換える。
ここで、3dBハイブリット回路(18)のすべての入
出力端子(19) (20) (21) (22)が、
これらに接続されている回路(3) (4) (23)
(10)と整合がとれていると、3dBハイブリット
回路(18)の性質上、送信用バッファアンプ(3)の
出力は3dBの減衰をもって2つの出力端子(21)
(22)に分岐される6分岐された後の回路(23)
(10)の入力端子で反射した信号は受信局バッファア
ンプ(4)の出力整合回路で吸収させるので、送信用バ
ッファアンプ(3)への反射はなく、送信用と受信用の
2つのV CO(1) (2)への悪影響を及ぼさない
。
出力端子(19) (20) (21) (22)が、
これらに接続されている回路(3) (4) (23)
(10)と整合がとれていると、3dBハイブリット
回路(18)の性質上、送信用バッファアンプ(3)の
出力は3dBの減衰をもって2つの出力端子(21)
(22)に分岐される6分岐された後の回路(23)
(10)の入力端子で反射した信号は受信局バッファア
ンプ(4)の出力整合回路で吸収させるので、送信用バ
ッファアンプ(3)への反射はなく、送信用と受信用の
2つのV CO(1) (2)への悪影響を及ぼさない
。
受信時には切換回路(23) (15)を受信側へ切換
えることにより送信時と略同様の動作をなす。なお、送
信時には送信用V CO(1)が動作して、受信用v
c O(2)は発振を停止し、また、受信時には受信用
V CO(2)が動作シテ、送信用V CO(1)は発
振を停止する。また、2つのバッファアンプ(3)(4
)は常時動作している。
えることにより送信時と略同様の動作をなす。なお、送
信時には送信用V CO(1)が動作して、受信用v
c O(2)は発振を停止し、また、受信時には受信用
V CO(2)が動作シテ、送信用V CO(1)は発
振を停止する。また、2つのバッファアンプ(3)(4
)は常時動作している。
「発明の効果」
本発明は上述のように構成したので、ハイブリット回路
によってアイソレータとカプラの働きを代用でき、極め
て安価に提供できるものである。
によってアイソレータとカプラの働きを代用でき、極め
て安価に提供できるものである。
第1図は本発明によるPLLシンセサイザ回路の一実施
例を示す電気回路図、第2図は従来の回路図である。 (1)−・・送信用VCO1(2)・・・受信用VCO
1(3)・・・送信用バッファアンプ、(4)・・・受
信用バッファアンプ、(9)・・・送信用出力端子、
(10)・・・プリスケーラ、 (11)・・・受信用
出力端子、(12)・・・PLL用IC1(13)・・
・分周回路、 (14)・・・基準発振回路、 (15
)・・・切換回路、(16)・・・送信用ループフィル
タ、(17)・・・受信用ループフィルタ、(18)・
・・3dBハイブリット回路、 (19)(20)・・
・入力端子、(21) <22)・・・出力端子、(2
3)・・・切換回路、 (24)・・・共通端子。 出願人 株式会社富士通ゼネラル !!15!J フ1 第 2 図
例を示す電気回路図、第2図は従来の回路図である。 (1)−・・送信用VCO1(2)・・・受信用VCO
1(3)・・・送信用バッファアンプ、(4)・・・受
信用バッファアンプ、(9)・・・送信用出力端子、
(10)・・・プリスケーラ、 (11)・・・受信用
出力端子、(12)・・・PLL用IC1(13)・・
・分周回路、 (14)・・・基準発振回路、 (15
)・・・切換回路、(16)・・・送信用ループフィル
タ、(17)・・・受信用ループフィルタ、(18)・
・・3dBハイブリット回路、 (19)(20)・・
・入力端子、(21) <22)・・・出力端子、(2
3)・・・切換回路、 (24)・・・共通端子。 出願人 株式会社富士通ゼネラル !!15!J フ1 第 2 図
Claims (2)
- (1)プレストーク方式の無線機であって、送信局部発
振用と受信局部発振用の2つの電圧制御発振回路を有し
、1つのPLL用ICで送信と受信の周波数を制御する
ようにしたPLLシンセサイザ回路において、前記2つ
の電圧制御発振回路の出力側に、それぞれバッファアン
プを介して1つのハイブリット回路の入力側に結合し、
このハイブリット回路の出力側をPLLシンセサイザ出
力端子とプリスケーラ入力端子に結合してなることを特
徴とするPLLシンセサイザ回路。 - (2)ハイブリット回路は3dB減衰のブランチライン
形からなる特許請求の範囲第1項記載のPLLシンセサ
イザ回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62038801A JPS63206028A (ja) | 1987-02-20 | 1987-02-20 | Pllシンセサイザ回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62038801A JPS63206028A (ja) | 1987-02-20 | 1987-02-20 | Pllシンセサイザ回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63206028A true JPS63206028A (ja) | 1988-08-25 |
JPH0551212B2 JPH0551212B2 (ja) | 1993-08-02 |
Family
ID=12535396
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62038801A Granted JPS63206028A (ja) | 1987-02-20 | 1987-02-20 | Pllシンセサイザ回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63206028A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011082857A (ja) * | 2009-10-08 | 2011-04-21 | Japan Radio Co Ltd | インピーダンス整合回路 |
JP5234006B2 (ja) * | 2007-11-21 | 2013-07-10 | 富士通株式会社 | 電力増幅器 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62186621A (ja) * | 1986-02-12 | 1987-08-15 | Hitachi Ltd | 衛星通信用局部発振装置 |
-
1987
- 1987-02-20 JP JP62038801A patent/JPS63206028A/ja active Granted
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62186621A (ja) * | 1986-02-12 | 1987-08-15 | Hitachi Ltd | 衛星通信用局部発振装置 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5234006B2 (ja) * | 2007-11-21 | 2013-07-10 | 富士通株式会社 | 電力増幅器 |
JP2011082857A (ja) * | 2009-10-08 | 2011-04-21 | Japan Radio Co Ltd | インピーダンス整合回路 |
Also Published As
Publication number | Publication date |
---|---|
JPH0551212B2 (ja) | 1993-08-02 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |