JPS62293991A - Protective method of inverter apparatus - Google Patents
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Abstract
Description
【発明の詳細な説明】
３、発明の詳細な説明
〔発明の目的〕
（産業上の利用分野）
本発明は、複数台のインバータ装置を並列運転して交流
電動機群を駆動するシステムに関するもので、特にイン
バータ装置の並列冗長発振器系が異常時の保護方法の改
良を図った並列運転されるインバータ装置の保護方法に
関するものである。[Detailed Description of the Invention] 3. Detailed Description of the Invention [Object of the Invention] (Field of Industrial Application) The present invention relates to a system for driving a group of AC motors by operating a plurality of inverter devices in parallel. In particular, the present invention relates to a method for protecting inverter devices operated in parallel, which improves the method for protecting the parallel redundant oscillator system of the inverter device when an abnormality occurs.
（従来の技術）
インバータ装置を用いた大容量電源システムでは、シス
テム・ダウンの事故を防止し、システムとしての信頼性
を向上させる目的で、複数台のインバータ装置を並列接
続して、任意のインバータ装置の故障時にこの故障した
インバータ装置を並列母線から切離し、他の健全なイン
バータ装置によって負荷に安定な電力を供給し、復旧し
たインバータ装置は再びシステムに投入できるように配
慮されている場合が多い。(Prior art) In large-capacity power supply systems using inverters, multiple inverters are connected in parallel to prevent system down accidents and improve system reliability. In many cases, when a device fails, the failed inverter device is disconnected from the parallel bus, other healthy inverters are used to supply stable power to the load, and the recovered inverter device can be reintroduced to the system. .
このインバータの並列運転制御のためには共通な基準パ
ルスが必要である。この基準パルスは、並列接続される
全てのインバータ装置に対して共通に設けられた発振器
（共通発振器と称す）、あるいは各インバータ装置に個
別に設けられ、互いに冗長性を有する発振器（個別冗長
発振器と称す）の出力から得られるものであり、この発
振器の基準パルスの授受が並列運転システムの信頼性を
決定する要因の１つとなっている。A common reference pulse is required to control the parallel operation of the inverters. This reference pulse is generated by an oscillator that is provided in common for all inverter devices connected in parallel (referred to as a common oscillator), or an oscillator that is provided individually for each inverter device and has mutual redundancy (referred to as an individual redundant oscillator). The transmission and reception of the reference pulse from this oscillator is one of the factors that determines the reliability of the parallel operation system.
システムの信頼性の面から考えて、共通部分のない個別
冗長発振器方式が信頼性が高い。個別冗長発振器方式に
ついて、第５図の２台の並列運転の場合のブロック図を
用いて説明する。同図において、発振回路ＩＡ、ＩＢか
ら構成され、この発振回路ＩＡ、１Ｂの出力を結んだ信
号線（以下コモンバスと称する）より並列運転される各
インバータ装置に周波数基準のパルスが与えられている
。From the standpoint of system reliability, an individual redundant oscillator system with no common parts is highly reliable. The individual redundant oscillator system will be explained using the block diagram of FIG. 5 in which two oscillators are operated in parallel. In the figure, a frequency-based pulse is given to each inverter device operated in parallel, which is composed of oscillation circuits IA and IB, and is connected to a signal line (hereinafter referred to as a common bus) connecting the outputs of oscillation circuits IA and 1B. .
発振回路ＩＡ、ＩＢは各回路量じ構成なので、以下発振
回路ＩＡを代表して説明する。１１Ａは発振回路ＩＡの
出力する周波数基準のパルスを決定する発振器、１２Ａ
は発振器ｌＩＡの出力を分周する分周器、１３Ａ、１４
Ａは入力が入る（入力が１゛０′″から′１″へ変化す
る）毎に一定幅の出力パルスを発生する単安定マルチバ
イブレータ、１５Ａはアンドゲート回路、１６Ａは、単
安定マルチバイブレータ１３Ａの発生するパルスをコモ
ンバスに送り出すライントライバ、１７Ａはコモンバス
上の信号パルスを受けて単安定マルチバイブレータ１４
Ａにトリガパルスを与えるラインレシーバである。Since the oscillation circuits IA and IB have the same circuit configuration, the oscillation circuit IA will be explained below as a representative. 11A is an oscillator that determines the frequency reference pulse output from the oscillation circuit IA; 12A;
are frequency dividers that divide the output of the oscillator lIA, 13A, 14
A is a monostable multivibrator that generates an output pulse of a constant width every time an input is input (the input changes from 1゛0'' to '1''), 15A is an AND gate circuit, 16A is a monostable multivibrator 13A A line driver 17A sends the pulses generated by
It is a line receiver that provides a trigger pulse to A.
次に、上記構成装置の動作を説明する。第６図は第５図
の実施例の各部に対応するタイムチャートである。ここ
で述べる個別冗長発信器方式は、最も発振周波数の高い
発振器の出力パルスに他の発振器を同期させる方式であ
る。第５図においては、発振器１１Ａの出力パルスＣＰ
Ａが、発振器１１Ｂの出力パルスＣＰＢよりも発振周波
数が高く、コモンバス上の信号Ｃｓは見掛は上発振器１
１Ａが出力パルスに同期して動作している。Next, the operation of the above-mentioned component device will be explained. FIG. 6 is a time chart corresponding to each part of the embodiment shown in FIG. The individual redundant oscillator system described here is a system in which other oscillators are synchronized with the output pulse of the oscillator with the highest oscillation frequency. In FIG. 5, the output pulse CP of the oscillator 11A
A has a higher oscillation frequency than the output pulse CPB of the oscillator 11B, and the signal Cs on the common bus appears to be the upper oscillator 1.
1A is operating in synchronization with the output pulse.
その動作の詳細について第６図のタイムチャートを用い
て説明する。まず、分周器１２Ａは第６図の如く発振器
１１Ａの出力パルスをＮ個カウントすることにより、出
力が′０″′から“１″へ変化する６その分周出力１２
Ａ Ｐは単安定マルチバイブレータ１３Ａに与えられＤ
ＰＡの様に所定幅のパルスに変換されて、ライントライ
バ１６Ａを通してコモンバス上に信号Ｃｓとして送られ
る。同時に、コモンバス上の信号ＣｓはＲＰＡの如くラ
インレシーバ１７Ａを通じて単安定マルチバイブレータ
１４Ａに与えられ、所定幅のパルスに変換されて、アン
ド回路１５Ａに入力される。アンド回路１５Ａは、単安
定マルチバイブレータ１３Ａの反転出力出力−の−と、
１４Ａの非反転出力Ｑのアンドをとっているので。The details of the operation will be explained using the time chart of FIG. First, the frequency divider 12A changes its output from ``0'' to ``1'' by counting N output pulses from the oscillator 11A as shown in FIG.
A P is given to the monostable multivibrator 13A and D
It is converted into a pulse of a predetermined width like PA and sent as a signal Cs onto the common bus through the line driver 16A. At the same time, the signal Cs on the common bus is applied to a monostable multivibrator 14A through a line receiver 17A such as an RPA, converted into a pulse of a predetermined width, and inputted to an AND circuit 15A. The AND circuit 15A connects the inverted output output - of the monostable multivibrator 13A, and
This is because the AND of the non-inverted output Q of 14A is taken.
分周器１２Ａに対しては、発振器ｌＩＡのパルスをＮ個
カウントアツプした信号が与えられる。一方発振器の発
振周波数の低い方の分周器１２Ｂに対しては、コモンバ
ス上の信号Ｃｓがリセット信号として与えられる。分周
器１２Ｂの出力は入力クロックのＣＰＢがカウトアップ
する前にリセットされるので第６図のように原理上出力
１２ＢＰにパルスは現われない。A signal obtained by counting up N pulses from the oscillator IIA is applied to the frequency divider 12A. On the other hand, the signal Cs on the common bus is given as a reset signal to the frequency divider 12B whose oscillation frequency is lower. Since the output of the frequency divider 12B is reset before the input clock CPB counts up, in principle no pulse will appear at the output 12BP as shown in FIG.
各インバータ装置は、ラインレシーバ１７Ａ、 １７Ｂ
の出力信号を基準パルスとするので、見掛は上。Each inverter device has line receivers 17A and 17B.
Since the output signal of is used as the reference pulse, the appearance is above.
コモンバス上の、信号に同期した、共通の基準パルスが
与えられる。今、発振周波数の高い発憾器ｌＩＡがダウ
ンした場合にも発振器１１Ｂが健全であれば、分周器１
２Ｂがカウントアツプ動作を行なうようになり、コモン
バス上の信号Ｏ８には発振器１１Ｂに同期した信号が得
られ、コモンバス信号は欠相することなく、各インバー
タ装置には、基準パルスが供給され続ける。発振器１１
Ａ、ＩＩＢには水晶発振器が用いられることが多く、き
わめて高精度、高信頼性の個別冗長発振器システムを実
現することができる。A common reference pulse is provided, synchronized to the signal, on the common bus. Now, if oscillator 11B is healthy even if oscillator lIA with a high oscillation frequency goes down, frequency divider 1
2B starts to perform a count-up operation, a signal synchronized with the oscillator 11B is obtained as the signal O8 on the common bus, and the reference pulse continues to be supplied to each inverter device without phase loss of the common bus signal. Oscillator 11
Crystal oscillators are often used for A and IIB, and it is possible to realize an individual redundant oscillator system with extremely high accuracy and reliability.
（発明が解決しようとする問題点）
ところで、本個別冗長発振器システムを用いたインバー
タ装置の並列運転した電源システムの負荷が電動機で、
しかも慣性が大きい場合には負荷への給電を必ずしも継
続しつづける必要がない場合がある。たとえばヒステリ
シス電動機を高周波数で駆動するシステムでは電動機の
慣性が非常に大きく数１０秒〜１分程度、給電を停止し
ても速度の低下が１％以内で電動機の運転システム上、
全く問題にならない場合がある。逆にこのようなシステ
ムでは、速度の上昇に対し電動機の機械的強度上の問題
から、インバータ装置の出力周波数が上昇した時の保護
を負荷側の条件から要求されることがある。このような
シテスムに前記個別冗長発振器システムを適用した場合
、周波数保護を行なうためには、発振器の出力周波数を
監視する機能を設け、発振器の周波数が上限を超えた場
合には、その発振器を切離してシテスムの運転を継続す
ることとなる。ところが、前記個別冗長発振器システム
では、インバータ装置の出力周波数は、最も発振周波数
の高い発振器で決定されており、周波数異常にて最も周
波数の高い発振器が切離されると、次に発振周波数の高
い発振器に切換り、その際に出力周波数の低下を生じせ
しめることになる。周波数異常検出精度はきびしく、出
力周波数の低下はきわめてわずかであるが、負荷の電動
機の慣性及び回転数が大きく、多数台ある場合には、負
荷電動機の回転数がインバータ装置の出力周波数より高
くなった時電力が回生される可能性があり、回生電力に
より各インバータ装置の直流電圧が上って並列システム
がダウンする危険性がある。(Problems to be Solved by the Invention) By the way, if the load of the power supply system in which the inverter device using the present individual redundant oscillator system is operated in parallel is an electric motor,
Furthermore, if the inertia is large, it may not necessarily be necessary to continue supplying power to the load. For example, in a system that drives a hysteresis motor at a high frequency, the inertia of the motor is extremely large, and even if the power supply is stopped, the speed decreases by less than 1%.
It may not be a problem at all. Conversely, in such a system, due to mechanical strength problems of the electric motor as the speed increases, protection may be required from load side conditions when the output frequency of the inverter device increases. When the individual redundant oscillator system described above is applied to such a system, in order to perform frequency protection, a function is provided to monitor the output frequency of the oscillator, and when the frequency of the oscillator exceeds the upper limit, the oscillator is disconnected. The system will continue to operate. However, in the individual redundant oscillator system, the output frequency of the inverter device is determined by the oscillator with the highest oscillation frequency, and when the oscillator with the highest frequency is disconnected due to a frequency abnormality, the output frequency of the inverter device is determined by the oscillator with the next highest oscillation frequency. , which causes a decrease in the output frequency. The frequency abnormality detection accuracy is strict, and the drop in the output frequency is extremely small, but the inertia and rotational speed of the load motor are large, and if there are many motors, the rotational speed of the load motor may become higher than the output frequency of the inverter. There is a risk that the regenerated power will cause the DC voltage of each inverter device to rise, causing the parallel system to go down.
（問題点を解決するための手段及び作用）本発明は前述
の点に鑑みなされたもので、慣性の大きい交流電動機群
を複数のインバータ装置で並列運転したシテスムにおい
て、その出力周波数が上昇する異常が発生した時に、全
てのインバータ装置を一旦解列し、交流電動機の回転数
低下を確認後再びインバータ装置にて給電することによ
り、システムダウンを招くことなく、異常発振器を安全
に切離して、再び負荷に電力を供給できる。(Means and effects for solving the problem) The present invention has been made in view of the above-mentioned points, and is an abnormality in which the output frequency increases in a system in which a group of AC motors with large inertia are operated in parallel with a plurality of inverter devices. When a problem occurs, all inverters are disconnected once, and after confirming that the rotational speed of the AC motor has decreased, the inverter is used again to supply power. This allows the abnormal oscillator to be safely disconnected and restarted without causing a system down. Can supply power to the load.
個別冗長発振器を用いたインバータ装置の周波数異常保
護方式を提供するものである。This invention provides a frequency abnormality protection method for an inverter device using individual redundant oscillators.
（実 施 例）
以下、本技術に係る複数台のインバータを並列運転する
システムの一例を第１図〜第４図を用いて説明する。(Embodiment) Hereinafter, an example of a system for operating a plurality of inverters in parallel according to the present technology will be described using FIGS. 1 to 4.
第１図〜第３図において、第５図および第６図と同一要
素は同一符号を付して省略する。In FIGS. 1 to 3, the same elements as those in FIGS. 5 and 6 are given the same reference numerals and omitted.
２Ａは開閉器３Ａは整流器４Ａは平滑フィルタ５Ａはイ
ンバータ回路、６Ａは半導体しゃ断器。2A is a switch 3A, a rectifier 4A, a smoothing filter 5A is an inverter circuit, and 6A is a semiconductor breaker.
７はコンタクト、８は負荷電動機である。９Ａは半導体
しゃ断器制御回路、１０はコンタクタ制御回路、２０は
回転数検出回路、２１Ａは分周器、２２Ａはゲートアン
プ回路である９１８Ａは周波数異常保護回路であり、そ
の内部ブロック図は第２図に記されている。２３Ａは周
波数異常検出回路、２４Ａは単安定マルチバイブレータ
、２５Ａはライントライバ。7 is a contact, and 8 is a load motor. 9A is a semiconductor breaker control circuit, 10 is a contactor control circuit, 20 is a rotation speed detection circuit, 21A is a frequency divider, 22A is a gate amplifier circuit, 918A is a frequency abnormality protection circuit, and its internal block diagram is shown in the second figure. It is marked in the figure. 23A is a frequency abnormality detection circuit, 24A is a monostable multivibrator, and 25A is a line driver.
２６Ａはラインレシーバ−である。また、発振回路ＩＡ
において発振器１１Ａの出力にスイッチ回路１９Ａを追
加している。26A is a line receiver. In addition, the oscillation circuit IA
A switch circuit 19A is added to the output of the oscillator 11A.
第１図は本技術の動作を説明する２台のインバータを並
列運転するシステム図で、第２図はその周波数制御ブロ
ック図、第３図はそのタイムチャートである。FIG. 1 is a system diagram for operating two inverters in parallel to explain the operation of the present technology, FIG. 2 is a frequency control block diagram thereof, and FIG. 3 is a time chart thereof.
インバータは入力の開閉器２Ａ、整流器３Ａにより交流
電圧を直流に変換した後に、さらに平滑回路４Ａ、イン
バータ回路５Ａを通して再び交流に変換し、半導体しゃ
断器６Ａ、コンタクタ７を介して負荷電動機８に電力を
供給する。The inverter converts AC voltage into DC using an input switch 2A and a rectifier 3A, then converts it back into AC through a smoothing circuit 4A and an inverter circuit 5A, and supplies power to a load motor 8 via a semiconductor breaker 6A and a contactor 7. supply.
ＩＡは従来技術で説明した個別冗長の発振回路で、他の
インバータとコモンバスを通じて周波数信号のやり取り
を行なう。発振回路ＩＡより出力されるクロックパルス
信号は分周器２１Ａ、ゲートアンプ２２Ａを通してイン
バータにゲート信号を供給する。The IA is the individual redundant oscillation circuit described in the prior art section, and exchanges frequency signals with other inverters via a common bus. The clock pulse signal output from the oscillation circuit IA supplies a gate signal to the inverter through a frequency divider 21A and a gate amplifier 22A.
第１図においても、発振器１１Ａの出力パルスＣＰＡの
周波数が発振器１１Ｂの周波数よりも高く。Also in FIG. 1, the frequency of the output pulse CPA of the oscillator 11A is higher than the frequency of the oscillator 11B.
コモンバス信号Ｃｓは発振器１１Ａから得られる信号に
同期しているものとする。It is assumed that the common bus signal Cs is synchronized with the signal obtained from the oscillator 11A.
発振器１１Ａの出力パルスＩＩＡの周波数が所定値より
上昇したことを周波数異常検出回路２３Ａで検出すると
半導体しゃ断器制御回路９Ａにオフ指令Ｓ ＯＦＦを送
り、半導体しゃ断６Ａをオフする。また同時に単安定マ
ルチバイブレータ２４Ａ、ラインドライバー２５Ａを介
して他号機へも半導体しゃ断器オフ指令Ｕｓを送ると共
に負荷側のコンタクタ制御回路１０へもオフ指令を送り
、さらに周波数異常を検出した発振器１１Ａをスイッチ
回路１９Ａをオフすることにより発振回路から切離すよ
うにする。When the frequency abnormality detection circuit 23A detects that the frequency of the output pulse IIA of the oscillator 11A has risen above a predetermined value, an off command S OFF is sent to the semiconductor breaker control circuit 9A to turn off the semiconductor breaker 6A. At the same time, a semiconductor breaker off command Us is also sent to other machines via the monostable multivibrator 24A and line driver 25A, and an off command is also sent to the contactor control circuit 10 on the load side. By turning off the switch circuit 19A, it is disconnected from the oscillation circuit.
半導体しゃ断器制御回路９Ａは第３図に示すように、周
波数異常検出後、所定時間経過後しゃ断器ゲート信号Ｃ
ＢＳを半導体しゃ断器６Ａに与え、負荷側コンタクタが
再投入されるまでの間、無負荷にて並列運転して待機し
ている。半導体しゃ断器オフ期間は、コンタクタ７が開
放されるまでの短時間でよく、コンタクタの動作遅れを
バックアップするために高速の半導体スイッチによりイ
ンバータ装置と負荷を高速で切離している。また、半導
体しゃ断器のオフ動作は全インバータ同時に行なう必要
があり、発振器システムで説明したコモンバスによる信
号の取合を行ない他号機で検出した場合はコモンバスよ
りラインレシーバ２６Ａを介して信号を受けることによ
り時間差を生じないようにしている。As shown in FIG. 3, the semiconductor breaker control circuit 9A outputs the breaker gate signal C after a predetermined period of time has passed after detecting the frequency abnormality.
BS is applied to the semiconductor circuit breaker 6A, and until the load-side contactor is turned on again, it is operated in parallel with no load and is on standby. The semiconductor breaker off period may be a short time until the contactor 7 is opened, and the inverter device and the load are disconnected at high speed by a high-speed semiconductor switch to back up the delay in contactor operation. In addition, it is necessary to turn off the semiconductor circuit breaker at the same time for all inverters, and if the signal is exchanged using the common bus as explained in the oscillator system, and if it is detected by another machine, the signal is received from the common bus via the line receiver 26A. We try to avoid time differences.
回転数検出回路２０は、フリーラン中の電動機の逆起電
圧より、電動機の回転数が所定値より下ったことを検出
してコンタクタ制御回路１０を介して負荷側コンタクタ
７を投入する。複数台のコンタクタは一般には、インバ
ータ容量の低減のためいっせいにではなく順次投入して
いく方式がとられている。The rotation speed detection circuit 20 detects that the rotation speed of the motor has fallen below a predetermined value based on the back electromotive voltage of the motor during free running, and turns on the load-side contactor 7 via the contactor control circuit 10. In order to reduce the inverter capacity, multiple contactors are generally installed one after another rather than all at once.
以上、一連の動作の間、発振器システムは前記個別冗長
方式によりコモンバス上の信号Ｃｓの元となる発振器が
ＩＩＡから１１Ｂに切換っているが、欠相することなく
、各インバータ装置に一定のパルス信号を供給している
。As described above, during the series of operations, the oscillator system switches the oscillator that is the source of the signal Cs on the common bus from IIA to 11B due to the individual redundancy method, but there is no phase loss and constant pulses are supplied to each inverter device. supplying the signal.
周波数異常検出回路２３Ａと回転数検出回路２０は同一
構成で容易に実現でき、そのブロック図を第４図に示す
、原理的には周波数信号あるいは回転数信号に等価なパ
ルス列信号を入力して、所定時間内のパルス数をカウン
トして、カウント値から判別をすればよい。３１Ａはカ
ウンタ、３２Ａはラッチ回路であり、発振器３３Ａで発
生する信号によりリセットまたはラッチされる。３４Ａ
はデジタルコンパレータでラッチ回路３２Ａの出力信号
とデジタル設定器３５Ａの設定信号の大小を比較し異常
信号発生時フリップフロップ３６Ａでホールドすること
により、所望の信号を得ることができる。The frequency abnormality detection circuit 23A and the rotation speed detection circuit 20 can be easily realized with the same configuration, and the block diagram thereof is shown in FIG. 4.In principle, by inputting a pulse train signal equivalent to a frequency signal or a rotation speed signal, What is necessary is to count the number of pulses within a predetermined time and make a determination based on the count value. 31A is a counter, and 32A is a latch circuit, which are reset or latched by a signal generated by an oscillator 33A. 34A
A desired signal can be obtained by comparing the magnitude of the output signal of the latch circuit 32A and the setting signal of the digital setting device 35A using a digital comparator and holding the signal in the flip-flop 36A when an abnormal signal occurs.
前記実施例においては、電動機の回転数が所定値以下に
下ったことをもってコンタクタを投入したか電動機フリ
ーラン後の時間経過で判別することも可能である。周波
数異常の検出周波数、再投入可能周波数、および電動機
のフリーラン特性とから再投入可能な時限を設定するこ
とができる。In the embodiment described above, it is also possible to determine whether the contactor has been turned on based on the fact that the number of revolutions of the electric motor has fallen below a predetermined value or not based on the passage of time after the motor free-runs. The time limit for restarting can be set based on the frequency abnormality detection frequency, the re-starting frequency, and the free run characteristics of the motor.
以上、説明したように本技術によれば、慣性の大きい交
流電動機を並列運転にて駆動している複数のインバータ
装置が、周波数上昇の異常を発生した場合にシステム上
許容できる時間負荷を切離した後再投入するように構成
したので、個別冗長発振器システムにおいて発振器が切
り替る過渡時の負荷電動機側よりの電力の回生を防止す
ることができ、システムの信頼性を高める効果がある。As explained above, according to this technology, when multiple inverter devices that drive AC motors with large inertia in parallel operation occur, the load can be disconnected for a time that is allowable in the system. Since the oscillator is configured to be turned on again later, it is possible to prevent regeneration of power from the load motor side during a transient period when the oscillator is switched in the individual redundant oscillator system, and this has the effect of increasing the reliability of the system.
第１図は本実施例を示す２台のインバータを並列運転す
るシステムのブロック図、第２図は、そのインバータの
周波数制御ブロック図、第３図はそのタイムチャート、
第４図は周波数異常検出回路の制御ブロック図、第５図
は個別冗長発振器システムのブロック図、第６図はその
タイムチャートである。
１１Ａ、３３Ａ・・・発振回路、２Ａ・・・開閉器、３
Ａ・・・整流器、４Ａ・・・平滑フィルタ、５Ａ・・・
インバータ回路、６Ａ・・・半導体しゃ断器、７・・・
コンタクタ。
８・・・負荷電動機、９Ａ・・・半導体しゃ断器制御回
路、ｌＯ・・・コンタクタ制御回路、ＩＩＡ、ＩＩＢ・
・・発振器、１２Ａ、１２Ｂ、２１Ａ・・・分周器、１
３Ａ、１３Ｂ、１４Ａ。
１４Ｂ、２４Ａ・・・単安定マルチバイブレータ、１５
Ａ。
１５Ｂ・・・アンドゲート回路、１６Ａ、１６Ｂ、２５
Ａ・・・ライントライバ、１７Ａ、１７Ｂ、２６Ａ・・
・ラインレシーバ、１９Ａ・・・スイッチ回路、２０・
・・回転数検出回路、３１Ａ・・・カウンタ、３２Ａ・
・・ラッチ回路、３４Ａ・・・デジタル比較器、３５Ａ
・・・デジタル設定器、３６Ａ・・・フリップフロップ
、ＣＰＡ、ＣＰＢ・・・発振器出力パルス、１２Ａ Ｐ
、 １２Ｂ Ｐ・・・分周器出力信号、ＤＰＡ。
ＤＰＩ３・・・ライントライバ入力信号、ＲＰＡ、ＲＰ
Ｂ・・・ラインレシーバ出力信号、Ｃｓ・・・コモンバ
ス信号、ＦＡＵＬＴ・・・周波数異常検出信号、Ｓ ０
ＦＦＵｓ・・・しゃ断器オフ指令、ＣＢＳ・・・しゃ断
ゲート信号、ＣＴＴ・・・１コンタクタ投入指令。
代理人 弁理士 則 近 憲 佑
同 三俣弘文
第１図
第２図
ＣＰＡＬ←−一←←−−−−−
ｃｓ−一」−一一一一一ローーロー
第３図
第４図
第５図
第６図Fig. 1 is a block diagram of a system for operating two inverters in parallel according to this embodiment, Fig. 2 is a frequency control block diagram of the inverter, and Fig. 3 is a time chart thereof.
FIG. 4 is a control block diagram of the frequency abnormality detection circuit, FIG. 5 is a block diagram of the individual redundant oscillator system, and FIG. 6 is a time chart thereof. 11A, 33A...Oscillation circuit, 2A...Switch, 3
A... Rectifier, 4A... Smoothing filter, 5A...
Inverter circuit, 6A...Semiconductor breaker, 7...
contactor. 8... Load motor, 9A... Semiconductor breaker control circuit, lO... Contactor control circuit, IIA, IIB.
...Oscillator, 12A, 12B, 21A...Frequency divider, 1
3A, 13B, 14A. 14B, 24A...monostable multivibrator, 15
A. 15B...AND gate circuit, 16A, 16B, 25
A...Line driver, 17A, 17B, 26A...
・Line receiver, 19A...Switch circuit, 20・
・・Rotation speed detection circuit, 31A・・Counter, 32A・
...Latch circuit, 34A...Digital comparator, 35A
...Digital setting device, 36A...Flip-flop, CPA, CPB...Oscillator output pulse, 12A P
, 12B P... Frequency divider output signal, DPA. DPI3...Line driver input signal, RPA, RP
B...Line receiver output signal, Cs...Common bus signal, FAULT...Frequency abnormality detection signal, S0
FFUs: breaker off command, CBS: breaker gate signal, CTT: 1 contactor closing command. Agent Patent Attorney Nori Ken Ken Yudo Hirofumi MitsumataFigure 1Figure 2CPAL←-1←←-----cs-1''-11111RoroRoFigure 3Figure 4Figure 5Figure 6 figure
Claims (1)
列運転した電源にて駆動し、前記インバータ装置に個別
に設けられ、互いに冗長性を有する発振器の出力が並列
運転制御の基準パルスとなる個別冗長発振器システムに
て運転されるインバータ装置の並列運転システムにおい
て、前記、インバータ装置に個別に設けられ、前記個別
の発振器の発振周波数が所定の値より高くなったことを
検出する周波数異常検出器を有し、その異常を検出した
場合に、全てのインバータ装置を前記交流電動機から切
り離すと共に、異常となった発振器を個別冗長発振器を
ステムから切り離すことにより発振器システムの周波数
を正常に復帰させ、交流電動機の回転数が所定値以下に
なったことをもって再び、インバータ装置を負荷と接続
するようにしたことを特徴とするインバータ装置の保護
方法。An AC motor with large inertia is driven by a power source obtained by operating a plurality of inverter devices in parallel, and individual redundant oscillators are provided individually in the inverter devices and the outputs of mutually redundant oscillators serve as reference pulses for parallel operation control. In the parallel operation system of inverter devices operated in the system, the frequency abnormality detector is provided individually in the inverter device and detects that the oscillation frequency of the individual oscillator has become higher than a predetermined value. When the abnormality is detected, all the inverter devices are disconnected from the AC motor, and the individual redundant oscillator of the abnormal oscillator is disconnected from the stem to restore the frequency of the oscillator system to normal, and the rotation of the AC motor is resumed. 1. A method for protecting an inverter device, characterized in that the inverter device is connected to a load again when the number becomes less than a predetermined value.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61133709A JPS62293991A (en) | 1986-06-11 | 1986-06-11 | Protective method of inverter apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61133709A JPS62293991A (en) | 1986-06-11 | 1986-06-11 | Protective method of inverter apparatus |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62293991A true JPS62293991A (en) | 1987-12-21 |
Family
ID=15111058
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61133709A Pending JPS62293991A (en) | 1986-06-11 | 1986-06-11 | Protective method of inverter apparatus |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62293991A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPWO2017006400A1 (en) * | 2015-07-03 | 2018-03-29 | 東芝三菱電機産業システム株式会社 | Control device for power converter |
-
1986
- 1986-06-11 JP JP61133709A patent/JPS62293991A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPWO2017006400A1 (en) * | 2015-07-03 | 2018-03-29 | 東芝三菱電機産業システム株式会社 | Control device for power converter |
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