JPS61224476A - レ−ザ電流制限装置 - Google Patents
レ−ザ電流制限装置Info
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- JPS61224476A JPS61224476A JP6388385A JP6388385A JPS61224476A JP S61224476 A JPS61224476 A JP S61224476A JP 6388385 A JP6388385 A JP 6388385A JP 6388385 A JP6388385 A JP 6388385A JP S61224476 A JPS61224476 A JP S61224476A
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- circuit
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01S—DEVICES USING THE PROCESS OF LIGHT AMPLIFICATION BY STIMULATED EMISSION OF RADIATION [LASER] TO AMPLIFY OR GENERATE LIGHT; DEVICES USING STIMULATED EMISSION OF ELECTROMAGNETIC RADIATION IN WAVE RANGES OTHER THAN OPTICAL
- H01S5/00—Semiconductor lasers
- H01S5/06—Arrangements for controlling the laser output parameters, e.g. by operating on the active medium
- H01S5/068—Stabilisation of laser output parameters
- H01S5/0683—Stabilisation of laser output parameters by monitoring the optical output parameters
- H01S5/06835—Stabilising during pulse modulation or generation
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- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Electromagnetism (AREA)
- Optics & Photonics (AREA)
- Semiconductor Lasers (AREA)
- Dot-Matrix Printers And Others (AREA)
- Laser Beam Printer (AREA)
- Exposure Or Original Feeding In Electrophotography (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、レーザビームを走査して画像を形成する画
像形成装置に係り、特にレーザ電流を制御する装置に関
するものである。
像形成装置に係り、特にレーザ電流を制御する装置に関
するものである。
半導体レーザ（以下レーザと呼ぶ）を使用して画像を書
き込むプリンタのレーザ発光量を安定化する装置として
、例えば特開昭５８−１０１３２５９号公報に示される
装置が提案されている。この装置は、レーザの光量を非
画像部で検出し、規定の光量になるように制御し、画像
部ではその光量を保持するようになっている。
・次に第４図を参照しながら従来の装置にお
けるレーザ発射制御動作について説明する。
き込むプリンタのレーザ発光量を安定化する装置として
、例えば特開昭５８−１０１３２５９号公報に示される
装置が提案されている。この装置は、レーザの光量を非
画像部で検出し、規定の光量になるように制御し、画像
部ではその光量を保持するようになっている。
・次に第４図を参照しながら従来の装置にお
けるレーザ発射制御動作について説明する。
第４図はレーザ発光特性を説明する波形図であり、縦軸
は光量を示し、横軸は電流をそれぞれ示す、ａ、ｂはス
イッチングの異なる電流、Ｃは発光出力を示す、
１画像を書き込む際
に、レーザへの印加電流をスイッチングし、消光時は電
流ａのように印加電流を完全に零にしていた。この図に
示されるように、レーザはスレッショルド電流Ｉｔｈ以
上の電流が印加されると発光し、印加電流がＩａになっ
たときに、規定光量Ｌｌ に達する。すなわち、印加電
流がＩ”ｔ’ｈ≦Ｉａ状態下においてレーザは作動する
といダ特性を有している。このため、電流ａ。
は光量を示し、横軸は電流をそれぞれ示す、ａ、ｂはス
イッチングの異なる電流、Ｃは発光出力を示す、
１画像を書き込む際
に、レーザへの印加電流をスイッチングし、消光時は電
流ａのように印加電流を完全に零にしていた。この図に
示されるように、レーザはスレッショルド電流Ｉｔｈ以
上の電流が印加されると発光し、印加電流がＩａになっ
たときに、規定光量Ｌｌ に達する。すなわち、印加電
流がＩ”ｔ’ｈ≦Ｉａ状態下においてレーザは作動する
といダ特性を有している。このため、電流ａ。
ｂのいずれをレーザに印加しても同様に発−光出力Ｃが
得られることになる。
得られることになる。
ところが、レーザを発光させるスイッチングトランジス
タに対して印加電流を０〜Ｉｔｈまで流すと、トランジ
スタの損失が増大するため、許容損失の大きなトランジ
スタを使用しなければならない等の制約が生じる。また
、高速に画像を書き込むためには、スイッチングスピー
ドの早いトランジスタを使用しなければならない、これ
らの条件を満足する、すなわち、スイッチングスピード
が高速で、かつ、許容損失の大きなトランジスタは非常
に高価になる等の問題点があった。
タに対して印加電流を０〜Ｉｔｈまで流すと、トランジ
スタの損失が増大するため、許容損失の大きなトランジ
スタを使用しなければならない等の制約が生じる。また
、高速に画像を書き込むためには、スイッチングスピー
ドの早いトランジスタを使用しなければならない、これ
らの条件を満足する、すなわち、スイッチングスピード
が高速で、かつ、許容損失の大きなトランジスタは非常
に高価になる等の問題点があった。
また、印加電流を零からＩｔｈまで立ち上げるための駆
動トランジスタの立ち上げ時間を考慮すると、レーザ発
光開始までに相当の時間を要してしまう等の欠点があっ
た。
動トランジスタの立ち上げ時間を考慮すると、レーザ発
光開始までに相当の時間を要してしまう等の欠点があっ
た。
そこで、上記の問題点を解決するため、レーザにＩｔｈ
以下のバイアス電流を流すことが考えられたが、第５図
に示すように、レーザ素子が環境温度の上昇に応じて、
スレッショルド電流Ｉ ｔｈｌがＩｔｈ２にシフトする
特有の性質があるため、所定レベルの固定バイアスをレ
ーザに印加しても、環境温度が下降した場合には、過大
の電流がレーザに印加されて光量オーバーとなる問題が
生じてしまう。
以下のバイアス電流を流すことが考えられたが、第５図
に示すように、レーザ素子が環境温度の上昇に応じて、
スレッショルド電流Ｉ ｔｈｌがＩｔｈ２にシフトする
特有の性質があるため、所定レベルの固定バイアスをレ
ーザに印加しても、環境温度が下降した場合には、過大
の電流がレーザに印加されて光量オーバーとなる問題が
生じてしまう。
この発明は、上記の問題点を解消するためになされたも
ので、半導体レーザのスイッチング電流およびバイアス
電流を同時に制御して、常に適正な光量を出力できるレ
ーザ電流制御装置を提供することを目的とする。
ので、半導体レーザのスイッチング電流およびバイアス
電流を同時に制御して、常に適正な光量を出力できるレ
ーザ電流制御装置を提供することを目的とする。
この発明に係るレーザ電流制御装置は、半導体レーザの
印加電流を所定のパルス信号に同期して段階的に増加さ
せる電流増加手段と、この電流増加手段のディジタル出
力を解読する電流値解読手段と、この電流値解読手段の
出力があらかじめ設定される所定値を越えたときに、半
導体レーザのスイッチング電流およびバイアス電流を同
時に抑止する電流制御手段とから構成されるものである
。
印加電流を所定のパルス信号に同期して段階的に増加さ
せる電流増加手段と、この電流増加手段のディジタル出
力を解読する電流値解読手段と、この電流値解読手段の
出力があらかじめ設定される所定値を越えたときに、半
導体レーザのスイッチング電流およびバイアス電流を同
時に抑止する電流制御手段とから構成されるものである
。
この発明においては、電流増加手段が半導体レーザの印
加電流を所定のパルス信号に同期して段階的に増加させ
行く、この段階的な電流の増加を電流値解読手段が常時
監視している。このとき、電流を制御するフィードバッ
ク系に、何らかのトラブルが発生して過大電流を印加す
る出力が電流増加手段からなされると、電流値解読手段
から電流制御手段に対して所定のパルス信号が出力され
る。これにより、電流制御手段が半導体レーザのスイッ
チング電流およびバイアス電流を同時に抑止する。
加電流を所定のパルス信号に同期して段階的に増加させ
行く、この段階的な電流の増加を電流値解読手段が常時
監視している。このとき、電流を制御するフィードバッ
ク系に、何らかのトラブルが発生して過大電流を印加す
る出力が電流増加手段からなされると、電流値解読手段
から電流制御手段に対して所定のパルス信号が出力され
る。これにより、電流制御手段が半導体レーザのスイッ
チング電流およびバイアス電流を同時に抑止する。
第１図はこの発明の一実施例を示すレーザ電流制御装置
の構成を示す回路図であり、１はレーザ、２はフォトデ
ィテクタで、レーザ１と同一基板上に設けられる。３は
感度補正用の素子となるボリュームで、フォトディテク
タ２の感度を調整する。４は前記ボリューム３の負荷抵
抗器である。５〜７はオペアンプ８の利得を決定する抵
抗器である。９はコンデンサで、レーザ１の光量がステ
ップ状に増加する場合にオーバーシュートが発生してコ
ンパレータ１０が誤作動するのを防止する。コンパレー
タ１ｏの反転端子には電流制限用の抵抗器１１が接続さ
れており、非反転端子には電流制限用の抵抗器１２が接
続されている。
の構成を示す回路図であり、１はレーザ、２はフォトデ
ィテクタで、レーザ１と同一基板上に設けられる。３は
感度補正用の素子となるボリュームで、フォトディテク
タ２の感度を調整する。４は前記ボリューム３の負荷抵
抗器である。５〜７はオペアンプ８の利得を決定する抵
抗器である。９はコンデンサで、レーザ１の光量がステ
ップ状に増加する場合にオーバーシュートが発生してコ
ンパレータ１０が誤作動するのを防止する。コンパレー
タ１ｏの反転端子には電流制限用の抵抗器１１が接続さ
れており、非反転端子には電流制限用の抵抗器１２が接
続されている。
１３はオペアンプＯＦ、を使用した電圧源で、基準電圧
を抵抗器１２を介してコンパレータ１ｏに供給ルている
。１４はコンデンサで、レーザ１の光量がステップ状に
増加する場合にオーバーシュートが発生してコンパレー
タ１０が誤作動するのを防止する。１５はインバートノ
ア回路で、コンパレータ１０の出力とＤ／Ａ変換器１６
の出力をナンド回路で構成されるデコーダ１６ａ（電流
値解読手段をなす）を介した出力とのインバートノアを
とり、ＪＫフリップフ目ツブ（以下フリップフロップを
単にＦＦと呼ぶ）１７のに端子に出力する。１８は公知
のパルスシンクロナイザで、ＤＦＦ１８ａ 、１８ｂ
、インバートナンド回路１８ｃから構成されている。
を抵抗器１２を介してコンパレータ１ｏに供給ルている
。１４はコンデンサで、レーザ１の光量がステップ状に
増加する場合にオーバーシュートが発生してコンパレー
タ１０が誤作動するのを防止する。１５はインバートノ
ア回路で、コンパレータ１０の出力とＤ／Ａ変換器１６
の出力をナンド回路で構成されるデコーダ１６ａ（電流
値解読手段をなす）を介した出力とのインバートノアを
とり、ＪＫフリップフ目ツブ（以下フリップフロップを
単にＦＦと呼ぶ）１７のに端子に出力する。１８は公知
のパルスシンクロナイザで、ＤＦＦ１８ａ 、１８ｂ
、インバートナンド回路１８ｃから構成されている。
１９はこの発明の電流増加手段となるカウンタで、ＪＫ
ＦＦ１７の出力に応じてチップイネーブルとなり、光量
を後述するクロック信号ＣＬＫに同期して１段階ずつ上
昇させる。２０．２１は抵抗器で、Ｄ／Ａ変換器１６の
基準電位を決定する。２２は電流−電圧変換回路で、Ｄ
／Ａ変換器１６の出力電流を所定レベルの電圧に変換す
る。２３は定電流回路で、オペアンプＯＰ２ とトラン
ジスタＴｒｔ とで構成される。
ＦＦ１７の出力に応じてチップイネーブルとなり、光量
を後述するクロック信号ＣＬＫに同期して１段階ずつ上
昇させる。２０．２１は抵抗器で、Ｄ／Ａ変換器１６の
基準電位を決定する。２２は電流−電圧変換回路で、Ｄ
／Ａ変換器１６の出力電流を所定レベルの電圧に変換す
る。２３は定電流回路で、オペアンプＯＰ２ とトラン
ジスタＴｒｔ とで構成される。
２４は定電流回路で、オペアンプＯＦ３ とトランジス
タＴｒ２ とで構成される。２５はコイルで、優良度Ｑ
を下げる抵抗器２６が接続されている。
タＴｒ２ とで構成される。２５はコイルで、優良度Ｑ
を下げる抵抗器２６が接続されている。
２７はコンデンサで、レーザ１のレーザ電流のオーバー
シュートを防止する。２８は差動電流スイッチで、エミ
ッタ接続のトランジスタＴｒ３ 。
シュートを防止する。２８は差動電流スイッチで、エミ
ッタ接続のトランジスタＴｒ３ 。
Ｔｒａおよび抵抗器Ｒ１−Ｒ３から構成されている。２
９は抵抗器で、差動電流スイッチ２８の電流バランスを
調整する。３０はダイオードで、レーザ１に逆電圧がか
かるのを防止する。３１は抵抗器で、レーザ１の順方向
バイアス電圧Ｖｏ近辺でレーザ電流が急変し、レーザ電
流にリンギングが発生するのを防止する。３２はダンパ
抵抗器で、レーザ電流のオーバーシュートを防止する。
９は抵抗器で、差動電流スイッチ２８の電流バランスを
調整する。３０はダイオードで、レーザ１に逆電圧がか
かるのを防止する。３１は抵抗器で、レーザ１の順方向
バイアス電圧Ｖｏ近辺でレーザ電流が急変し、レーザ電
流にリンギングが発生するのを防止する。３２はダンパ
抵抗器で、レーザ電流のオーバーシュートを防止する。
３３はコンデンサで、ダンパ抵抗器３２の直流成分をカ
ットする。なお、ダンパ抵抗器３２とコンデンサ３３と
の時定数は数Ｉｏｎｓ〜数１００ｎｓ程度にセレクトす
る。３４は入力端子で、図示しない外部装置より送出さ
れた画像信号ＶＩＤＥＯが入力される。３５はノア回路
で、画像信号ＶＩＤＥＯトＪＫＦＦ１７ト（７）／７を
、！ル、３６は入力ポートで、クロック信号ＣＬＫが入
力される。３７は入力ポートで、自動的に光査を制御す
るパルス信号ＡＰＣ５が入力される。３８は入力ポート
で、クリア信号ＣＬが入力される。３９は １バイ
アス電流を可変する素子となるボリュームで、レーザ１
のスイッチング電流に対するバイアス電流の比率を可変
する。
ットする。なお、ダンパ抵抗器３２とコンデンサ３３と
の時定数は数Ｉｏｎｓ〜数１００ｎｓ程度にセレクトす
る。３４は入力端子で、図示しない外部装置より送出さ
れた画像信号ＶＩＤＥＯが入力される。３５はノア回路
で、画像信号ＶＩＤＥＯトＪＫＦＦ１７ト（７）／７を
、！ル、３６は入力ポートで、クロック信号ＣＬＫが入
力される。３７は入力ポートで、自動的に光査を制御す
るパルス信号ＡＰＣ５が入力される。３８は入力ポート
で、クリア信号ＣＬが入力される。３９は １バイ
アス電流を可変する素子となるボリュームで、レーザ１
のスイッチング電流に対するバイアス電流の比率を可変
する。
なお、ＤＦＦ１８ａ 、１８ｂのＤは入力端子を示し、
ＱはＦＦの出力端子を示し、Ｊ、にはＪＫＦＦ１７の入
力端子を示し、ＧＫはクロック信号ＣＬＫの入力端子を
示し、ＬＤはカウンタ１９のロード端子を示し、ＥＮＢ
はカウンタ１９のイネーブル入力端子を示し、０１〜０
８はカウンタ１９の出力端子で、ＯｌがＬＳＢで０８が
ＭＳＢを示す、また、工１〜Ｘ８はＤ／Ａ変換器１６の
ディジタル入力を示シ、ＶＲ（−） 、 ＶＲ（−）は
Ｄ／Ａ変換器１６の基準電流端子を示し、Ｉ ｏｕｔは
Ｄ／Ａ変換器１６の電流出力を示す。
ＱはＦＦの出力端子を示し、Ｊ、にはＪＫＦＦ１７の入
力端子を示し、ＧＫはクロック信号ＣＬＫの入力端子を
示し、ＬＤはカウンタ１９のロード端子を示し、ＥＮＢ
はカウンタ１９のイネーブル入力端子を示し、０１〜０
８はカウンタ１９の出力端子で、ＯｌがＬＳＢで０８が
ＭＳＢを示す、また、工１〜Ｘ８はＤ／Ａ変換器１６の
ディジタル入力を示シ、ＶＲ（−） 、 ＶＲ（−）は
Ｄ／Ａ変換器１６の基準電流端子を示し、Ｉ ｏｕｔは
Ｄ／Ａ変換器１６の電流出力を示す。
次に第２図（ａ）〜（ｊ）を参照しながら第１図の動作
について説明する。
について説明する。
第２図（ａ）〜（ｊ）は第１図に示した回路の動作を説
明するタイムチャートで、同図（ａ）。
明するタイムチャートで、同図（ａ）。
において、ＣＬＫはクロック信号を示し、同図（ｂ）に
おいて、ＡＰＣ３は光量を制御するパルス信号を示し、
同図（Ｃ）において、０１はパルスシンクロナイザ１８
からの出力信号を示し、同図（ｄ）において、０２はＪ
ＫＦＦ１７の出力、 信号を示し、同図（ｅ）″にお
いて、ｏ ｕ ｔ ／ １は定電流回路２３の出力電流
を示し、同図（ｆ）において、ｏ ｕ ｔ ／ ２は定
電流回路２４の出力電流を示し、同図（ｇ）において、
ｏ ｕ ｔ ／ ３はレーザ電流を示し、同図（ｈ）に
おいて、ΔＬは光量変化を示し、同図（ｉ）において、
０３はコンパレータ１ｏの出力信号を示し、同図Ｈ）に
おいて、０４はインバートノア回路１５の出力信号を示
す。
おいて、ＡＰＣ３は光量を制御するパルス信号を示し、
同図（Ｃ）において、０１はパルスシンクロナイザ１８
からの出力信号を示し、同図（ｄ）において、０２はＪ
ＫＦＦ１７の出力、 信号を示し、同図（ｅ）″にお
いて、ｏ ｕ ｔ ／ １は定電流回路２３の出力電流
を示し、同図（ｆ）において、ｏ ｕ ｔ ／ ２は定
電流回路２４の出力電流を示し、同図（ｇ）において、
ｏ ｕ ｔ ／ ３はレーザ電流を示し、同図（ｈ）に
おいて、ΔＬは光量変化を示し、同図（ｉ）において、
０３はコンパレータ１ｏの出力信号を示し、同図Ｈ）に
おいて、０４はインバートノア回路１５の出力信号を示
す。
電源ＯＮ時は、図示しないリセット回路よりクリア信号
ＣＬが入力ポート３８に入力されると、パルスシンクロ
ナイザ１８．ＪＫＦＦ１７．カウンタ１９がそれぞれリ
セットされる。第２図（ａ）に示されるクロック信号Ｃ
ＬＫは、常時入力ポート３６に印加されている。
ＣＬが入力ポート３８に入力されると、パルスシンクロ
ナイザ１８．ＪＫＦＦ１７．カウンタ１９がそれぞれリ
セットされる。第２図（ａ）に示されるクロック信号Ｃ
ＬＫは、常時入力ポート３６に印加されている。
レーザ１から発射されるレーザビームがプリンタの非画
像領域を照射する時に、プリンタ制御回路（図示しない
）より入力ポート３７に対してパルス信号ＡＰＣ５（第
２図（ｂ）に示す）が送出され、このパルス信号ＡＰＣ
Ｓが次段のパルスシンクロナイザ１８で１クロック分だ
け取り出され出力信号Ｏ１（第２図（Ｃ）に示す）がＪ
ＫＦＦ１７の入力端子Ｊに入力されるとともに、カウン
タ１９のロード端子ＬＤに入力される。このため、ＪＫ
ＦＦＩ７がセットされ出力端子Ｑより出力信号０２（第
２図（ｄ）に示す）がカウンタ１９のイネーブル端子Ｅ
ＮＢに送出されるとともに、ノア回路３５に送出される
。出力信号０２はレーザ電流ｏ ｕ ｔ ／ ３の上昇
中を示す信号である。一方、カウンタ１９はパルスシン
クロナイザ１８の出力信号Ｏ１によりオール零にロード
されているが、ＪＫＦＦＩ７の出力端子Ｑより出力信号
０２が送出されると、カウント動作可能となり、ｌクロ
ック毎に出力端子０１〜０８からディジタル信号をＤ／
Ａ変換器１６の入力端子！１〜Ｉ８に送出する。これに
応じてＤ／Ａ変換器１６の出力ｒ ｏｕｔが増加し、電
流−電圧変換回路２２の出力が増加し、定電流回路２３
．２４の出力もクロック信号ＣＬＫのｌクロック毎に増
加する。
像領域を照射する時に、プリンタ制御回路（図示しない
）より入力ポート３７に対してパルス信号ＡＰＣ５（第
２図（ｂ）に示す）が送出され、このパルス信号ＡＰＣ
Ｓが次段のパルスシンクロナイザ１８で１クロック分だ
け取り出され出力信号Ｏ１（第２図（Ｃ）に示す）がＪ
ＫＦＦ１７の入力端子Ｊに入力されるとともに、カウン
タ１９のロード端子ＬＤに入力される。このため、ＪＫ
ＦＦＩ７がセットされ出力端子Ｑより出力信号０２（第
２図（ｄ）に示す）がカウンタ１９のイネーブル端子Ｅ
ＮＢに送出されるとともに、ノア回路３５に送出される
。出力信号０２はレーザ電流ｏ ｕ ｔ ／ ３の上昇
中を示す信号である。一方、カウンタ１９はパルスシン
クロナイザ１８の出力信号Ｏ１によりオール零にロード
されているが、ＪＫＦＦＩ７の出力端子Ｑより出力信号
０２が送出されると、カウント動作可能となり、ｌクロ
ック毎に出力端子０１〜０８からディジタル信号をＤ／
Ａ変換器１６の入力端子！１〜Ｉ８に送出する。これに
応じてＤ／Ａ変換器１６の出力ｒ ｏｕｔが増加し、電
流−電圧変換回路２２の出力が増加し、定電流回路２３
．２４の出力もクロック信号ＣＬＫのｌクロック毎に増
加する。
ＪＫＦＦＩ ７の出力端子Ｑより出力信号０２が送出さ
れると、ノア回路３５の出力はＬ（Ｌｏｗ）レベルとな
り、差動電流スイッチ２８のトランジスタＴｒａがオン
し、レーザ１に電流が流れる状態となり、定電流回路２
３．２４の出力電流ｏｕｔ／１．ｏｕｔ／２の合計電流
がレーザ電流ｏｕｔ／３となる。こうして、順次レーザ
電流ｏｕｔ／３が増加してスレッショルドＩＴＨを越え
ると。
れると、ノア回路３５の出力はＬ（Ｌｏｗ）レベルとな
り、差動電流スイッチ２８のトランジスタＴｒａがオン
し、レーザ１に電流が流れる状態となり、定電流回路２
３．２４の出力電流ｏｕｔ／１．ｏｕｔ／２の合計電流
がレーザ電流ｏｕｔ／３となる。こうして、順次レーザ
電流ｏｕｔ／３が増加してスレッショルドＩＴＨを越え
ると。
レーザーが発光する。その出力光の変化（光量変化ΔＬ
）をフォトディテクタ２で検知し、オペアンプ８で増幅
する。そして、コンパレータ１０により、光量に応じた
出力電位と定電圧源１３の出力電位とを比較する。この
とき、コンパレータ１０の反転入力レベルが非反転入力
レベルより大きくなると、出力信号０３（第２図（ｉ）
に示す）のように、出力が反転して出力信号０４がＪＫ
ＦＦＩ７の入力端子Ｋに送出される。これに呼応してＪ
ＫＦＦＩ７の出力端子Ｑから送出されていた出力信号０
２がＬ（Ｌｏｗ）レベルとなり。
）をフォトディテクタ２で検知し、オペアンプ８で増幅
する。そして、コンパレータ１０により、光量に応じた
出力電位と定電圧源１３の出力電位とを比較する。この
とき、コンパレータ１０の反転入力レベルが非反転入力
レベルより大きくなると、出力信号０３（第２図（ｉ）
に示す）のように、出力が反転して出力信号０４がＪＫ
ＦＦＩ７の入力端子Ｋに送出される。これに呼応してＪ
ＫＦＦＩ７の出力端子Ｑから送出されていた出力信号０
２がＬ（Ｌｏｗ）レベルとなり。
ノア回路３５の出力がＨ（Ｈｉｇｈ）レベルとなる。こ
のため、差動電流スイッチ２８のトランジスタＴｒｓが
オフし、定電流回路２３の電流はレーザーを流れなくな
る。この状態において、入力端子３４に画像信号ＶＩＤ
ＥＯがノア回路３５に入力されると、この画像信号ＶＩ
ＤＥＯに応じて差動電流スイッチ２８がオン、オフ動作
するので、レーザ電流ｏ ｕ ｔ ／ ３に定電流回路
２３のスイッチング波形が重畳され、第４図に示される
電流すに等しい電流波形となる。
のため、差動電流スイッチ２８のトランジスタＴｒｓが
オフし、定電流回路２３の電流はレーザーを流れなくな
る。この状態において、入力端子３４に画像信号ＶＩＤ
ＥＯがノア回路３５に入力されると、この画像信号ＶＩ
ＤＥＯに応じて差動電流スイッチ２８がオン、オフ動作
するので、レーザ電流ｏ ｕ ｔ ／ ３に定電流回路
２３のスイッチング波形が重畳され、第４図に示される
電流すに等しい電流波形となる。
また、光量増加中にフォトディテクタ２の出力側の接触
不良等で出力が途切れると、レーザ光量が規定光量にな
ってもレーザ電流ｏ ｕ ｔ ／ ３は増加されて行く
、そこで、一定レベル以上のレーザ電流ｏ ｕ ｔ ／
３が流れないように、デコーダ１６ａがカウンタ１９
の出力をチェックし、上記一定レベル以上のレーザ電流
Ｏｕ ｔ ／ ３が流れたら、ＪＫＦＦＩ ７ （電流
制御手段をなす）の入力端子Ｋに出力パルスが送出され
、出力端子Ｑから送出されている出力信号０２のレベル
をＬｏｗにして、レーザ電流ｏ ｕ ｔ ／ ３がそれ
以上流れないようにホールドしてしまう、この電流制限
はレーザ１のスイッチング電流とバイアス電流の両者を
同時に制限するものである。
不良等で出力が途切れると、レーザ光量が規定光量にな
ってもレーザ電流ｏ ｕ ｔ ／ ３は増加されて行く
、そこで、一定レベル以上のレーザ電流ｏ ｕ ｔ ／
３が流れないように、デコーダ１６ａがカウンタ１９
の出力をチェックし、上記一定レベル以上のレーザ電流
Ｏｕ ｔ ／ ３が流れたら、ＪＫＦＦＩ ７ （電流
制御手段をなす）の入力端子Ｋに出力パルスが送出され
、出力端子Ｑから送出されている出力信号０２のレベル
をＬｏｗにして、レーザ電流ｏ ｕ ｔ ／ ３がそれ
以上流れないようにホールドしてしまう、この電流制限
はレーザ１のスイッチング電流とバイアス電流の両者を
同時に制限するものである。
なお、ボリューム３９はスイッチング電流に対するバイ
アス電流の比率を可変するもので、レーザ１のスレッシ
冨ルド電流は感度バラツキがあるから、このボリューム
３９により最適に調整する。このボリューム３９と感度
補正用のボリューム３とをレーザ１．フォトディテクタ
２のペアと同一の基板上に組み込めるように構成するこ
とにより、故障時のメインティナンスを簡素化できる。
アス電流の比率を可変するもので、レーザ１のスレッシ
冨ルド電流は感度バラツキがあるから、このボリューム
３９により最適に調整する。このボリューム３９と感度
補正用のボリューム３とをレーザ１．フォトディテクタ
２のペアと同一の基板上に組み込めるように構成するこ
とにより、故障時のメインティナンスを簡素化できる。
また、フォトディテクタ２の感度バラツキに、比べてス
レッシ璽ルド電流のバラツキは少ないので、同一基板上
に組み込むのはボリューム３のみとしてもよい。
レッシ璽ルド電流のバラツキは少ないので、同一基板上
に組み込むのはボリューム３のみとしてもよい。
第３図（ａ）〜（Ｃ）はこの発明の一実施例を示すレー
ザユニットの配置構成図であり、同図（ａ）はレーザ１
．フォトディテクタ２．ボリューム３．３９を同一基板
４１に組み込んだ場合の配置状態を示し、同図（ｂ）は
同図（ａ）の回路図を示し、同図（Ｃ）はレーザ１．フ
ォトディテクタ２．ボリューム３を同一基板４１に組み
込んだ場合の配置状態を示している。
ザユニットの配置構成図であり、同図（ａ）はレーザ１
．フォトディテクタ２．ボリューム３．３９を同一基板
４１に組み込んだ場合の配置状態を示し、同図（ｂ）は
同図（ａ）の回路図を示し、同図（Ｃ）はレーザ１．フ
ォトディテクタ２．ボリューム３を同一基板４１に組み
込んだ場合の配置状態を示している。
以上説明したように、この発明は半導体レーザの印加電
流を所定のパルス信号に同期して段階的に増加させる電
流増加手段と、この電流増加手段のディジタル出力を解
読する電流値解読手段と、この電流値解読手段の出力が
あらかじめ設定される所定値を越えたときに、半導体レ
ーザのスイッチング電流およびバイアス電流を同時に抑
止する電流制御手段とを設けたので、半導体レーザのス
イッチング電流およびバイアス電流を同時に制御でき、
環境温度が変動しても常に適正な光量を出力できる膚れ
た利点を有する。
流を所定のパルス信号に同期して段階的に増加させる電
流増加手段と、この電流増加手段のディジタル出力を解
読する電流値解読手段と、この電流値解読手段の出力が
あらかじめ設定される所定値を越えたときに、半導体レ
ーザのスイッチング電流およびバイアス電流を同時に抑
止する電流制御手段とを設けたので、半導体レーザのス
イッチング電流およびバイアス電流を同時に制御でき、
環境温度が変動しても常に適正な光量を出力できる膚れ
た利点を有する。
第１図はこの発明の一実施例を示すレーザ電流制限装置
の構成回路図、第２図（ａ）〜（Ｄは第１図に示した回
路の動作を説明するタイムチャート、第３図（ａ）〜（
Ｃ）はこの発明の一実施例を示すレーザユニットの配置
構成図、第４図はレーザ発光特性を説明する波形図、第
５図はレーザのしきい値特性を説明する波形図である。 図中、１はレーザ、２はフォトディテクタ、３．３９は
ボリューム、１６ａはデコーダ、１７ハＪ Ｋ Ｆ Ｆ
、１８はパルスシンクロナイザ、１９はカウンタ、２３
．２４は定電流回路、２８は差動電流スイッチである。 第２図 （ａ） ０２ （ｄ）（ｅ
） ０４ （Ｊ） 第３図 （ａ） （ｂ） 第４図 第５図
の構成回路図、第２図（ａ）〜（Ｄは第１図に示した回
路の動作を説明するタイムチャート、第３図（ａ）〜（
Ｃ）はこの発明の一実施例を示すレーザユニットの配置
構成図、第４図はレーザ発光特性を説明する波形図、第
５図はレーザのしきい値特性を説明する波形図である。 図中、１はレーザ、２はフォトディテクタ、３．３９は
ボリューム、１６ａはデコーダ、１７ハＪ Ｋ Ｆ Ｆ
、１８はパルスシンクロナイザ、１９はカウンタ、２３
．２４は定電流回路、２８は差動電流スイッチである。 第２図 （ａ） ０２ （ｄ）（ｅ
） ０４ （Ｊ） 第３図 （ａ） （ｂ） 第４図 第５図
Claims (1)
- 半導体レーザの印加電流を所定のパルス信号に同期して
段階的に増加させる電流増加手段と、この電流増加手段
のディジタル出力を解読する電流値解読手段と、この電
流値解読手段の出力があらかじめ設定される所定値を越
えたときに、前記半導体レーザのスイッチング電流およ
びバイアス電流を同時に抑止する電流制御手段とからな
ることを特徴とするレーザ電流制限装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6388385A JPS61224476A (ja) | 1985-03-29 | 1985-03-29 | レ−ザ電流制限装置 |
| US07/256,122 US4985896A (en) | 1985-03-29 | 1988-10-11 | Laser driving device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6388385A JPS61224476A (ja) | 1985-03-29 | 1985-03-29 | レ−ザ電流制限装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61224476A true JPS61224476A (ja) | 1986-10-06 |
Family
ID=13242128
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6388385A Pending JPS61224476A (ja) | 1985-03-29 | 1985-03-29 | レ−ザ電流制限装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61224476A (ja) |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56100487A (en) * | 1979-12-27 | 1981-08-12 | Western Electric Co | Output stabilizing circuit for injection laser |
| JPS57112089A (en) * | 1980-12-29 | 1982-07-12 | Fujitsu Ltd | Light output control circuit |
| JPS58212256A (ja) * | 1982-06-03 | 1983-12-09 | Hitachi Ltd | レ−ザ光源装置 |
| JPS5918964A (ja) * | 1982-07-23 | 1984-01-31 | Hitachi Ltd | レ−ザ−ダイオ−ド駆動回路 |
-
1985
- 1985-03-29 JP JP6388385A patent/JPS61224476A/ja active Pending
Patent Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56100487A (en) * | 1979-12-27 | 1981-08-12 | Western Electric Co | Output stabilizing circuit for injection laser |
| JPS57112089A (en) * | 1980-12-29 | 1982-07-12 | Fujitsu Ltd | Light output control circuit |
| JPS58212256A (ja) * | 1982-06-03 | 1983-12-09 | Hitachi Ltd | レ−ザ光源装置 |
| JPS5918964A (ja) * | 1982-07-23 | 1984-01-31 | Hitachi Ltd | レ−ザ−ダイオ−ド駆動回路 |
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