JPS5837828A - オ−デイオ信号再生装置 - Google Patents
オ−デイオ信号再生装置Info
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- JPS5837828A JPS5837828A JP13729581A JP13729581A JPS5837828A JP S5837828 A JPS5837828 A JP S5837828A JP 13729581 A JP13729581 A JP 13729581A JP 13729581 A JP13729581 A JP 13729581A JP S5837828 A JPS5837828 A JP S5837828A
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- Japan
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- Pending
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/14—Digital recording or reproducing using self-clocking codes
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はオーディオ信号をディジタル信号に変換して記
−した、ディジタル・オーディオ・ディスク(以下DA
Dと称する〕からオーディオ信号を再生するオーディオ
信号再生装置に関するものである〇 従来、オーディオ信号を録音盤に記録するにはオーディ
オ信号の変化に対応して優音盤O溝の深さをアナログ的
に変化させていえ。しかしながら、仁の方法で拡得られ
る音質に限界があフ、これを解決する方法にオーディオ
信号をディジタル信号に変換した後、所定の規則に従が
って録音盤に記録するDADが提案されている0 本発明の目的は、DADに記録され良信号の中からオー
ディオ信号を読出して再生する、オーディオ信号外生装
置を提供することにある。
−した、ディジタル・オーディオ・ディスク(以下DA
Dと称する〕からオーディオ信号を再生するオーディオ
信号再生装置に関するものである〇 従来、オーディオ信号を録音盤に記録するにはオーディ
オ信号の変化に対応して優音盤O溝の深さをアナログ的
に変化させていえ。しかしながら、仁の方法で拡得られ
る音質に限界があフ、これを解決する方法にオーディオ
信号をディジタル信号に変換した後、所定の規則に従が
って録音盤に記録するDADが提案されている0 本発明の目的は、DADに記録され良信号の中からオー
ディオ信号を読出して再生する、オーディオ信号外生装
置を提供することにある。
このような目的を達成するために、本発明の装置は、D
ADレコードプレーヤから拾い出された信号によってり
四ツク信号シよび同期信号を発生させ、このクロック信
号および同期信号とによって読出信号を発生させ、との
読出信号によって、DADから拾い出された信号の中か
らオーディオ信号を再生するものである。
ADレコードプレーヤから拾い出された信号によってり
四ツク信号シよび同期信号を発生させ、このクロック信
号および同期信号とによって読出信号を発生させ、との
読出信号によって、DADから拾い出された信号の中か
らオーディオ信号を再生するものである。
ディジタル方式によって記録された録音盤罠DADがあ
り、これは#I1図(イ)に示すフォーマットに従がっ
て記録されている。同図において同期部ム4例えば%0
1 が11ビツト連続する部分ム1に続いて111 が
11ビツト連続するような部分ム鵞の合計22ビツトで
構成される◎また、記録部lは情報内容に応じて適宜1
01または%11が連続する一定のビット数で構成され
ている。そして、この記録部8は11 と%01 のビ
ットが交互に存在する5ビツトの第1の冗長部B1 と
、アナpグ量のオーディオ信号を14ビツトのディジタ
ル信号に変換した情報部B、と、%IIと%O1のビッ
トが交互に存在する3ビツトの#E2の冗長部B、とに
よって構成され、次のような順序で1フレームが構成さ
れる。
り、これは#I1図(イ)に示すフォーマットに従がっ
て記録されている。同図において同期部ム4例えば%0
1 が11ビツト連続する部分ム1に続いて111 が
11ビツト連続するような部分ム鵞の合計22ビツトで
構成される◎また、記録部lは情報内容に応じて適宜1
01または%11が連続する一定のビット数で構成され
ている。そして、この記録部8は11 と%01 のビ
ットが交互に存在する5ビツトの第1の冗長部B1 と
、アナpグ量のオーディオ信号を14ビツトのディジタ
ル信号に変換した情報部B、と、%IIと%O1のビッ
トが交互に存在する3ビツトの#E2の冗長部B、とに
よって構成され、次のような順序で1フレームが構成さ
れる。
先ず、同期部Aの次に第1の冗長部B1が続き。
その後は情報部B、と第2の冗長fits B sが交
互に33薗遅絖する記録部Bが続き、同期部ムと記録部
1とを合せてlフレームCを構成している。そして、デ
ィスク上KFi複数の7レー五〇が連続して記録されて
いる。
互に33薗遅絖する記録部Bが続き、同期部ムと記録部
1とを合せてlフレームCを構成している。そして、デ
ィスク上KFi複数の7レー五〇が連続して記録されて
いる。
この場合、記録部Bは情報内容がいかなる場合であって
も、11ビツトの%0# tたは%11 が連続する
組合せはとらない定義となっている。この定義によって
1フレームの冒頭に配置された同期鄭ムを記録部Bと弁
別して、第1図←)に示すように同期部Aと記録部Bの
境界で立上る信号(以下同期信号と称する)を発生する
ことができる。
も、11ビツトの%0# tたは%11 が連続する
組合せはとらない定義となっている。この定義によって
1フレームの冒頭に配置された同期鄭ムを記録部Bと弁
別して、第1図←)に示すように同期部Aと記録部Bの
境界で立上る信号(以下同期信号と称する)を発生する
ことができる。
更に、この同期信号を元に第1図eiに示すように各情
報sB鵞の後縁で立上る信号(以下読出信号と称するン
を発生させ、こO続出信号とDADから拾い出され遇嬌
された信号とから、情報fRS B sだけを読出して
オデイオ(M号を再生することがで自る。
報sB鵞の後縁で立上る信号(以下読出信号と称するン
を発生させ、こO続出信号とDADから拾い出され遇嬌
された信号とから、情報fRS B sだけを読出して
オデイオ(M号を再生することがで自る。
第2図は本発明に係る装置の一実施1PIlを示すブロ
ック図で6るoJ”1図において1はディスクから記録
信号を取出すピックアップ手段であってガえば回転数が
正確に制御され九りムD1−ヤからなり、レーザ光線を
DAD の面上に発射して、このレーザ光−の反射光を
フォトトランジスタで受光して第1図(イ)K示すよう
な電気信号に変換する。
ック図で6るoJ”1図において1はディスクから記録
信号を取出すピックアップ手段であってガえば回転数が
正確に制御され九りムD1−ヤからなり、レーザ光線を
DAD の面上に発射して、このレーザ光−の反射光を
フォトトランジスタで受光して第1図(イ)K示すよう
な電気信号に変換する。
2はクロック発振器であって、DADプレーヤ1から拾
い出された信号によって位相の制御される信号を発生す
る。3は同期信号発生部であって、DADプレーヤ1か
ら拾い出された信号とりqツク発生器2によって発生し
たり四ツク信号とから前述したように、WJ1図(ロ)
K示すような決った周期に1個づつ同期信号を発生する
。4は読出信号発生部であって、クロック信号と同期信
号とから前述したようにtiIJ1図(ハ)に示すよう
に(イ)の情報部1、と同期する読出偏′号を発生する
。5は情報信号読出部であって、DADプレーヤ1から
拾い出された信号と続出信号発生部4で発生した続出信
号とから、DADプレーヤ1から拾い出された信号のう
ちオーディオ信号がディジタル信号に変換され*S分の
信号、即ち第1図G)の情報部B3だけを続出す。6は
ディジタル・アナログ変換6(以下D/ム変換器と称す
)で6って、清報信−ttvt山部5によって読出され
たディジタル形式で表わされ良信号をアナ四グ形式に変
換する。なお、情報信号読出部5はシリアル信号を14
ビツトのパラレル信号に変換するシリアルイ/・パラレ
ルアウト形のシフトレジスタ5凰とこの出力信号を保持
する2ツテ回路5富とから構成されている。
い出された信号によって位相の制御される信号を発生す
る。3は同期信号発生部であって、DADプレーヤ1か
ら拾い出された信号とりqツク発生器2によって発生し
たり四ツク信号とから前述したように、WJ1図(ロ)
K示すような決った周期に1個づつ同期信号を発生する
。4は読出信号発生部であって、クロック信号と同期信
号とから前述したようにtiIJ1図(ハ)に示すよう
に(イ)の情報部1、と同期する読出偏′号を発生する
。5は情報信号読出部であって、DADプレーヤ1から
拾い出された信号と続出信号発生部4で発生した続出信
号とから、DADプレーヤ1から拾い出された信号のう
ちオーディオ信号がディジタル信号に変換され*S分の
信号、即ち第1図G)の情報部B3だけを続出す。6は
ディジタル・アナログ変換6(以下D/ム変換器と称す
)で6って、清報信−ttvt山部5によって読出され
たディジタル形式で表わされ良信号をアナ四グ形式に変
換する。なお、情報信号読出部5はシリアル信号を14
ビツトのパラレル信号に変換するシリアルイ/・パラレ
ルアウト形のシフトレジスタ5凰とこの出力信号を保持
する2ツテ回路5富とから構成されている。
このように構成された本発明に係る装置の動作は次の通
りである。DADプレーヤ1がらは、前述した第1図G
)に示す電気信号が拾い出され、クロック発振器2に供
給されるので、り四ツク発振儲2はDADプレーヤ1か
ら拾い出された信号によって位相の制御されたクロック
信号を発生する。
りである。DADプレーヤ1がらは、前述した第1図G
)に示す電気信号が拾い出され、クロック発振器2に供
給されるので、り四ツク発振儲2はDADプレーヤ1か
ら拾い出された信号によって位相の制御されたクロック
信号を発生する。
このDAD ル−ヤ1から拾い出された信号とクロック
信号とは同期信号発生部3に供給されて第1図(ロ)に
示すようなタイζフグの同期信号を発生する。そしてク
ロック信号と同期信号とは続出信号発生部4に供給され
、第1図f慢に示すようなタイ(ングの続出信号を発生
する。
信号とは同期信号発生部3に供給されて第1図(ロ)に
示すようなタイζフグの同期信号を発生する。そしてク
ロック信号と同期信号とは続出信号発生部4に供給され
、第1図f慢に示すようなタイ(ングの続出信号を発生
する。
一方、DADプレーヤ1から拾い出された信号扛情報信
号読出部Sのシリアルイン・バラレルアウドのシフトレ
ジスタ5t IIC供給され、このシフトレジスタ51
は14ビツトの出力信号端を有しており、シフ)レジス
タ51は入力信号を取込んで出力端から送出し7、出方
端の信号は入力(i!号が取込まれゐ都度、隣接する出
力端にシフトされる。
号読出部Sのシリアルイン・バラレルアウドのシフトレ
ジスタ5t IIC供給され、このシフトレジスタ51
は14ビツトの出力信号端を有しており、シフ)レジス
タ51は入力信号を取込んで出力端から送出し7、出方
端の信号は入力(i!号が取込まれゐ都度、隣接する出
力端にシフトされる。
ぞして、JI11図(イ)の清報部B3の後縁では清報
sBlを構成する14ビツトは全てシフトレジスタ51
の出力@に現われておシ、イツトレジスタ51の出力信
号はラッチ回路5.IC供給されている。この時、ラッ
チ回路5!には続出信号発生部4から第1図e屯示す絖
田信号が供給されるために、情報部B1はラッチ回路5
!に保持さhて出力され、111図0)に示すDADプ
レーヤによって拾い出された信号のうちから清報Pl:
B *だけが続出される。情報信号呼出部5によって
読出された情報部B、はD/A変換器6によってディジ
タル形式からアナログ形式に変換されるので、DADK
記録された信号からオーディオ信号を再生すゐことかで
きゐ。
sBlを構成する14ビツトは全てシフトレジスタ51
の出力@に現われておシ、イツトレジスタ51の出力信
号はラッチ回路5.IC供給されている。この時、ラッ
チ回路5!には続出信号発生部4から第1図e屯示す絖
田信号が供給されるために、情報部B1はラッチ回路5
!に保持さhて出力され、111図0)に示すDADプ
レーヤによって拾い出された信号のうちから清報Pl:
B *だけが続出される。情報信号呼出部5によって
読出された情報部B、はD/A変換器6によってディジ
タル形式からアナログ形式に変換されるので、DADK
記録された信号からオーディオ信号を再生すゐことかで
きゐ。
この場合、同期信号発生部3は例えば第3囚の出力信号
の相関関係tiJIJ図に示す概念図のようになってい
る。JI4図(イ)はDADプレーヤ1から拾い出され
た信号で、#I3図に示す入力端子Tに供給される0こ
の信号の時間幅はIl1図(イ)に示すイ8号フォーマ
ット01ビット単位で分割可能なように対応し%JI4
図←)an)図の幅と対応するビット数を示すものであ
る。第4rKJf役は第3図の入力端子1に供給された
入力信号が微分回路8によって処理され、かつ出力され
る1mlパルス信号である。第4図(ホ)は第1カクン
タ9から出力される計数値を示し、#I4図(へ)鉱第
2カウンタ1oがら出力される計数値である0#I4図
(ト)はMlカウンタ9から出力を保持する#Ilパラ
レル・り7トレジスタ110ラツチ針数値を示し、第4
図例は第2@[を示す。
の相関関係tiJIJ図に示す概念図のようになってい
る。JI4図(イ)はDADプレーヤ1から拾い出され
た信号で、#I3図に示す入力端子Tに供給される0こ
の信号の時間幅はIl1図(イ)に示すイ8号フォーマ
ット01ビット単位で分割可能なように対応し%JI4
図←)an)図の幅と対応するビット数を示すものであ
る。第4rKJf役は第3図の入力端子1に供給された
入力信号が微分回路8によって処理され、かつ出力され
る1mlパルス信号である。第4図(ホ)は第1カクン
タ9から出力される計数値を示し、#I4図(へ)鉱第
2カウンタ1oがら出力される計数値である0#I4図
(ト)はMlカウンタ9から出力を保持する#Ilパラ
レル・り7トレジスタ110ラツチ針数値を示し、第4
図例は第2@[を示す。
ml 、第2パラレル・シフトレジスタ11,120ラ
ツチタイ擢ングバルスは微分回路8.13から各々4見
られる。!l、第2パラレル・シフトレジスタ11.1
2の各々の計数値はそれぞれ第1e第2f:7−ダ14
,15に与えられる。第1、第2デコー/14,15で
解読される計数値が数字「11」で一致した時、出力端
子18に出力信号が現われるように、一致回路16が設
けられている。
ツチタイ擢ングバルスは微分回路8.13から各々4見
られる。!l、第2パラレル・シフトレジスタ11.1
2の各々の計数値はそれぞれ第1e第2f:7−ダ14
,15に与えられる。第1、第2デコー/14,15で
解読される計数値が数字「11」で一致した時、出力端
子18に出力信号が現われるように、一致回路16が設
けられている。
なお、17Viインバータであり、入力端子T&には第
2のクロック発振器2からクロック信号が供給されてい
る。
2のクロック発振器2からクロック信号が供給されてい
る。
また、続出信号発生部4は向えば落5図のように構成さ
れており、嬉5図における各部の入出力信号の相関関係
ti@6図に示すタイムチャートのようになっている0
第5図においてアンド回路19の一方の入力端には入力
端子20を介して第2図のクロック発振器2から第6図
0)に示すクロック信号が供給されている。一方、jl
!l記憶回路21のセット信号入力端子Sには第2図の
同期信号発生部4から入力端子22t−介して第1図O
矢印で示す同期信号りが供給される0こhは第6W7A
では(P)K示す波形であり、このことKよって第1記
憶回路21はセットされ、その出力信号は第6図に)に
示すようになシ、こO信号がアンド回路19の他方O入
力端に供給されるので、アンド回路18はJIK6図f
9に示す信号をM1分周器230入力端INに供給する
O M1分周1!23は例えば5進カウンタで構成され、パ
ルス信号を5個カク/卜すると#I6図に)に示す出力
tJi2記憶回路24のセット信号入力端8に供給する
ので、第2記憶回路24はセットされ、第6図に)に示
す出力信号をアンド回路2Sの一方の入力端に供給する
。このアンド回路25の他方の入力jllKは第6図(
へ)に示すクロック信号がカクンタで構成もれ、菖6図
(ト)に示す出力信号を@3記憶崗路2Tのセット信号
入力端8に供給するので、記憶回路27iセツトされ、
出方信号をアンド−w12・の一方の入力端に供給する
。このアンド關路280他方の入力端Krよアンド回路
2Sから第6図(へ)に示す信号が供給されているので
、アンド回路28は第6図(イ)K示す出力信号を第3
分周器2sの入力端INK供給する。
れており、嬉5図における各部の入出力信号の相関関係
ti@6図に示すタイムチャートのようになっている0
第5図においてアンド回路19の一方の入力端には入力
端子20を介して第2図のクロック発振器2から第6図
0)に示すクロック信号が供給されている。一方、jl
!l記憶回路21のセット信号入力端子Sには第2図の
同期信号発生部4から入力端子22t−介して第1図O
矢印で示す同期信号りが供給される0こhは第6W7A
では(P)K示す波形であり、このことKよって第1記
憶回路21はセットされ、その出力信号は第6図に)に
示すようになシ、こO信号がアンド回路19の他方O入
力端に供給されるので、アンド回路18はJIK6図f
9に示す信号をM1分周器230入力端INに供給する
O M1分周1!23は例えば5進カウンタで構成され、パ
ルス信号を5個カク/卜すると#I6図に)に示す出力
tJi2記憶回路24のセット信号入力端8に供給する
ので、第2記憶回路24はセットされ、第6図に)に示
す出力信号をアンド回路2Sの一方の入力端に供給する
。このアンド回路25の他方の入力jllKは第6図(
へ)に示すクロック信号がカクンタで構成もれ、菖6図
(ト)に示す出力信号を@3記憶崗路2Tのセット信号
入力端8に供給するので、記憶回路27iセツトされ、
出方信号をアンド−w12・の一方の入力端に供給する
。このアンド關路280他方の入力端Krよアンド回路
2Sから第6図(へ)に示す信号が供給されているので
、アンド回路28は第6図(イ)K示す出力信号を第3
分周器2sの入力端INK供給する。
絽3分周器2自は、的えば3進カウンタで構成され、#
!6図Q))に示す出力信号を@2分周器26のリセッ
ト入力端一1および第3記憶@* 2 Tのリセット入
力端R1に供給するので、#!2分X器26および第3
記憶回路27はリセットされる。
!6図Q))に示す出力信号を@2分周器26のリセッ
ト入力端一1および第3記憶@* 2 Tのリセット入
力端R1に供給するので、#!2分X器26および第3
記憶回路27はリセットされる。
そして、96図(す)に示すリセット信号が無くなると
、第2分周(至)26は入力端に供給されている第6図
(へ)に示す信号f:再び分周し、#I6図(hに示す
出力信号を第3記憶回路2Tに供給する。このことによ
りjI3分周器29は再びM6図Hに示す信号を分周し
、(す)に示す出力信号を発生して再度、#I2分周口
26および第3記憶回路21をリセツする。
、第2分周(至)26は入力端に供給されている第6図
(へ)に示す信号f:再び分周し、#I6図(hに示す
出力信号を第3記憶回路2Tに供給する。このことによ
りjI3分周器29は再びM6図Hに示す信号を分周し
、(す)に示す出力信号を発生して再度、#I2分周口
26および第3記憶回路21をリセツする。
こOため、第2分w4器26線第1図(うに示すようけ
)の情@部Bsと第2の冗長部Bsのビット数の合計で
ある17ビツト毎に1個のパルスをjI4分周器sOに
供給する○第4分周器30は例えば33進カウンタで構
成され、第6図←)に示す出力信号を記憶囲路21と2
4と27.分周器23と26と2Iのリセット入力端に
供給するので、それぞれの回路はリセットされる0この
ことによって、W、l記憶回路21の出力信号がアンド
回路1Bに供給されな(な夛、第5図の回路は全ての動
作を停止する0以上の動作によって出力端子31からは
第1図e→に示すように、期間T中に33IIAの[出
信号が得られる。
)の情@部Bsと第2の冗長部Bsのビット数の合計で
ある17ビツト毎に1個のパルスをjI4分周器sOに
供給する○第4分周器30は例えば33進カウンタで構
成され、第6図←)に示す出力信号を記憶囲路21と2
4と27.分周器23と26と2Iのリセット入力端に
供給するので、それぞれの回路はリセットされる0この
ことによって、W、l記憶回路21の出力信号がアンド
回路1Bに供給されな(な夛、第5図の回路は全ての動
作を停止する0以上の動作によって出力端子31からは
第1図e→に示すように、期間T中に33IIAの[出
信号が得られる。
そして、1II1図仲)の矢印Eに示すように、再び同
期信号が入力端子22に供給されると出力端子31から
は再[33@の読出信号が得られる。この結果、出力端
子31からはM1図(ハ)に示すように情報部B、の周
期に同期して発生する続出信号が得られる。
期信号が入力端子22に供給されると出力端子31から
は再[33@の読出信号が得られる。この結果、出力端
子31からはM1図(ハ)に示すように情報部B、の周
期に同期して発生する続出信号が得られる。
以上説明したように、本発明に係るオーディオ信号再生
懺置社、DADレコードプレーヤから拾い出された信号
によってクロック信号および同期信号を発生させ、この
クロック信号および同期信号とによって読出信号を発生
させ、この読出信号によって、r)ADから拾い出され
た信号からオーディオ信号を再生するものであるから、
高品質のオーディオ信号の再生が行える0
懺置社、DADレコードプレーヤから拾い出された信号
によってクロック信号および同期信号を発生させ、この
クロック信号および同期信号とによって読出信号を発生
させ、この読出信号によって、r)ADから拾い出され
た信号からオーディオ信号を再生するものであるから、
高品質のオーディオ信号の再生が行える0
第1図はDADから拾い出される信号の46号フォーマ
ットおよびこの信号を元に発生する同期信号および読出
信号のタイミングを示す図、#I2図は本発明に係るオ
ーディオ信号発生装置の一実施例を示すブロック図、第
3図は同期信号検出部の一実IIIIiガを示すブロッ
ク図、$4因は同期信号検出部内0m号の相関関係を示
す図、嬉5図眸読出信号発生部の一実施例を示すブロッ
ク図、第6図は読出信号発生部の信号のタイムチャート
である0 1Φ・・・ディジタル−オーディオ・ディスク、ル−ヤ
(DADプレーヤ〕、2・・・・クロック発振器、3・
・・・同期信号発生部、4・・・・読出信号発生部、5
・・・・清報信号続出部、6・・・・ディジタル・アナ
ログ変換器(D/A変換器)口
ットおよびこの信号を元に発生する同期信号および読出
信号のタイミングを示す図、#I2図は本発明に係るオ
ーディオ信号発生装置の一実施例を示すブロック図、第
3図は同期信号検出部の一実IIIIiガを示すブロッ
ク図、$4因は同期信号検出部内0m号の相関関係を示
す図、嬉5図眸読出信号発生部の一実施例を示すブロッ
ク図、第6図は読出信号発生部の信号のタイムチャート
である0 1Φ・・・ディジタル−オーディオ・ディスク、ル−ヤ
(DADプレーヤ〕、2・・・・クロック発振器、3・
・・・同期信号発生部、4・・・・読出信号発生部、5
・・・・清報信号続出部、6・・・・ディジタル・アナ
ログ変換器(D/A変換器)口
Claims (1)
- ディジタル信号に変換されたオーディオ信号がわらをじ
め清報部として定められた個所に記録されたディスクか
ら前記記録信号を取出すピックアップ手段と、この記録
信号によって位相が制御されるりはツク信号を発生する
クロック発振器と、前記記録信号とりpツク信号とから
あらかじめ定めた周期毎に同期信号を発生する同期信号
発生部と、り四ツク信号と同期信号とによって前記記録
信号の情報部に同期して続出信号を発生する読出信号発
生部と、前記記録信号を前記続出信号によって所定のル
ールで解読する情報信号読出部と、その情報信号読出部
で解読された信号をディジタル信号からアナログ信号に
変換するディジタル・アナ゛ログ変換器とから構成され
るオーディオ信号再生装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13729581A JPS5837828A (ja) | 1981-08-31 | 1981-08-31 | オ−デイオ信号再生装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13729581A JPS5837828A (ja) | 1981-08-31 | 1981-08-31 | オ−デイオ信号再生装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5837828A true JPS5837828A (ja) | 1983-03-05 |
Family
ID=15195339
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13729581A Pending JPS5837828A (ja) | 1981-08-31 | 1981-08-31 | オ−デイオ信号再生装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5837828A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6258333U (ja) * | 1985-09-30 | 1987-04-10 | ||
JPH02105820U (ja) * | 1989-02-13 | 1990-08-22 | ||
US5141133A (en) * | 1990-03-06 | 1992-08-25 | Marubeni Corporation | Pouring plug of a container |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5468617A (en) * | 1977-11-11 | 1979-06-01 | Mitsubishi Electric Corp | Signal recorder-reproducer |
JPS5570922A (en) * | 1978-11-21 | 1980-05-28 | Mitsubishi Electric Corp | Demodulation system of digital signal |
-
1981
- 1981-08-31 JP JP13729581A patent/JPS5837828A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5468617A (en) * | 1977-11-11 | 1979-06-01 | Mitsubishi Electric Corp | Signal recorder-reproducer |
JPS5570922A (en) * | 1978-11-21 | 1980-05-28 | Mitsubishi Electric Corp | Demodulation system of digital signal |
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