JPS58204621A - パルス信号制御回路 - Google Patents
パルス信号制御回路Info
- Publication number
- JPS58204621A JPS58204621A JP57087476A JP8747682A JPS58204621A JP S58204621 A JPS58204621 A JP S58204621A JP 57087476 A JP57087476 A JP 57087476A JP 8747682 A JP8747682 A JP 8747682A JP S58204621 A JPS58204621 A JP S58204621A
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- pulse
- signal
- emitter
- base
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
- H03K19/01—Modifications for accelerating switching
- H03K19/013—Modifications for accelerating switching in bipolar transistor circuits
Landscapes
- Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Computing Systems (AREA)
- General Engineering & Computer Science (AREA)
- Mathematical Physics (AREA)
- Electronic Switches (AREA)
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、パルス信号制御回路、とくにデータ信号に
対応した高周波パにスを含む増幅されたパルスデータ信
号を得るパルス信号制御回路に関する。
対応した高周波パにスを含む増幅されたパルスデータ信
号を得るパルス信号制御回路に関する。
従来上記パルス信号制御回路としては、データ入力信号
と高周波パルス信号とから得られ九ノくルスデータ信号
を増幅する方式が知られている。
と高周波パルス信号とから得られ九ノくルスデータ信号
を増幅する方式が知られている。
まず従来方式についてその動作方式を図を用いて説明し
、それに伴なう欠点について述べる。第１図および第２
図は、従来方式を示す回路図および波形図である。第１
図において、ゲート１は、縞２図に示すデータ信号ａと
高周波ノ（ルス信号すとからパルスデータ信号Ｃを得る
ための論理回路でＴｏシ、増幅回路２はパルスデータ信
号Ｃを増幅するための回路である。増幅回路２は、スイ
ッチングトランジスタ３、コレクタ抵抗５、バッファト
ランジスタ４およびダイオード６を具備している。スイ
ッチングトランジスタ３は、ＮＰＮ形トランジスタでそ
のエミッタはアース（ＧＮＤ）に。
、それに伴なう欠点について述べる。第１図および第２
図は、従来方式を示す回路図および波形図である。第１
図において、ゲート１は、縞２図に示すデータ信号ａと
高周波ノ（ルス信号すとからパルスデータ信号Ｃを得る
ための論理回路でＴｏシ、増幅回路２はパルスデータ信
号Ｃを増幅するための回路である。増幅回路２は、スイ
ッチングトランジスタ３、コレクタ抵抗５、バッファト
ランジスタ４およびダイオード６を具備している。スイ
ッチングトランジスタ３は、ＮＰＮ形トランジスタでそ
のエミッタはアース（ＧＮＤ）に。
コレクタはコレクタ抵抗５を介して電源＋Ｖに接続され
ている。バッファトランジスタ４は、ＮＰＮ形トランジ
スタでそのコレクタは電源十Ｖに接続され、ベース・エ
ミッタ間にはバッファダイオード６が接続され、さらに
ベースはスイッチングトランジスタ３のコレクタに接続
されている。パルスデータ信号Ｃは、スイッチングトラ
ンジスタによって電圧増幅され、さらにバッファトラン
ジスタによって電流増幅されて、出力Ｐにパルスデータ
信号Ｃに対応した増幅されたパルスデータ信号ｄを生じ
る。
ている。バッファトランジスタ４は、ＮＰＮ形トランジ
スタでそのコレクタは電源十Ｖに接続され、ベース・エ
ミッタ間にはバッファダイオード６が接続され、さらに
ベースはスイッチングトランジスタ３のコレクタに接続
されている。パルスデータ信号Ｃは、スイッチングトラ
ンジスタによって電圧増幅され、さらにバッファトラン
ジスタによって電流増幅されて、出力Ｐにパルスデータ
信号Ｃに対応した増幅されたパルスデータ信号ｄを生じ
る。
増幅回路２において、出力Ｐの信号を見ると、スイッチ
ングトランジスタ３がオンになる時即ち立ち下がシ特性
は急しゅんであるが、オフになる時にはスイッチングト
ランジスタ３のコレクタ容量およびコレクタ抵抗５から
なる時定数にしたがって電源電圧十■に引かれるため立
ち上がシ特性が惑い。このスイッチングトランジスタ３
のオフ時のスイッチング速度を早めるには、コレクタ抵
抗５の値會充分小さくすることが必要であるが、抵抗値
を低下させるとスイッチングトランジスタ３のオン時に
大電流が流れて電力抽失が大きくなりさらにはトランジ
スタが破裂してしまう欠点を有する。
ングトランジスタ３がオンになる時即ち立ち下がシ特性
は急しゅんであるが、オフになる時にはスイッチングト
ランジスタ３のコレクタ容量およびコレクタ抵抗５から
なる時定数にしたがって電源電圧十■に引かれるため立
ち上がシ特性が惑い。このスイッチングトランジスタ３
のオフ時のスイッチング速度を早めるには、コレクタ抵
抗５の値會充分小さくすることが必要であるが、抵抗値
を低下させるとスイッチングトランジスタ３のオン時に
大電流が流れて電力抽失が大きくなりさらにはトランジ
スタが破裂してしまう欠点を有する。
したがって本発明の目的は、前記の欠点をなくし、抵抗
電力損やトランジスタ電力損などの電力損失を小さくし
パルス信号制御回路を得ることである。
電力損やトランジスタ電力損などの電力損失を小さくし
パルス信号制御回路を得ることである。
本発明によるパルス信号制御回路においては、あらかじ
め増幅された高周波パルスをスイッチング回路に常時加
えておき、データ信号に応じて増□ 暢された高周波パルスを通断あるいは通過させている。
め増幅された高周波パルスをスイッチング回路に常時加
えておき、データ信号に応じて増□ 暢された高周波パルスを通断あるいは通過させている。
次に本発明の一実施例およびその波形を示した第３図お
よび第４図を参考して、本発明の詳細な説明する。
よび第４図を参考して、本発明の詳細な説明する。
第３図に示した本発明の一実施例において、第１のトラ
ンジスタ９のエミッタ・ベース間にはエミッタ・ベース
のダイオード特性とその極性が逆になるように第１のダ
イオード１２が接続され。
ンジスタ９のエミッタ・ベース間にはエミッタ・ベース
のダイオード特性とその極性が逆になるように第１のダ
イオード１２が接続され。
ベース・コレクタ間には高抵抗１１が接続され、さらに
第２のトランジスタ１ｏのベース・エミッタ間にはベー
ス抵抗１３が接続され、さらにそのコレクタは第１のト
ランジスタ９のベースに接続されるごとき構成となって
いる。
第２のトランジスタ１ｏのベース・エミッタ間にはベー
ス抵抗１３が接続され、さらにそのコレクタは第１のト
ランジスタ９のベースに接続されるごとき構成となって
いる。
第３図においては、いま第２のダイオード１４ヲ介して
第２のトランジスタ１ｏのコレクタ抵抗幅された高周波
パルス信号ｅを入力しておき、第２のトランジスタ１０
のベースおよびエミッタに高周波パルス信号と逆位相の
パルスデータ信号Ｃおよび高周波パルス信号と同位相の
パルス信号ｄを入力させるとする。パルスデータ信号Ｃ
中にデータがない場合、第２のトランジスタ１ｏはオフ
となっており、第１のトランジスタ９のエミッタは増幅
された高周波パルスｅの正の波高値＋■に保たれる。パ
ルスデータ信号Ｃ中にデータがある場合、データ中のパ
ルスの極性に応じて第２のトランジスタ１０はオン、オ
フをくり返す。即ち第１のトランジスタ９の工ずツタ電
位は第２のトランジスタ１０がオンの場合は第１のダイ
オード１２、第２のトランジスタ１０のコレクタ、工ば
ツタを介してアース電位に固定され％第２のトランジス
ｊ’ ｌ Ｏカオ７ Ｏ場合は、第１のトランジスタ９
のベース、および第２のダイオード１４１に介して増幅
された１Ｉｉｌｉ局波パルスｅの正の波顯値＋Ｖに固定
される。結局ｊｇ２のトランジスタ１ｏのベースに入力
するパルスデータ信号 に対応して第１のトランジスタ
９のエミッタよシ増幅されたパルステータ信号ｆを得る
ことができる。
第２のトランジスタ１ｏのコレクタ抵抗幅された高周波
パルス信号ｅを入力しておき、第２のトランジスタ１０
のベースおよびエミッタに高周波パルス信号と逆位相の
パルスデータ信号Ｃおよび高周波パルス信号と同位相の
パルス信号ｄを入力させるとする。パルスデータ信号Ｃ
中にデータがない場合、第２のトランジスタ１ｏはオフ
となっており、第１のトランジスタ９のエミッタは増幅
された高周波パルスｅの正の波高値＋■に保たれる。パ
ルスデータ信号Ｃ中にデータがある場合、データ中のパ
ルスの極性に応じて第２のトランジスタ１０はオン、オ
フをくり返す。即ち第１のトランジスタ９の工ずツタ電
位は第２のトランジスタ１０がオンの場合は第１のダイ
オード１２、第２のトランジスタ１０のコレクタ、工ば
ツタを介してアース電位に固定され％第２のトランジス
ｊ’ ｌ Ｏカオ７ Ｏ場合は、第１のトランジスタ９
のベース、および第２のダイオード１４１に介して増幅
された１Ｉｉｌｉ局波パルスｅの正の波顯値＋Ｖに固定
される。結局ｊｇ２のトランジスタ１ｏのベースに入力
するパルスデータ信号 に対応して第１のトランジスタ
９のエミッタよシ増幅されたパルステータ信号ｆを得る
ことができる。
ここで第２のトランジスタ１ｏのエミッタＫＱ周波パル
ス信号１４と同位相のパルス信号ｄを入力する理由につ
きのべる。
ス信号１４と同位相のパルス信号ｄを入力する理由につ
きのべる。
第２のトランジスタ１ｏのエミッタをアースなどの固定
電位にクランプした場合、第２のトランジスタ１００オ
ン、オフの尚波数特性はベース容影とベース抵抗の積か
らなる時定数により定まるベース容詰″、ベース抵抗を
小さくすることが第２のトランジスタのオン、オフ特性
を改１１スることにつながるが、ベース容ｉｔはトラン
ジスタ自身の特性によって、又ベース抵抗は、パルステ
ータ１６号の出力インピーダンスによってそれぞれ市１
」限される。
電位にクランプした場合、第２のトランジスタ１００オ
ン、オフの尚波数特性はベース容影とベース抵抗の積か
らなる時定数により定まるベース容詰″、ベース抵抗を
小さくすることが第２のトランジスタのオン、オフ特性
を改１１スることにつながるが、ベース容ｉｔはトラン
ジスタ自身の特性によって、又ベース抵抗は、パルステ
ータ１６号の出力インピーダンスによってそれぞれ市１
」限される。
実験によれば、パルステータ信号の周波数が４００ｋＨ
ｚ ｆこえると第２のトランジスター０のオフ特性が悪
くなりｓ ’Ｗ幅された篩周彼パルス信号１４の立ち上
がり時に一時的に第２のトランジスター０に大Ｖ流が流
れ電力損を生じる他、第１のトランジスタ９のエミッタ
に充分な振幅をもつ増幅されたパルステータ信号が得ら
れなく彦る。
ｚ ｆこえると第２のトランジスター０のオフ特性が悪
くなりｓ ’Ｗ幅された篩周彼パルス信号１４の立ち上
がり時に一時的に第２のトランジスター０に大Ｖ流が流
れ電力損を生じる他、第１のトランジスタ９のエミッタ
に充分な振幅をもつ増幅されたパルステータ信号が得ら
れなく彦る。
いま、第２のトランジスター０のエミッタに高周波パル
ス信号１４と同位相のパルス信号ｄｔ−人：１： 力させると、第２のトランジスター０はオフ時エミッタ
電位がベース電位より高くなるため前記ベース抵抗、ベ
ース容讐による時定数にかかわりなくオフとなり、オフ
特性が改善される。
ス信号１４と同位相のパルス信号ｄｔ−人：１： 力させると、第２のトランジスター０はオフ時エミッタ
電位がベース電位より高くなるため前記ベース抵抗、ベ
ース容讐による時定数にかかわりなくオフとなり、オフ
特性が改善される。
第３図においては、第２のトランジスタがオフとなった
場合、前述の如く第１のトランジスタ９のエミッタは第
１のトランジスタ９のベースおよび第２のダイオード１
４を介して＋Ｖに固定されるため時定数遅れはなく、増
幅されたパルスデータ信号ｆの立ち上がり時性は非常に
よい。さらに鳥抵抗１１の抵抗値は高い値に設定されて
いるが、前記増幅されたパルステータ信号ｆの立ち上が
９特性は くならない為回路中の電力損を改善すること
ができる。さらにキ２のトランジスタのコレクタに入力
される増幅された高周波パルスｅはその極性が負の時は
第２のダイオード１４によってし中断され、極性が正の
時は第１のトランジスタ９において＊Ｓ増偏された後そ
のエミッタに出力を生じる為高周波パルスＣの供給電流
は非常に少なくてすむというすぐれた特徴を有する。
場合、前述の如く第１のトランジスタ９のエミッタは第
１のトランジスタ９のベースおよび第２のダイオード１
４を介して＋Ｖに固定されるため時定数遅れはなく、増
幅されたパルスデータ信号ｆの立ち上がり時性は非常に
よい。さらに鳥抵抗１１の抵抗値は高い値に設定されて
いるが、前記増幅されたパルステータ信号ｆの立ち上が
９特性は くならない為回路中の電力損を改善すること
ができる。さらにキ２のトランジスタのコレクタに入力
される増幅された高周波パルスｅはその極性が負の時は
第２のダイオード１４によってし中断され、極性が正の
時は第１のトランジスタ９において＊Ｓ増偏された後そ
のエミッタに出力を生じる為高周波パルスＣの供給電流
は非常に少なくてすむというすぐれた特徴を有する。
ヶお＊’ｇｑｏ。諭１におい□□、およ。、２のトラン
ジスタは、ＮＰＮ型としているが、第１および第２のダ
イオードの極性を逆極性となる如く接続すればＰＮＰＪ
としても全く同様の効果が得られることはもちろんであ
る。
ジスタは、ＮＰＮ型としているが、第１および第２のダ
イオードの極性を逆極性となる如く接続すればＰＮＰＪ
としても全く同様の効果が得られることはもちろんであ
る。
第１図、第２図は従来の方式によるパルス１〆号制御回
路およびての波形図、第３図、第４図は本発明によるパ
ルス１ぎ号制呻回路およびその波形図をそれぞれ示す。 図において、ｌ・・・・・・ゲート、２・・・・・・増
幅回路、３・・・・・°スイッチングトランジスタ、４
・・団・バッファトランジスタ、５・・・・・・コレク
タ抵抗、６・・四・ダイオード、９・・・・・・第１の
トランジスタ、１０・・・・・・第２のトランジスタ、
１１・・・・・・高抵抗、１２・・・・・・第１のダイ
オード、１３・・・・・・ベース抵抗、１４０．・・・
・第２のダイオードをそれぞれ示す〇第 ／ 図 −８８
路およびての波形図、第３図、第４図は本発明によるパ
ルス１ぎ号制呻回路およびその波形図をそれぞれ示す。 図において、ｌ・・・・・・ゲート、２・・・・・・増
幅回路、３・・・・・°スイッチングトランジスタ、４
・・団・バッファトランジスタ、５・・・・・・コレク
タ抵抗、６・・四・ダイオード、９・・・・・・第１の
トランジスタ、１０・・・・・・第２のトランジスタ、
１１・・・・・・高抵抗、１２・・・・・・第１のダイ
オード、１３・・・・・・ベース抵抗、１４０．・・・
・第２のダイオードをそれぞれ示す〇第 ／ 図 −８８
Claims (1)
- 第１のトランジスタのエミッタ・ベース間にはエミッタ
・ベース間のダイオード特性と逆となる如き方向に第１
のダイオードが接続され、さらにコレクタ・ベース間に
は高抵抗が接続され、コレクタは高圧電源に接続され、
第２のトランジスタのベース・エミッタ間にはベース抵
抗が接続され、さらにそのコレクタは第１のトランジス
タのベースおよび第２のダイオードに接続されるごとき
パルス発生回路において第２のダイオードを介して増幅
された高周波パルス信号を第２のトランジスタのコレク
タに入力させるとともに高周波パルス信号と逆位相のパ
ルスを含むパルスデータ信号および高周波パルス信号と
同位相のパルス信号を第２のトランジスタのベースおよ
びエミッタにそれぞれ入力させることにより、第１のト
ランジスタのエミッタからパルスデータ信号に対応した
増幅されたパルスデータ信号を得ることを特徴とするパ
ルス信号制御回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57087476A JPS58204621A (ja) | 1982-05-24 | 1982-05-24 | パルス信号制御回路 |
| US06/497,047 US4555641A (en) | 1982-05-24 | 1983-05-23 | Pulse signal control circuits with improved turn-off characteristic |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57087476A JPS58204621A (ja) | 1982-05-24 | 1982-05-24 | パルス信号制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58204621A true JPS58204621A (ja) | 1983-11-29 |
| JPH0424889B2 JPH0424889B2 (ja) | 1992-04-28 |
Family
ID=13915970
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57087476A Granted JPS58204621A (ja) | 1982-05-24 | 1982-05-24 | パルス信号制御回路 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4555641A (ja) |
| JP (1) | JPS58204621A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5805123A (en) * | 1995-03-16 | 1998-09-08 | Texas Instruments Incorporated | Display panel driving circuit having an integrated circuit portion and a high power portion attached to the integrated circuit |
| EP0851586A1 (fr) * | 1996-12-31 | 1998-07-01 | Koninklijke Philips Electronics N.V. | Circuit intégré contenant un dissymétriseur |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5447468A (en) * | 1977-09-21 | 1979-04-14 | Nec Corp | Pulse signal control circuit |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3183370A (en) * | 1961-12-07 | 1965-05-11 | Ibm | Transistor logic circuits operable through feedback circuitry in nonsaturating manner |
| US3363116A (en) * | 1965-06-07 | 1968-01-09 | Fairchild Camera Instr Co | High-speed transistor pulse repeater circuit |
| US3482111A (en) * | 1966-03-04 | 1969-12-02 | Ncr Co | High speed logical circuit |
| US4234805A (en) * | 1978-03-15 | 1980-11-18 | Evc, Inc. | Circuit and method for paralleling power transistors |
-
1982
- 1982-05-24 JP JP57087476A patent/JPS58204621A/ja active Granted
-
1983
- 1983-05-23 US US06/497,047 patent/US4555641A/en not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5447468A (en) * | 1977-09-21 | 1979-04-14 | Nec Corp | Pulse signal control circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| US4555641A (en) | 1985-11-26 |
| JPH0424889B2 (ja) | 1992-04-28 |
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