JPH11265165A - プラズマディスプレ―パネルの表示ライン駆動方法 - Google Patents
プラズマディスプレ―パネルの表示ライン駆動方法Info
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Abstract
(57)【要約】
【課題】 表示パルスを独立的に調節してホワイトバラ
ンスが正確に取られるようにするプラズマディスプレー
パネルの表示ライン駆動方法を提供すること。 【解決手段】 パネルの特性を考えてホワイトバランス
を調整する時、色信号の輝度と色座標とにより、表示パ
ルスが加えられる期間に各カラー別に消去パルスを入れ
て、ホワイトバランスが取られる比率のパルスが正確に
加えられるようにしたことを特徴とする。これによって
パネルの特性を考えたホワイトバランスを調整する時、
ルックアップテーブルの追加または蛍光体を交換しなく
ても、ホワイトバランスを正確に調節することができる
という利点がある。
ンスが正確に取られるようにするプラズマディスプレー
パネルの表示ライン駆動方法を提供すること。 【解決手段】 パネルの特性を考えてホワイトバランス
を調整する時、色信号の輝度と色座標とにより、表示パ
ルスが加えられる期間に各カラー別に消去パルスを入れ
て、ホワイトバランスが取られる比率のパルスが正確に
加えられるようにしたことを特徴とする。これによって
パネルの特性を考えたホワイトバランスを調整する時、
ルックアップテーブルの追加または蛍光体を交換しなく
ても、ホワイトバランスを正確に調節することができる
という利点がある。
Description
【０００１】
【発明の属する技術分野】本発明は、プラズマディスプ
レーパネルでホワイトバランスのための表示ライン駆動
方法に関するもので、具体的にはパネルの特性を考えた
ホワイトバランスの調整時、表示パルスが加えられる期
間に、各カラー別に消去パルスを入れてホワイトバラン
スが取られる比率のパルスが加えられるようにする、プ
ラズマディスプレーパネルの表示ラインの駆動方法に関
する。
レーパネルでホワイトバランスのための表示ライン駆動
方法に関するもので、具体的にはパネルの特性を考えた
ホワイトバランスの調整時、表示パルスが加えられる期
間に、各カラー別に消去パルスを入れてホワイトバラン
スが取られる比率のパルスが加えられるようにする、プ
ラズマディスプレーパネルの表示ラインの駆動方法に関
する。
【０００２】
【従来の技術】例えば、平面表示装置の中の１つである
プラズマ表示装置は、発光形素子のプラズマ表示パネル
（ＰＤＰ）を備え、ＰＤＰの内部の気体放電現象を用い
て、動画像または停止画像を表示する。図１に一般的な
プラズマディスプレーパネルの１つのセルの構造を示
す。セル構造は、画像の表示面である上部ガラス基板
（１）と、その上部ガラス基板と所定の距離を持って平
行に配置した下部ガラス基板（２）と、上部ガラス基板
（１）と下部ガラス基板（２）との間に配列されて放電
空間を形成する隔壁（３）とを備えている。上部ガラス
基板（１）の下部ガラス基板（２）と対向する面に、隔
壁（３）と平行に一定の間隔を保って走査電極（４）と
共通電極（５）（以下、“第１、第２表示電極”と称す
る）が形成され、下部ガラス基板（２）には上記表示電
極と直交するように、第１、第２表示電極（４、５）と
共に放電を発生させるアドレス電極（７）が形成されて
いる。上部ガラス基板（１）の表面にはさらに表示電極
を覆い、放電時に放電電流を制限する誘電層（６）が形
成され、かつ、放電空間の内部の下部ガラス基板
（２）、隔壁（３）、アドレス電極（７）上に、各セル
の放電時に赤色、緑色、青色（Ｒ、Ｇ、Ｂ）の可視光を
それぞれ放出する蛍光層（８）が形成されている。隔壁
３の隣には同様の構成の放電空間が平行に多数並んでい
る。
プラズマ表示装置は、発光形素子のプラズマ表示パネル
（ＰＤＰ）を備え、ＰＤＰの内部の気体放電現象を用い
て、動画像または停止画像を表示する。図１に一般的な
プラズマディスプレーパネルの１つのセルの構造を示
す。セル構造は、画像の表示面である上部ガラス基板
（１）と、その上部ガラス基板と所定の距離を持って平
行に配置した下部ガラス基板（２）と、上部ガラス基板
（１）と下部ガラス基板（２）との間に配列されて放電
空間を形成する隔壁（３）とを備えている。上部ガラス
基板（１）の下部ガラス基板（２）と対向する面に、隔
壁（３）と平行に一定の間隔を保って走査電極（４）と
共通電極（５）（以下、“第１、第２表示電極”と称す
る）が形成され、下部ガラス基板（２）には上記表示電
極と直交するように、第１、第２表示電極（４、５）と
共に放電を発生させるアドレス電極（７）が形成されて
いる。上部ガラス基板（１）の表面にはさらに表示電極
を覆い、放電時に放電電流を制限する誘電層（６）が形
成され、かつ、放電空間の内部の下部ガラス基板
（２）、隔壁（３）、アドレス電極（７）上に、各セル
の放電時に赤色、緑色、青色（Ｒ、Ｇ、Ｂ）の可視光を
それぞれ放出する蛍光層（８）が形成されている。隔壁
３の隣には同様の構成の放電空間が平行に多数並んでい
る。
【０００３】上記構成のＰＤＰセルは、電極間の放電時
に放出される紫外線が蛍光体を励起して、蛍光体に可視
光を発生させる。この放電原理を図２及び図３を参照し
て以下に説明する。図２及び図３に、各電極に印加され
る駆動波形とその駆動波形による該当セルの壁電荷の進
行過程を示す。画素の階調を得るためには、陰極線管
（ＣＲＴ）の場合は電子ビームの強さを変えて明るさの
調節が可能であるが、ＰＤＰは放電の強弱の調整が難し
いので、単位時間当たりの放電回数により階調を表現し
ている。そして、１つの画素はＲ、Ｇ、Ｂの３個の放電
セルからなるが、２５６階調の場合、フレーム毎に各放
電セルの放電回数を０〜２５５回に分けて放電させ、放
電回数によって２５６階調の明るさが実現される。
に放出される紫外線が蛍光体を励起して、蛍光体に可視
光を発生させる。この放電原理を図２及び図３を参照し
て以下に説明する。図２及び図３に、各電極に印加され
る駆動波形とその駆動波形による該当セルの壁電荷の進
行過程を示す。画素の階調を得るためには、陰極線管
（ＣＲＴ）の場合は電子ビームの強さを変えて明るさの
調節が可能であるが、ＰＤＰは放電の強弱の調整が難し
いので、単位時間当たりの放電回数により階調を表現し
ている。そして、１つの画素はＲ、Ｇ、Ｂの３個の放電
セルからなるが、２５６階調の場合、フレーム毎に各放
電セルの放電回数を０〜２５５回に分けて放電させ、放
電回数によって２５６階調の明るさが実現される。
【０００４】各セルの内部で選択的に発生される放電の
種類には、発光される画素の指定のためのアドレス放電
と、放電したセルの放電を維持させる表示放電及び放電
セルの維持を停止させる消去放電からなる。下部ガラス
基板（２）のアドレス電極（７）と上部ガラス基板
（１）の表示電極（４、５）と間のアドレス放電によ
り、放電空間の内部に以前にはなかった壁電荷が第１、
第２表示電極（４、５）近所の誘電層（６）に形成さ
れ、上部ガラス基板（１）の第１、第２表示電極（４、
５）間に表示放電が維持される。
種類には、発光される画素の指定のためのアドレス放電
と、放電したセルの放電を維持させる表示放電及び放電
セルの維持を停止させる消去放電からなる。下部ガラス
基板（２）のアドレス電極（７）と上部ガラス基板
（１）の表示電極（４、５）と間のアドレス放電によ
り、放電空間の内部に以前にはなかった壁電荷が第１、
第２表示電極（４、５）近所の誘電層（６）に形成さ
れ、上部ガラス基板（１）の第１、第２表示電極（４、
５）間に表示放電が維持される。
【０００５】例えば、各電極（４、５、７）に図２の駆
動波形が印加される時、（ａ）〜（ｈ）区間における壁
電荷及び放電は、図３の（ａ）〜（ｈ）に図示の通りに
現れる。以下それを詳細に説明する。図３の（ａ）状態
の以前には放電セルに壁電荷はなかったものとする。
（ａ）の区間でアドレス電極（７）と第１表示電極
（４）とに電圧が加えられてそれらの間にアドレス放電
が発生する。アドレス放電後の（ｂ）区間でセルの内部
に壁電荷が形成される。この時、壁電荷のほとんどは、
第１、第２表示電極（４、５）の間に形成される。アド
レス電極（７）に加えられる書き込みパルスの間隔は通
常２μｓ以上である。これは壁電荷を形成するための時
間である。
動波形が印加される時、（ａ）〜（ｈ）区間における壁
電荷及び放電は、図３の（ａ）〜（ｈ）に図示の通りに
現れる。以下それを詳細に説明する。図３の（ａ）状態
の以前には放電セルに壁電荷はなかったものとする。
（ａ）の区間でアドレス電極（７）と第１表示電極
（４）とに電圧が加えられてそれらの間にアドレス放電
が発生する。アドレス放電後の（ｂ）区間でセルの内部
に壁電荷が形成される。この時、壁電荷のほとんどは、
第１、第２表示電極（４、５）の間に形成される。アド
レス電極（７）に加えられる書き込みパルスの間隔は通
常２μｓ以上である。これは壁電荷を形成するための時
間である。
【０００６】次ぎに、（ｃ）区間で第１、第２表示電極
（４、５）間に表示放電が発生し、（ｄ）区間で表示放
電後の壁電荷は、（ｂ）区間における壁電荷と反対にな
る。この時、各電極（４、５、７）の表示電圧の差は、
アドレス電極（７）と表示電極（４）と間の書き込み電
圧の差より低い電圧を使用することができる。これは誘
電層（６）に形成された壁電荷のためであり、壁電荷が
形成されていないセルでは、表示放電が発生されない。
以降（ｅ）区間と（ｆ）区間では、表示パルスによる表
示放電を示している。この時の壁電荷は（ｄ）区間との
反対となる。従って、一表示周期は、（ｃ）区間から
（ｆ）区間までであり、一表示周期の間の放電回数は２
回となる。この放電を所要回数継続する。
（４、５）間に表示放電が発生し、（ｄ）区間で表示放
電後の壁電荷は、（ｂ）区間における壁電荷と反対にな
る。この時、各電極（４、５、７）の表示電圧の差は、
アドレス電極（７）と表示電極（４）と間の書き込み電
圧の差より低い電圧を使用することができる。これは誘
電層（６）に形成された壁電荷のためであり、壁電荷が
形成されていないセルでは、表示放電が発生されない。
以降（ｅ）区間と（ｆ）区間では、表示パルスによる表
示放電を示している。この時の壁電荷は（ｄ）区間との
反対となる。従って、一表示周期は、（ｃ）区間から
（ｆ）区間までであり、一表示周期の間の放電回数は２
回となる。この放電を所要回数継続する。
【０００７】そして、消去放電は、図２の消去パルスに
より図３の（ｇ）区間で発生する。消去パルスはその幅
が通常的に１μｓ以下であり、パルスレベル（電圧）も
表示パルスのレベル（電圧）より低い。この消去パルス
により第１、第２表示電極（４、５）間に放電を発生さ
せるが壁電荷を形成する時間がないので、（ｈ）区間で
壁電荷のないセルとなり、これに伴ってその後表示パル
スを加えても放電が発生されない。
より図３の（ｇ）区間で発生する。消去パルスはその幅
が通常的に１μｓ以下であり、パルスレベル（電圧）も
表示パルスのレベル（電圧）より低い。この消去パルス
により第１、第２表示電極（４、５）間に放電を発生さ
せるが壁電荷を形成する時間がないので、（ｈ）区間で
壁電荷のないセルとなり、これに伴ってその後表示パル
スを加えても放電が発生されない。
【０００８】図４に一般的なプラズマディスプレーパネ
ルの駆動回路を示している。以下その回路を簡単に説明
する。ＰＤＰ（１０）は、６４０個のＲ、Ｇ、Ｂアドレ
ス電極ライン（Ｒ１、Ｇ１、Ｂ１、・・・、Ｒ６４０、
Ｇ６４０、Ｂ６４０）と４８０個の第１、第２表示電極
ライン（Ｓ１、Ｓ２、・・・、Ｓ４７９、Ｓ４８０）を
備えている。このＰＤＰ（１０）はマイクロプロセッサ
（２０）によって制御されるが、この例においてはこの
マイクロプロセッサ（２０）は、外部から入力される
Ｒ、Ｇ、Ｂ画像データをデジタル化して、８ビットの
Ｒ、Ｇ、Ｂデジタル画像データ（２8 ＝２５６階調）と
外部の信号によってＰＤＰ（１０）の駆動に必要な各種
の制御信号を出力する。このマイクロプロセッサ（２
０）の制御によって、走査及び表示駆動部（３０）は、
４８０個の第１、第２表示電極ライン（Ｓ１〜Ｓ４８
０）に走査パルスを印加して、１ラインずつ順次に走査
した後、全ての第１、第２表示電極ライン（Ｓ１〜Ｓ４
８０）に表示パルスを印加して、各セルの放電及び発光
を維持させる。メモリ（４０）がマイクロプロセッサ
（２０）のＲ、Ｇ、Ｂデジタル画像データをフレーム
別、カラー別、ビット別に記憶している。さらにこの回
路は、走査及び表示駆動部（３０）が走査することによ
り、第１、第２表示電極ライン（Ｓ１〜Ｓ４８０）に対
応する６４０個のＲ、Ｇ、Ｂデジタル画像データのビッ
ト値をメモリ（４０）から読み込んで、６４０個のＲ、
Ｇ、Ｂアドレス電極ライン（Ｒ１〜Ｂ６４０）に必要な
電圧を加えることができるアドレス駆動部（５０）を備
えている。
ルの駆動回路を示している。以下その回路を簡単に説明
する。ＰＤＰ（１０）は、６４０個のＲ、Ｇ、Ｂアドレ
ス電極ライン（Ｒ１、Ｇ１、Ｂ１、・・・、Ｒ６４０、
Ｇ６４０、Ｂ６４０）と４８０個の第１、第２表示電極
ライン（Ｓ１、Ｓ２、・・・、Ｓ４７９、Ｓ４８０）を
備えている。このＰＤＰ（１０）はマイクロプロセッサ
（２０）によって制御されるが、この例においてはこの
マイクロプロセッサ（２０）は、外部から入力される
Ｒ、Ｇ、Ｂ画像データをデジタル化して、８ビットの
Ｒ、Ｇ、Ｂデジタル画像データ（２8 ＝２５６階調）と
外部の信号によってＰＤＰ（１０）の駆動に必要な各種
の制御信号を出力する。このマイクロプロセッサ（２
０）の制御によって、走査及び表示駆動部（３０）は、
４８０個の第１、第２表示電極ライン（Ｓ１〜Ｓ４８
０）に走査パルスを印加して、１ラインずつ順次に走査
した後、全ての第１、第２表示電極ライン（Ｓ１〜Ｓ４
８０）に表示パルスを印加して、各セルの放電及び発光
を維持させる。メモリ（４０）がマイクロプロセッサ
（２０）のＲ、Ｇ、Ｂデジタル画像データをフレーム
別、カラー別、ビット別に記憶している。さらにこの回
路は、走査及び表示駆動部（３０）が走査することによ
り、第１、第２表示電極ライン（Ｓ１〜Ｓ４８０）に対
応する６４０個のＲ、Ｇ、Ｂデジタル画像データのビッ
ト値をメモリ（４０）から読み込んで、６４０個のＲ、
Ｇ、Ｂアドレス電極ライン（Ｒ１〜Ｂ６４０）に必要な
電圧を加えることができるアドレス駆動部（５０）を備
えている。
【０００９】走査及び表示駆動部（３０）は、マイクロ
プロセッサ（２０）の制御によって、クロック（ＣＬ
Ｋ）とデータ（ＤＡＴＡ）とを発生するクロック及びデ
ータ発生部（３１）と、マイクロプロセッサ（２０）の
制御によって表示パルスを発生する表示パルス発生部
（３２）と、第１、第２表示電極ライン（Ｓ１〜Ｓ４８
０）と連結された状態でクロック（ＣＬＫ）、出（ＤＡ
ＴＡ）、表示パルスによって第１、第２表示電極ライン
（Ｓ１〜Ｓ４８０）に順次的に走査パルスと表示パルス
を印加する駆動ロジック部（３３）とを含む。
プロセッサ（２０）の制御によって、クロック（ＣＬ
Ｋ）とデータ（ＤＡＴＡ）とを発生するクロック及びデ
ータ発生部（３１）と、マイクロプロセッサ（２０）の
制御によって表示パルスを発生する表示パルス発生部
（３２）と、第１、第２表示電極ライン（Ｓ１〜Ｓ４８
０）と連結された状態でクロック（ＣＬＫ）、出（ＤＡ
ＴＡ）、表示パルスによって第１、第２表示電極ライン
（Ｓ１〜Ｓ４８０）に順次的に走査パルスと表示パルス
を印加する駆動ロジック部（３３）とを含む。
【００１０】このように構成されるプラズマディスプレ
ーパネルは、いろいろの駆動方式の中の１つであるＡＤ
Ｓ(Addressing Display-Separating) サブフィールド方
式によって、パネル上に２５６階調の画像を表示する過
程を図〜図３を参照して説明する。ＡＤＳサブフィール
ド方式は、２Ｘ階調を実現するために、１フレーム画面
をＸ個のサブフィールド画面に分けて表示し、外部から
入力される画像データを、Ｘビットのデジタル画像デー
タ（最下位ビット（Ｄ１）−最上位ビット（ＤＸ））に
デジタル化してパネルに印加する方式である。そして、
各サブフィールド画面は、リセット期間とアドレス期間
と表示期間とから構成されるが、そのリセット期間とア
ドレス期間は、サブフィールド毎にその全てが同一に割
り当てられているが、表示期間は、アドレス期間に表示
されるデジタル画像データのビット加重値によって相互
に異なるように割り当てられているので、各サブフィー
ルドの組み合せで（目で積分効果を用いる）画像の階調
を表示することが可能になる。即ち、１フレームを８個
のサブフィールド（ＳＦ１〜ＳＦ８）に分け、各サブフ
ィールド（ＳＦ１〜ＳＦ８）の表示期間を、２0：２1：
２2：・・・２6：２7の比率で割り当てる。
ーパネルは、いろいろの駆動方式の中の１つであるＡＤ
Ｓ(Addressing Display-Separating) サブフィールド方
式によって、パネル上に２５６階調の画像を表示する過
程を図〜図３を参照して説明する。ＡＤＳサブフィール
ド方式は、２Ｘ階調を実現するために、１フレーム画面
をＸ個のサブフィールド画面に分けて表示し、外部から
入力される画像データを、Ｘビットのデジタル画像デー
タ（最下位ビット（Ｄ１）−最上位ビット（ＤＸ））に
デジタル化してパネルに印加する方式である。そして、
各サブフィールド画面は、リセット期間とアドレス期間
と表示期間とから構成されるが、そのリセット期間とア
ドレス期間は、サブフィールド毎にその全てが同一に割
り当てられているが、表示期間は、アドレス期間に表示
されるデジタル画像データのビット加重値によって相互
に異なるように割り当てられているので、各サブフィー
ルドの組み合せで（目で積分効果を用いる）画像の階調
を表示することが可能になる。即ち、１フレームを８個
のサブフィールド（ＳＦ１〜ＳＦ８）に分け、各サブフ
ィールド（ＳＦ１〜ＳＦ８）の表示期間を、２0：２1：
２2：・・・２6：２7の比率で割り当てる。
【００１１】従って、マイクロプロセッサ（２０）は、
２５６の階調を得るために、外部から入力されるアナロ
グのＲ、Ｇ、Ｂ画像信号をデジタル化して、８ビットの
Ｒ、Ｇ、Ｂのデジタル画像データと、外部信号によって
ＰＤＰ（１０）の駆動に必要な各種の制御信号とを出力
する。マイクロプロセッサ（２０）から出力される８ビ
ットのＲ、Ｇ、Ｂデジタル画像データは、メモリ（４
０）にフレーム別、カラー別、ビット別に記憶されてい
る。
２５６の階調を得るために、外部から入力されるアナロ
グのＲ、Ｇ、Ｂ画像信号をデジタル化して、８ビットの
Ｒ、Ｇ、Ｂのデジタル画像データと、外部信号によって
ＰＤＰ（１０）の駆動に必要な各種の制御信号とを出力
する。マイクロプロセッサ（２０）から出力される８ビ
ットのＲ、Ｇ、Ｂデジタル画像データは、メモリ（４
０）にフレーム別、カラー別、ビット別に記憶されてい
る。
【００１２】その後、サブフィールド画面（ＳＦ１〜Ｓ
Ｆ８）のリセット期間とアドレス期間には、駆動ロジッ
ク部（３３）が第１、第２表示電極ライン（Ｓ１〜Ｓ４
８０）に、１段階で前のフィールドで生成された壁電荷
を消去する消去パルスを、２段階でパネル（１０）全体
に均等な壁電荷を形成するための書き込みパルスを、３
段階で更に消去パルスを印加して、６４０個のＲ、Ｇ、
Ｂアドレス電極ライン（Ｒ１〜Ｂ６４０）上に壁電荷を
形成させる。これによりその後に印加されるアドレス放
電電圧を低くすることができる。そして、４段階でクロ
ック（ＣＬＫ）とこれに同期されたデータ（ＤＡＴＡ）
及び表示パルスによって、４８０個の第１、第２表示電
極ライン（Ｓ１〜Ｓ４８０）に順次に走査パルスが印加
されて、第１、第２表示電極ライン（Ｓ１〜Ｓ４８０）
の走査が完了する。
Ｆ８）のリセット期間とアドレス期間には、駆動ロジッ
ク部（３３）が第１、第２表示電極ライン（Ｓ１〜Ｓ４
８０）に、１段階で前のフィールドで生成された壁電荷
を消去する消去パルスを、２段階でパネル（１０）全体
に均等な壁電荷を形成するための書き込みパルスを、３
段階で更に消去パルスを印加して、６４０個のＲ、Ｇ、
Ｂアドレス電極ライン（Ｒ１〜Ｂ６４０）上に壁電荷を
形成させる。これによりその後に印加されるアドレス放
電電圧を低くすることができる。そして、４段階でクロ
ック（ＣＬＫ）とこれに同期されたデータ（ＤＡＴＡ）
及び表示パルスによって、４８０個の第１、第２表示電
極ライン（Ｓ１〜Ｓ４８０）に順次に走査パルスが印加
されて、第１、第２表示電極ライン（Ｓ１〜Ｓ４８０）
の走査が完了する。
【００１３】において４段階の走査パルス印加時に、ア
ドレス駆動部（５０）は、第１、第２表示電極ライン
（Ｓ１〜Ｓ４８０）に対応するアドレスパルス（Ｒ、
Ｇ、Ｂデジタル画像データの１ビット値）を走査パルス
と同期して、Ｒ、Ｇ、Ｂ全体のアドレス電極ライン（Ｒ
１〜Ｂ６４０）にそれぞれ印加し、これに伴って各セル
の放電空間の内部で放電が発生する。そして、アドレス
駆動部（５０）は、各セルに対応する８ビットのＲ、
Ｇ、Ｂ画像データ（Ｄ１〜Ｄ８）は、それぞれＤ１はＳ
Ｆ１に、Ｄ２はＳＦ２に、・・・Ｄ７はＳＦ７に、Ｄ８
はＳＦ８にそれぞれ対応させて印加する。
ドレス駆動部（５０）は、第１、第２表示電極ライン
（Ｓ１〜Ｓ４８０）に対応するアドレスパルス（Ｒ、
Ｇ、Ｂデジタル画像データの１ビット値）を走査パルス
と同期して、Ｒ、Ｇ、Ｂ全体のアドレス電極ライン（Ｒ
１〜Ｂ６４０）にそれぞれ印加し、これに伴って各セル
の放電空間の内部で放電が発生する。そして、アドレス
駆動部（５０）は、各セルに対応する８ビットのＲ、
Ｇ、Ｂ画像データ（Ｄ１〜Ｄ８）は、それぞれＤ１はＳ
Ｆ１に、Ｄ２はＳＦ２に、・・・Ｄ７はＳＦ７に、Ｄ８
はＳＦ８にそれぞれ対応させて印加する。
【００１４】一方、各サブフィールド画面（ＳＦ１〜Ｓ
Ｆ８）とアドレス期間が完了すると、表示パルス発生部
（３２）から駆動ロジック部（３３）に表示パルスを入
力させ、駆動ロジック部（３３）が全体の表示電極ライ
ン（Ｓ１〜Ｓ４８０）にＳＦ１：ＳＦ２：・・・ＳＦ
７：ＳＦ８＝２0：２1：・・・２6：２7（輝度比）に比
例する個数の表示パルスを印加する。これによりアドレ
ス期間で放電が発生した特定のセルの放電及び発光が、
表示パルスが印加される期間（表示期間）の間維持され
る。このような過程を経てサブフィールド画面（ＳＦ１
〜ＳＦ８）の構成が完了されると、ＰＤＰ（１０）に２
５６階調の画像が表示される。
Ｆ８）とアドレス期間が完了すると、表示パルス発生部
（３２）から駆動ロジック部（３３）に表示パルスを入
力させ、駆動ロジック部（３３）が全体の表示電極ライ
ン（Ｓ１〜Ｓ４８０）にＳＦ１：ＳＦ２：・・・ＳＦ
７：ＳＦ８＝２0：２1：・・・２6：２7（輝度比）に比
例する個数の表示パルスを印加する。これによりアドレ
ス期間で放電が発生した特定のセルの放電及び発光が、
表示パルスが印加される期間（表示期間）の間維持され
る。このような過程を経てサブフィールド画面（ＳＦ１
〜ＳＦ８）の構成が完了されると、ＰＤＰ（１０）に２
５６階調の画像が表示される。
【００１５】
【発明が解決しようとする課題】上述した従来のプラズ
マディスプレーパネルの駆動方式では、Ｒ、Ｇ、Ｂの全
てが共に表示されるので、表示パルスの数でホワイトバ
ランスを取ることができない。かかる問題を解決するた
めの試みとして、プラズマディスプレーパネルの駆動回
路にルックアップテーブルを用いてデータの変化により
ホワイトバランスを取るかまたは、蛍光体を変えてホワ
イトバランスを取る方式を用いている。しかし、ルック
アップテーブルを用いる場合、ある色は階調が減少して
表現できる色の数が少なくなるという短所があるだけで
なく、ルックアップテーブルの使用による費用が追加さ
れるという問題がある。また、後者の蛍光体を変える場
合は、微細なホワイトバランスの調整が難しく、各セッ
ト毎の差異、即ち蛍光体の塗布厚さや電極の差異による
駆動電圧の変化により、正確なＲ、Ｇ、Ｂの明るさ比率
を合わせることが相当に難しいという問題が内在してい
る。
マディスプレーパネルの駆動方式では、Ｒ、Ｇ、Ｂの全
てが共に表示されるので、表示パルスの数でホワイトバ
ランスを取ることができない。かかる問題を解決するた
めの試みとして、プラズマディスプレーパネルの駆動回
路にルックアップテーブルを用いてデータの変化により
ホワイトバランスを取るかまたは、蛍光体を変えてホワ
イトバランスを取る方式を用いている。しかし、ルック
アップテーブルを用いる場合、ある色は階調が減少して
表現できる色の数が少なくなるという短所があるだけで
なく、ルックアップテーブルの使用による費用が追加さ
れるという問題がある。また、後者の蛍光体を変える場
合は、微細なホワイトバランスの調整が難しく、各セッ
ト毎の差異、即ち蛍光体の塗布厚さや電極の差異による
駆動電圧の変化により、正確なＲ、Ｇ、Ｂの明るさ比率
を合わせることが相当に難しいという問題が内在してい
る。
【００１６】このような問題を解決し、しかも廉価のＰ
ＤＰを、そして、信頼性面ではより効率的で画質が安定
したＰＤＰを提供することが好ましい。したがって、本
発明の目的は、表示パルスを独立的に調節してホワイト
バランスが正確に取られるようにするプラズマディスプ
レーパネルの表示ライン駆動方法を提供することであ
る。本発明の他の目的は、走査電極とアドレス電極また
は共通電極とアドレス電極とはカラー別に消去パルスを
印加して、それぞれの色比率を独立的に調節できるよう
にすることにある。
ＤＰを、そして、信頼性面ではより効率的で画質が安定
したＰＤＰを提供することが好ましい。したがって、本
発明の目的は、表示パルスを独立的に調節してホワイト
バランスが正確に取られるようにするプラズマディスプ
レーパネルの表示ライン駆動方法を提供することであ
る。本発明の他の目的は、走査電極とアドレス電極また
は共通電極とアドレス電極とはカラー別に消去パルスを
印加して、それぞれの色比率を独立的に調節できるよう
にすることにある。
【００１７】
【課題を解決するための手段】本発明駆動方法は、パネ
ルの特性を考えてホワイトバランスを調整する時、色信
号の輝度と色座標とにより、表示パルスが加えられる期
間に各カラー別に消去パルスを入れて、ホワイトバラン
スが取られる比率のパルスが正確に加えられるようにし
たことを特徴とする。本発明の１実施態様によるプラズ
マディスプレーパネルの表示ライン駆動方法は、（１）
少なくとも１つ以上のサブフィールドで、色信号のそれ
ぞれの輝度と色座標を測定して、ホワイトバランスが取
られる色信号比率の表示パルスの個数を算出する段階
と、（２）表示パルスの個数を算出した後、走査電極と
共通電極とに表示パルスを印加する段階と、（３）表示
パルスが印加される期間に、算出値に起因して走査電極
とアドレス電極とにカラー別に所定の幅を有する消去パ
ルスを印加する段階と、カラー別の消去パルスに起因す
る色信号のそれぞれの表示期間を独立的に調節すること
を特徴とする。
ルの特性を考えてホワイトバランスを調整する時、色信
号の輝度と色座標とにより、表示パルスが加えられる期
間に各カラー別に消去パルスを入れて、ホワイトバラン
スが取られる比率のパルスが正確に加えられるようにし
たことを特徴とする。本発明の１実施態様によるプラズ
マディスプレーパネルの表示ライン駆動方法は、（１）
少なくとも１つ以上のサブフィールドで、色信号のそれ
ぞれの輝度と色座標を測定して、ホワイトバランスが取
られる色信号比率の表示パルスの個数を算出する段階
と、（２）表示パルスの個数を算出した後、走査電極と
共通電極とに表示パルスを印加する段階と、（３）表示
パルスが印加される期間に、算出値に起因して走査電極
とアドレス電極とにカラー別に所定の幅を有する消去パ
ルスを印加する段階と、カラー別の消去パルスに起因す
る色信号のそれぞれの表示期間を独立的に調節すること
を特徴とする。
【００１８】選択的に、走査電極とアドレス電極とに印
加されるカラー別の消去パルスは、互いにパルス幅が同
一で反対位相を有することを特徴とする。選択的に、所
定の消去パルス幅は、ほぼ０．５〜１．２μｓであるこ
とを特徴とする。選択的に、カラー別の消去パルスは、
色信号の中から少なくとも２色相の表示期間が独立的に
調節されるように、少なくとも二対以上を印加して、色
信号の比率を調節することを特徴とする。また、上記実
施態様においては消去パルスを走査電極とアドレス電極
との間に加えたが、共通電極とアドレス電極との間に加
えてもよい。
加されるカラー別の消去パルスは、互いにパルス幅が同
一で反対位相を有することを特徴とする。選択的に、所
定の消去パルス幅は、ほぼ０．５〜１．２μｓであるこ
とを特徴とする。選択的に、カラー別の消去パルスは、
色信号の中から少なくとも２色相の表示期間が独立的に
調節されるように、少なくとも二対以上を印加して、色
信号の比率を調節することを特徴とする。また、上記実
施態様においては消去パルスを走査電極とアドレス電極
との間に加えたが、共通電極とアドレス電極との間に加
えてもよい。
【００１９】
【作用】このように、本発明は、サブフィールド毎に
Ｒ、Ｇ、Ｂそれぞれの輝度と色座標を測定して、ホワイ
トバランスが取られる比率の表示パルス個数の消去パル
スを印加できることが分かる。その結果、プラズマディ
スプレーパネルにおけるホワイトバランスの調節のため
のルックアップテーブルの追加または蛍光体を変えるこ
となくても、ホワイトバランスを正確に調節できる。
Ｒ、Ｇ、Ｂそれぞれの輝度と色座標を測定して、ホワイ
トバランスが取られる比率の表示パルス個数の消去パル
スを印加できることが分かる。その結果、プラズマディ
スプレーパネルにおけるホワイトバランスの調節のため
のルックアップテーブルの追加または蛍光体を変えるこ
となくても、ホワイトバランスを正確に調節できる。
【００２０】
【発明の実施の形態】本発明の実施形態は多数あるが、
以下ではもっとも好ましい実施形態に対して詳細に説明
する。以下、添付図面を参照して本発明によるプラズマ
ディスプレーパネルの表示ライン駆動方法の好ましい実
施形態を詳細に説明する。図面に用いられる各図面にお
いて、同一の構成要素について同一の番号を付与して表
示し、その重複する説明は省略することもある。
以下ではもっとも好ましい実施形態に対して詳細に説明
する。以下、添付図面を参照して本発明によるプラズマ
ディスプレーパネルの表示ライン駆動方法の好ましい実
施形態を詳細に説明する。図面に用いられる各図面にお
いて、同一の構成要素について同一の番号を付与して表
示し、その重複する説明は省略することもある。
【００２１】図５は、本実施形態によるプラズマディス
プレーパネルの表示ライン駆動方法の説明のための駆動
波形を示す。本実施形態によるプラズマディスプレーパ
ネルは、各サブフィールドに印加する信号波形をリセッ
ト期間、アドレス期間、表示期間とに分けて、リセット
期間とアドレス期間は、サブフィールド毎にすべてを同
一に割り当てるが、表示期間はアドレス期間に表示され
るデジタル画像データのビット加重値によって相互に異
なるように割り当てる。この時、各サブフィールド毎に
色信号（Ｒ、Ｇ、Ｂ）それぞれの輝度と色座標を測定し
て、ホワイトバランスが取られる表示パルス（１００）
の個数の後で、パルス幅は同一であるが位相が反対であ
る一対のカラー１の消去パルス（１０３、１０４）を走
査電極のような第１表示電極（４）とアドレス電極
（７）とに同期されるように印加し、かつ第１表示電極
（４）とアドレス電極（７）に、パルス幅は同一である
が位相が反対である一対のカラー２の消去パルス（１０
３ａ、１０４ａ）を印加する。そして、共通電極のよう
な第２表示電極（５）には、アドレス期間後に第１表示
電極（４）の表示パルスと位相が反対である表示パルス
（１０１）を第１表示電極の表示パルス（１００）の間
に印加する。
プレーパネルの表示ライン駆動方法の説明のための駆動
波形を示す。本実施形態によるプラズマディスプレーパ
ネルは、各サブフィールドに印加する信号波形をリセッ
ト期間、アドレス期間、表示期間とに分けて、リセット
期間とアドレス期間は、サブフィールド毎にすべてを同
一に割り当てるが、表示期間はアドレス期間に表示され
るデジタル画像データのビット加重値によって相互に異
なるように割り当てる。この時、各サブフィールド毎に
色信号（Ｒ、Ｇ、Ｂ）それぞれの輝度と色座標を測定し
て、ホワイトバランスが取られる表示パルス（１００）
の個数の後で、パルス幅は同一であるが位相が反対であ
る一対のカラー１の消去パルス（１０３、１０４）を走
査電極のような第１表示電極（４）とアドレス電極
（７）とに同期されるように印加し、かつ第１表示電極
（４）とアドレス電極（７）に、パルス幅は同一である
が位相が反対である一対のカラー２の消去パルス（１０
３ａ、１０４ａ）を印加する。そして、共通電極のよう
な第２表示電極（５）には、アドレス期間後に第１表示
電極（４）の表示パルスと位相が反対である表示パルス
（１０１）を第１表示電極の表示パルス（１００）の間
に印加する。
【００２２】このように構成された本発明の一実施形態
によるプラズマディスプレーパネルの表示ライン駆動方
法によって、パネル上に画像を表示する過程において、
従来の技術と比較して差のある表示期間を、図１と図３
〜図５及び図７を参照して説明する。パネルの特性を考
えてホワイトバランスを調整する時、各サブフィールド
画面（ＳＦ１〜ＳＦ８）毎にＲ、Ｇ、Ｂそれぞれの輝度
と色座標を測定して、ホワイトバランスが取られるＲ：
Ｇ：Ｂ比率の表示個数を算出し、その算出値をマイクロ
プロセッサ（２０）に入力しておくと、マイクロプロセ
ッサ（２０）は表示パルス発生部（３２）とアドレス駆
動部（５０）にそれに応じた制御信号を出力する。これ
に伴って、表示パルス発生部（３２）が表示パルスを出
力すると、駆動ロジック部（３３）はクロック（ＣＬ
Ｋ）、これに同期された８ビットのデータ（Ｄ１〜Ｃ
８）及び表示パルスによって第１、第２表示電極ライン
（Ｓ１〜Ｓ４８０）に順次走査パルスを印加する。
によるプラズマディスプレーパネルの表示ライン駆動方
法によって、パネル上に画像を表示する過程において、
従来の技術と比較して差のある表示期間を、図１と図３
〜図５及び図７を参照して説明する。パネルの特性を考
えてホワイトバランスを調整する時、各サブフィールド
画面（ＳＦ１〜ＳＦ８）毎にＲ、Ｇ、Ｂそれぞれの輝度
と色座標を測定して、ホワイトバランスが取られるＲ：
Ｇ：Ｂ比率の表示個数を算出し、その算出値をマイクロ
プロセッサ（２０）に入力しておくと、マイクロプロセ
ッサ（２０）は表示パルス発生部（３２）とアドレス駆
動部（５０）にそれに応じた制御信号を出力する。これ
に伴って、表示パルス発生部（３２）が表示パルスを出
力すると、駆動ロジック部（３３）はクロック（ＣＬ
Ｋ）、これに同期された８ビットのデータ（Ｄ１〜Ｃ
８）及び表示パルスによって第１、第２表示電極ライン
（Ｓ１〜Ｓ４８０）に順次走査パルスを印加する。
【００２３】駆動ロジック部（３３）からの走査パルス
の印加時に、アドレス駆動部（５０）は走査パルスが印
加されて走査される第１、第２表示電極ライン（Ｓ１〜
Ｓ４８０）に対応するアドレスパルス（１０２）（Ｒ、
Ｇ、Ｂデジタル画像データの１ビット値）を走査パルス
と同期して、Ｒ、Ｇ、Ｂアドレス電極ライン（Ｒ１〜Ｂ
６４０）にそれぞれ印加する。これに伴ってセルの放電
空間の内部で放電が発生する。そして、各サブフィール
ド画面（ＳＦ１〜ＳＦ８）のアドレス期間が完了する
と、駆動ロジック部（３３）は全体の表示電極ライン
（Ｓ１〜Ｓ４８０）の表示パルス（１００、１０１）を
印加する。これによりアドレス期間で放電が発生した一
部のセルの放電及び発光が、表示パルス（１００、１０
１）が印加される期間（表示期間）の間維持される。
の印加時に、アドレス駆動部（５０）は走査パルスが印
加されて走査される第１、第２表示電極ライン（Ｓ１〜
Ｓ４８０）に対応するアドレスパルス（１０２）（Ｒ、
Ｇ、Ｂデジタル画像データの１ビット値）を走査パルス
と同期して、Ｒ、Ｇ、Ｂアドレス電極ライン（Ｒ１〜Ｂ
６４０）にそれぞれ印加する。これに伴ってセルの放電
空間の内部で放電が発生する。そして、各サブフィール
ド画面（ＳＦ１〜ＳＦ８）のアドレス期間が完了する
と、駆動ロジック部（３３）は全体の表示電極ライン
（Ｓ１〜Ｓ４８０）の表示パルス（１００、１０１）を
印加する。これによりアドレス期間で放電が発生した一
部のセルの放電及び発光が、表示パルス（１００、１０
１）が印加される期間（表示期間）の間維持される。
【００２４】この時、各サブフィールド画面（ＳＦ１〜
ＳＦ８）で算出されたＲ：Ｇ：Ｂ比率によって、特定色
相の表示パルスの全てが印加されると、表示パルス発生
部（３２）とアドレス駆動部（５０）は、走査電極のよ
うな第１表示電極（４）とアドレス電極（７）にパルス
幅は同一であるが、位相が反対である一対のカラー１消
去パルス（１０３、１０４）を同期させて印加し、消去
放電を発生させる。
ＳＦ８）で算出されたＲ：Ｇ：Ｂ比率によって、特定色
相の表示パルスの全てが印加されると、表示パルス発生
部（３２）とアドレス駆動部（５０）は、走査電極のよ
うな第１表示電極（４）とアドレス電極（７）にパルス
幅は同一であるが、位相が反対である一対のカラー１消
去パルス（１０３、１０４）を同期させて印加し、消去
放電を発生させる。
【００２５】このようにＲ、Ｇ、Ｂの中、特定の色相の
セルで消去放電が発生する時までの壁電荷の進行状態を
図７に示した。即ち図５に図示した駆動波形で、（ａ）
〜（ｈ）区間の壁電荷の進行状態は、図７の（ａ）〜
（ｎ）状態で示したとおりである。図５の表示期間の
（ａ）区間で図７の（ａ）状態のように、アドレス放電
が発生すると、（ｂ）区間では図７の（ｂ）の状態のよ
うに、セル内部の第１表示電極（４）に陽（＋）の壁電
荷が形成され、第２表示電極（５）には陰（−）の壁電
荷が形成される。そして、（ｃ）区間で第１表示電極
（４）と共通電極のような第２表示電極（５）間で表示
放電を発生させると、（ｄ）区間における表示放電後の
壁電荷は（ｂ）区間における壁電荷と反対に形成され
る。以降、（ｅ）区間と（ｆ）区間では、表示パルス
（１００、１０１）による表示放電を示し、この時の壁
電荷は（ｄ）区間との反対となる。以降、（ｇ）区間で
（ｃ）区間のような表示放電が発生して、結果的に
（ｆ）区間と反対の壁電荷が（ｈ）区間に形成される。
セルで消去放電が発生する時までの壁電荷の進行状態を
図７に示した。即ち図５に図示した駆動波形で、（ａ）
〜（ｈ）区間の壁電荷の進行状態は、図７の（ａ）〜
（ｎ）状態で示したとおりである。図５の表示期間の
（ａ）区間で図７の（ａ）状態のように、アドレス放電
が発生すると、（ｂ）区間では図７の（ｂ）の状態のよ
うに、セル内部の第１表示電極（４）に陽（＋）の壁電
荷が形成され、第２表示電極（５）には陰（−）の壁電
荷が形成される。そして、（ｃ）区間で第１表示電極
（４）と共通電極のような第２表示電極（５）間で表示
放電を発生させると、（ｄ）区間における表示放電後の
壁電荷は（ｂ）区間における壁電荷と反対に形成され
る。以降、（ｅ）区間と（ｆ）区間では、表示パルス
（１００、１０１）による表示放電を示し、この時の壁
電荷は（ｄ）区間との反対となる。以降、（ｇ）区間で
（ｃ）区間のような表示放電が発生して、結果的に
（ｆ）区間と反対の壁電荷が（ｈ）区間に形成される。
【００２６】図５の（ｉ）区間で第１表示電極（４）と
カラー１のアドレス電極（７）に、パルス幅は同一であ
るが位相が反対である一対のカラー１消去パルス（１０
３、１０４）が同期されて印加されると、このパルスに
よりカラー１に該当するセルのみで、アドレス電極第
１、第２表示電極（４、５）間に消去放電が発生し、図
７の（ｉ）状態となる。しかし、この場合に印加される
カラー１消去パルス（１０３、１０４）は、そのパルス
の電圧が表示電圧より低く、またパルス幅が０．５μｓ
から１．２μｓの間のパルスが印加されるので、壁電荷
を形成する時間がないので、カラー１消去パルスが印加
されたセルは、図５の（ｊ）区間で図７の（ｊ）状態の
ように壁電荷のないセルとなる。
カラー１のアドレス電極（７）に、パルス幅は同一であ
るが位相が反対である一対のカラー１消去パルス（１０
３、１０４）が同期されて印加されると、このパルスに
よりカラー１に該当するセルのみで、アドレス電極第
１、第２表示電極（４、５）間に消去放電が発生し、図
７の（ｉ）状態となる。しかし、この場合に印加される
カラー１消去パルス（１０３、１０４）は、そのパルス
の電圧が表示電圧より低く、またパルス幅が０．５μｓ
から１．２μｓの間のパルスが印加されるので、壁電荷
を形成する時間がないので、カラー１消去パルスが印加
されたセルは、図５の（ｊ）区間で図７の（ｊ）状態の
ように壁電荷のないセルとなる。
【００２７】そして、図５の（ｊ）区間でカラー１に該
当するセルは壁電荷がないので、（ｋ）区間で表示パル
ス（１００、１０１）が加えられても、図７の（ｋ）状
態のように、表示放電がこれ以上発生しない。この時、
カラー１を除いたカラー２とカラー３に該当するセル
は、カラー１消去パルス（１０３、１０４）の影響を受
けず、（ｉ）〜（ｋ）区間でも図７の（ｌ）〜（ｎ）の
状態となる。即ち、図５のカラー２とカラー３に該当す
る（ｌ）区間で第１表示電極（４）には、消去パルスの
一部であるマイナス（−）パルスが入り、カラー２とカ
ラー３のアドレス電極（７）に何らのパルスも入らなく
なるので、放電がまったく発生されないようになる。
当するセルは壁電荷がないので、（ｋ）区間で表示パル
ス（１００、１０１）が加えられても、図７の（ｋ）状
態のように、表示放電がこれ以上発生しない。この時、
カラー１を除いたカラー２とカラー３に該当するセル
は、カラー１消去パルス（１０３、１０４）の影響を受
けず、（ｉ）〜（ｋ）区間でも図７の（ｌ）〜（ｎ）の
状態となる。即ち、図５のカラー２とカラー３に該当す
る（ｌ）区間で第１表示電極（４）には、消去パルスの
一部であるマイナス（−）パルスが入り、カラー２とカ
ラー３のアドレス電極（７）に何らのパルスも入らなく
なるので、放電がまったく発生されないようになる。
【００２８】以降、図５の（ｍ）区間では、（ｌ）区間
で放電が発生されなかったので、壁電荷状態がそのまま
維持される。図５の（ｎ）区間で第１表示電極（４）に
は０ボルトが印加され、第２表示電極（５）にプラス
（＋）電圧が印加されると、表示放電が継続して発生す
るようになる。また、算出されたＲ：Ｇ：Ｂの比率によ
って、Ｒ、Ｇ、Ｂのカラー１消去パルス（１０３、１０
４）が印加された特定の色相を除いた色相で、図５に示
した通り、表示パルス（１００、１０１）の全てが印加
された後、パルス幅は同一であるが位相が反対である一
対のカラー２消去パルス（１０３ａ、１０４ａ）が同期
して印加される。そうすると、（ｉ）と（ｊ）区間にお
ける壁電荷の進行状態である図７の（ｉ）及び（ｊ）状
態と同一に、その色相のセルでも消去放電が発生して壁
電荷のないセルとなり、表示パルス（１００、１０１）
が加えられても（ｋ）状態のように放電が発生しない。
で放電が発生されなかったので、壁電荷状態がそのまま
維持される。図５の（ｎ）区間で第１表示電極（４）に
は０ボルトが印加され、第２表示電極（５）にプラス
（＋）電圧が印加されると、表示放電が継続して発生す
るようになる。また、算出されたＲ：Ｇ：Ｂの比率によ
って、Ｒ、Ｇ、Ｂのカラー１消去パルス（１０３、１０
４）が印加された特定の色相を除いた色相で、図５に示
した通り、表示パルス（１００、１０１）の全てが印加
された後、パルス幅は同一であるが位相が反対である一
対のカラー２消去パルス（１０３ａ、１０４ａ）が同期
して印加される。そうすると、（ｉ）と（ｊ）区間にお
ける壁電荷の進行状態である図７の（ｉ）及び（ｊ）状
態と同一に、その色相のセルでも消去放電が発生して壁
電荷のないセルとなり、表示パルス（１００、１０１）
が加えられても（ｋ）状態のように放電が発生しない。
【００２９】上述のように、Ｒ、Ｇ、Ｂそれぞれの色相
に表示パルス（１００、１０１）の適正個数によって消
去パルス（１０３、１０４）、（１０３ａ、１０４ａ）
を印加すると、Ｒ：Ｇ：Ｂの比率を微細に調整すること
ができるので、ホワイトバランスを取ることができる。
に表示パルス（１００、１０１）の適正個数によって消
去パルス（１０３、１０４）、（１０３ａ、１０４ａ）
を印加すると、Ｒ：Ｇ：Ｂの比率を微細に調整すること
ができるので、ホワイトバランスを取ることができる。
【００３０】本発明の他の実施形態を図６に示す。図６
は、図５に図示した駆動波形と同一に、表示期間はアド
レス期間で表示されるデジタル画像データのビット加重
値によって互いに異なるように割り当て、各サブフィー
ルド毎にＲ、Ｇ、Ｂそれぞれの輝度と色座標とを測定し
て、共通電極のような第２表示電極（５）とアドレス電
極（７）にホワイトバランスが取られる表示パルスの個
数で、パルス値は同一であるが位相が反対である一対の
カラー１用の消去パルス（１０５、１０６）を同期され
るように印加する。また第２表示電極（５）とアドレス
電極（７）にパルス幅は同一であるが位相が反対である
一対のカラー２用の消去パルス（１０５ａ、１０６ａ）
を同期されるように印加することによって、図７に図示
した壁電荷の進行状態と同一の過程を経て消去放電が発
生すので、図５に図示した本発明の一実施形態と同じ結
果を得る。
は、図５に図示した駆動波形と同一に、表示期間はアド
レス期間で表示されるデジタル画像データのビット加重
値によって互いに異なるように割り当て、各サブフィー
ルド毎にＲ、Ｇ、Ｂそれぞれの輝度と色座標とを測定し
て、共通電極のような第２表示電極（５）とアドレス電
極（７）にホワイトバランスが取られる表示パルスの個
数で、パルス値は同一であるが位相が反対である一対の
カラー１用の消去パルス（１０５、１０６）を同期され
るように印加する。また第２表示電極（５）とアドレス
電極（７）にパルス幅は同一であるが位相が反対である
一対のカラー２用の消去パルス（１０５ａ、１０６ａ）
を同期されるように印加することによって、図７に図示
した壁電荷の進行状態と同一の過程を経て消去放電が発
生すので、図５に図示した本発明の一実施形態と同じ結
果を得る。
【００３１】
【発明の効果】以上説明した通り、本発明はＲ、Ｇ、Ｂ
の各色相の表示期間を独立的に調節するために、アドレ
ス電極と表示電極に少なくとも一対以上の特定消去パル
スを印加して色信号の比率を調節することによって、ホ
ワイトバランスを正確に取ることができるという効果が
ある。
の各色相の表示期間を独立的に調節するために、アドレ
ス電極と表示電極に少なくとも一対以上の特定消去パル
スを印加して色信号の比率を調節することによって、ホ
ワイトバランスを正確に取ることができるという効果が
ある。
【図１】 一般的なプラズマディスプレーパネルの一セ
ル構造を示した断面図、
ル構造を示した断面図、
【図２】 セルの各電極に印加される駆動波形を示した
図、
図、
【図３】 駆動波形による該当セルの壁電荷の進行状態
を示した図、
を示した図、
【図４】 一般的なプラズマディスプレーパネルの説明
に提供される駆動回路のブロック図、
に提供される駆動回路のブロック図、
【図５】 本発明によるプラズマディスプレーパネルの
表示ライン駆動方法の説明に提供される実施形態を示す
駆動波形図、
表示ライン駆動方法の説明に提供される実施形態を示す
駆動波形図、
【図６】 本発明の他の実施形態による駆動波形図、
【図７】 駆動波形による各電極の壁電荷の進行状態を
示す図である。
示す図である。
１………上部ガラス基板、２………下部ガラス基板、３
………隔壁、４………走査電極、５………共通電極、６
………誘電層、７………アドレス電極、１０………ＰＤ
Ｐ、２０………マイクロプロセッサ、３０………表示駆
動部、３１………データ発生部、３２………パルス発生
部、３３………駆動ロジック部、４０………メモリ、５
０………アドレス駆動部。
………隔壁、４………走査電極、５………共通電極、６
………誘電層、７………アドレス電極、１０………ＰＤ
Ｐ、２０………マイクロプロセッサ、３０………表示駆
動部、３１………データ発生部、３２………パルス発生
部、３３………駆動ロジック部、４０………メモリ、５
０………アドレス駆動部。
Claims (7)
- 【請求項１】 （１）少なくとも１つ以上のサブフィー
ルドで色信号それぞれの輝度と色座標を測定して、ホワ
イトバランスが取られる色信号比率の表示パルスの個数
を算出するステップと、 （２）表示パルスの個数を算出した後、走査電極と共通
電極とに表示パルスを印加するステップと、 （３）表示パルスが印加される期間に、算出値に起因し
て、走査電極とアドレス電極とにカラー別に所定幅を有
する消去パルスを印加するステップと、を有し、カラー
別の消去パルスに起因する色信号のそれぞれの表示期間
を独立に調節することを特徴とするプラズマディスプレ
ーパネルの表示ライン駆動方法。 - 【請求項２】 走査電極とアドレス電極とに印加される
カラー別の消去パルスは、互いにパルス幅が同一で反対
位相を有することを特徴とする請求項１記載のプラズマ
ディスプレーパネルの表示ライン駆動方法。 - 【請求項３】 カラー別の消去パルス幅は、０．５〜
１．２μｓの範囲の値を有することを特徴とする請求項
２記載のプラズマディスプレーパネルの表示ライン駆動
方法。 - 【請求項４】 カラー別の消去パルス幅は、０．７μｓ
に規定されたことを特徴とする請求項３記載のプラズマ
ディスプレーパネルの表示ライン駆動方法。 - 【請求項５】 カラー別の消去パルスは、色信号の中か
ら少なくとも二色相の表示期間が独立的に調節されるよ
うに、少なくとも二対以上を印加して、色信号の比率を
調節することを特徴とする請求項１記載のプラズマディ
スプレーパネルの表示ライン駆動方法。 - 【請求項６】 （１）少なくとも１つ以上のサブフィー
ルドで色信号それぞれの輝度と色座標を測定して、ホワ
イトバランスが取られる色信号比率の表示パルスの個数
を算出するステップと、 （２）表示パルスの個数を算出した後、走査電極と共通
電極とに表示パルスを印加するステップと、 （３）表示パルスが印加される期間に、算出値に起因し
て、共通電極とアドレス電極とにカラー別に所定幅を有
する消去パルスを印加するステップとを有し、カラー別
の消去パルスに起因する色信号のそれぞれの表示期間を
独立に調節することを特徴とするプラズマディスプレー
パネルの表示ライン駆動方法。 - 【請求項７】 共通電極とアドレス電極とに印加される
カラー別の消去パルスは、互いにパルス幅が同一で反対
位相を有し、カラー別の消去パルス幅は、０．５〜１．
２μｓの範囲の値を有することを特徴とする請求項６記
載のプラズマディスプレーパネルの表示ライン駆動方
法。
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Family
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| EP1244088A2 (en) * | 2001-03-19 | 2002-09-25 | Fujitsu Limited | Method of driving a plasma display panel |
| JP2003029699A (ja) * | 2001-07-13 | 2003-01-31 | Hitachi Ltd | プラズマディスプレイパネル表示装置 |
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| JP3939066B2 (ja) * | 2000-03-08 | 2007-06-27 | 富士通日立プラズマディスプレイ株式会社 | カラープラズマディスプレイ装置 |
| US20020008679A1 (en) * | 2000-07-19 | 2002-01-24 | Rutherford James C. | Sub-field white balance electronically controlled for plasma display panel device |
| KR100385882B1 (ko) * | 2001-05-28 | 2003-06-02 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 소거방전 구동방법 및 그의구동장치 |
| KR20020094316A (ko) * | 2001-06-11 | 2002-12-18 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 소거방전 구동방법 |
| KR20050082124A (ko) * | 2004-02-17 | 2005-08-22 | 엘지전자 주식회사 | 플라즈마 표시 패널의 구동 방법 |
| KR100651946B1 (ko) * | 2004-09-22 | 2006-12-06 | 엘지전자 주식회사 | 피디피의 색온도 조정방법 |
| KR100747257B1 (ko) * | 2004-12-16 | 2007-08-07 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널 |
| US8762864B2 (en) | 2007-08-06 | 2014-06-24 | Apple Inc. | Background removal tool for a presentation application |
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| JPH02288047A (ja) * | 1989-04-26 | 1990-11-28 | Nec Corp | プラズマディスプレイ及びその駆動方法 |
| JP2687684B2 (ja) | 1990-06-08 | 1997-12-08 | 日本電気株式会社 | プラズマディスプレイパネルの駆動方法 |
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-
1998
- 1998-01-23 KR KR1019980002122A patent/KR100508964B1/ko not_active IP Right Cessation
-
1999
- 1999-01-22 US US09/236,006 patent/US6400347B1/en not_active Expired - Lifetime
- 1999-01-25 JP JP01531199A patent/JP3592119B2/ja not_active Expired - Fee Related
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