JPH0714253B2 - 電断検出回路 - Google Patents
電断検出回路Info
- Publication number
- JPH0714253B2 JPH0714253B2 JP9463388A JP9463388A JPH0714253B2 JP H0714253 B2 JPH0714253 B2 JP H0714253B2 JP 9463388 A JP9463388 A JP 9463388A JP 9463388 A JP9463388 A JP 9463388A JP H0714253 B2 JPH0714253 B2 JP H0714253B2
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- JP
- Japan
- Prior art keywords
- power supply
- voltage
- input voltage
- detection circuit
- collector
- Prior art date
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は電源回路の入力電圧の低下を検出する電断検出
回路に関し、特にこの回路の誤動作を防止する回路に関
するものである。
回路に関し、特にこの回路の誤動作を防止する回路に関
するものである。
従来この種の回路としては第３図に示される構成のもの
が知られている。
が知られている。
すなわち同図において、入力電圧検出回路１は所定の基
準電圧VISよりも入力電圧VINの方が高い場合には「Ｌ
（ロー）」信号，低い場合には「Ｈ（ハイ）」信号をス
イッチングトランジスタ２のベースへ供給する。このた
め、スイッチングトランジスタ２のコレクタに接続され
た出力端子３には、基準電圧VIS＞入力電圧VINの場合に
は「Ｈ」，基準電圧VIS＜入力電圧VINの場合には「Ｌ」
の信号が出力される。なお、スイッチングトランジスタ
２のコレクタは抵抗４を介して電源電圧VCCに吊り上げ
られている。
準電圧VISよりも入力電圧VINの方が高い場合には「Ｌ
（ロー）」信号，低い場合には「Ｈ（ハイ）」信号をス
イッチングトランジスタ２のベースへ供給する。このた
め、スイッチングトランジスタ２のコレクタに接続され
た出力端子３には、基準電圧VIS＞入力電圧VINの場合に
は「Ｈ」，基準電圧VIS＜入力電圧VINの場合には「Ｌ」
の信号が出力される。なお、スイッチングトランジスタ
２のコレクタは抵抗４を介して電源電圧VCCに吊り上げ
られている。
また、第４図に示すように、（ａ）に示される電源回路
の入力電圧VINが徐々に低下し、入力電圧VIN＜基準電圧
VISとなると、（ｂ）に示される入力電圧検出回路１の
出力信号である入力電圧検出信号は「Ｌ」→「Ｈ」へ変
化し、（ｄ）に示される出力端子３から出力される信号
のレベルはほぼ電源電圧と同じ電位のハイレベルからほ
ぼ接地電位と同じ電位のローレベルとなる。
の入力電圧VINが徐々に低下し、入力電圧VIN＜基準電圧
VISとなると、（ｂ）に示される入力電圧検出回路１の
出力信号である入力電圧検出信号は「Ｌ」→「Ｈ」へ変
化し、（ｄ）に示される出力端子３から出力される信号
のレベルはほぼ電源電圧と同じ電位のハイレベルからほ
ぼ接地電位と同じ電位のローレベルとなる。
しかし、同図（ｃ）に示されるように電源電圧VCCが低
下すると、入力電圧検出回路１の電源が不足して出力し
ている「Ｈ」信号を保持できなくなり、一旦「Ｈ」とな
った入力検出信号は、入力電圧IN＜基準電圧VISにも係
わらず、再び「Ｌ」信号に戻る。そして、この「Ｌ」信
号に戻る瞬間に電源電圧VCCが０でない場合には（ｄ）
に示されるように誤った出力信号が出力端子３から出力
されてしまう。なお、この出力信号は電源電圧VCCとほ
ぼ同じ電位のものである。このように、従来の電断検出
回路は、入力電圧検出回路の電源電圧が不足した場合に
誤動作をするという課題を有していた。
下すると、入力電圧検出回路１の電源が不足して出力し
ている「Ｈ」信号を保持できなくなり、一旦「Ｈ」とな
った入力検出信号は、入力電圧IN＜基準電圧VISにも係
わらず、再び「Ｌ」信号に戻る。そして、この「Ｌ」信
号に戻る瞬間に電源電圧VCCが０でない場合には（ｄ）
に示されるように誤った出力信号が出力端子３から出力
されてしまう。なお、この出力信号は電源電圧VCCとほ
ぼ同じ電位のものである。このように、従来の電断検出
回路は、入力電圧検出回路の電源電圧が不足した場合に
誤動作をするという課題を有していた。
本発明はこのような課題を解消するために為されたもの
で、電源回路の入力電圧が低下した時に信号を出力する
入力電圧検出回路と、この入力電圧検出回路の出力する
信号をベースに入力しエミッタが接地されコレクタを出
力端子とするNPNトランジスタと、電源電圧が低下した
時にオフし電源電圧が増加した時にオンするシャントレ
ギュレータと、このシャントレギュレータのカソードが
ベースに接続されエミッタが電源電圧に吊り上げられコ
レクタが前記のNPNトランジスタのコレクタに接続され
たPNPトランジスタとから構成されるものである。
で、電源回路の入力電圧が低下した時に信号を出力する
入力電圧検出回路と、この入力電圧検出回路の出力する
信号をベースに入力しエミッタが接地されコレクタを出
力端子とするNPNトランジスタと、電源電圧が低下した
時にオフし電源電圧が増加した時にオンするシャントレ
ギュレータと、このシャントレギュレータのカソードが
ベースに接続されエミッタが電源電圧に吊り上げられコ
レクタが前記のNPNトランジスタのコレクタに接続され
たPNPトランジスタとから構成されるものである。
入力電圧の低下はシャントレギュレータにより検知され
てPNPトランジスタはオフされ、電源供給端子から出力
端子への供給電圧はカットされる。
てPNPトランジスタはオフされ、電源供給端子から出力
端子への供給電圧はカットされる。
次に本発明について図面を参照して説明する。第１図は
本発明の一実施例を示す回路図である。
本発明の一実施例を示す回路図である。
同図において、入力電圧検出回路11の出力はNPNトラン
ジスタであるスイッチングトランジスタ12のベースに接
続され、スイッチングトランジスタ12のコレクタは出力
端子13に接続されている。また、このベース，エミッタ
間には抵抗14が接続され、エミッタは接地されている。
さらに、このスイッチングトランジスタ12のコレクタは
抵抗15を介してPNPトランジスタであるスイッチングト
ランジスタ16のコレクタに接続され、このスイッチング
トランジスタ16のエミッタは電源供給端子17に接続され
て電源電圧VCCが供給されている。
ジスタであるスイッチングトランジスタ12のベースに接
続され、スイッチングトランジスタ12のコレクタは出力
端子13に接続されている。また、このベース，エミッタ
間には抵抗14が接続され、エミッタは接地されている。
さらに、このスイッチングトランジスタ12のコレクタは
抵抗15を介してPNPトランジスタであるスイッチングト
ランジスタ16のコレクタに接続され、このスイッチング
トランジスタ16のエミッタは電源供給端子17に接続され
て電源電圧VCCが供給されている。
この電源供給端子17を介する電源電圧VCCは抵抗18,19に
よって分圧されてシャントレギュレータ20のリファレン
スに入力されており、このシャントレギュレータ20のカ
ソードは抵抗21,22を介して電源供給端子17に接続され
ている。また、スイッチングトランジスタ16のベースは
これら抵抗21,22の接続点に接続されている。
よって分圧されてシャントレギュレータ20のリファレン
スに入力されており、このシャントレギュレータ20のカ
ソードは抵抗21,22を介して電源供給端子17に接続され
ている。また、スイッチングトランジスタ16のベースは
これら抵抗21,22の接続点に接続されている。
このような構成において、第２図の波形図を参照して動
作について説明する。
作について説明する。
同図（ａ）は電源回路に入力される入力電圧VINおよび
予め設定されている所定の基準電圧VIS、（ｂ）は入力
電圧検出回路11の出力する入力電圧検出信号、（ｃ）は
電源供給端子17に供給される電源電圧VCCおよび予め設
定されている所定の基準電圧VCS、（ｄ）はスイッチン
グトランジスタ12のコレクタ電圧VCC′、（ｅ）は出力
端子13から出力される出力信号を表す。
予め設定されている所定の基準電圧VIS、（ｂ）は入力
電圧検出回路11の出力する入力電圧検出信号、（ｃ）は
電源供給端子17に供給される電源電圧VCCおよび予め設
定されている所定の基準電圧VCS、（ｄ）はスイッチン
グトランジスタ12のコレクタ電圧VCC′、（ｅ）は出力
端子13から出力される出力信号を表す。
入力電圧VIN＞基準電圧VISとなって入力電圧検出信号が
「Ｌ」となっている場合はスイッチングトランジスタ12
はオフになる。また、電源電圧VCCが基準電圧VCSよりも
高くなっていると検出抵抗18,19によりシャントレギュ
レータ20はオンの状態となり、抵抗21,22およびシャン
トレギュレータ20には電流が流れて抵抗22の両端には電
圧が生じ、スイッチングトランジスタ16がオンとなる。
このため、出力端子13には電源電圧VCCとほぼ同じ電圧
の「Ｈ」信号が出力される。しかし、入力電圧検出信号
が「Ｌ」→「Ｈ」となった後に入力電圧VIN＜基準電圧V
ISとなると、入力電圧検出回路11の電源が低下して再び
入力電圧検出信号は「Ｈ」→「Ｌ」へ変化する。しか
し、この場合においては、入力電圧VINが低下したこと
により電源電圧VCCも低下し、この電源電圧VCCが基準電
圧VCSより低い電圧となった瞬間にシャントレギュレー
タ20はただちにオフする。このため、抵抗22の両端の電
圧は消滅してスイッチングトランジスタ16もオフし、電
源供給端子17から出力端子13への供給電圧はカットされ
る。このため、スイッチングトランジスタ12のコレクタ
電圧はほぼ接地電位と同じ電位である「Ｌ」状態を保持
しつづけ、出力端子13には従来のように誤った「Ｈ」信
号は出力されない。
「Ｌ」となっている場合はスイッチングトランジスタ12
はオフになる。また、電源電圧VCCが基準電圧VCSよりも
高くなっていると検出抵抗18,19によりシャントレギュ
レータ20はオンの状態となり、抵抗21,22およびシャン
トレギュレータ20には電流が流れて抵抗22の両端には電
圧が生じ、スイッチングトランジスタ16がオンとなる。
このため、出力端子13には電源電圧VCCとほぼ同じ電圧
の「Ｈ」信号が出力される。しかし、入力電圧検出信号
が「Ｌ」→「Ｈ」となった後に入力電圧VIN＜基準電圧V
ISとなると、入力電圧検出回路11の電源が低下して再び
入力電圧検出信号は「Ｈ」→「Ｌ」へ変化する。しか
し、この場合においては、入力電圧VINが低下したこと
により電源電圧VCCも低下し、この電源電圧VCCが基準電
圧VCSより低い電圧となった瞬間にシャントレギュレー
タ20はただちにオフする。このため、抵抗22の両端の電
圧は消滅してスイッチングトランジスタ16もオフし、電
源供給端子17から出力端子13への供給電圧はカットされ
る。このため、スイッチングトランジスタ12のコレクタ
電圧はほぼ接地電位と同じ電位である「Ｌ」状態を保持
しつづけ、出力端子13には従来のように誤った「Ｈ」信
号は出力されない。
以上説明したように本発明は、電源回路の入力電圧が低
下した時に信号を出力する入力電圧検出回路と、この入
力電圧検出回路の出力する信号をベースに入力しエミッ
タが接地されコレクタを出力端子とするNPNトランジス
タと、電源電圧が低下した時にオフし電源電圧が増加し
た時にオンするシャントレギュレータと、このシャント
レギュレータのカソードがベースに接続されエミッタが
電源電圧に吊り上げられコレクタが前記のNPNトランジ
スタのコレクタに接続されたPNPトランジスタとから構
成したことにより、入力電圧の低下はシャントレギュレ
ータにより検知されてPNPトランジスタはオフされ、電
源供給端子から出力端子への供給電圧はカットされる。
このため、従来の回路のように、入力電圧検出回路の電
源電圧が不足した場合に誤動作をするという課題は解消
されるという効果を有する。
下した時に信号を出力する入力電圧検出回路と、この入
力電圧検出回路の出力する信号をベースに入力しエミッ
タが接地されコレクタを出力端子とするNPNトランジス
タと、電源電圧が低下した時にオフし電源電圧が増加し
た時にオンするシャントレギュレータと、このシャント
レギュレータのカソードがベースに接続されエミッタが
電源電圧に吊り上げられコレクタが前記のNPNトランジ
スタのコレクタに接続されたPNPトランジスタとから構
成したことにより、入力電圧の低下はシャントレギュレ
ータにより検知されてPNPトランジスタはオフされ、電
源供給端子から出力端子への供給電圧はカットされる。
このため、従来の回路のように、入力電圧検出回路の電
源電圧が不足した場合に誤動作をするという課題は解消
されるという効果を有する。
第１図は本発明の一実施例を表す回路図、第２図はこの
回路図の各部の波形を示す波形図、第３図は従来の構成
を表す回路図、第４図はこの従来の回路図の各部の波形
を示す波形図である。 11……入力電圧検出回路、12,16……スイッチングトラ
ンジスタ、13……出力端子、14,15,18,19,21,22……抵
抗、17……電源供給端子、20……シャントレギュレー
タ。
回路図の各部の波形を示す波形図、第３図は従来の構成
を表す回路図、第４図はこの従来の回路図の各部の波形
を示す波形図である。 11……入力電圧検出回路、12,16……スイッチングトラ
ンジスタ、13……出力端子、14,15,18,19,21,22……抵
抗、17……電源供給端子、20……シャントレギュレー
タ。
Claims (1)
- 【請求項１】電源回路の入力電圧を所定の第１の基準電
圧と比較して前記入力電圧がこの第１の基準電圧より低
下した時に信号を出力する入力電圧検出回路と、この入
力電圧検出回路の出力する前記信号をベースに入力しエ
ミッタが接地されコレクタを出力端子とするNPNトラン
ジスタと、電源電圧を所定の第２の基準電圧と比較して
前記電源電圧がこの第２の基準電圧より低下した時にオ
フし前記電源電圧がこの第２の基準電圧より増加した時
にオンするシャントレギュレータと、このシャントレギ
ュレータのカソードが抵抗を介してベースに接続されエ
ミッタが電源電圧に吊り上げられコレクタが抵抗を介し
て前記NPNトランジスタのコレクタに接続されたPNPトラ
ンジスタとから構成される電断検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9463388A JPH0714253B2 (ja) | 1988-04-19 | 1988-04-19 | 電断検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9463388A JPH0714253B2 (ja) | 1988-04-19 | 1988-04-19 | 電断検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01268420A JPH01268420A (ja) | 1989-10-26 |
| JPH0714253B2 true JPH0714253B2 (ja) | 1995-02-15 |
Family
ID=14115670
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9463388A Expired - Lifetime JPH0714253B2 (ja) | 1988-04-19 | 1988-04-19 | 電断検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0714253B2 (ja) |
-
1988
- 1988-04-19 JP JP9463388A patent/JPH0714253B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01268420A (ja) | 1989-10-26 |
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