JPH066753A - 誤り修整装置 - Google Patents
誤り修整装置Info
- Publication number
- JPH066753A JPH066753A JP15692492A JP15692492A JPH066753A JP H066753 A JPH066753 A JP H066753A JP 15692492 A JP15692492 A JP 15692492A JP 15692492 A JP15692492 A JP 15692492A JP H066753 A JPH066753 A JP H066753A
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- Japan
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- error
- circuit
- data
- component
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- Pending
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- Television Signal Processing For Recording (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
- Compression Of Band Width Or Redundancy In Fax (AREA)
Abstract
(57)【要約】
【目的】エラーブロックと周辺ブロックとの境界のレベ
ル差を小さくしてエラーを目立たなくする。 【構成】エラー検出回路32は再生出力に訂正しきれない
エラーが発生している場合には、エラーフラグを修整演
算回路48,49に出力する。修整演算回路48,49はエラー
ブロックに隣接した2行の画素から垂直方向の差分平均
値を求め、エラーブロックに隣接した2列の画素から水
平方向の差分平均値を求める。更に、水平及び垂直方向
の差分平均値とエラーブロックの各画素位置とから、エ
ラーブロックの各画素の修整値を求める。この修整値を
用いることで、エラーが目立たなくなる。
ル差を小さくしてエラーを目立たなくする。 【構成】エラー検出回路32は再生出力に訂正しきれない
エラーが発生している場合には、エラーフラグを修整演
算回路48,49に出力する。修整演算回路48,49はエラー
ブロックに隣接した2行の画素から垂直方向の差分平均
値を求め、エラーブロックに隣接した2列の画素から水
平方向の差分平均値を求める。更に、水平及び垂直方向
の差分平均値とエラーブロックの各画素位置とから、エ
ラーブロックの各画素の修整値を求める。この修整値を
用いることで、エラーが目立たなくなる。
Description
【0001】
【産業上の利用分野】本発明は、ブロック符号化されて
伝送された画像データを受信して誤りを修整する誤り修
正装置に関する。
伝送された画像データを受信して誤りを修整する誤り修
正装置に関する。
【0002】
【従来の技術】近年、画像処理におけるディジタル技術
の進歩は著しく、誤り訂正技術及び高能率符号化は標準
化されている。ディジタル映像信号を磁気テープ上に記
録するディジタルビデオテープレコーダ(以下、ディジ
タルVTRという)においても、記録データに誤り訂正
符号を付加して記録するようになっており、再生時に
は、記録データと誤り訂正符号との規則性を利用して、
記録データの誤りを訂正している。
の進歩は著しく、誤り訂正技術及び高能率符号化は標準
化されている。ディジタル映像信号を磁気テープ上に記
録するディジタルビデオテープレコーダ(以下、ディジ
タルVTRという)においても、記録データに誤り訂正
符号を付加して記録するようになっており、再生時に
は、記録データと誤り訂正符号との規則性を利用して、
記録データの誤りを訂正している。
【0003】しかし、磁気テープの磁性面上の傷及びご
み等によって再生データの誤りが増大し、誤り訂正符号
だけでは訂正しきれないことがある。そこで、従来、
「ディジタルビデオ記録技術」(江藤良純他,日刊工業
新聞社刊pp122)において開示されている誤り修整
技術を採用することがある。図8はこの誤り修整技術を
説明するための説明図である。図中、直線は走査線を示
し、○印は誤っていない画素を示し、◎印は誤り画素を
示している。
み等によって再生データの誤りが増大し、誤り訂正符号
だけでは訂正しきれないことがある。そこで、従来、
「ディジタルビデオ記録技術」(江藤良純他,日刊工業
新聞社刊pp122)において開示されている誤り修整
技術を採用することがある。図8はこの誤り修整技術を
説明するための説明図である。図中、直線は走査線を示
し、○印は誤っていない画素を示し、◎印は誤り画素を
示している。
【0004】この修整方法は、誤っていない周辺画素を
用いた補間によって誤りを修整するものである。図8
(a),(b)は水平画素間の補間を示している。図8
(a)では、誤り画素Xを直前の画素Aと同一の値とす
る補間方法である。図8(b)は、水平方向前後に隣接
した画素A,Bを用い、誤り画素XをX=1/2(A+
B)として補間するものである。図8(c),(d)は
垂直画素間の補間を示している。図8(c)では、前走
査線の同一の位置の画素Cを誤り画素Xに代えて用い、
図8(d)では、前後の走査線の同一位置の画素C,D
の平均(=1/2(C+D))を誤り画素Xに代えて用
いる。また、図8(e)は水平垂直補間を示し、誤り画
素Xを前後左右の画素A,B,C,Dの平均によって求
めるものである。更に、図8(f)は時間軸方向の画素
間、すなわち、1フィールド前の走査線の同一位置の画
素Eを誤り画素Xに置き代えて用いるものを示してい
る。
用いた補間によって誤りを修整するものである。図8
(a),(b)は水平画素間の補間を示している。図8
(a)では、誤り画素Xを直前の画素Aと同一の値とす
る補間方法である。図8(b)は、水平方向前後に隣接
した画素A,Bを用い、誤り画素XをX=1/2(A+
B)として補間するものである。図8(c),(d)は
垂直画素間の補間を示している。図8(c)では、前走
査線の同一の位置の画素Cを誤り画素Xに代えて用い、
図8(d)では、前後の走査線の同一位置の画素C,D
の平均(=1/2(C+D))を誤り画素Xに代えて用
いる。また、図8(e)は水平垂直補間を示し、誤り画
素Xを前後左右の画素A,B,C,Dの平均によって求
めるものである。更に、図8(f)は時間軸方向の画素
間、すなわち、1フィールド前の走査線の同一位置の画
素Eを誤り画素Xに置き代えて用いるものを示してい
る。
【0005】ところで、映像データのデータ量は極めて
大きく、磁気テープ上にそのまま記録すると、高密度記
録の限界から長時間記録は困難である。そこで、民生用
のディジタルVTRにおいては高能率符号化技術を採用
して映像データを圧縮することにより、テープ消費量を
低減して長時間記録を可能にしている。画像圧縮の高能
率符号化においては、複数画素から成るブロックに対し
て符号化を行うブロック符号化、例えば、アダマール変
換及び離散コサイン変換(以下、DCTという)等を採
用する。ブロック符号化は、各ブロックに対して直交変
換を行い、これにより、各ブロックを相関性を有してい
ないデータで表現して冗長性を排除し圧縮を行うもので
ある。従って、誤りは次ブロックまで伝搬することなく
収束し、しかも、ブロック符号化の圧縮率は高い。
大きく、磁気テープ上にそのまま記録すると、高密度記
録の限界から長時間記録は困難である。そこで、民生用
のディジタルVTRにおいては高能率符号化技術を採用
して映像データを圧縮することにより、テープ消費量を
低減して長時間記録を可能にしている。画像圧縮の高能
率符号化においては、複数画素から成るブロックに対し
て符号化を行うブロック符号化、例えば、アダマール変
換及び離散コサイン変換(以下、DCTという)等を採
用する。ブロック符号化は、各ブロックに対して直交変
換を行い、これにより、各ブロックを相関性を有してい
ないデータで表現して冗長性を排除し圧縮を行うもので
ある。従って、誤りは次ブロックまで伝搬することなく
収束し、しかも、ブロック符号化の圧縮率は高い。
【0006】図9はブロック符号化を説明するための説
明図である。
明図である。
【0007】1ブロックは、図9(a)に示すように、
8水平画素×8垂直画素(Y0.0 乃至Y7.7 )で構成す
る。このブロックデータに対して2次元直交変換を行っ
て、図9(b)に示す変換係数(YDC,YAC0 乃至YAC
62)を得る。変換係数の直流成分YDCは全変換係数の平
均値であり、交流成分YAC0 乃至YAC62は、図9(b)
に示すように、水平及び垂直方向の低域から高域に向か
って配列する。更に、ブロック符号化では、交流成分Y
AC0 乃至YAC62に対して可変長符号化を行って可変長符
号に変換し、圧縮率を一層向上させる。この場合、各ブ
ロックの符号化データは可変長であり、復号しなければ
各ブロックデータの区切りは判明しない。そこで、各ブ
ロックの先頭に識別データを付加することによって、再
生時に各ブロックデータの区切りを識別可能にしてい
る。
8水平画素×8垂直画素(Y0.0 乃至Y7.7 )で構成す
る。このブロックデータに対して2次元直交変換を行っ
て、図9(b)に示す変換係数(YDC,YAC0 乃至YAC
62)を得る。変換係数の直流成分YDCは全変換係数の平
均値であり、交流成分YAC0 乃至YAC62は、図9(b)
に示すように、水平及び垂直方向の低域から高域に向か
って配列する。更に、ブロック符号化では、交流成分Y
AC0 乃至YAC62に対して可変長符号化を行って可変長符
号に変換し、圧縮率を一層向上させる。この場合、各ブ
ロックの符号化データは可変長であり、復号しなければ
各ブロックデータの区切りは判明しない。そこで、各ブ
ロックの先頭に識別データを付加することによって、再
生時に各ブロックデータの区切りを識別可能にしてい
る。
【0008】しかし、記録再生過程において識別データ
に訂正することができない誤りが残ると、次のブロック
は復号することができず、1ブロックの全データが誤り
となってしまう。このため、この場合には、上述した周
辺画素を用いた補間方法を採用することはできず、ブロ
ック単位の補間を行う必要がある。
に訂正することができない誤りが残ると、次のブロック
は復号することができず、1ブロックの全データが誤り
となってしまう。このため、この場合には、上述した周
辺画素を用いた補間方法を採用することはできず、ブロ
ック単位の補間を行う必要がある。
【0009】図10はこのブロック単位の補間を説明す
るための説明図である。
るための説明図である。
【0010】図10(a)は所定の3×3ブロックの画
像(原画)を示している。図10(a)に示す原画の中
央のブロックに誤りが発生するものとする。図10
(b)は、交流成分に対する復号出力を用いず、直流成
分の復号出力のみを用いた例である。この場合には、誤
りブロックはその平均輝度レベルの表示となる。また、
時間軸ブロック間で補間を行うこともある。例えば、前
フィールドの絵柄を図10(c)に示すものとすると、
中央の誤りブロックを前フィールドのブロックを用いて
補間すると、図10(d)に示すものとなる。
像(原画)を示している。図10(a)に示す原画の中
央のブロックに誤りが発生するものとする。図10
(b)は、交流成分に対する復号出力を用いず、直流成
分の復号出力のみを用いた例である。この場合には、誤
りブロックはその平均輝度レベルの表示となる。また、
時間軸ブロック間で補間を行うこともある。例えば、前
フィールドの絵柄を図10(c)に示すものとすると、
中央の誤りブロックを前フィールドのブロックを用いて
補間すると、図10(d)に示すものとなる。
【0011】しかしながら、直流成分のみでブロックを
補間すると、ブロック内の全画素が同一レベルとなり、
また、そのレベルはブロックの平均レベルであるので、
周辺ブロックとの間で画素レベルの差が生じ、誤りが目
立ってしまうという欠点があった。また、時間軸ブロッ
ク間で補間を行うと、動きが早い画像信号については、
ブロック単位で画像のずれが目立ってしまう。
補間すると、ブロック内の全画素が同一レベルとなり、
また、そのレベルはブロックの平均レベルであるので、
周辺ブロックとの間で画素レベルの差が生じ、誤りが目
立ってしまうという欠点があった。また、時間軸ブロッ
ク間で補間を行うと、動きが早い画像信号については、
ブロック単位で画像のずれが目立ってしまう。
【0012】
【発明が解決しようとする課題】このように、従来、ブ
ロック符号化を採用した場合には、周辺ブロックを用い
て誤りブロックを補間しても、誤りが目立ってしまうと
いう問題点があった。
ロック符号化を採用した場合には、周辺ブロックを用い
て誤りブロックを補間しても、誤りが目立ってしまうと
いう問題点があった。
【0013】本発明は、誤りブロックと周辺ブロックと
の境界における画素レベルの急峻な変化を抑制すること
により、誤りを目立たなくすることができる誤り修正装
置を提供することを目的とする。
の境界における画素レベルの急峻な変化を抑制すること
により、誤りを目立たなくすることができる誤り修正装
置を提供することを目的とする。
【0014】
【課題を解決するための手段】本発明に係る誤り修正装
置は、複数の画素データによって構成されるブロックデ
ータが順次入力され入力されたブロックデータがエラー
ブロックであるか否かを検出するエラー検出手段と、前
記エラーブロックを含む複数のブロックのブロックデー
タを画素位置に対応させて記憶するメモリと、前記エラ
ー検出手段の出力によって前記メモリから前記エラーブ
ロックに隣接したブロックの画素データを読出し読出し
た画素データと前記エラーブロックの各画素の位置とを
用いた所定の演算によって前記エラーブロックの各画素
データを修整して前記メモリに格納する修整演算手段と
を具備したものである。
置は、複数の画素データによって構成されるブロックデ
ータが順次入力され入力されたブロックデータがエラー
ブロックであるか否かを検出するエラー検出手段と、前
記エラーブロックを含む複数のブロックのブロックデー
タを画素位置に対応させて記憶するメモリと、前記エラ
ー検出手段の出力によって前記メモリから前記エラーブ
ロックに隣接したブロックの画素データを読出し読出し
た画素データと前記エラーブロックの各画素の位置とを
用いた所定の演算によって前記エラーブロックの各画素
データを修整して前記メモリに格納する修整演算手段と
を具備したものである。
【0015】
【作用】本発明において、メモリにはエラーブロックと
その周辺のブロックの画素データを格納する。修整演算
手段は、エラーブロックに隣接したブロックの画素デー
タをメモリから読出し、読出した各画素データによって
絵柄の変化の状態を得、この変化の状態とエラーブロッ
クの各画素位置とからエラーブロックの各画素を修整す
る。
その周辺のブロックの画素データを格納する。修整演算
手段は、エラーブロックに隣接したブロックの画素デー
タをメモリから読出し、読出した各画素データによって
絵柄の変化の状態を得、この変化の状態とエラーブロッ
クの各画素位置とからエラーブロックの各画素を修整す
る。
【0016】
【実施例】以下、図面を参照して本発明の実施例につい
て説明する。図1は本発明に係る誤り修正装置の一実施
例を示すブロック図である。
て説明する。図1は本発明に係る誤り修正装置の一実施
例を示すブロック図である。
【0017】入力端子1には画像信号を入力する。この
画像信号はY/C分離回路2に与える。Y/C分離回路
2は画像信号を輝度信号Y及び色差信号Cr,Cbに分
離して夫々A/D変換器3,4,5に与える。A/D変
換器3は入力された信号をディジタル信号に変換してフ
ィールドメモリ6に与え、A/D変換器4,5は入力さ
れた信号をディジタル信号に変換してマルチプレクサ7
に出力する。マルチプレクサ7はディジタルの色差信号
Cr,Cbを時分割多重してフィールドメモリ8に出力
する。
画像信号はY/C分離回路2に与える。Y/C分離回路
2は画像信号を輝度信号Y及び色差信号Cr,Cbに分
離して夫々A/D変換器3,4,5に与える。A/D変
換器3は入力された信号をディジタル信号に変換してフ
ィールドメモリ6に与え、A/D変換器4,5は入力さ
れた信号をディジタル信号に変換してマルチプレクサ7
に出力する。マルチプレクサ7はディジタルの色差信号
Cr,Cbを時分割多重してフィールドメモリ8に出力
する。
【0018】フィールドメモリ6,8は入力画像データ
を、例えば8×8画素のブロック単位で夫々DCT回路
9,10に与える。DCT回路9,10は、夫々入力された
ブロックデータをDCT処理して変換係数をフィールド
メモリ11,12を介して量子化回路13,14に出力する。D
CT回路9,10からのDCT変換係数は水平及び垂直方
向に低域から高域まで各周波数性分を有しており、全デ
ータの平均値は直流成分として出力し、他の成分は交流
成分として出力する。フィールドメモリ11,12は、変換
係数の交流成分については、水平及び垂直の低域から高
域に向かってジグザグスキャンして読出して量子化回路
13,14に与えている。量子化回路13,14は、変換係数の
直流成分と交流成分とを別々に量子化する。例えば、量
子化回路13,14は、図示しない量子化テーブルに格納さ
れた量子化係数でDCT変換係数を割り算することによ
って量子化出力を求める。
を、例えば8×8画素のブロック単位で夫々DCT回路
9,10に与える。DCT回路9,10は、夫々入力された
ブロックデータをDCT処理して変換係数をフィールド
メモリ11,12を介して量子化回路13,14に出力する。D
CT回路9,10からのDCT変換係数は水平及び垂直方
向に低域から高域まで各周波数性分を有しており、全デ
ータの平均値は直流成分として出力し、他の成分は交流
成分として出力する。フィールドメモリ11,12は、変換
係数の交流成分については、水平及び垂直の低域から高
域に向かってジグザグスキャンして読出して量子化回路
13,14に与えている。量子化回路13,14は、変換係数の
直流成分と交流成分とを別々に量子化する。例えば、量
子化回路13,14は、図示しない量子化テーブルに格納さ
れた量子化係数でDCT変換係数を割り算することによ
って量子化出力を求める。
【0019】ところで、量子化テーブルの量子化係数を
変化させることによって、符号化後のデータ量を制御す
ることができる。例えば、量子化係数を比較的大きな値
に設定すると、量子化ステップは粗くなって情報は劣化
するが、量子化出力のダイナミックレンジは小さくなっ
て符号量も小さくなる。従って、絵柄に応じて量子化係
数を制御することによって、符号化出力を定レート化す
ることができる。
変化させることによって、符号化後のデータ量を制御す
ることができる。例えば、量子化係数を比較的大きな値
に設定すると、量子化ステップは粗くなって情報は劣化
するが、量子化出力のダイナミックレンジは小さくなっ
て符号量も小さくなる。従って、絵柄に応じて量子化係
数を制御することによって、符号化出力を定レート化す
ることができる。
【0020】この定レート化制御のために、DCT回路
9,10からの変換係数はフィールドアクティビティ演算
回路15にも与える。フィールドアクティビティ演算回路
15は、画像の符号量を推定するためにブロック毎の情報
量(以下、アクティビティという)を求める。アクティ
ビティ演算回路15は求めたブロックアクティビティを積
算してフィールド毎の情報量を示すフィールドアクティ
ビティを求め、更に、これらのアクティビティに基づい
て、量子化係数を正規化するための正規化係数αを求め
て量子化回路13,14に出力する。量子化回路13,14は正
規化係数αによって量子化係数を正規化した後、変換係
数を量子化するようになっている。
9,10からの変換係数はフィールドアクティビティ演算
回路15にも与える。フィールドアクティビティ演算回路
15は、画像の符号量を推定するためにブロック毎の情報
量(以下、アクティビティという)を求める。アクティ
ビティ演算回路15は求めたブロックアクティビティを積
算してフィールド毎の情報量を示すフィールドアクティ
ビティを求め、更に、これらのアクティビティに基づい
て、量子化係数を正規化するための正規化係数αを求め
て量子化回路13,14に出力する。量子化回路13,14は正
規化係数αによって量子化係数を正規化した後、変換係
数を量子化するようになっている。
【0021】量子化回路13,14からの量子化出力の直流
成分は夫々DC成分符号化回路16,17に与える。DC成
分符号化回路16,17は、各ブロックの直流成分を固定長
符号化し、ブロック単位でアドレス情報、同期信号及び
ID番号等を付加して、所定の順序でマルチプレクサ20
に出力する。
成分は夫々DC成分符号化回路16,17に与える。DC成
分符号化回路16,17は、各ブロックの直流成分を固定長
符号化し、ブロック単位でアドレス情報、同期信号及び
ID番号等を付加して、所定の順序でマルチプレクサ20
に出力する。
【0022】一方、量子化回路13,14からの量子化出力
の交流成分は夫々AC成分符号化回路18,19に与える。
AC成分符号化回路18,19は、入力された量子化出力の
交流成分に対して、零が連続する数(以下、ゼロランと
いう)及び非零係数のコード長の組みのデータ毎に、図
示しないハフマンテーブルを参照して2次元ハフマン符
号化し、非零係数のコードを付加する。この場合には、
予め各ブロックに所定の符号量を割当て(ブロックビッ
ト配分し)、符号化出力が割当てられた符号量を超過す
ると、そのブロックにおける符号化を停止する方法を採
用することによって、固定長化を図っている。
の交流成分は夫々AC成分符号化回路18,19に与える。
AC成分符号化回路18,19は、入力された量子化出力の
交流成分に対して、零が連続する数(以下、ゼロランと
いう)及び非零係数のコード長の組みのデータ毎に、図
示しないハフマンテーブルを参照して2次元ハフマン符
号化し、非零係数のコードを付加する。この場合には、
予め各ブロックに所定の符号量を割当て(ブロックビッ
ト配分し)、符号化出力が割当てられた符号量を超過す
ると、そのブロックにおける符号化を停止する方法を採
用することによって、固定長化を図っている。
【0023】すなわち、符号量配分回路21はブロックア
クティビティとフィールドアクティビティとの比によっ
て、各ブロックの配分ビット数を決定する。符号量配分
回路21は、符号化データの符号量の積算値がブロックの
配分ビット数を越えると、AC成分符号化回路18,19の
符号化処理を停止させて、ブロック配分ビット数を超過
した符号化データは出力させないようになっている。A
C成分符号化回路18,19は、直流成分と同様に、符号化
出力にブロック単位でアドレス情報、同期信号及びID
番号等を付加すると共に、コード長のデータを付加し
て、ブロック単位で順序化した後マルチプレクサ20に出
力する。マルチプレクサ20は交流成分及び直流成分につ
いての符号化出力を多重して出力する。
クティビティとフィールドアクティビティとの比によっ
て、各ブロックの配分ビット数を決定する。符号量配分
回路21は、符号化データの符号量の積算値がブロックの
配分ビット数を越えると、AC成分符号化回路18,19の
符号化処理を停止させて、ブロック配分ビット数を超過
した符号化データは出力させないようになっている。A
C成分符号化回路18,19は、直流成分と同様に、符号化
出力にブロック単位でアドレス情報、同期信号及びID
番号等を付加すると共に、コード長のデータを付加し
て、ブロック単位で順序化した後マルチプレクサ20に出
力する。マルチプレクサ20は交流成分及び直流成分につ
いての符号化出力を多重して出力する。
【0024】マルチプレクサ20からの高能率符号化デー
タはエラー訂正符号付加回路22に与える。エラー訂正符
号付加回路22は入力されたデータにエラー訂正用パリテ
ィを付加して変調回路23に出力する。変調回路23は図示
しない回転トランスの伝送効率及び磁気記録再生特性の
低下が著しい直流成分と周波数低域成分とを抑圧するた
めに、所定の法則に基づいて“1”と“0”との並び換
え処理を行う。更に、変調回路23は変調したデータに同
期データを付加した後、シリアルデータに変換して記録
処理回路24に出力する。記録処理回路24は変調回路23の
出力を周波数帯域制限すると共に増幅し、図示しない回
転トランスを介して回転シリンダ25上のAヘッド26及び
Bヘッド27に伝送する。A,Bヘッド26,27は記録処理
回路24の出力を磁気テープ28に磁気記録すると共に再生
する。
タはエラー訂正符号付加回路22に与える。エラー訂正符
号付加回路22は入力されたデータにエラー訂正用パリテ
ィを付加して変調回路23に出力する。変調回路23は図示
しない回転トランスの伝送効率及び磁気記録再生特性の
低下が著しい直流成分と周波数低域成分とを抑圧するた
めに、所定の法則に基づいて“1”と“0”との並び換
え処理を行う。更に、変調回路23は変調したデータに同
期データを付加した後、シリアルデータに変換して記録
処理回路24に出力する。記録処理回路24は変調回路23の
出力を周波数帯域制限すると共に増幅し、図示しない回
転トランスを介して回転シリンダ25上のAヘッド26及び
Bヘッド27に伝送する。A,Bヘッド26,27は記録処理
回路24の出力を磁気テープ28に磁気記録すると共に再生
する。
【0025】一方、再生系においては、A,Bヘッド2
6,27によって磁気テープ28から再生された再生データ
を切換回路29を介して再生処理回路30に与える。切換回
路29は、図示しないサーボ回路から発生するヘッドスイ
ッチング信号によって、磁気テープ28に接触しているヘ
ッドを選択することにより、再生出力を再生処理回路30
に供給している。再生処理回路30は再生出力を増幅し、
帯域制限して復調回路31に出力する。復調回路31は、記
録再生時に生じた時間軸変動を補正した後同期データを
検出し、記録時の変調処理と逆の処理を行ってエラー検
出訂正回路32に出力する。エラー検出訂正回路32は、記
録時に付加したリードソロモン符号に基づいて、記録再
生時に生じたデータ誤りを検出すると共に訂正し、デマ
ルチプレクサ33に出力する。また、エラー検出訂正回路
32は、誤り訂正能力を越えたエラーが発生した場合に
は、後述する修整演算回路48,49のフラグ入力端子及び
変換回路57にエラーフラグを出力するようになってい
る。
6,27によって磁気テープ28から再生された再生データ
を切換回路29を介して再生処理回路30に与える。切換回
路29は、図示しないサーボ回路から発生するヘッドスイ
ッチング信号によって、磁気テープ28に接触しているヘ
ッドを選択することにより、再生出力を再生処理回路30
に供給している。再生処理回路30は再生出力を増幅し、
帯域制限して復調回路31に出力する。復調回路31は、記
録再生時に生じた時間軸変動を補正した後同期データを
検出し、記録時の変調処理と逆の処理を行ってエラー検
出訂正回路32に出力する。エラー検出訂正回路32は、記
録時に付加したリードソロモン符号に基づいて、記録再
生時に生じたデータ誤りを検出すると共に訂正し、デマ
ルチプレクサ33に出力する。また、エラー検出訂正回路
32は、誤り訂正能力を越えたエラーが発生した場合に
は、後述する修整演算回路48,49のフラグ入力端子及び
変換回路57にエラーフラグを出力するようになってい
る。
【0026】デマルチプレクサ33は、記録時に付加した
ブロック毎のアドレス情報に基づいて、輝度信号Yの直
流成分及び交流成分並びに色差信号Cr,Cbの直流成
分及び交流成分を検出して分割し、夫々DC成分復号回
路34、AC成分復号回路36、DC成分復号回路35、AC
成分復号回路37に出力する。DC成分復号回路34,35
は、再生されたブロック毎のアドレス情報及びコード長
に基づいて、記録時の逆処理によって量子化された直流
成分を求めて、夫々輝度成分再生回路38及び色差成分再
生回路39に出力する。また、AC成分復号回路36,37
は、再生されたブロック毎のアドレス情報及びコード長
に基づいて再生データをハフマン復号し、ゼロラン及び
非零係数を求めて量子化された交流成分を得る。輝度信
号Yの交流成分は輝度成分再生回路38に与え、輝度成分
再生回路38は輝度信号Yの直流成分及び交流成分を周波
数信号に戻して逆量子化回路40に出力する。色差信号C
r,Cbの交流成分は色差成分再生回路39に与え、色差
成分再生回路39は色差信号Cr,Cbの交流成分及び直
流成分を周波数信号に戻して逆量子化回路41に出力す
る。
ブロック毎のアドレス情報に基づいて、輝度信号Yの直
流成分及び交流成分並びに色差信号Cr,Cbの直流成
分及び交流成分を検出して分割し、夫々DC成分復号回
路34、AC成分復号回路36、DC成分復号回路35、AC
成分復号回路37に出力する。DC成分復号回路34,35
は、再生されたブロック毎のアドレス情報及びコード長
に基づいて、記録時の逆処理によって量子化された直流
成分を求めて、夫々輝度成分再生回路38及び色差成分再
生回路39に出力する。また、AC成分復号回路36,37
は、再生されたブロック毎のアドレス情報及びコード長
に基づいて再生データをハフマン復号し、ゼロラン及び
非零係数を求めて量子化された交流成分を得る。輝度信
号Yの交流成分は輝度成分再生回路38に与え、輝度成分
再生回路38は輝度信号Yの直流成分及び交流成分を周波
数信号に戻して逆量子化回路40に出力する。色差信号C
r,Cbの交流成分は色差成分再生回路39に与え、色差
成分再生回路39は色差信号Cr,Cbの交流成分及び直
流成分を周波数信号に戻して逆量子化回路41に出力す
る。
【0027】また、デマルチプレクサ33は再生出力から
正規化係数αを抽出して係数発生回路42,43に出力す
る。係数発生回路42,43は正規化係数αによって逆量子
化係数を発生して、夫々逆量子化回路40,41に与える。
逆量子化回路40,41は逆量子化係数を用いて周波数信号
を逆量子化し、夫々IDCT回路44,45に出力する。I
DCT回路44は記録時のDCT処理の逆処理を行って、
ブロック単位の輝度信号データをフィールドメモリ46及
び修整演算回路48に出力する。IDCT回路45は逆DC
T処理によってブロック単位の色差信号データを得て、
フィールドメモリ47及び修整演算回路49に出力する。フ
ィールドメモリ46,47は、夫々8×8画素のブロック単
位のデータを元の時間順序に配列させて切換回路50,51
に出力する。
正規化係数αを抽出して係数発生回路42,43に出力す
る。係数発生回路42,43は正規化係数αによって逆量子
化係数を発生して、夫々逆量子化回路40,41に与える。
逆量子化回路40,41は逆量子化係数を用いて周波数信号
を逆量子化し、夫々IDCT回路44,45に出力する。I
DCT回路44は記録時のDCT処理の逆処理を行って、
ブロック単位の輝度信号データをフィールドメモリ46及
び修整演算回路48に出力する。IDCT回路45は逆DC
T処理によってブロック単位の色差信号データを得て、
フィールドメモリ47及び修整演算回路49に出力する。フ
ィールドメモリ46,47は、夫々8×8画素のブロック単
位のデータを元の時間順序に配列させて切換回路50,51
に出力する。
【0028】図2は図1中の修整演算回路48,49の具体
的な構成を示すブロック図である。
的な構成を示すブロック図である。
【0029】IDCT回路44,45からのブロックデータ
は入力端子58に与える。このブロックデータは書込みデ
ータ用の切換回路59を介してメモリ60に与える。アドレ
ス発生回路61はメモリ60の書込み及び読出しアドレスを
発生してアドレス用の切換回路62を介してメモリ60に与
える。メモリ60から読出されたデータは読出しデータ用
の切換回路63を介してデータ出力端子64に出力する。デ
ータ出力端子64は切換回路50,51(図1参照)に接続す
る。
は入力端子58に与える。このブロックデータは書込みデ
ータ用の切換回路59を介してメモリ60に与える。アドレ
ス発生回路61はメモリ60の書込み及び読出しアドレスを
発生してアドレス用の切換回路62を介してメモリ60に与
える。メモリ60から読出されたデータは読出しデータ用
の切換回路63を介してデータ出力端子64に出力する。デ
ータ出力端子64は切換回路50,51(図1参照)に接続す
る。
【0030】一方、フラグ入力端子65にはエラー検出訂
正回路32からのエラーフラグを供給する。このフラグは
マイクロコンピュータ(以下、マイコンという)66に与
える。マイコン66は切換回路59,62,63を制御すると共
に、メモリ60のアドレスを発生して切換回路62を介して
出力する。すなわち、マイコン66は、エラーフラグが入
力されると、アドレス切換回路62を制御してエラーブロ
ックの周辺のデータを切換回路63を介して読出し、後述
する演算によってエラーブロックのデータを修整して、
切換回路59を介してメモリ60のエラーブロックに対応す
る領域に書込むようになっている。
正回路32からのエラーフラグを供給する。このフラグは
マイクロコンピュータ(以下、マイコンという)66に与
える。マイコン66は切換回路59,62,63を制御すると共
に、メモリ60のアドレスを発生して切換回路62を介して
出力する。すなわち、マイコン66は、エラーフラグが入
力されると、アドレス切換回路62を制御してエラーブロ
ックの周辺のデータを切換回路63を介して読出し、後述
する演算によってエラーブロックのデータを修整して、
切換回路59を介してメモリ60のエラーブロックに対応す
る領域に書込むようになっている。
【0031】変換回路57はエラーフラグに基づいて切換
回路50,51を制御することにより、エラーを有していな
いブロックについてはフィールドメモリ46,47の出力を
選択させ、エラーブロックについては修整演算回路48,
49の出力を選択させるようになっている。切換回路50,
51の出力は夫々D/A変換器52及びデマルチプレクサ55
に出力する。デマルチプレクサ55は時分割多重されてい
る色差信号Cr,Cbを分割して夫々D/A変換器53,
54に出力する。D/A変換器52,53,54は入力されたデ
ィジタルデータをアナログ信号に変換してY/C混合回
路56に出力する。Y/C混合回路56は輝度信号Yと色差
信号Cr,Cbとを混合して画像信号を出力端子57に出
力する。
回路50,51を制御することにより、エラーを有していな
いブロックについてはフィールドメモリ46,47の出力を
選択させ、エラーブロックについては修整演算回路48,
49の出力を選択させるようになっている。切換回路50,
51の出力は夫々D/A変換器52及びデマルチプレクサ55
に出力する。デマルチプレクサ55は時分割多重されてい
る色差信号Cr,Cbを分割して夫々D/A変換器53,
54に出力する。D/A変換器52,53,54は入力されたデ
ィジタルデータをアナログ信号に変換してY/C混合回
路56に出力する。Y/C混合回路56は輝度信号Yと色差
信号Cr,Cbとを混合して画像信号を出力端子57に出
力する。
【0032】次に、このように構成された実施例の動作
について図3乃至図7を参照して説明する。
について図3乃至図7を参照して説明する。
【0033】記録側において、画像信号はY/C分離回
路2によって輝度信号Yと色差信号Cr,Cbに分離し
た後、夫々D/A変換器3,4,5に与える。D/A変
換器3によってディジタル信号に変換した輝度信号Y
は、フィールドメモリ6で8×8画素のブロックデータ
に変換してDCT回路9に与える。DCT回路9は2次
元DCT処理によって輝度信号を水平及び垂直の周波数
信号に変換し、変換係数をフィールドアクティビティ演
算回路15に与えると共に、フィールドメモリ11を介して
量子化回路13にも与える。色差信号Cr,Cbについて
も同様の処理であり、A/D変換器4,5によってディ
ジタル信号に変換した色差信号Cr,Cbをマルチプレ
クサ7によって時分割多重し、フィールドメモリ8によ
ってブロックデータに変換した後、DCT回路10で2次
元DCT処理を行う。DCT回路10の出力はフィールド
アクティビティ演算回路15に与えると共に、フィールド
メモリ12を介して量子化回路14にも与える。
路2によって輝度信号Yと色差信号Cr,Cbに分離し
た後、夫々D/A変換器3,4,5に与える。D/A変
換器3によってディジタル信号に変換した輝度信号Y
は、フィールドメモリ6で8×8画素のブロックデータ
に変換してDCT回路9に与える。DCT回路9は2次
元DCT処理によって輝度信号を水平及び垂直の周波数
信号に変換し、変換係数をフィールドアクティビティ演
算回路15に与えると共に、フィールドメモリ11を介して
量子化回路13にも与える。色差信号Cr,Cbについて
も同様の処理であり、A/D変換器4,5によってディ
ジタル信号に変換した色差信号Cr,Cbをマルチプレ
クサ7によって時分割多重し、フィールドメモリ8によ
ってブロックデータに変換した後、DCT回路10で2次
元DCT処理を行う。DCT回路10の出力はフィールド
アクティビティ演算回路15に与えると共に、フィールド
メモリ12を介して量子化回路14にも与える。
【0034】フィールドアクティビティ演算回路15はD
CT回路9,10の出力から、ブロックアクティビティ及
びフィールドアクティビティを求め、更に、求めたアク
ティビティから正規化係数αを得ると共に、1ブロック
において使用可能な配分ビット数を求める。量子化回路
13,14は正規化係数αによって量子化テーブルを正規化
し、正規化した量子化係数を用いて変換係数を量子化す
る。輝度信号の直流成分及び交流成分の量子化出力は夫
々DC成分符号化回路16及びAC成分符号化回路18に与
え、色差信号の直流成分及び交流成分の量子化出力は夫
々DC成分符号化回路17及びAC成分符号化回路19に与
える。
CT回路9,10の出力から、ブロックアクティビティ及
びフィールドアクティビティを求め、更に、求めたアク
ティビティから正規化係数αを得ると共に、1ブロック
において使用可能な配分ビット数を求める。量子化回路
13,14は正規化係数αによって量子化テーブルを正規化
し、正規化した量子化係数を用いて変換係数を量子化す
る。輝度信号の直流成分及び交流成分の量子化出力は夫
々DC成分符号化回路16及びAC成分符号化回路18に与
え、色差信号の直流成分及び交流成分の量子化出力は夫
々DC成分符号化回路17及びAC成分符号化回路19に与
える。
【0035】DC成分符号化回路16,17は、各ブロック
の直流成分を固定長符号化し、ブロック単位でアドレス
情報、同期信号及びID番号等を付加して、所定の順序
でマルチプレクサ20に出力する。一方、AC成分符号化
回路18,19は、量子化出力のゼロラン及び非零係数のコ
ード長の組みのデータをハフマン符号化し、更に、非零
係数コードを付加して可変長符号化する。更に、AC成
分符号化回路18,19は、直流成分と同様に、ブロック単
位でアドレス情報、同期信号、ID番号及びコード長を
付加し、ブロック単位で順序化した後マルチプレクサ20
に出力する。
の直流成分を固定長符号化し、ブロック単位でアドレス
情報、同期信号及びID番号等を付加して、所定の順序
でマルチプレクサ20に出力する。一方、AC成分符号化
回路18,19は、量子化出力のゼロラン及び非零係数のコ
ード長の組みのデータをハフマン符号化し、更に、非零
係数コードを付加して可変長符号化する。更に、AC成
分符号化回路18,19は、直流成分と同様に、ブロック単
位でアドレス情報、同期信号、ID番号及びコード長を
付加し、ブロック単位で順序化した後マルチプレクサ20
に出力する。
【0036】マルチプレクサ20は符号化回路17乃至19の
出力及び正規化係数αを時分割多重してエラー訂正符号
付加回路22に出力する。エラー訂正符号付加回路22によ
ってマルチプレクサ20の出力にリードソロモン符号を付
加し、次いで、変調回路23において記録に適合した変調
を行う。更に、変調回路23は変調信号に同期データを付
加しシリアルデータに変換して記録処理回路24に供給す
る。記録処理回路24は変調信号を周波数帯域制限すると
共に増幅し、ヘッド26,27に与えて磁気テープ28に記録
させる。
出力及び正規化係数αを時分割多重してエラー訂正符号
付加回路22に出力する。エラー訂正符号付加回路22によ
ってマルチプレクサ20の出力にリードソロモン符号を付
加し、次いで、変調回路23において記録に適合した変調
を行う。更に、変調回路23は変調信号に同期データを付
加しシリアルデータに変換して記録処理回路24に供給す
る。記録処理回路24は変調信号を周波数帯域制限すると
共に増幅し、ヘッド26,27に与えて磁気テープ28に記録
させる。
【0037】一方、再生系においては、切換回路29を介
してヘッド26,27からの再生信号を再生処理回路30に与
える。再生処理回路30は再生信号を増幅し、帯域制限し
て復調回路31に出力する。復調回路31において記録再生
時に生じた時間軸変動を補正し、同期データを検出して
記録時の変調処理の逆処理によって復調する。この復調
出力をエラー検出訂正回路32に与えて、リードソロモン
符号を用いて誤り訂正を行う。エラー検出訂正回路32は
エラー訂正能力を越えたエラーが発生している場合に
は、エラーフラグを修整演算回路48,49及び変換回路57
に出力する。
してヘッド26,27からの再生信号を再生処理回路30に与
える。再生処理回路30は再生信号を増幅し、帯域制限し
て復調回路31に出力する。復調回路31において記録再生
時に生じた時間軸変動を補正し、同期データを検出して
記録時の変調処理の逆処理によって復調する。この復調
出力をエラー検出訂正回路32に与えて、リードソロモン
符号を用いて誤り訂正を行う。エラー検出訂正回路32は
エラー訂正能力を越えたエラーが発生している場合に
は、エラーフラグを修整演算回路48,49及び変換回路57
に出力する。
【0038】エラー訂正した再生データは、デマルチプ
レクサ33によって、輝度信号の直流成分,交流成分及び
色差信号Cr,Cbの直流成分,交流成分に分離して、
夫々DC成分復号回路34、AC成分復号回路36、DC成
分復号回路35及びAC成分復号回路37に出力する。DC
成分復号回路34は輝度信号の直流成分を復号し、AC成
分復号回路36は交流成分をハフマン復号する。輝度成分
再生回路38は復号回路34,36の出力を周波数信号に戻し
て逆量子化回路40に与える。また、DC成分復号回路35
は色差信号の直流成分を復号し、AC成分復号回路37は
交流成分をハフマン復号する。色差成分再生回路39は復
号回路35,37の出力を周波数信号に戻して逆量子化回路
41に与える。
レクサ33によって、輝度信号の直流成分,交流成分及び
色差信号Cr,Cbの直流成分,交流成分に分離して、
夫々DC成分復号回路34、AC成分復号回路36、DC成
分復号回路35及びAC成分復号回路37に出力する。DC
成分復号回路34は輝度信号の直流成分を復号し、AC成
分復号回路36は交流成分をハフマン復号する。輝度成分
再生回路38は復号回路34,36の出力を周波数信号に戻し
て逆量子化回路40に与える。また、DC成分復号回路35
は色差信号の直流成分を復号し、AC成分復号回路37は
交流成分をハフマン復号する。色差成分再生回路39は復
号回路35,37の出力を周波数信号に戻して逆量子化回路
41に与える。
【0039】一方、デマルチプレクサ33は正規化係数α
を係数発生回路42,43に出力している。係数発生回路4
2,43は正規化係数αによって逆量子化係数を正規化
し、逆量子化回路40,41は夫々係数発生回路42,43から
の逆量子化係数を用いて逆量子化を行って変換係数に戻
し、IDCT回路44,42に出力する。IDCT回路44は
逆DCT処理によって、輝度信号のブロックデータを再
生してフィールドメモリ46及び修整演算回路48に出力す
る。また、IDCT回路45は逆DCT処理によって、色
差信号のブロックデータを再生してフィールドメモリ47
及び修整演算回路49に出力する。フィールドメモリ46,
47は、8×8画素のブロックデータを元の時間順序に配
列させて夫々切換回路50,51に出力する。
を係数発生回路42,43に出力している。係数発生回路4
2,43は正規化係数αによって逆量子化係数を正規化
し、逆量子化回路40,41は夫々係数発生回路42,43から
の逆量子化係数を用いて逆量子化を行って変換係数に戻
し、IDCT回路44,42に出力する。IDCT回路44は
逆DCT処理によって、輝度信号のブロックデータを再
生してフィールドメモリ46及び修整演算回路48に出力す
る。また、IDCT回路45は逆DCT処理によって、色
差信号のブロックデータを再生してフィールドメモリ47
及び修整演算回路49に出力する。フィールドメモリ46,
47は、8×8画素のブロックデータを元の時間順序に配
列させて夫々切換回路50,51に出力する。
【0040】エラー検出訂正回路32によって全ブロック
のエラーが訂正され、エラーフラグが発生しない場合に
は、変換回路57は切換回路50,51に夫々フィールドメモ
リ46,47の出力を選択させる。フィールドメモリ46の出
力は切換回路50を介してD/A変換器52に与えてアナロ
グ信号に変換し、フィールドメモリ47の出力は切換回路
51を介してデマルチプレクサ55に与えて色差信号Cr,
Cbに分離する。色差信号Cr,Cbは夫々D/A変換
器53,54によってディジタル信号に変換する。Y/C混
合回路56はD/A変換器52,53,54の出力を混合して画
像信号を出力端子57に出力する。
のエラーが訂正され、エラーフラグが発生しない場合に
は、変換回路57は切換回路50,51に夫々フィールドメモ
リ46,47の出力を選択させる。フィールドメモリ46の出
力は切換回路50を介してD/A変換器52に与えてアナロ
グ信号に変換し、フィールドメモリ47の出力は切換回路
51を介してデマルチプレクサ55に与えて色差信号Cr,
Cbに分離する。色差信号Cr,Cbは夫々D/A変換
器53,54によってディジタル信号に変換する。Y/C混
合回路56はD/A変換器52,53,54の出力を混合して画
像信号を出力端子57に出力する。
【0041】いま、エラー検出訂正回路32の訂正能力を
越える誤りが発生して、所定ブロックがエラーブロック
となるものとする。IDCT回路44,45の出力は夫々修
整演算回路48,49に与えており、エラーブロック及びそ
の周辺のデータは図2の入力端子58から切換回路59を介
してメモリ60に記憶される。この場合には、アドレス発
生回路61からのアドレスを切換回路62を介してメモリ60
に供給しており、メモリ60は元の時間順序で各ブロック
のデータを記憶する。
越える誤りが発生して、所定ブロックがエラーブロック
となるものとする。IDCT回路44,45の出力は夫々修
整演算回路48,49に与えており、エラーブロック及びそ
の周辺のデータは図2の入力端子58から切換回路59を介
してメモリ60に記憶される。この場合には、アドレス発
生回路61からのアドレスを切換回路62を介してメモリ60
に供給しており、メモリ60は元の時間順序で各ブロック
のデータを記憶する。
【0042】ここで、3ブロック×3ブロックの所定の
9ブロックのデータのうち中央のブロックのみがエラー
ブロックであるものとする。図3はこの場合の修整演算
回路48,49の動作を説明するための説明図であり、図4
はマイコン66の動作を示すフローチャートである。
9ブロックのデータのうち中央のブロックのみがエラー
ブロックであるものとする。図3はこの場合の修整演算
回路48,49の動作を説明するための説明図であり、図4
はマイコン66の動作を示すフローチャートである。
【0043】図3(a)に示す9ブロックのデータのう
ち中央のブロックY[m,n](mはフィールド内の垂
直方向座標、nはフィールド内の水平座標)をエラーブ
ロックとする。なお、図3(b)は図3(a)の太枠で
囲った部分を画素単位で示したものであり、各ブロック
は画素(0,0)乃至(7,7)の64個の画素によっ
て構成している。マイコン66は図4のステップS1 にお
いて、エラーフラグによってエラーブロックが発生した
ことを検出すると、修整演算を開始する。すなわち、マ
イコン66は、ステップS2 において、エラーフラグによ
りエラーが発生したブロックY[m,n]を判定する。
次いで、マイコン66は、ステップS3 において、エラー
ブロックの垂直上方向においてエラーが発生していない
ブロック(以下、誤りなしブロックという)があるか否
かを判断する。誤りなしブロックがある場合には、次の
ステップS4 において最も近接した誤りなしブロックま
でのブロック数γを求める。すなわち、この誤りなしブ
ロックはY[m−γ,n]である。エラーブロックが1
フィールドの最上のブロックラインである場合を含み、
垂直上方向に誤りなしブロックが存在しない場合には、
マイコン66はステップS5 でUフラグを立ててステップ
S6 に移行する。
ち中央のブロックY[m,n](mはフィールド内の垂
直方向座標、nはフィールド内の水平座標)をエラーブ
ロックとする。なお、図3(b)は図3(a)の太枠で
囲った部分を画素単位で示したものであり、各ブロック
は画素(0,0)乃至(7,7)の64個の画素によっ
て構成している。マイコン66は図4のステップS1 にお
いて、エラーフラグによってエラーブロックが発生した
ことを検出すると、修整演算を開始する。すなわち、マ
イコン66は、ステップS2 において、エラーフラグによ
りエラーが発生したブロックY[m,n]を判定する。
次いで、マイコン66は、ステップS3 において、エラー
ブロックの垂直上方向においてエラーが発生していない
ブロック(以下、誤りなしブロックという)があるか否
かを判断する。誤りなしブロックがある場合には、次の
ステップS4 において最も近接した誤りなしブロックま
でのブロック数γを求める。すなわち、この誤りなしブ
ロックはY[m−γ,n]である。エラーブロックが1
フィールドの最上のブロックラインである場合を含み、
垂直上方向に誤りなしブロックが存在しない場合には、
マイコン66はステップS5 でUフラグを立ててステップ
S6 に移行する。
【0044】次いで、マイコン66は、ステップS6 にお
いて、エラーブロックの水平左方向に誤りなしブロック
があるか否かを検出し、ステップS7 で最も近接した誤
りなしブロックまでのブロック数αを求める。この誤り
なしブロックはY[m,n−α]である。誤りなしブロ
ックが存在しない場合には、ステップS8 においてLフ
ラグを発生させてステップS8 に移行する。
いて、エラーブロックの水平左方向に誤りなしブロック
があるか否かを検出し、ステップS7 で最も近接した誤
りなしブロックまでのブロック数αを求める。この誤り
なしブロックはY[m,n−α]である。誤りなしブロ
ックが存在しない場合には、ステップS8 においてLフ
ラグを発生させてステップS8 に移行する。
【0045】同様に、マイコン66は、次のステップS9
,S10において、エラーブロックの垂直下方向に誤り
なしブロックがあるか否かを検出し、最も近接した誤り
なしブロックY[m+δ,n]までのブロック数δを求
める。誤りなしブロックが存在しない場合には、マイコ
ン66はステップS11においてBフラグをオンにする。ま
た、マイコン66は、ステップS12,S13において、エラ
ーブロックの水平右方向に誤りなしブロックがあるか否
かを検出し、最も近接した誤りなしブロックY[m,n
+β]までのブロック数βを求める。この誤りなしブロ
ックが存在しない場合には、ステップS14でRフラグを
発生させる。なお、図3ではα,β,γ,δはいずれも
1であり、U,L,B,Rフラグはいずれもオフであ
る。
,S10において、エラーブロックの垂直下方向に誤り
なしブロックがあるか否かを検出し、最も近接した誤り
なしブロックY[m+δ,n]までのブロック数δを求
める。誤りなしブロックが存在しない場合には、マイコ
ン66はステップS11においてBフラグをオンにする。ま
た、マイコン66は、ステップS12,S13において、エラ
ーブロックの水平右方向に誤りなしブロックがあるか否
かを検出し、最も近接した誤りなしブロックY[m,n
+β]までのブロック数βを求める。この誤りなしブロ
ックが存在しない場合には、ステップS14でRフラグを
発生させる。なお、図3ではα,β,γ,δはいずれも
1であり、U,L,B,Rフラグはいずれもオフであ
る。
【0046】次に、マイコン66はステップS15におい
て、エラーブロック周辺の垂直方向の絵柄の変化を検出
するために、エラーブロックの垂直方向上下に隣接した
行の画素データを読込む。すなわち、マイコン66は、誤
りなしブロックであるブロックY[m−1,n]の最下
行の画素(以下、Y[m−1,n](7,0)乃至Y
[m−1,n](7,7)という)及びブロックY[m
+1,n](0,0)乃至Y[m+1,n](0,7)
のデータが格納されているメモリ60のアドレスを指定す
る。このアドレスは切換回路62を介してメモリ60に与
え、メモリ60から読出したデータは切換回路63を介して
マイコン66に取込む。マイコン66は取込んだ2行の画素
データに対する下記式(1)に示す演算によって、垂直
方向の差分平均値を求める(ステップS16)。
て、エラーブロック周辺の垂直方向の絵柄の変化を検出
するために、エラーブロックの垂直方向上下に隣接した
行の画素データを読込む。すなわち、マイコン66は、誤
りなしブロックであるブロックY[m−1,n]の最下
行の画素(以下、Y[m−1,n](7,0)乃至Y
[m−1,n](7,7)という)及びブロックY[m
+1,n](0,0)乃至Y[m+1,n](0,7)
のデータが格納されているメモリ60のアドレスを指定す
る。このアドレスは切換回路62を介してメモリ60に与
え、メモリ60から読出したデータは切換回路63を介して
マイコン66に取込む。マイコン66は取込んだ2行の画素
データに対する下記式(1)に示す演算によって、垂直
方向の差分平均値を求める(ステップS16)。
【0047】 LAVE(j) ={Y[m+1,n](0,j)−Y[m−1,n](7,j)}/8+1 …(1) 但し、jは0乃至7列を示す。なお、上記式(1)の分
母は、演算に用いる1対の画素データの垂直方向の距離
を示し、(γ+δ−1)×v+1で与えられる(但し、
vは1ブロックの垂直方向の画素数)。
母は、演算に用いる1対の画素データの垂直方向の距離
を示し、(γ+δ−1)×v+1で与えられる(但し、
vは1ブロックの垂直方向の画素数)。
【0048】次に、マイコン66はステップS17におい
て、エラーブロック周辺の水平方向の絵柄の変化を検出
するために、エラーブロックの水平方向左右に隣接した
列の画素データを読込む。すなわち、マイコン66は、画
素Y[m,n−1](0,7)乃至Y[m,n−1]
(7,7)及び画素Y[m,n+1](0,0)乃至Y
[m,n+1](7,0)のデータを取込む。マイコン
66は取込んだ2列のデータに対する下記式(2)に示す
演算によって、水平方向の差分平均値を求める(ステッ
プS18)。
て、エラーブロック周辺の水平方向の絵柄の変化を検出
するために、エラーブロックの水平方向左右に隣接した
列の画素データを読込む。すなわち、マイコン66は、画
素Y[m,n−1](0,7)乃至Y[m,n−1]
(7,7)及び画素Y[m,n+1](0,0)乃至Y
[m,n+1](7,0)のデータを取込む。マイコン
66は取込んだ2列のデータに対する下記式(2)に示す
演算によって、水平方向の差分平均値を求める(ステッ
プS18)。
【0049】 BAVE(i) ={Y[m,n+1](i,0)−Y[m,n−1](i,7)}/8+1 …(2) 但し、iは0乃至7行を示す。また、上記式(2)の分
母は、演算に用いる1対の画素データの水平方向の距離
を示し、(α+β−1)×h+1で与えられる(但し、
hは1ブロックの水平方向の画素数)。
母は、演算に用いる1対の画素データの水平方向の距離
を示し、(α+β−1)×h+1で与えられる(但し、
hは1ブロックの水平方向の画素数)。
【0050】次に、マイコン66は、ステップS19におい
て、エラーブロックY[m,n]の各画素(i,j)の
修整値を演算によって求める。図5はこの演算を説明す
るための説明図である。
て、エラーブロックY[m,n]の各画素(i,j)の
修整値を演算によって求める。図5はこの演算を説明す
るための説明図である。
【0051】図5(a)は垂直方向の差分平均値LAV
E(4)を用いて修整する範囲を斜線によって示してい
る。また、図5(b)は水平方向の差分平均値BAVE
(4)を用いて修整する範囲を斜線によって示してい
る。エラーブロックの画素A(4,4)はブロック[m
−1,n][m+1,n][m,n−1][m,n+
1]の画素B(7,4),C(0,4),D(4,
7),E(4,0)の算術平均によって求める。つま
り、画素(i,j)の修整値は差分平均値LAVE
(j),BAVE(i)を用いた下記式(3)によって
得る。
E(4)を用いて修整する範囲を斜線によって示してい
る。また、図5(b)は水平方向の差分平均値BAVE
(4)を用いて修整する範囲を斜線によって示してい
る。エラーブロックの画素A(4,4)はブロック[m
−1,n][m+1,n][m,n−1][m,n+
1]の画素B(7,4),C(0,4),D(4,
7),E(4,0)の算術平均によって求める。つま
り、画素(i,j)の修整値は差分平均値LAVE
(j),BAVE(i)を用いた下記式(3)によって
得る。
【0052】 Y[m,n](i,j)= [{Y[m−1,n](7,j)+LAVE(j)×(i+1)} +{Y[m,n−1](i,7)+BAVE(i)×(j+1)}]/2 …(3) 次に、マイコン66はステップS20において修整値をメモ
リ60に書込む。この場合、マイコン66は、切換回路62を
介してメモリ60にエラーブロックY[m,n]の各画素
のデータを格納しているアドレスを順次与える。修整値
はマイコン66によって、切換回路59を介してメモリ60の
各アドレスに書込まれる。こうして、メモリ60には、修
整値が元々の画像信号順序に応じた位置に格納される。
誤りなしブロックについては、フィールドメモリ46,47
からのデータを切換回路50,51は選択し、エラーブロッ
クの出力タイミングでは、変換回路57によって、修整演
算回路48,49の出力を切換回路50,51は選択する。
リ60に書込む。この場合、マイコン66は、切換回路62を
介してメモリ60にエラーブロックY[m,n]の各画素
のデータを格納しているアドレスを順次与える。修整値
はマイコン66によって、切換回路59を介してメモリ60の
各アドレスに書込まれる。こうして、メモリ60には、修
整値が元々の画像信号順序に応じた位置に格納される。
誤りなしブロックについては、フィールドメモリ46,47
からのデータを切換回路50,51は選択し、エラーブロッ
クの出力タイミングでは、変換回路57によって、修整演
算回路48,49の出力を切換回路50,51は選択する。
【0053】図6は図10(a)の絵柄について、本実
施例を適用した場合の表示を示す説明図である。なお、
図10(a)は黒の斜線の絵柄であるものとし、図6
(a)はエラーブロック及びその周辺画素の画像データ
値を示し、図6(b)は表示を示している。
施例を適用した場合の表示を示す説明図である。なお、
図10(a)は黒の斜線の絵柄であるものとし、図6
(a)はエラーブロック及びその周辺画素の画像データ
値を示し、図6(b)は表示を示している。
【0054】図6(a)においては、太枠で囲った部分
がエラーブロックを示している。黒部分の画像レベルは
0であるものとし、白部分の画像レベルは90であるも
のとする。図6(a)に示すように、エラーブロックの
垂直上方向のブロックの最下行は左から5画素が黒であ
り、残りの3画素は白である。エラーブロックの垂直下
方向のブロックの最上行は左から3画素が白であり、残
りの5画素は黒である。また、エラーブロックの水平左
方向のブロックの最右行の画素は上から5画素が黒であ
り、残りの3画素が白である。また、エラーブロックの
水平右方向のブロックの最左行の画素は上から3画素が
白であり、残りの5画素が黒である。これらのエラーブ
ロックの周辺の画素を用いて、上記式(3)の演算を行
うと、太枠内の修整値が得られる。図6(a)の修整値
を用いた表示を模式的に示すと図6(b)に示すものと
なる。図6(b)の網線部はレベル0の黒部分を示して
いる。
がエラーブロックを示している。黒部分の画像レベルは
0であるものとし、白部分の画像レベルは90であるも
のとする。図6(a)に示すように、エラーブロックの
垂直上方向のブロックの最下行は左から5画素が黒であ
り、残りの3画素は白である。エラーブロックの垂直下
方向のブロックの最上行は左から3画素が白であり、残
りの5画素は黒である。また、エラーブロックの水平左
方向のブロックの最右行の画素は上から5画素が黒であ
り、残りの3画素が白である。また、エラーブロックの
水平右方向のブロックの最左行の画素は上から3画素が
白であり、残りの5画素が黒である。これらのエラーブ
ロックの周辺の画素を用いて、上記式(3)の演算を行
うと、太枠内の修整値が得られる。図6(a)の修整値
を用いた表示を模式的に示すと図6(b)に示すものと
なる。図6(b)の網線部はレベル0の黒部分を示して
いる。
【0055】図7はステップS5 においてUフラグのみ
がオンとなった場合を説明するための説明図である。
がオンとなった場合を説明するための説明図である。
【0056】図7(a)に示す9ブロックY[0,n−
1]乃至Y[2,n+1]のうちブロックY[0,n]
のみがエラーブロックであるものとする。この場合に
は、垂直上方向には誤りなしブロックが存在しないの
で、マイコン66は、図7(a),(b)の太枠で示すよ
うに、エラーブロックに最も近接した垂直下方向の誤り
なしブロックY[1,n]のデータを垂直方向の修整演
算に用いる。
1]乃至Y[2,n+1]のうちブロックY[0,n]
のみがエラーブロックであるものとする。この場合に
は、垂直上方向には誤りなしブロックが存在しないの
で、マイコン66は、図7(a),(b)の太枠で示すよ
うに、エラーブロックに最も近接した垂直下方向の誤り
なしブロックY[1,n]のデータを垂直方向の修整演
算に用いる。
【0057】この場合には、垂直方向の差分平均値LA
VE(j)は下記式(4)に示すものとなる。
VE(j)は下記式(4)に示すものとなる。
【0058】 LAVE(j) ={Y[1,n](0,j)−Y[1,n](1,j)}/2 …(4) 一方、垂直方向の差分平均値は上記式(2)で与えら
れ、結局エラーブロックY[0,n]の各画素(i,
j)の修整値は下記式(5)で得られる。
れ、結局エラーブロックY[0,n]の各画素(i,
j)の修整値は下記式(5)で得られる。
【0059】 Y[0,n](i,j)= [{Y[1,n](0,j)−LAVE(j)×(8−i)} +{Y[0,n−1](i,7)+BAVE(i)×(j+1)}]/2 …(5) この式(5)の演算によって求めた修整値をメモリ60の
エラーブロックのアドレスに書込むことは図3の場合と
同様であり、以後の動作も同様である。なお、他のL,
B,Rフラグがオンとなっている場合でも、同様の演算
によって修整値を求めればよい。
エラーブロックのアドレスに書込むことは図3の場合と
同様であり、以後の動作も同様である。なお、他のL,
B,Rフラグがオンとなっている場合でも、同様の演算
によって修整値を求めればよい。
【0060】このように、本実施例においては、エラー
ブロック近傍の誤りなしブロックのデータを用い、絵柄
の変化に応じた修整値を画素毎に求めてエラーブロック
の各画素を修整しており、エラーブロックと周辺のブロ
ックとの画素レベルの急峻な変化を抑制することがで
き、再生画質を向上させることができる。
ブロック近傍の誤りなしブロックのデータを用い、絵柄
の変化に応じた修整値を画素毎に求めてエラーブロック
の各画素を修整しており、エラーブロックと周辺のブロ
ックとの画素レベルの急峻な変化を抑制することがで
き、再生画質を向上させることができる。
【0061】なお、本発明は上記実施例に限定されるも
のではなく、例えば、実施例ではVTRに適用した例を
説明したが、有線又は無線伝送に適用してもよく、ブロ
ック符号化された画像信号を受信する装置であれば適用
することができる。また、実施例では、先ず、誤りなし
ブロックのデータを用いて差分の平均値を求め、この平
均値とエラーブロックの各画素の座標とによって修整値
を求めたが、誤りなしブロックの画素を用いた平均値補
間であれば計算順序は問わない。また、演算に用いる誤
りなしブロック及びその行又は列の選択は実施例に限定
されない。更に、実施例ではマイコンによって修整演算
を行っているが、所定の演算回路で行ってもよい。
のではなく、例えば、実施例ではVTRに適用した例を
説明したが、有線又は無線伝送に適用してもよく、ブロ
ック符号化された画像信号を受信する装置であれば適用
することができる。また、実施例では、先ず、誤りなし
ブロックのデータを用いて差分の平均値を求め、この平
均値とエラーブロックの各画素の座標とによって修整値
を求めたが、誤りなしブロックの画素を用いた平均値補
間であれば計算順序は問わない。また、演算に用いる誤
りなしブロック及びその行又は列の選択は実施例に限定
されない。更に、実施例ではマイコンによって修整演算
を行っているが、所定の演算回路で行ってもよい。
【0062】
【発明の効果】以上説明したように本発明によれば、誤
りブロックと周辺ブロックとの境界における画素レベル
の急峻な変化を抑制することにより、誤りを目立たなく
することができるという効果を有する。
りブロックと周辺ブロックとの境界における画素レベル
の急峻な変化を抑制することにより、誤りを目立たなく
することができるという効果を有する。
【図1】本発明に係る誤り修整装置の一実施例を示すブ
ロック図。
ロック図。
【図2】図1中の修整演算回路を示すブロック図。
【図3】実施例の動作を説明するための説明図。
【図4】図2中のマイコン66の動作を示すフローチャー
ト。
ト。
【図5】実施例の動作を説明するための説明図。
【図6】実施例の動作を説明するための説明図。
【図7】実施例の動作を説明するための説明図。
【図8】誤り修整技術を説明するための説明図。
【図9】ブロック符号化を説明するための説明図。
【図10】ブロック単位の補間を説明するための説明
図。
図。
32…エラー検出訂正回路、48,49…修整演算回路、50,
51…切換回路、57…変換回路
51…切換回路、57…変換回路
Claims (1)
- 【請求項1】 複数の画素データによって構成されるブ
ロックデータが順次入力され入力されたブロックデータ
がエラーブロックであるか否かを検出するエラー検出手
段と、 前記エラーブロックを含む複数のブロックのブロックデ
ータを画素位置に対応させて記憶するメモリと、 前記エラー検出手段の出力によって前記メモリから前記
エラーブロックに隣接したブロックの画素データを読出
し読出した画素データと前記エラーブロックの各画素の
位置とを用いた所定の演算によって前記エラーブロック
の各画素データを修整して前記メモリに格納する修整演
算手段とを具備したことを特徴とする誤り修正装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15692492A JPH066753A (ja) | 1992-06-16 | 1992-06-16 | 誤り修整装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP15692492A JPH066753A (ja) | 1992-06-16 | 1992-06-16 | 誤り修整装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH066753A true JPH066753A (ja) | 1994-01-14 |
Family
ID=15638351
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP15692492A Pending JPH066753A (ja) | 1992-06-16 | 1992-06-16 | 誤り修整装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH066753A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2003023625A (ja) * | 2001-07-11 | 2003-01-24 | Hitachi Ltd | 映像符号化信号加工装置 |
KR100413757B1 (ko) * | 2001-01-22 | 2003-12-31 | 삼성전자주식회사 | 블록 경계 위반 검출 방법 및 이에 적합한 장치 |
US8210753B2 (en) | 2007-05-24 | 2012-07-03 | Jtekt Corporation | Cylindrical roller bearing device |
-
1992
- 1992-06-16 JP JP15692492A patent/JPH066753A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100413757B1 (ko) * | 2001-01-22 | 2003-12-31 | 삼성전자주식회사 | 블록 경계 위반 검출 방법 및 이에 적합한 장치 |
JP2003023625A (ja) * | 2001-07-11 | 2003-01-24 | Hitachi Ltd | 映像符号化信号加工装置 |
US8210753B2 (en) | 2007-05-24 | 2012-07-03 | Jtekt Corporation | Cylindrical roller bearing device |
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