JPH06197146A - Control parameter setting system and data link setting system for communication control system - Google Patents
Control parameter setting system and data link setting system for communication control systemInfo
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- JPH06197146A JPH06197146A JP4345895A JP34589592A JPH06197146A JP H06197146 A JPH06197146 A JP H06197146A JP 4345895 A JP4345895 A JP 4345895A JP 34589592 A JP34589592 A JP 34589592A JP H06197146 A JPH06197146 A JP H06197146A
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Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明は、通信制御システムに関
し、特に、HDLC系プロトコルを扱う通信制御システ
ムに好適な制御パラメータの設定方式に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a communication control system, and more particularly to a control parameter setting method suitable for a communication control system handling an HDLC protocol.
【0002】[0002]
【従来の技術】現在、実用化されている狭帯域ISDN
の基本インタフェースにおいて、1加入者線当たりに設
定可能な最大のデータリンク数は「16」である。この
狭帯域ISDNのデータリンクレイヤの処理を実現する
ためのLSIとしては、例えば、電子情報通信学会技術
研究報告SSE89−85、スタディ オブ ハイスペ
ード コントロール オブ データ リンク レイヤ
プロトコル(「Study of High Spee
d Control of Data LinkLay
er Protocol」)に記載のLSIが挙げられ
る。このLSIの場合、1つのLSI当たり設定可能な
最大リンク数は「24」となっている。一方、現在、C
CITT(国際電信電話諮問委員会)では、次世代のI
SDNとして、広帯域ISDNの検討が進められてい
る。広帯域ISDNでは、ユーザに対して、例えば、1
50Mbit/sの回線速度のサービスを提供しようと
するものであり、呼制御用の信号チャネルに必要な回線
速度は、64kbit/s、あるいは1.5Mbit/
s程度であるものと考えられている。なお、信号チャネ
ル処理に関しては、広帯域ISDNであっても、従来の
データリンクレイヤ(レイヤ2)のLSIを流用するこ
とが可能である。2. Description of the Related Art Narrowband ISDN currently in practical use
In the basic interface of, the maximum number of data links that can be set per subscriber line is "16". As an LSI for realizing the processing of the data link layer of this narrow band ISDN, for example, the Institute of Electronics, Information and Communication Engineers Technical Report SSE89-85, Study of High Spade Control of Data Link Layer is used.
Protocol ("Study of High Speed
d Control of Data LinkLay
er Protocol ”). In the case of this LSI, the maximum number of links that can be set per LSI is "24". On the other hand, currently C
The CITT (International Telegraph and Telephone Advisory Committee)
Wideband ISDN is being studied as an SDN. In broadband ISDN, for example, 1
It aims to provide a service with a line speed of 50 Mbit / s, and the line speed required for a signal channel for call control is 64 kbit / s, or 1.5 Mbit / s.
It is considered to be about s. Regarding the signal channel processing, the conventional data link layer (layer 2) LSI can be used even in the wideband ISDN.
【0003】上記広帯域ISDNにおいては、回線上の
全てのデータは、5オクテットのヘッダと48オクテッ
トの情報フィールドとからなる「セル」と呼ばれる固定
長のパケットとして伝送される。このため、上記信号チ
ャネルのデータを送受信する通信制御装置には、固定長
の受信セルを可変長のレイヤ2フレームに変換したり、
これとは逆に、送信すべき可変長のレイヤ2フレームを
複数の固定長セルに変換するための処理を行うアダプテ
ーション処理部を設ける必要がある。In the above-mentioned wideband ISDN, all data on the line are transmitted as fixed length packets called "cells" each consisting of a 5-octet header and a 48-octet information field. Therefore, in the communication control device that transmits and receives the data of the signal channel, a fixed length reception cell is converted into a variable length layer 2 frame,
On the contrary, it is necessary to provide an adaptation processing unit that performs processing for converting a variable-length Layer 2 frame to be transmitted into a plurality of fixed-length cells.
【0004】広帯域ISDN用交換機における上述した
信号用アダプテーション処理部の設置方式の1つとし
て、例えば、電子情報通信学会技術研究報告SSE88
−166に記載の「ATMプロトコル処理方式の検討−
アダプテーションレイヤの検討」の表3、および、電子
情報通信学会技術研究報告SSE89−146に記載の
「ATM Adaptation Layerの検討」
の図4には、回線共通後置方式が示されている。As one of the installation methods of the above-mentioned signal adaptation processing section in the broadband ISDN exchange, for example, the Institute of Electronics, Information and Communication Engineers Technical Research Report SSE88
-166, "Examination of ATM protocol processing method-
Table 3 in "Study of Adaptation Layer" and "Study of ATM Adaptation Layer" described in IEICE Technical Report SSE89-146.
4 shows a post-line common system.
【0005】回線共通後置方式は、1つの信号処理部
で、複数の加入者線からの信号チャネルの処理を集中的
の処理するようにしたものであり、信号処理部に設けら
れた各レイヤ2プロセッサの最大サポートリンク数をで
きるだけ大きくすること、例えば、1000リンク程度
とすることが望まれている。なお、1000リンクサポ
ートのレイヤ2LSIの1例は、電子情報通信学会技術
研究報告SSE91−115の「高スループットデータ
リンク処理方式の提案」に記載されている。The common post-line system is a system in which one signal processing unit intensively processes signal channels from a plurality of subscriber lines, and each layer provided in the signal processing unit. It is desired that the maximum number of support links of the two processors be as large as possible, for example, about 1000 links. An example of a layer 2 LSI with 1000 link support is described in "Proposal of High Throughput Data Link Processing Method" of Technical Report SSE91-115 of IEICE.
【0006】[0006]
【発明が解決しようとする課題】然るに、従来の回線共
通後置方式においては、各レイヤ2LSIの最大サポー
トリンク数を単に増加させた場合、リンク数に比例し
て、上位プロセッサがレイヤ2LSIに対して発行する
コマンドの数も増大してしまうという問題がある。However, in the conventional line common post-installation method, when the maximum support link number of each layer 2 LSI is simply increased, the upper processor is in proportion to the number of links, There is a problem in that the number of commands issued by the system will also increase.
【0007】すなわち、従来は、上位プロセッサからレ
イヤ2LSIに対して、レイヤ2LSIがリンク識別の
ために用いるデータリンクコネクション識別子(DLC
I)を1コマンドで1個ずつ与えていたため、この回線
共通後置方式をそのまま1000リンクサポートのレイ
ヤ2LSIに適用すると、レイヤ2LSIに1000リ
ンク分のDLCIを設定するためには、上位プロセッサ
から全部で1000回のDLCI登録コマンドを発行し
なければならなくなる。That is, conventionally, a data link connection identifier (DLC) used by the layer 2 LSI for link identification is sent from the upper processor to the layer 2 LSI.
Since I) is given one by one with one command, if this line common post-approach is applied to a layer 2 LSI with 1000 link support as it is, in order to set the DLCI for 1000 links in the layer 2 LSI, all from the upper processor Therefore, the DLCI registration command must be issued 1000 times.
【0008】本発明の目的は、上記問題点を解決するた
めになされたものであり、上位プロセッサから通信制御
システム、例えばレイヤ2LSIに対して、上記DLC
Iのような複数の制御パラメータを容易に設定できるよ
うにした制御パラメータ設定方式、およびそれを利用し
たデータリンクの設定方式を提供することにある。The object of the present invention is to solve the above-mentioned problems, and the above-mentioned DLC is provided from a host processor to a communication control system, for example, a layer 2 LSI.
It is to provide a control parameter setting method in which a plurality of control parameters such as I can be easily set, and a data link setting method using the control parameter setting method.
【0009】[0009]
【課題を解決するための手段】上記目的を達成するため
に、本発明による制御パラメータ設定方式では、上位プ
ロセッサから通信制御装置、例えばレイヤ2LSIに設
定すべき複数のパラメータを、レイヤ2LSIと上位プ
ロセッサとの共有のメモリに予め一覧表の形式で格納し
ておき、上位プロセッサからレイヤ2LSIに対してコ
マンドを発行することによって、上記共有メモリ内の複
数のパラメータを一括してレイヤ2LSI設定するよう
にしたことを特徴とする。上記パラメータの一括設定方
式は、DLCI以外のパラメータ、例えばタイマ値や、
最大情報フィールド長など、リンク別の通信パラメータ
の設定にも適用できる。In order to achieve the above object, in the control parameter setting method according to the present invention, a plurality of parameters to be set from the upper processor to the communication control device, for example, the layer 2 LSI, are set to the layer 2 LSI and the upper processor. It is stored in the form of a list in advance in a shared memory with and the command from the upper processor is issued to the layer 2 LSI so that the plurality of parameters in the shared memory are collectively set in the layer 2 LSI. It is characterized by having done. The batch setting method of the above parameters is based on parameters other than DLCI, such as a timer value,
It can also be applied to the setting of communication parameters for each link such as the maximum information field length.
【0010】また、本発明によるデータリンクの設定方
式は、通信制御装置が、制御パラメータを共有メモリか
らDMA転送によって内部メモリに一括して転送し、通
信相手システムからのデータリンクコネクションの設定
要求に対して、該データリンクコネクションを識別する
ためのデータコネクション識別子が上記内部メモリのデ
ータリンクコネクション識別子一覧に登録されているか
否かを判断し、未登録の場合には上記相手システムに該
データリンクコネクションの設定の拒否を通知し、登録
の場合には該データリンクコネクションの設定の確認を
通知するようにしたことを特徴とする。Further, in the data link setting method according to the present invention, the communication control device collectively transfers control parameters from the shared memory to the internal memory by DMA transfer, and requests the data link connection setting from the communication partner system. On the other hand, it is judged whether or not a data connection identifier for identifying the data link connection is registered in the data link connection identifier list of the internal memory. If not registered, the data link connection is made to the partner system. Is rejected and, in the case of registration, confirmation of the setting of the data link connection is notified.
【0011】[0011]
【作用】本発明によれば、上位プロセッサからの1回の
コマンド発行によって、通信制御装置に対して、複数の
制御パラメータを一括して設定できるため、制御パラメ
ータの設定処理が極めて容易になる。According to the present invention, since a plurality of control parameters can be collectively set in the communication control device by issuing a command from the host processor once, the control parameter setting process becomes extremely easy.
【0012】[0012]
【実施例】以下、本発明の一実施例を図面を参照して説
明する。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of the present invention will be described below with reference to the drawings.
【0013】図1は、通信プロトコルに従いフレームの
送受信を行う通信システムの全体構成図を示したもので
あり、100はレイヤ2の信号処理を行なうLSIであ
り、バス400を介して、該レイヤ2LSI100をコ
ントロールする上位プロセッサ300と、該レイヤ2L
SI100と上位プロセッサ300との間のデータの受
け渡しのための共有メモリ200とに接続されている。FIG. 1 is an overall configuration diagram of a communication system for transmitting and receiving frames according to a communication protocol. Reference numeral 100 is an LSI for performing layer 2 signal processing, and the layer 2 LSI 100 is provided via a bus 400. Host processor 300 for controlling the layer and the layer 2L
It is connected to a shared memory 200 for exchanging data between the SI 100 and the upper processor 300.
【0014】上記共有メモリ200には、レイヤ2LS
I100が受信回線190aから受信した受信データを
格納するための受信バッファ(図示せず)と、上位プロ
セッサ300がレイヤ2LSI100に対して送信要求
する送信データを格納するための送信バッファ(図示せ
ず)とを備える。上位プロセッサ300は、必要に応じ
て、後述する上記共有メモリ200に、DLCI登録テ
ーブル210、リンク別パラメータ登録テーブル22
0、あるいは、初期設定テーブル230を生成する。The shared memory 200 has a layer 2 LS.
A reception buffer (not shown) for storing the reception data received by the I100 from the reception line 190a and a transmission buffer (not shown) for storing the transmission data requested by the upper processor 300 to the layer 2 LSI 100. With. The upper processor 300, if necessary, stores the DLCI registration table 210 and the link-specific parameter registration table 22 in the shared memory 200 described later.
0, or the initial setting table 230 is generated.
【0015】上記レイヤ2LSI100は、回線制御部
110と、送/受信データを一時的に格納するためのF
IFO120(受信FIFO120aと送信FIFO1
20b)と、上記共有メモリ200とFIFO120お
よび内部バス180との間でデータの転送を行うための
ダイレクト・メモリ・アクセス・コントローラ(以下、
DMACと称する)130と、レイヤ2LSI100内
のコントロールやプロトコル処理を行うμCPU140
と、上記μCPU140が実行する命令セットを格納す
るためのROM150と、上記μCPU140が命令を
実行するときワークエリアとして使用するためのRAM
160と、上記上位プロセッサ300とレイヤ2LSI
100との間での情報のやりとりを行うためのインタフ
ェース部170と、内部バス180とから構成されてい
る。The layer 2 LSI 100 includes a line controller 110 and an F for temporarily storing transmission / reception data.
IFO 120 (reception FIFO 120a and transmission FIFO 1
20b), and a direct memory access controller (hereinafter, referred to as a “direct memory access controller” for transferring data between the shared memory 200, the FIFO 120 and the internal bus 180).
(Referred to as DMAC) 130 and the μCPU 140 that performs control and protocol processing in the layer 2 LSI 100.
A ROM 150 for storing an instruction set executed by the μCPU 140, and a RAM used as a work area when the μCPU 140 executes an instruction.
160, the upper processor 300, and the layer 2 LSI
It comprises an interface section 170 for exchanging information with 100 and an internal bus 180.
【0016】上記回線制御部110は、回線190(受
信回線190aと送信回線190b)により通信相手と
なる他のシステムと接続され、図2に示すフォーマット
を持つ通信フレーム500の送受信を行う。通信フレー
ム500は、フラグ501、506と、アドレス・フィ
ールド502と、コントロール・フィールド503と、
インフォーメーション・フィールド504と、フレーム
チェックシーケンス・フィールド505とからなる。The line control unit 110 is connected to another system as a communication partner by a line 190 (reception line 190a and transmission line 190b) and transmits / receives a communication frame 500 having the format shown in FIG. The communication frame 500 includes flags 501 and 506, an address field 502, a control field 503,
It consists of an information field 504 and a frame check sequence field 505.
【0017】図3は、CCITT勧告Q.922で規定
された上記アドレス・フィールド502のフォーマット
のうち、アドレスフィールド長2オクテットのデフォル
トアドレス・フォーマットの詳細を示したものである。
図に示すように、アドレスフィールドのうち、DLCI
として使用可能なエリアは、全部で10bitである。
このDLCI値の割当て方は、Q.922勧告において
規定されているが、ユーザー網または網間インタフェー
スにおいて、ネゴシエーションまたは両者の合意により
決定しても良いことになっている。本実施例では、
「0」から「1023」までの全てのDLCI値を使用
可能なものとする。従って、レイヤ2LSI100がサ
ポートする必要のある最大リンク数は「1024」とな
る。FIG. 3 shows CCITT recommendation Q. Of the formats of the address field 502 defined by 922, the details of the default address format with an address field length of 2 octets are shown.
As shown in the figure, DLCI is included in the address field.
The area that can be used as is 10 bits in total.
The method of assigning this DLCI value is as follows. Although it is defined in the Recommendation 922, it may be decided by negotiation or agreement between the two in the user network or the inter-network interface. In this embodiment,
All DLCI values from “0” to “1023” can be used. Therefore, the maximum number of links that the layer 2 LSI 100 needs to support is “1024”.
【0018】図4は、上記レイヤ2LSI100が、1
024個のリンクをサポートするものとした場合に使用
されるDLCI登録テーブル210の構成の一例を示
す。DLCI登録テーブル210は、全体で128by
teの大きさを持ち、「0」から「1023」までの各
DLCIに対して、アドレス順に従った記憶位置をそれ
ぞれ1bitずつ割り当てる。記憶されたbitの値が
「1」であれば、そのbitと対応するDLCIを登録
すべきことを意味し、値が「0」であれば、そのDLC
Iは登録不要である。FIG. 4 shows that the layer 2 LSI 100 is
An example of the structure of the DLCI registration table 210 used when supporting 024 links is shown. The DLCI registration table 210 is 128 by in total.
A storage position having a size of te and 1 bit is assigned to each DLCI from “0” to “1023” according to the address order. If the value of the stored bit is "1", it means that the DLCI corresponding to the bit should be registered, and if the value is "0", the DLC is registered.
I does not need to be registered.
【0019】以上の構成に基づいて、本発明によるDL
CI一括登録方式の第1の実施例について説明する。Based on the above configuration, the DL according to the present invention
A first embodiment of the CI batch registration method will be described.
【0020】上位プロセッサ300は、共有メモリ20
0内に、図4に示したDLCI登録テーブル210を生
成した後、バス400を介して、レイヤ2LSI100
にDLCI登録コマンドを発行する。この場合、共有メ
モリ200上での上記DLCI登録テーブル210のア
ドレスは、各DLCI登録コマンドのパラメータとして
与えてもよいし、予めレイヤ2LSI100に対して通
知しておいてもよい。The upper processor 300 has a shared memory 20.
4, the DLCI registration table 210 shown in FIG. 4 is generated, and then the layer 2 LSI 100 is transmitted via the bus 400.
Issue a DLCI registration command to. In this case, the address of the DLCI registration table 210 on the shared memory 200 may be given as a parameter of each DLCI registration command, or may be notified to the layer 2 LSI 100 in advance.
【0021】バス400に出力されたDLCI登録コマ
ンドは、インタフェース部170と内部バス180を介
して、μCPU140に通知される。DLCI登録コマ
ンドを受け取ったμCPU140は、DMAC130を
起動して、DLCI登録テーブル210の内容を、共有
メモリ200からLSI内部のRAM160に転送させ
る。ただし、上記共有メモリ200からのDLCI登録
テーブル210の読み出しは、DLCI登録コマンドの
受信時点ではそのままにしておき、DLCI登録コマン
ドが発行されたことをμCPU140で記憶しておい
て、その後、必要に応じて共有メモリ200へアクセス
しに行くようにしてもよい。The DLCI registration command output to the bus 400 is notified to the μCPU 140 via the interface section 170 and the internal bus 180. Upon receiving the DLCI registration command, the μCPU 140 activates the DMAC 130 to transfer the contents of the DLCI registration table 210 from the shared memory 200 to the RAM 160 inside the LSI. However, the reading of the DLCI registration table 210 from the shared memory 200 is left as it is at the time of receiving the DLCI registration command, and the μCPU 140 stores that the DLCI registration command has been issued, and then, if necessary. Alternatively, the shared memory 200 may be accessed.
【0022】レイヤ2LSI100は、内部RAM16
0に取り込まれたDLCI登録テーブル(または、共有
メモリ200上のDLCI登録テーブル)210の内容
に基づいて、通信制御処理を実行する。例えば、相手通
信システムからリンク設定要求のフレームを受信した場
合、受信フレームのアドレスフィールド502に設定さ
れたDLCIが既に「登録」済みのDLCIであれば、
上記リンク設定要求を受け入れる、逆に「未登録」のD
LCIであれば、上記リンク設定要求を拒否する。The layer 2 LSI 100 has an internal RAM 16
The communication control process is executed based on the contents of the DLCI registration table (or the DLCI registration table on the shared memory 200) 210 that has been loaded into 0. For example, when the frame of the link setting request is received from the partner communication system, if the DLCI set in the address field 502 of the received frame is the DLCI that has already been “registered”,
Accept the above link setting request, conversely "unregistered" D
If it is LCI, the link setting request is rejected.
【0023】次に、本発明の第2の実施例としてリンク
別パラメータの一括登録方式について説明する。Next, as a second embodiment of the present invention, a system for collectively registering link-specific parameters will be described.
【0024】図5は、リンク別パラメータ登録テーブル
220の構成の一例を示す。上記テーブル220は、図
4に示したDLCI登録テーブル210のように「0」
から「1023」までの全てのDLCIについてのパラ
メータを登録するのではなく、必要なDLCIについて
のみパラメータを登録するものである。すなわち、リン
ク別パラメータ登録テーブル220は、それぞれが16
byte長の複数のブロック220−1〜220−nか
らなり、各ブロック毎に、パラメータ設定の対象となる
DLCI、T200タイマ、T203タイマ、N200
(最大再送回数)、N201(情報フィールドの最大オ
クテット長)、および、K(最大アウトスタンディング
Iフレーム数)の値がそれぞれ設定される。FIG. 5 shows an example of the structure of the link-specific parameter registration table 220. The table 220 is “0” like the DLCI registration table 210 shown in FIG.
The parameters are not registered for all DLCIs from 1 to "1023", but the parameters are registered only for necessary DLCIs. That is, each of the link-specific parameter registration tables 220 has 16
It is composed of a plurality of blocks 220-1 to 220-n each having a byte length, and a DLCI, a T200 timer, a T203 timer, and an N200 which are parameters to be set for each block.
The values of (maximum number of retransmissions), N201 (maximum octet length of information field), and K (maximum number of outstanding I frames) are set.
【0025】上記テーブル220は可変長であり、パラ
メータ指定するリンクの数nによって、テーブル長さが
決定される。図5に示した実施例では、最終ブロックの
先頭2byteに値「FFFFH(16進表示)」を設
定することによって、テーブルの終わりを示すようにし
ている。なお、図中、括弧内の数字は、各フィールドの
バイト数を示す。The table 220 has a variable length, and the table length is determined by the number n of links designated by parameters. In the embodiment shown in FIG. 5, the end of the table is indicated by setting the value "FFFFH (hexadecimal notation)" in the first 2 bytes of the last block. In the figure, the number in parentheses indicates the number of bytes in each field.
【0026】上記リンク別パラメータ登録テーブル22
0を用いたパラメータの一括登録の手順は、上述したD
LCI一括登録の場合と同様、上位プロセッサ300
が、共有メモリ200上にリンク別パラメータ登録テー
ブル220を生成した後、レイヤ2LSI100に対し
てコマンドを発行することにより行う。The link-specific parameter registration table 22
The procedure for batch registration of parameters using 0 is the above-mentioned D
Similar to the case of LCI batch registration, the upper processor 300
After generating the link-specific parameter registration table 220 on the shared memory 200, the command is issued to the layer 2 LSI 100.
【0027】次に、本発明の第3の実施例を図6を参照
して説明する。この実施例は、第1の実施例で説明した
DLCI一括登録と、第2の実施例で説明したリンク別
パラメータ一括登録を、レイヤ2LSIの初期設定時に
行なうものである。Next, a third embodiment of the present invention will be described with reference to FIG. In this embodiment, the DLCI batch registration described in the first embodiment and the link-specific parameter batch registration described in the second embodiment are performed at the time of initial setting of the layer 2 LSI.
【0028】図6は、初期設定テーブル230の構成の
一例を示す。このテーブル230は、LSIの動作モー
ド、T200タイマのデフォルト値であるT200D、
T203タイマのデフォルト値であるT203D、N2
00(最大再送回数)のデフォルト値であるN200
D、N201(情報フィールドの最大オクテット長)の
デフォルト値であるN201D、K(最大アウトスタン
ディングIフレーム数)のデフォルト値であるKD、D
LCI登録テーブル210の先頭アドレス、および、リ
ンク別パラメータ登録テーブル220の先頭アドレスか
ら構成される。FIG. 6 shows an example of the structure of the initial setting table 230. This table 230 shows the operation mode of the LSI, T200D which is the default value of the T200 timer,
T203D, N2 which is the default value of T203 timer
N200, which is the default value of 00 (maximum number of retransmissions)
D, N201 (maximum octet length of information field) which is the default value N201D, K (maximum outstanding I frame number) which is the default value KD, D
It is composed of the start address of the LCI registration table 210 and the start address of the link-specific parameter registration table 220.
【0029】LSIの動作モードは、例えば、端末モー
ドか網モードかの指定、T203タイマを使用するか否
かの指定、あるいはフレーム間タイムフィルをフラグに
するか連続「1」にするかの指定等の、各種の動作モー
ドを指定するビットの集合からなる。T200D、T2
03D、N200D、N201D、およびKDは、リン
ク別パラメータ登録テーブル220でリンク別に通信パ
ラメータを登録していないリンクに対する通信パラメー
タとして利用する。The operation mode of the LSI is, for example, designation of a terminal mode or a network mode, designation of whether to use a T203 timer, or designation of an interframe time fill as a flag or continuous "1". Etc. consists of a set of bits that specify various operation modes. T200D, T2
03D, N200D, N201D, and KD are used as communication parameters for links for which communication parameters have not been registered for each link in the link-specific parameter registration table 220.
【0030】次に、上記初期設定テーブル230のよる
パラメータ設定手順について、図1を参照して説明す
る。上位プロセッサ300は、共用メモリ200上に、
図6に示した初期設定テーブル230と、図4に示した
DLCI登録テーブル210と、図5に示したリンク別
パラメータ登録テーブル220を生成した後、バス10
を介して、レイヤ2LSI100に初期設定コマンドを
発行する。この場合、共有メモリ上での上記初期設定テ
ーブル230のアドレスは、初期設定コマンドのパラメ
ータとして与えてもよいし、予め固定アドレスとしてレ
イヤ2LSI100に記憶させておいても良い。Next, a parameter setting procedure according to the initial setting table 230 will be described with reference to FIG. The upper processor 300, on the shared memory 200,
After generating the initialization table 230 shown in FIG. 6, the DLCI registration table 210 shown in FIG. 4, and the per-link parameter registration table 220 shown in FIG.
An initial setting command is issued to the layer 2 LSI 100 via. In this case, the address of the initial setting table 230 on the shared memory may be given as a parameter of the initial setting command, or may be stored in the layer 2 LSI 100 as a fixed address in advance.
【0031】上記初期設定コマンドは、インタフェース
部170と内部バス180を介して、μCPU140に
通知される。μCPU140は、初期設定コマンドに応
答して、回線制御部110、受信FIFO120a、送
信FIFO120b、DMAC130、RAM160、
およびインタフェース部170の状態を、それぞれ内部
バス180を介して初期設定した後、DMAC130を
起動して、初期設定テーブル230の内容を、共有メモ
リ200からLSIの内部RAM160へ転送させる。
次に、μCPU140は、上記初期設定テーブル230
で指定されたDLCI登録テーブルの先頭アドレスと、
リンク別パラメータ登録テーブルの先頭アドレスに基づ
いてDMAC130を起動し、これらのテーブルの内容
を共有メモリ200からLSIの内部RAM160へ転
送させる。以上の動作により、レイヤ2LSI100の
初期設定動作が終了し、通信制御処理動作が開始され
る。なお、DLCI登録テーブル210とリンク別パラ
メータ登録テーブル220は、初期設定動作時にはLS
I内部RAMへ転送せずにおき、それらの先頭アドレス
のみを記憶しておいて、必要時に共有メモリ200をア
クセスするようにしても良い。また、上記実施例では、
DLCI登録テーブル210とリンク別パラメータ登録
テーブル220の先頭アドレスを、初期設定テーブル2
30によってレイヤ2LSIに通知したが、これらのテ
ーブルの先頭アドレスを固定のアドレスとし、予めレイ
ヤ2LSIに記憶させるようにしても良い。また、DL
CI登録テーブルとリンク別パラメータ登録テーブルの
内容を、初期設定テーブル230と一体化し、複数のテ
ーブル内容を1回のDMA操作で内部メモリに転送する
ようにしても良い。The above initialization command is notified to the μCPU 140 via the interface section 170 and the internal bus 180. The μCPU 140 responds to the initialization command by the line control unit 110, the reception FIFO 120a, the transmission FIFO 120b, the DMAC 130, the RAM 160,
After initializing the states of the interface section 170 and the interface section 170 via the internal bus 180, the DMAC 130 is activated to transfer the contents of the initialization table 230 from the shared memory 200 to the internal RAM 160 of the LSI.
Next, the μCPU 140 sets the initial setting table 230.
The start address of the DLCI registration table specified by
The DMAC 130 is activated based on the start address of the parameter registration table for each link, and the contents of these tables are transferred from the shared memory 200 to the internal RAM 160 of the LSI. By the above operation, the initial setting operation of the layer 2 LSI 100 is completed and the communication control processing operation is started. It should be noted that the DLCI registration table 210 and the per-link parameter registration table 220 are stored in the LS during the initial setting operation.
Instead of transferring to the I internal RAM, only the leading addresses of them may be stored and the shared memory 200 may be accessed when necessary. Further, in the above embodiment,
The initial addresses of the DLCI registration table 210 and the link-specific parameter registration table 220 are set to the initial setting table 2.
Although the layer 2 LSI is notified by 30, the head addresses of these tables may be fixed addresses and may be stored in the layer 2 LSI in advance. Also, DL
The contents of the CI registration table and the parameter registration table for each link may be integrated with the initial setting table 230, and the contents of a plurality of tables may be transferred to the internal memory by one DMA operation.
【0032】[0032]
【発明の効果】以上の説明から明らかな如く、本発明に
よれば、上位プロセッサが、通信に使用する複数のパラ
メータを通信制御装置(例えば、レイヤ2LSI)に設
定する場合に、これらのパラメータを一旦共有メモリ上
に一覧表の形式で書き込んだ後、通信制御装置に対して
コマンドを発行するようにしているため、設定すべき制
御パラメータの数が増加した場合でも、パラメータの設
定処理を迅速に完了できるという効果がある。As is apparent from the above description, according to the present invention, when a host processor sets a plurality of parameters used for communication in a communication control device (for example, layer 2 LSI), these parameters are set. Even if the number of control parameters to be set increases, the parameter setting process can be performed quickly because the command is issued to the communication control device after the list is written in the shared memory. The effect is that it can be completed.
【図1】本発明を適用する通信制御システムの全体構成
の1例を示す図。FIG. 1 is a diagram showing an example of the overall configuration of a communication control system to which the present invention is applied.
【図2】通信フレームのフォーマットを示す図。FIG. 2 is a diagram showing a format of a communication frame.
【図3】Q.922勧告におけるアドレスフィールドの
フォーマットを示す図。FIG. 3 Q. The figure which shows the format of the address field in 922 recommendation.
【図4】制御パラメータの1例であるDLCIの登録テ
ーブルを示す図。FIG. 4 is a diagram showing a DLCI registration table which is an example of control parameters.
【図5】制御パラメータの1例であるリンク別パラメー
タの登録テーブルを示す図。FIG. 5 is a diagram showing a registration table of link-specific parameters, which is an example of control parameters.
【図6】制御パラメータの1例である初期設定のテーブ
ルを示す図。FIG. 6 is a diagram showing an initial setting table which is an example of control parameters.
100…レイヤ2LSI、200…共有メモリ、210
…DLCI登録テーブル、220…リンク別パラメータ
登録テーブル、230…初期設定テーブル、300…上
位プロセッサ。100 ... Layer 2 LSI, 200 ... Shared memory, 210
... DLCI registration table, 220 ... Link parameter registration table, 230 ... Initial setting table, 300 ... Upper processor.
フロントページの続き (72)発明者 清水 聡 神奈川県横浜市戸塚区戸塚町216番地 株 式会社日立製作所情報通信事業部内 (72)発明者 吉成 偉久 神奈川県横浜市戸塚区戸塚町216番地 株 式会社日立製作所情報通信事業部内 (72)発明者 赤池 武志 東京都千代田区内幸町一丁目1番6号 日 本電信電話株式会社内Front page continuation (72) Inventor Satoshi Shimizu 216 Totsuka-cho, Totsuka-ku, Yokohama-shi, Kanagawa Ltd. Information & Communications Division, Hitachi, Ltd. Hitachi, Ltd. Information & Communication Division (72) Inventor Takeshi Akaike 1-1-6 Uchisaiwaicho, Chiyoda-ku, Tokyo Nihon Telegraph and Telephone Corporation
Claims (4)
た通信制御装置と、上記通信制御装置をコントロールす
るための上位プロセッサと、上記通信制御装置と上位プ
ロセッサとが共有する記憶装置とを有する通信システム
において、 上記上位プロセッサが、通信に使用する複数の制御パラ
メータの一覧を上記共有記憶装置上に格納した後、上記
通信制御装置に対して指示を与え、 上記通信制御装置が、上記共有記憶装置内の制御パラメ
ータをDMA転送によって内部メモリに一括して転送す
ることを特徴とする通信制御システムにおける通信制御
パラメータ設定方式。1. A communication control device connected to a partner system via a communication line, a host processor for controlling the communication control device, and a storage device shared by the communication control device and the host processor. In the communication system, the upper processor stores a list of a plurality of control parameters used for communication in the shared storage device, and thereafter gives an instruction to the communication control device, and the communication control device stores the shared storage device. A communication control parameter setting method in a communication control system, wherein control parameters in the device are collectively transferred to an internal memory by DMA transfer.
装置に格納される制御パラメータが、データリンクコネ
クション識別子(DLCI)であることを特徴とする請
求項1に記載の通信制御システムにおける通信制御パラ
メータ設定方式。2. The communication control parameter setting method in the communication control system according to claim 1, wherein the control parameter stored in the shared storage device by the upper processor is a data link connection identifier (DLCI). .
装置に格納される制御パラメータが、通信制御に用いら
れるリンク別の制御パラメータであることを特徴とする
請求項1に記載の通信制御システムにおける通信制御パ
ラメータ設定方式。3. The communication control in the communication control system according to claim 1, wherein the control parameter stored in the shared storage device by the host processor is a control parameter for each link used for communication control. Parameter setting method.
た通信制御装置と、上記通信制御装置をコントロールす
るための上位プロセッサと、上記通信制御装置と上位プ
ロセッサとが共有する記憶装置とを有する通信システム
において、 上記上位プロセッサが、通信に使用するデータリンクコ
ネクション識別子(DLCI)の一覧を上記共有記憶装
置上に格納した後、上記通信制御装置に対して指示を与
え、 上記通信制御装置が、上記共有記憶装置内の制御パラメ
ータをDMA転送によって内部メモリに一括して転送
し、相手システムからのデータリンクコネクションの設
定要求に対して、該データリンクコネクションを識別す
るためのデータコネクション識別子が内部メモリのデー
タリンクコネクション識別子一覧に登録されているか否
かを判断し、未登録の場合には上記相手システムに該デ
ータリンクコネクションの設定の拒否を通知し、登録の
場合には該データリンクコネクションの設定の確認を通
知することを特徴とした通信制御システムにおけるデー
タリンクの設定方式。4. A communication control device connected to a partner system via a communication line, a host processor for controlling the communication control device, and a storage device shared by the communication control device and the host processor. In the communication system, the upper processor stores a list of data link connection identifiers (DLCI) used for communication in the shared storage device, then gives an instruction to the communication control device, and the communication control device, The control parameters in the shared storage device are collectively transferred to the internal memory by DMA transfer, and in response to the data link connection setting request from the partner system, the data connection identifier for identifying the data link connection is the internal memory. Whether it is registered in the data link connection identifier list of In the communication control system, the judgment is made, and if it is not registered, the other system is notified of refusal of the setting of the data link connection, and if it is registered, the confirmation of the setting of the data link connection is notified. Data link setting method.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4345895A JPH06197146A (en) | 1992-12-25 | 1992-12-25 | Control parameter setting system and data link setting system for communication control system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4345895A JPH06197146A (en) | 1992-12-25 | 1992-12-25 | Control parameter setting system and data link setting system for communication control system |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH06197146A true JPH06197146A (en) | 1994-07-15 |
Family
ID=18379724
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4345895A Pending JPH06197146A (en) | 1992-12-25 | 1992-12-25 | Control parameter setting system and data link setting system for communication control system |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH06197146A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7006442B1 (en) | 1999-11-25 | 2006-02-28 | Nec Corporation | Communication control system and control method thereof |
US7362863B2 (en) | 2000-05-01 | 2008-04-22 | International Business Machines Corporation | DES hardware throughput for short operations |
-
1992
- 1992-12-25 JP JP4345895A patent/JPH06197146A/en active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7006442B1 (en) | 1999-11-25 | 2006-02-28 | Nec Corporation | Communication control system and control method thereof |
US7362863B2 (en) | 2000-05-01 | 2008-04-22 | International Business Machines Corporation | DES hardware throughput for short operations |
US7831040B2 (en) | 2000-05-01 | 2010-11-09 | International Business Machines Corporation | DES hardware throughput for short operations |
US8374343B2 (en) | 2000-05-01 | 2013-02-12 | International Business Machines Corporation | DES hardware throughput for short operations |
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