JPH02231627A - 画像表示装置 - Google Patents
画像表示装置Info
- Publication number
- JPH02231627A JPH02231627A JP5241889A JP5241889A JPH02231627A JP H02231627 A JPH02231627 A JP H02231627A JP 5241889 A JP5241889 A JP 5241889A JP 5241889 A JP5241889 A JP 5241889A JP H02231627 A JPH02231627 A JP H02231627A
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- Japan
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- memory
- image
- coordinate
- frame memory
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- Prior art date
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- 238000006243 chemical reaction Methods 0.000 description 4
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は画像表示装置に関し、特に画像の倍率と位置と
を変更して表示する画像表示装置に関する. 〔従来の技術〕 従来から原画像情報の倍率及び位置を変えて表示する画
像表示装置は知られているが、これらは倍率変換の制御
を専らハードワイヤードロジツクにより行っていた. 〔発明が解決しようとする課題〕 上述した従来の画像表示装置は、倍率変換の制御をハー
ドワイヤードロジックで行っているので、任意の倍率に
対応しようとすると制御回路が複雑かつ大規模化すると
いう欠点がある.〔課題を解決するための手段〕 本発明の画像表示装置は、原画像データを格納する画像
メモリと、被表示データを格納するフレームメモリと、
前記画像メモリからフレームメモリへのデータ転送を制
御するデータ転送制御回路と、前記データ転送制御回路
から与えられるフレームメモリ上の書込みアドレスを表
示倍率情報を元に前記画像メモリ上の相対読出しアドレ
スに変換するルックアップテーブルと、前記相対読出し
アドレスに表示開始位置情報を加算し前記画像メモリ上
の絶対読出しアドレスを作成する加算回路とを備えて構
成される. 〔実施例〕 次に、本発明について図面を参照して説明する. 第1図は本発明の一実施例の構成を示すブロック図であ
る. データ転送制御回路2は、原画像データを格納する画像
メモリ14から表示画像データを格納するフレームメモ
リ14へのデータ転送を制御する回路で、フレームメモ
リ16に対しX方向書込みアドレス3とY方向書込みア
ドレス4とを指定する.これらの書込みアドレス3・4
は、それぞれX座標ルックアップテーブル5及びY座標
ルックアップテーブル6にも与えられている.X座標ル
ックアップテーブル5及びY座標ルックアップテーブル
6は、予め書込まれているルックアップテーブルデータ
に基づき、フレームメモ刃16の書込みアドレス3・4
及び倍率情報から、画像メモリ14のX方向読出しアド
レス12及びY方向読出しアドレス13に変換する.こ
れらの読出しアドレス12・13の指定によって画像メ
モリ14から読出された画像データ15は、フレームメ
モリ16のX方向書込みアドレス3とY方向書込みアド
レス4とに対応した記憶領域に書込まれる.フレームメ
モリ16に書込まれたデータは、表示データ17として
ビデオ信号出力回路l8に入力され、ビデオ信号出力回
路l8でビデオ信号1つに変換されて出力される. 以上の構成において、いま、画像メモリ14に格納され
た原画像データが第4図(a)に示すように12X12
の画素で構成された場合について説明する.各画素に付
された数字は、原画像データの画素番号である.この原
画像に対し、表示倍率情報として拡大率A.,AYが、
AX=1.5.Ay ”1.5,表示位置情報として表
示開始位置の座標がXo,Yoであるとすると、Xo
=3,Yo =1が指定された場合、図中斜線で囲まれ
た8×8の画素の原画像データが例えば第4図(b)に
示すように適宜内挿補間され、1.5倍に拡大されてフ
レームメモリ16に格納される必要がある. このため、ルックアップテーブル5・6には倍率情報A
X−AY及びフレームメモリ16の書込みアドレスF
W A x−F W A Yを入力すると相対読出しア
ドレス■RRAx−IRRAYを、下記(1).(2)
式と等価な変換により出力するデータを書込んでおく. I RRAx = i n t ( FWAx /Ax
) −(1)I RRAY = i n t ( F
WAY /AY ) −(2)但し、int{X}はX
を四捨五入した整数を表わす. 第2図及び第3図にAx −Ay =1、5の場合のX
座標およびY座標のルックアップテーブル書込み内容を
示す. これにより、データ転送制御回路2が、フレームメモリ
16の書込みアドレス3.4を指定すると、第2図及び
第3図のX座標ルックアップテーブル5及びY座標ルッ
クアップテーブル6により相対読出しアドレスに変換さ
れ、次いでX座標加算器10及びY座標加算器11にて
、次の(3),(4)式によりY座標メモリ14の絶対
読出しアドレスI RAAx ,I RAAyを求めら
れる. I RAAx = I RRAx +Xo ・” (
3 )I RAAY = I RRAY +YO −
(4 )以上により、第4図(b)の拡大画像が、フレ
ームメモリ16に生成される. 以上のようにして得られたビデオ信号19を、CRT表
示器などで表示すればよい. 〔発明の効果〕 以上説明したように本発明は、原画像データを格納した
画像メモリから表示用のフレームメモリへのデータ転送
時に、画像メモリの読出しアドレスをルックアップテー
ブル及び加算器により変換して読出すようにしたので、
制御回路が単純で小規模なもので済み、しかも任意の倍
率及び位置での表示について容易に対応することができ
るという効果がある。
を変更して表示する画像表示装置に関する. 〔従来の技術〕 従来から原画像情報の倍率及び位置を変えて表示する画
像表示装置は知られているが、これらは倍率変換の制御
を専らハードワイヤードロジツクにより行っていた. 〔発明が解決しようとする課題〕 上述した従来の画像表示装置は、倍率変換の制御をハー
ドワイヤードロジックで行っているので、任意の倍率に
対応しようとすると制御回路が複雑かつ大規模化すると
いう欠点がある.〔課題を解決するための手段〕 本発明の画像表示装置は、原画像データを格納する画像
メモリと、被表示データを格納するフレームメモリと、
前記画像メモリからフレームメモリへのデータ転送を制
御するデータ転送制御回路と、前記データ転送制御回路
から与えられるフレームメモリ上の書込みアドレスを表
示倍率情報を元に前記画像メモリ上の相対読出しアドレ
スに変換するルックアップテーブルと、前記相対読出し
アドレスに表示開始位置情報を加算し前記画像メモリ上
の絶対読出しアドレスを作成する加算回路とを備えて構
成される. 〔実施例〕 次に、本発明について図面を参照して説明する. 第1図は本発明の一実施例の構成を示すブロック図であ
る. データ転送制御回路2は、原画像データを格納する画像
メモリ14から表示画像データを格納するフレームメモ
リ14へのデータ転送を制御する回路で、フレームメモ
リ16に対しX方向書込みアドレス3とY方向書込みア
ドレス4とを指定する.これらの書込みアドレス3・4
は、それぞれX座標ルックアップテーブル5及びY座標
ルックアップテーブル6にも与えられている.X座標ル
ックアップテーブル5及びY座標ルックアップテーブル
6は、予め書込まれているルックアップテーブルデータ
に基づき、フレームメモ刃16の書込みアドレス3・4
及び倍率情報から、画像メモリ14のX方向読出しアド
レス12及びY方向読出しアドレス13に変換する.こ
れらの読出しアドレス12・13の指定によって画像メ
モリ14から読出された画像データ15は、フレームメ
モリ16のX方向書込みアドレス3とY方向書込みアド
レス4とに対応した記憶領域に書込まれる.フレームメ
モリ16に書込まれたデータは、表示データ17として
ビデオ信号出力回路l8に入力され、ビデオ信号出力回
路l8でビデオ信号1つに変換されて出力される. 以上の構成において、いま、画像メモリ14に格納され
た原画像データが第4図(a)に示すように12X12
の画素で構成された場合について説明する.各画素に付
された数字は、原画像データの画素番号である.この原
画像に対し、表示倍率情報として拡大率A.,AYが、
AX=1.5.Ay ”1.5,表示位置情報として表
示開始位置の座標がXo,Yoであるとすると、Xo
=3,Yo =1が指定された場合、図中斜線で囲まれ
た8×8の画素の原画像データが例えば第4図(b)に
示すように適宜内挿補間され、1.5倍に拡大されてフ
レームメモリ16に格納される必要がある. このため、ルックアップテーブル5・6には倍率情報A
X−AY及びフレームメモリ16の書込みアドレスF
W A x−F W A Yを入力すると相対読出しア
ドレス■RRAx−IRRAYを、下記(1).(2)
式と等価な変換により出力するデータを書込んでおく. I RRAx = i n t ( FWAx /Ax
) −(1)I RRAY = i n t ( F
WAY /AY ) −(2)但し、int{X}はX
を四捨五入した整数を表わす. 第2図及び第3図にAx −Ay =1、5の場合のX
座標およびY座標のルックアップテーブル書込み内容を
示す. これにより、データ転送制御回路2が、フレームメモリ
16の書込みアドレス3.4を指定すると、第2図及び
第3図のX座標ルックアップテーブル5及びY座標ルッ
クアップテーブル6により相対読出しアドレスに変換さ
れ、次いでX座標加算器10及びY座標加算器11にて
、次の(3),(4)式によりY座標メモリ14の絶対
読出しアドレスI RAAx ,I RAAyを求めら
れる. I RAAx = I RRAx +Xo ・” (
3 )I RAAY = I RRAY +YO −
(4 )以上により、第4図(b)の拡大画像が、フレ
ームメモリ16に生成される. 以上のようにして得られたビデオ信号19を、CRT表
示器などで表示すればよい. 〔発明の効果〕 以上説明したように本発明は、原画像データを格納した
画像メモリから表示用のフレームメモリへのデータ転送
時に、画像メモリの読出しアドレスをルックアップテー
ブル及び加算器により変換して読出すようにしたので、
制御回路が単純で小規模なもので済み、しかも任意の倍
率及び位置での表示について容易に対応することができ
るという効果がある。
第1図は本発明の一実施例の構成を示すブロック図、第
2図はX座標ルックアップテーブルの内容を示す説明図
、第3図はY座標ルックアップテーブルの内容を示す説
明図、第4図(a)および(b)は原画像と表示データ
との変換例を示す説明図である。 1・・・倍率情報、2・・・データ転送制御回路、5・
・・X座標ルックアップテーブル、6・・・Y座標ルッ
クアップテーブル、9・・・読出開始位置情報、10・
・・X座標加算器、11・・・Y座標加算器、14・・
・画像メモリ、16・・・フレームメモリ、18・・・
ビデオ信号出力回路、19・・・ビデオ信号。
2図はX座標ルックアップテーブルの内容を示す説明図
、第3図はY座標ルックアップテーブルの内容を示す説
明図、第4図(a)および(b)は原画像と表示データ
との変換例を示す説明図である。 1・・・倍率情報、2・・・データ転送制御回路、5・
・・X座標ルックアップテーブル、6・・・Y座標ルッ
クアップテーブル、9・・・読出開始位置情報、10・
・・X座標加算器、11・・・Y座標加算器、14・・
・画像メモリ、16・・・フレームメモリ、18・・・
ビデオ信号出力回路、19・・・ビデオ信号。
Claims (1)
- 原画像データを格納する画像メモリと、被表示データを
格納するフレームメモリと、前記画像メモリからフレー
ムメモリへのデータ転送を制御するデータ転送制御回路
と、前記データ転送制御回路から与えられるフレームメ
モリ上の書込みアドレスを表示倍率情報を元に前記画像
メモリ上の相対読出しアドレスに変換するルックアップ
テーブルと、前記相対読出しアドレスに表示開始位置情
報を加算し前記画像メモリ上の絶対読出しアドレスを作
成する加算回路とを備えて成ることを特徴とする画像表
示装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5241889A JPH02231627A (ja) | 1989-03-03 | 1989-03-03 | 画像表示装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5241889A JPH02231627A (ja) | 1989-03-03 | 1989-03-03 | 画像表示装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02231627A true JPH02231627A (ja) | 1990-09-13 |
Family
ID=12914241
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5241889A Pending JPH02231627A (ja) | 1989-03-03 | 1989-03-03 | 画像表示装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02231627A (ja) |
-
1989
- 1989-03-03 JP JP5241889A patent/JPH02231627A/ja active Pending
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