JP5716216B2 - 電子機器装置及びメモリのデータ更新方法 - Google Patents
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Description
以上説明したように、本実施形態に係るカードリーダ1によれば、CPU10によって、カードリーダ1が待機状態のときに(図4(a)のステップS15:受信なし)、外部ROM11に格納されている作業データ(本実施形態ではプログラムデータ)により、外部RAM12内の作業データを更新することとしているので、正誤判定処理を必要としない。より具体的には、カードリーダ1が上位装置20からコマンドを受信するまでの間(図4(a)のステップS15:受信なし)、CPU20が外部ROM11に格納されている作業データにより、外部RAM12内の作業データを更新し(図4(b)参照)、カードリーダ1が上位装置20からコマンドを受信したとき(図4(a)のステップS15:受信あり)、そのコマンドに従って処理が実行され(図4(a)のステップS16)、コマンド処理が終了すると、再び作業データの更新が行われるので(図4(a)のステップS17:)、正誤判定処理を必要としない。したがって、正誤判定処理を繰り返すことに起因したメモリ消費や処理時間の増加を防ぐことができる。
10 CPU
11 外部ROM
12 外部RAM
13 センサー回路
14 センサー
15 R/W回路
16 ヘッド
17 モータ駆動回路
18 モータ
19 インターフェース回路
20 上位装置
Claims (3)
- 上位装置からコマンドを受信して、当該コマンドに従って処理を実行する電子機器装置であって、
当該電子機器装置の各種動作に必要な作業データが格納される、書換え不可能な第一メモリと、
前記電子機器装置が処理を実行する際に必要な前記作業データがコピーされる、書換え可能な第二メモリと、
前記第一メモリ及び前記第二メモリにアクセス可能な制御部と、を有し、
前記制御部は、前記電子機器装置が前記上位装置からのコマンドに従った処理が終了した待機状態のときに、前記第一メモリと前記第二メモリとの内容の異同によらず、前記第一メモリに格納されている前記作業データにより、前記第二メモリ内の前記作業データを更新する電子機器装置であって、
前記作業データは、所定のデータ数に分割されたブロックデータであって、各ブロックデータを更新している最中に上位装置からコマンドを受信したとき、現在更新中のブロックデータが前記第二メモリにコピーされた後、当該コマンドが実行されることを特徴とする電子機器装置。 - 前記電子機器装置は、上位装置に電気的に接続されたカードリーダであって、
前記制御部は、前記電子機器装置が待機状態のときに、前記第一メモリに格納されている前記作業データにより、前記第二メモリ内の前記作業データを更新し続けることを特徴とする請求項1記載の電子機器装置。 - 各種動作に必要な作業データが所定の単位に分割されたブロックデータとして格納される書換え不可能な第一メモリと、各種処理を実行する際に必要な当該作業データをコピーする書換え可能な第二メモリと、当該第一メモリ及び当該第二メモリにアクセス可能な制御部と、を有し、上位装置からコマンドを受信して、当該コマンドに従って処理を実行する電子機器装置で実行されるメモリのデータ更新方法において、
前記電子機器装置が前記上位装置からの前記コマンドに従った処理が終了して前記コマンドを受信するまでの間、前記第一メモリと前記第二メモリとの内容の異同によらず、前記制御部が、前記第一メモリに格納されている前記作業データにより、前記第二メモリ内の前記作業データを更新するデータ更新ステップと、
各ブロックデータを更新している最中に前記電子機器装置が前記上位装置から前記コマンドを受信したとき、現在更新中のブロックデータが前記第二メモリにコピーされた後、前記コマンドに従って処理が実行されるコマンド処理ステップと、を含むとともに、
前記コマンド処理ステップが終了した後、再び前記データ更新ステップが実行されることを特徴とするメモリのデータ更新方法。
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