JP5355496B2 - バイアス制御増幅器 - Google Patents
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Description
図1に、この発明の実施の形態1に係るバイアス制御増幅器の構成図を示す。図1において、上述の図3に示した従来技術の構成と同一または相当するものには同一符号を付して説明する。図1において、10は比較器、11は減衰器(ATT)、12はドライバ増幅器(DRV)である。
図2に、この発明の実施の形態2に係るバイアス制御増幅器の構成図を示す。図中、図1または図3と同一のものには同一符号を付して示し、ここではその説明を省略する。図2において、20は比較器、21は高域通過フィルタ(HPF)、22は減衰器(ATT)、23は低域通過フィルタ(LPF)である。図1との構成の違いは、図2においては、図1で示した、比較器10、減衰器11、および、ドライバ増幅器12が設けられておらず、代わりに、比較器20、高域通過フィルタ21、減衰器22、低域通過フィルタ23が設けられている点である。従って、図2においては、比較器8の+入力端子への入力は、比較器10およびドライバ増幅器12を介さずに、包絡線入力端子3から直接入力される。他の構成は、図1と同じである。
Fc3<Fc1<Fc2 (1)
の関係を満たすように設定されている。
Claims (5)
- 入力信号を増幅する高出力増幅器と、
前記入力信号の包絡線成分に応じて前記高出力増幅器へ供給される電源電圧を制御するエンベロープ増幅器と、
前記エンベロープ増幅器の出力を前記エンベロープ増幅器の入力に負帰還する第一の負帰還ループと、
前記第一の負帰還ループの外側に設けられ、前記エンベロープ増幅器の出力を前記第一の負帰還ループの入力に負帰還する第二の負帰還ループと
を備えたことを特徴とするバイアス制御増幅器。 - 前記第二の負帰還ループの外側に、前記エンベロープ増幅器の出力を前記第二の負帰還ループの入力に負帰還する1以上の負帰還ループをさらに備えたことを特徴とする請求項1に記載のバイアス制御増幅器。
- 前記エンベロープ増幅器は、パルス幅変調器とスイッチング増幅器と低域通過フィルタの直列接続により構成されることを特徴とする請求項1または2に記載のバイアス制御増幅器。
- 入力信号を増幅する高出力増幅器と、
パルス幅変調器とスイッチング増幅器と第一の低域通過フィルタの直列接続により構成され、前記入力信号の包絡線成分に応じて前記高出力増幅器へ供給される電源電圧を制御するエンベロープ増幅器と、
前記エンベロープ増幅器の出力を前記エンベロープ増幅器の入力に負帰還する第一の負帰還ループと、
前記第一の負帰還ループの外側に設けられ、比較器と高域通過フィルタと第二の低域通過フィルタとを有する第二の負帰還ループと
を備え、
前記第二の負帰還ループは、前記入力信号の包絡線成分を前記比較器に入力するとともに、前記比較器からの出力を前記高域通過フィルタに入力し、前記高域通過フィルタの出力を前記エンベロープ増幅器の出力信号に合成させた出力合成信号を生成し、前記出力合成信号を前記第二の低域通過フィルタを介して前記比較器にフィードバックすることで、前記入力信号の包絡線成分との比較を行い、両者が一致するように負帰還処理を行う
ことを特徴とするバイアス制御増幅器。 - 前記第一の低域通過フィルタのカットオフ周波数をFc1、前記第二の低域通過フィルタのカットオフ周波数をFc2、前記高域通過フィルタのカットオフ周波数をFc3とすると、各カットオフ周波数Fc1、Fc2、および、Fc3は、
Fc3 < Fc1 < Fc2
の関係を満たすように設定されることを特徴とする請求項4に記載のバイアス制御増幅器。
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JP2010117956A JP5355496B2 (ja) | 2010-05-24 | 2010-05-24 | バイアス制御増幅器 |
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JP2010117956A JP5355496B2 (ja) | 2010-05-24 | 2010-05-24 | バイアス制御増幅器 |
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JP2011249892A JP2011249892A (ja) | 2011-12-08 |
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Family Applications (1)
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JP2010117956A Active JP5355496B2 (ja) | 2010-05-24 | 2010-05-24 | バイアス制御増幅器 |
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