JP4934886B2 - 電源回路 - Google Patents
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Description
2 コア部用電源部
3 I/F部用電源部
4 タイミング制御回路
5 コア部
6 I/F部
7 コア部用IC
8 I/F部用IC
Q1 トランジスタ
C4 コンデンサ
Claims (2)
- 第1入力電圧に基づいて、第1被電源供給部に供給する第1電源電圧を生成する第1電源部と、
第2入力電圧に基づいて、第2被電源供給部に供給する第2電源電圧を生成する第2電源部と、
前記第2電源部から出力される前記第2電源電圧が入力されることにより、前記第1電源部が前記第1電源電圧を前記第1被電源供給部に出力するタイミングを、前記第2電源部が前記第2電源電圧を前記第2被電源供給部に出力するタイミングよりも遅延させるタイミング制御部とを備え、
前記第1電源部が、前記第1入力電圧に応じて充電される第1コンデンサと、前記第1コンデンサと共に前記第1コンデンサが充電される際の時定数を決定する第1抵抗と、前記第1コンデンサの一端が接続され前記第1コンデンサの充電電圧が入力される制御端子とを有し、前記制御端子に入力される前記第1コンデンサの充電電圧に応じて前記第1電源電圧を出力し、
前記タイミング制御部が、第2コンデンサと、前記第2コンデンサと共に前記第2コンデンサが充電される際の時定数を決定する第2抵抗と、スイッチ素子とを含み、前記第2コンデンサの一端が前記第2電源部の出力端子に接続され、前記第2コンデンサの他端が前記スイッチ素子の制御電極に接続され、前記スイッチ素子の第1電極が前記制御端子および前記第1コンデンサの一端に接続され、前記スイッチ素子の第2電極が接地電位に接続されており、
前記第2電源部から前記第2電源電圧が前記タイミング制御部に入力開始されたとき、前記第2コンデンサの他端の電圧が増加し、前記スイッチ素子がオン状態になることにより前記制御端子および前記第1コンデンサの一端を接地電位に接続させ、その結果、前記制御端子に前記第1コンデンサの充電電圧が入力されることを禁止し、
その後、前記第2コンデンサおよび前記第2抵抗による時定数に応じて、前記第2コンデンサの他端の電圧によって前記第2コンデンサが充電され、前記第2コンデンサの他端の電圧が低下し、前記スイッチ素子がオフ状態になることにより前記制御端子および前記第1コンデンサの一端を接地電位から開放させ、前記第1コンデンサおよび前記第1抵抗による時定数に応じて、前記第1コンデンサが充電され、その結果、前記第2電源部から前記第2電源電圧が前記タイミング制御部に入力開始されてから所定時間経過後に、前記制御端子に前記第1コンデンサの充電電圧が入力されることを許可する、電源回路。 - 前記タイミング制御部が、カソードが前記第2コンデンサの他端に接続され、アノードが接地電位に接続されたダイオードをさらに含み、
前記第1入力電圧及び前記第2入力電圧が低下したとき、前記第2コンデンサの充電電圧が前記第2電源部側に放電されることによって、その後、前記第1入力電圧及び前記第2入力電圧が増加したときに、前記第2コンデンサの他端の電圧が増加し、前記スイッチ素子がオン状態になり、その後、前記第2コンデンサの他端の電圧が低下し、前記スイッチ素子がオフ状態になる、請求項1に記載の電源回路。
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