JP2009076976A - アナログ信号生成装置 - Google Patents
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Abstract
【解決手段】D/A変換器10は、制御部12がデータ生成部14および16に固定値24を供給し、データ生成部14および16でクロック信号30および32に応じてデータ46および58を生成し、生成したデータ46および58をバッファ部20に出力し、バッファ部20で供給されるデータ46および58を一時的に保持し、制御部12で生成した制御信号26および28を選択部18に供給し、選択部18で供給される制御信号26および28をデコードし、選択信号78なし82を生成し、選択信号78ないし82に応じてバッファ部20の保持したデータ46および58の出力をオン/オフし、フィルタ部22に供給し、フィルタ部22で供給されたデータを基にアナログ信号108を生成する。
【選択図】図1
Description
[X:0]A REGISTER = {1’B0, FIX_DATA} + {1’B0, A REGISTER[(X-1):0];
・・・(1)
を基に生成したデータ46(A[X] :Xビット目のデータ)および出力信号42([(X-1):0]A)を出力する。データ46(A[X])はバッファ部20に供給される。出力信号42([(X-1):0]A)は、加算器34に供給される。
COUNTER1 = COUNTER + 1;
IF(COUNTER1 == 2^X -1) COUNTER1 = 0; ・・・(2)
カウンタ48は、カウンタの出力52(COUNTER1)を比較器50の一端54側に出力する。比較器50には、他端56側に所望のターゲット電圧レベル値である固定値24(FIX_DATA)が供給される。したがって、アナログ信号の電圧レベルを変化させない場合、電圧レベルは一定値となる。
IF(COUNTER1 <= FIX_DATA) COMP = 1;
ELSE COMP = 0; ・・・(3)
すなわち、比較した結果が真の場合、データ58(COMP=1)をバッファ部20に出力する。また、比較器50は、比較した結果が偽の場合、データ58(COMP=0)をバッファ部20に出力する。
IF(COUNTER1[0:(X-1)]) <= FIX_DATA) COMP1 = 1;
ELSE COMP1 = 0; ・・・(4)
すなわち、カウント値120の全ビットの位置をビット中心に対して対称に交換した値が固定値24以下のとき、比較器118はレベル“H”(COMP=1)のデータ46をバッファ84に出力する。逆にカウント値120のMSBとLSBをビット中心に対して対称に交換した値が固定値24より大きいとき、比較器118はレベル“L”(COMP=0)をバッファ84に出力する。バッファ84は、イネーブル信号のレベル“H”期間中に供給されたデータとしてデータ46を出力し、イネーブル信号のレベル“L”期間中の出力を停止する(EN1=1; BUFFER A = COMPl; EN1=0; BUFFER A = Z;)。
lF(COUNTER1 > 2^(X+1) -1) COUNTER1 = (COUNTER1 + 3)%(2^(X+1));
・・・(5)
に応じた減算値-1の値を出力し、セットする。
(FIX_DATA)を比較する。比較器118は、条件式(6)
IF(COUNTER1[(X-1):0] <= FIX_DATA) COMP1 = 1;
ELSE COMP1 = 0; ・・・(6)
が示すように、カウンタ値120の上位1ビットを除く値が固定値24以下のとき、値“1”(COMP1=1)のデータ46を出力し、逆にカウンタ値120の上位1ビットを除く値が固定値24より大きいとき、データ46値“0”(COMP1=0)のデータ46を出力する。
12 制御部
14、16 データ生成部
18 選択部
20 バッファ部
22 フィルタ部
Claims (5)
- 供給される第1のクロック信号に応じて所定の周期内にデータを生成する第1のデータ生成手段と、
供給される第2のクロック信号に応じて可変する周期内にデータを生成する第2のデータ生成手段と、
第1および第2のデータ生成手段から出力されるデータを一時的に保持し、保持したデータの出力におけるオン/オフを切り換える切換手段と、
供給される制御信号をデコードして、オン/オフを切り換える選択信号を生成し、前記切換手段に出力する選択手段と、
第1および第2のデータ生成手段に所定の値を供給し、前記選択手段に制御信号を生成し、供給する制御手段と、
前記切換手段を介して供給されるデータを基にフィルタリングによりアナログ信号を生成するアナログ生成手段を含むことを特徴とするアナログ信号生成装置。 - 請求項1に記載の装置において、第1のデータ生成手段は、前記データを加算する加算手段と、
該加算手段の出力を第1のクロック信号に応じて一時保持し、保持したデータの最上位ビットを出力するデータ記憶手段とを含み、
前記加算手段は、一端側に前記固定値を入力し、他端側に前記保持したデータの最上位ビットを除くビットで表わされるデータを入力し、加算し出力することを特徴とするアナログ信号生成装置。 - 請求項1に記載の装置において、第1のデータ生成手段は、前記供給される第1のクロック信号に応じてカウントし、カウントした計数値を出力する計数手段と、
前記計数値と前記固定値とを入力し、前記計数値を表わすビットすべてをビット中心に対して対称に交換し、交換した値が前記固定値以下にてデータ“1”を出力し、これ以外にてデータゼロを出力する比較手段とを含むことを特徴とするアナログ信号生成装置。 - 請求項1に記載の装置において、第1のデータ生成手段は、前記供給される第1のクロック信号に応じて所定の値を増分としてカウントし、カウントした計数値を出力する計数手段と、
該計数手段の最大値と前記カウントした計数値とを減算し、減算して得られた値が所定の減算値以下にて前記減算して得られた値をセット値としての出力を禁止し、所定の減算値より大きい値をセット値として出力する減算機能付比較手段と、
前記計数値と前記固定値とを入力し、前記計数値が表わすビットにおける所定の上位ビットを除いて表わされる比較値と前記固定値とを比較し、前記比較値が前記固定値以下にてデータ“1”を出力し、これ以外にてデータ“0”を出力する比較手段とを含むことを特徴とするアナログ信号生成装置。 - 請求項1に記載の装置において、前記アナログ生成手段は、複数のフィルタリングするフィルタ手段を含むことを特徴とするアナログ信号生成装置。
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