CN111885410A - 图像数据处理装置、方法及显示装置 - Google Patents

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Abstract

本发明提供一种图像数据处理装置、方法及显示装置。该***包括：多个写控制器，与输入图像被划分的多个图像块一一对应，被配置为获取每一帧输入图像中相对应的图像块的输入数据，并确定输入数据在存储器中存储的帧地址，根据所确定的帧地址向存储器写入输入数据；多个读控制器，每一读控制器分别与输出图像被划分的其中一个图像块对应，读控制器被配置为确定每一帧输出图像中相对应的图像块的输出数据在所述存储器中存储的帧地址，根据所确定的帧地址从存储器读出输出数据。

Description

图像数据处理装置、方法及显示装置
技术领域
本发明涉及显示技术领域，尤其是指一种图像数据处理装置、方法及显示装置。
背景技术
在视频显示***中，为了提升用户的视觉享受品质，视频的分辨率在不断提高，比如分辨率为4096×2160像素的4K高清视频，或分辨率为7680×4320像素的8K超高清视频等，使得视频需要传输和显示的数据流量随其分辨率的提高而不断增加，导致高清视频和超高清视频需要传输和显示的数据流量较为巨大。因此，在高清视频或超高清视频从源端到显示设备的传输过程中，需要同时使用多个视频接口对视频进行多路传输。
在超高分辨率的视频通过多个视频接口输入到***中时，不同接口输入的视频到达***内需要完成视频数据的同步、输入数据的图像分割方式与所需要数据的图像分割方式的变换以及帧率变换等。
发明内容
本发明技术方案的目的是提供一种图像数据处理装置、方法及显示装置，能够保证多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式的变换以及帧率变换。
本发明实施例提供一种图像数据处理装置，其中，包括：
多个写控制器，被配置为分别获取多帧输入图像被划分的多个图像块的输入数据，其中，每一所述写控制器被配置为获取每一帧输入图像被划分的多个图像块中的一个图像块的输入数据，并确定所述输入数据在存储器中存储的帧地址，根据所确定的帧地址向所述存储器发送所述输入数据；
多个读控制器，其中，每一所述读控制器与至少一所述写控制器相关联，每一所述读控制器被配置为确定第一帧地址，根据所述第一帧地址获取所述存储器中为第二帧地址的数据，并输出所获取的为第二帧地址的数据，其中，所述第一帧地址是与每一所述读控制器相关联的所述写控制器当前获取的输入数据在所述存储器中的帧地址，所述第二帧地址与所述第一帧地址之间相差预设固定数量个帧地址。
可选地，所述的图像数据处理装置，其中，每一所述读控制器与至少两个所述写控制器相关联，所述读控制器所获取的数据相对应的图像块，包括第一子图像块和第二子图像块，且不包括第三子图像块和第四子图像块，其中，与所述读控制器相关联的第一写控制器所获取的输入数据相对应的图像块包括所述第一子图像块和第三子图像块，与所述读控制器相关联的第二写控制器所获取的输入数据相对应的图像块包括所述第二子图像块和第四子图像块。
可选地，所述的图像数据处理装置，其中，所述读控制器被配置为：获取所述存储器中为第二帧地址的数据后，再次从所述存储器获取数据时，若与所述读控制器相关联的所述写控制器当前获取的输入数据在所述存储器中的帧地址仍保持为所述第一帧地址，则重复获取为所述第二帧地址的数据。
可选地，所述的图像数据处理装置，其中，所述读控制器被配置为：从所述存储器获取为第二帧地址的数据之前，若所述存储器内还包括为第三帧地址的数据未被获取，则放弃获取为所述第三帧地址的数据，其中，与所述读控制器相关联的所述写控制器发送所述第三帧地址对应的输入数据的时间在发送所述第二帧地址对应的输入数据的时间之前。
可选地，所述的图像数据处理装置，其中，所述图像数据处理装置还包括：
检测模块，被配置为检测输入至每一所述写控制器的输入数据是否为异常数据；
第一图像填补模块，与所述检测模块和所述读控制器连接，所述第一图像填补模块被配置为：获取由每一所述读控制器输出的数据，响应于所述检测模块确定输入至所述写控制器的目标帧相对应图像块的输入数据为异常数据，将所述目标帧相对应图像块的数据以预设填补图像数据输出；或者，所述第一图像填补模块被配置为：
响应于所述检测模块确定当前输入至所述写控制器的输入数据为异常数据，所述读控制器停止获取所述存储器中的数据，所述第一图像填补模块输出预设填补图像数据。
可选地，所述的图像数据处理装置，其中，对于所述第一图像填补模块被配置为：获取由每一所述读控制器输出的数据，响应于所述检测模块确定输入至所述写控制器的目标帧相对应图像块的输入数据为异常数据，将所述目标帧相对应图像块的数据以预设填补图像数据输出的情形，
所述第一图像填补模块还与所述写控制器连接，所述写控制器还被配置为向所述第一图像填补模块输出所述目标帧相对应图像块在所述存储器中的帧地址，所述第一图像填补模块根据所述目标帧相对应图像块在所述存储器中的帧地址，确定所述读控制器输出的所述目标帧相对应图像块的数据。
可选地，所述的图像数据处理装置，其中，所述写控制器还被配置为在向所述存储器发送所述输入数据时，若确定所述输入数据为异常数据，则根据所确定的帧地址，以预设填补图像数据代替所述输入数据发送至所述存储器，或者向所述存储器发送预设字符。
可选地，所述的图像数据处理装置，其中，所述图像数据处理装置还包括：
第二图像填补模块，与所述读控制器连接，被配置为响应于所述读控制器输出的目标帧相对应图像块的输出数据为所述预设字符，将所述目标帧相对应图像块的数据以预设填补图像数据输出。
可选地，所述的图像数据处理装置，其中，多个所述写控制器中，其中一所述写控制器在向所述存储器的目标帧地址发送所述输入数据后，若间隔预设时长未接收到所述输入数据，则在重新接收所述输入数据后，从所述存储器的所述目标帧地址的下一个帧地址开始向所述存储器发送所述输入数据。
可选地，所述的图像数据处理装置，其中，所述读控制器在从所述存储器获取所述第二帧地址的数据的过程中，若与所述读控制器相关联的所述写控制器当前向所述存储器所发送输入数据的帧地址变更为第四帧地址，所述读控制器保持获取所述第二帧地址的数据，直至所述第二帧地址的数据获取完毕，其中，所述第四帧地址和所述第一帧地址不同。
可选地，所述的图像数据处理装置，其中，所述图像数据处理装置还包括：
仲裁器，与所述存储器、所述写控制器和所述读控制器分别连接，所述仲裁器用于配置每一所述写控制器向所述存储器发送所述输入数据的传输权限，以及配置每一所述读控制器从所述存储器读出数据的传输权限。
可选地，所述的图像数据处理装置，其中，所述图像数据处理装置还包括所述存储器，所述存储器为双倍速率存储器，且所述双倍速率存储器通过存储器控制器与所述仲裁器连接；
所述仲裁器还被配置为，当所述写控制器和所述读控制器被配置传输权限时，控制所述写控制器和所述读控制器与所述存储器控制器之间的数据传输通路连通，当所述写控制器和所述读控制器未被配置传输权限时，控制所述写控制器和所述读控制器与所述存储器控制器之间的数据传输通路断开。
可选地，所述的图像数据处理装置，其中，所述图像数据处理装置还包括：
至少两个图像数据输入接口，每一所述图像数据输入接口与至少一所述写控制器连接；所述图像数据输入接口被配置为接收每一帧输入图像的部分待处理数据，并对所述部分待处理数据进行格式转换，获得发送至与其相连接的所述写控制器的所述输入数据。
可选地，所述的图像数据处理装置，其中，不同的所述写控制器将属于同一帧输入图像的输入数据，发送至所述存储器的同一帧地址中，或者发送至所述存储器的不同帧地址中。
本发明实施例还提供一种显示装置，其中，包括显示模组和如上任一项所述的图像数据处理装置。
本发明实施例还提供一种图像数据处理方法，其中，包括：
多个写控制器分别获取多帧输入图像被划分的多个图像块的输入数据，其中，每一写控制器获取每一帧输入图像被划分的多个图像块中的一个图像块的输入数据，并确定所述输入数据在存储器中存储的帧地址，根据所确定的帧地址向所述存储器发送所述输入数据；
多个读控制器分别确定第一帧地址，根据所述第一帧地址获取所述存储器中为第二帧地址的数据，并输出所获取的为第二帧地址的数据，其中，所述第一帧地址是与每一读控制器相关联的所述写控制器当前获取的输入数据的帧地址，所述第二帧地址与所述第一帧地址之间相差预设固定数量个帧地址；其中，每一所述读控制器与至少一所述写控制器相关联。
本发明具体实施例上述技术方案中的至少一个具有以下有益效果：
采用本发明实施例所述图像数据处理装置，利用多个写控制器确定输入图像的多个图像块的输入数据在存储器中存储的帧地址，向存储器发送输入数据，以及利用多个读控制器确定从存储器读出数据时的帧地址并从存储器读出数据，使多个读控制器的数据输出与相关联的多个写控制器的数据输入，保持相差预设固定数量个帧地址，保证从多个读控制器输出的各图像块属于同一图像帧，实现图像数据在存储器中存取地址、存取时机和存取速度的控制，以保证多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式之间的变换以及帧率变换。
附图说明
图1为本发明实施例一所述图像数据处理装置的结构示意图；
图2为说明输入数据的图像分割方式与所需要数据的图像分割方式的变换的原理示意图；
图3为本发明实施例二所述图像数据处理装置的结构示意图；
图4为说明输入数据的图像块分割方式与输出数据的图像块分割方式之间关系的示意图；
图5为说明第一图像填补模块进行预设填补数据输出的原理示意图；
图6a和图6b为说明采用本发明实施例所述图像数据处理装置的其中一实施方式，读写控制方法的示意图；
图7为说明采用本发明实施例所述图像数据处理装置的另一实施方式，读写控制方法的示意图；
图8为说明本发明实施例所述图像数据处理方法的流程示意图。
具体实施方式
为使本发明要解决的技术问题、技术方案和优点更加清楚，下面将结合附图及具体实施例进行详细描述。
为保证多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式之间的变换以及帧率变换，本发明实施例提供一种图像数据处理装置，通过设置与输入图像被划分的图像块一一对应的多个写控制器，以及与输出图像被划分的图像块一一对应的多个读控制器，多个写控制器确定每一帧输入图像被划分的多个图像块中一个图像块的输入数据在存储器中存储的帧地址，并依据该帧地址向存储器中写入输入数据；读控制器确定相对应的图像块的输出数据在所述存储器中存储的帧地址，根据所确定的帧地址从所述存储器读出所述输出数据，这样利用多个写控制器和多个读控制器，分别进行多帧输入图像在存储器中的写入和读取，能够保证多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式之间的变换以及帧率变换。
本发明实施例中，可选地，多个写控制器的数据输入与多个读控制器的数据输出的过程中，读控制器从存储器中读取数据时跟随与之相关联的写控制器写入数据的帧地址，便可使从多个读控制器输出的各图像块属于同一图像帧，即简单地实现输出图像帧同步。
具体地，本发明实施例所述图像数据处理装置，如图1所示，包括：
多个写控制器200，被配置为分别获取多帧输入图像被划分的多个图像块的输入数据，其中，每一写控制器200被配置为获取每一帧输入图像被划分的多个图像块中的一个图像块的输入数据，并确定所述输入数据在存储器100中存储的帧地址，根据所确定的帧地址向存储器100发送所述输入数据；
多个读控制器300，其中，每一读控制器300与至少一写控制器200相关联，每一读控制器300被配置为确定第一帧地址，根据第一帧地址获取存储器100中为第二帧地址的数据，并输出所获取的为第二帧地址的数据，其中，第一帧地址是与每一读控制器300相关联的写控制器200当前获取的输入数据在存储器100中的帧地址，第二帧地址与第一帧地址之间相差预设固定数量个帧地址。
本发明实施例中，可选地，写控制器200与读控制器300可以分别为现场可编程逻辑门阵列(Field Programmable Gate Array，FPGA)芯片，分别对应形成为写控制器200与读控制器300的FPGA芯片与存储器100通过电路线路连接。
本发明实施例中，写控制器200的数量由输入图像被划分的多个图像块的分割数量确定，读控制器300的数量由输出图像中被划分的多个图像块的分割数量确定。
举例说明，如图2所示，输入图像可以通过4个HDMI2.0接口输入至写控制器200，每一帧输入图像依据“田”字型分割方式被划分为四个图像块A、B、C和D；当输入显示模组时，需要输入依据“川”字型分割的图像，每一帧输入图像依据“川”字型分割方式被划分为四个图像块A’、B’、C’和D’，也即需要将依据“田”字型分割的输入数据，变换为依据“川”字型分割的输出数据，以能够输入至显示装置，实现输入数据的图像分割方式的变换。
具体地，结合图4所示，所输出的四个图像块A’、B’、C’和D’中，图像块A’对应输入图像的图像块A的左部分图像块和图像块C的左部分图像块；图像块B’对应输入图像的图像块A的右部分图像块和图像块C的右部分图像块；图像块C’对应输入图像的图像块B的左部分图像块和图像块D的左部分图像块；图像块D’对应输入图像的图像块B的右部分图像块和图像块D的右部分图像块。
基于该实施方式，本发明实施例中，写控制器200的数量为四个，每一帧输入图像中相对应的图像块的输入数据被输入至其中一写控制器200，参阅图1和图2所示，每一帧输入图像中的图像块A、图像块B、图像块C和图像块D的输入数据分别被输入至写控制器200中的第一写控制器201、第二写控制器202、第三写控制器203和第四写控制器204；每一帧输出图像中的图像块A’、图像块B’、图像块C’和图像块D’的输出数据分别被第一读控制器301、第二读控制器302、第三读控制器303和第四读控制器304从存储器100读出，以能够进一步输入至显示模组，用于图像显示。
因此，采用本发明实施例所述图像数据处理装置，通过上述实施结构，能够实现输入数据的图像分割方式的变换。
由于多个写控制器200向存储器100写入输入数据，以及多个读控制器300从存储器100读出输出数据分别能够为独立控制，通过控制写入和读出时的时序即能够保证多接口视频数据输入时的数据同步和帧率变换。
以下结合本发明实施例所述图像数据处理装置，对本发明实施例所述图像数据处理装置实现上述的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式的变换以及帧率变换的具体结构和方式进行详细说明。
参阅图3所示，本发明实施例所述图像数据处理装置，包括存储器100、多个写控制器200和多个读控制器300，可选地，还包括：视频输入模块400、仲裁器500、时序信号发生器600、检测模块700、第一图像填补模块800、存储器控制模块900和视频输出模块1000。
其中，视频输入模块400的数量为至少两个，每一视频输入模块400对应一个视频输入接口，负责依据视频输入接口的协议标准接收每一帧输入图像的部分待处理数据。具体地，所输入视频的每一帧输入图像依据视频输入模块400的数量被划分为几个部分的待处理数据，分别由对应的视频输入模块400输入，通过视频输入模块400传输至对应的写控制器200。
其中，输入至每一视频输入模块400的部分待处理数据的视频的格式可能与写控制器200能接收和处理的数据的格式不同。因此视频输入模块400被配置为接收每一帧输入图像的部分待处理数据，并对该部分待处理数据进行格式转换，获得发送至相对应的写控制器200的输入数据。
例如，输入至每一视频输入模块400的视频的数据格式可能为RGB、YCbCbr444、YCbCr422和YCbCr420的其中一种，位深可能为8位、10位或者12位等，视频输入模块400能够将所输入的为上述格式的部分待处理数据，恢复为标准的视频时序和数据(如包括帧同步信号、行同步信号、视频数据使能信号和视频数据)，并将该部分待处理数据的格式统一为RGB、预设位深(如为10bit位深)的格式。
本发明实施例中，视频输入模块400可以支持的视频接口包括但不限于高清多媒体接口(High Definition Multimedia Interface，HDMI)、显示接口(DisplayPort，DP)和低电压差分信号(Low-Voltage Differential Signaling，LVDS)版本等。
本发明实施例中，写控制器200与视频输入模块400连接，其中一个视频输入模块400与至少一个写控制器200连接，写控制器200的数量由输入图像被划分的多个图像块的分割数量确定，每一写控制器200由所连接的至少一个视频输入模块400获取每一帧输入图像中相对应的图像块的输入数据。
可选地，写控制器200和视频输入模块400的数量相同，多个写控制器200与多个视频输入模块400一一对应地连接，但并不以此为限，具体以至少一视频输入模块400的数据输出能够满足写控制器200的相对应的图像块的数据输入为设定条件。
具体地，写控制器200将接收的相对应的图像块的输入数据以像素行为单位进行数据格式转换，其中每次进行格式转换的像素行数据可以称为突发格式数据，并指定输入数据的图像帧、行和像素在存储器100中的地址，并以突发(也可以称为一次触发)的方式向存储器100写入相对应的图像块的其中一像素行的输入数据。读控制器300指定从存储器100中读出所需要读取的图像帧、行和像素在存储器100中的地址，可选地以突发的方式从存储器100读出输出数据，每次突发从存储器100读出相对应的图像块的其中一像素行的输出数据。读控制器300所读出的输出数据通过视频输出模块1000输出至显示模组的驱动芯片，以在显示模组上显示所输出图像。
本发明实施例中，可选地，所述图像数据处理装置还包括仲裁器500，与存储器100、写控制器200和读控制器300分别连接，该仲裁器500用于配置每一写控制器200向存储器100写入输入数据的传输权限，以及配置每一读控制器300从存储器100读出输出数据的传输权限。
具体地，被配置传输权限的写控制器200获得向存储器100写入输入数据的传输权限，能够向存储器100写入输入数据；被配置传输权限的读控制器300获得从存储器100读取输出数据的传输权限，能够从存储器100中读出输出数据。
本发明实施例中，可选地，存储器100为双倍速率(Double Data Rate，DDR)存储器，且DDR存储器通过存储器控制模块900与仲裁器500连接，其中写控制器200和读控制器300被配置传输权限时与存储器控制模块900之间的数据传输通路连通，写控制器200和读控制器300未被配置传输权限时与存储器控制模块900之间的数据传输通路断开。
采用该实施结构，仲裁器500负责将存储器100、写控制器200、读控制器300和存储器控制模块900通过具有突发功能的总线连接在一起，并且通过一定的仲裁机制对所接入的每一写控制器200和每一读控制器300进行仲裁，获得仲裁的写控制器100和读控制器300被配置传输权限，能够直接与存储器控制模块900建立连接，独立占用与存储器控制模块900之间的数据传输通路。
可选地，写控制器200和读控制器300分别与仲裁器500之间的连接为支持数据突发功能的总线，可选的为采用AXI4-MM总线，其中，写控制器200与读控制器300的设置端为总线主Master端，仲裁器500的设置端为总线从Slave端。
写控制器200和读控制器300分别与仲裁器500之间的总线类型，与存储器控制模块900和仲裁器500之间的总线类型相同。
可选地，仲裁器500采用循环均等的方式配置多个写控制器200和多个读控制器300的传输权限，即每一写控制器200和每一读控制器300在获得传输权限上是平等的，均等循环地获取传输权限。
具体地，写控制器200以像素行为单位进行数据突发，根据像素行像素数据的数量决定突发写入的数据位宽、数据长度等参数，并确定每一像素行的输入数据在存储器100中存储的地址，在获得向存储器100写入数据的传输权限后，向存储器100写入其中一像素行的输入数据，在完成一次突发后释放该传输权限。其中一实施方式，每次突发写入的数据为一像素行的像素数据；另一实施方式，每次突发写入的数据为一像素行的部分像素数据，一像素行的像素数据可以通过多次(如为两次)突发写入过程，写入至存储器100。
同理，读控制器300以像素行为单位进行数据突发，根据像素行像素数据的数量决定突发读取的数据位宽、数据长度等参数，并确定每一像素行的输出数据在存储器100中存储的地址，在获得从存储器100读取数据的传输权限后，从存储器100读取其中一像素行的输出数据，在完成一次突发后释放该传输权限。其中一实施方式，每次突发读取的数据为一像素行的像素数据；另一实施方式，每次突发读取的数据为一像素行的部分像素数据，一像素行的像素数据可以通过多次(如为两次)突发读取过程，从存储器100读取数据。
本发明实施例中，可选地，在存储器100的每一子存储空间内，输入数据依据像素行进行存储，每一像素行对应一行地址，每一像素行内的每一像素对应一像素地址。
存储器100内的存储空间被进行划分和组织，存储空间被划分为多个子存储空间，每一子存储空间对应一个帧地址，进一步地每一子存储空间内，包括对应像素行的行地址以及对应每一像素的像素地址。因此，存储器100内的存储空间包括帧地址(FrameAddress，FA)、行地址(Line Address，LA)和像素地址(Pixel Address,PA)。
具体地，存储器100的存储空间被划分为n个子存储空间，每个子存储空间存放一帧的图像，每个子存储空间对应一个帧地址；例如：第1个子存储空间对应的帧地址为1，第2个子存储空间对应的帧地址为2，…，依此类推，第n个子空间对应的帧地址为n。可选地，在每个子存储空间内，输入数据按照像素行的方式进行存储，每个像素行对应着一个行地址，比如输入数据的第1像素行对应的行地址为0，第2像素行对应的行地址为1，…，依此类推，第H行对应的行地址为H-1。可选地，每一像素行内的每个像素分别对应一个地址，为像素地址。例如，每一像素行的第1个像素的像素地址为0，第2个像素的像素地址为1，…，依此类推，第L个像素的地址为L-1。
可选地，帧地址、行地址和像素地址与存储器100的物理地址存在一定的映射关系，且帧地址、行地址和像素地址分别与存储器100的映射关系不同，比如帧地址可以映射为存储器100的存储库Bank地址，行地址可以映射为存储器100的行Line地址等。
本发明实施例中，存储器控制模块900负责与存储器100进行接口，负责完成存储器100的初始化及管理，将总线突发数据转换为符合存储器100接口要求的数据，并执行该些数据在存储器100中的突发存取。
本发明实施例中，可选地，所述图像数据处理装置还包括时序信号发生器600，与每一读控制器300连接，该时序信号发生器600被配置为向每一读控制器300输入时序信号，使读控制器300响应该时序信号，输出从存储器100读出的所述输出数据。
采用该实施结构，通过时序信号发生器600向每一读控制器300输入时序信号，使读控制器300根据该时序信号，将所读取的输出数据传输至显示模组，以保证读控制器300将输出数据传输至显示模组的时序能够符合显示模组的数据输入频率要求，保证从多个读控制器300读出的属于同一帧的多个输出数据传输至显示模组的时间同步。
本发明实施例中，可选地，如图3所示，所述图像数据处理装置还包括检测模块700和第一图像填补模块800。
其中，检测模块700，被配置为检测输入至每一写控制器200的输入数据是否为异常数据；
第一图像填补模块800，与检测模块700和每一读控制器300连接，该第一图像填补模块800被配置为：获取由每一读控制器300输出的数据，在检测模块700确定输入至写控制器200的目标帧相对应图像块的输入数据为异常数据时，将目标帧相对应图像块的数据以预设填补数据输出；或者，第一图像填补模块800被配置为：
响应于检测模块700确定当前输入至写控制器200的输入数据为异常数据，读控制器300停止获取存储器100中的数据，第一图像填补模块800输出预设填补图像数据。可选地，检测模块700负责检测由每一视频输入模块400输入的输入数据是否为异常数据，检测的内容包括视频输入模块400是否在线(即对应的视频输入模块400是否连接了播放源)、输入数据的分辨率和帧率是否异常等。
其中，当检测模块700确定输入至写控制器200的目标帧相对应图像块的输入数据为异常数据时，第一图像填补模块800将目标帧相对应图像块的输出数据以预设填补数据输出，例如将目标帧相对应图像块的显示区域填充为黑色，以避免将错误格式的图像帧显示出来，避免画屏、闪烁和错位等错误图像显示的情况。
可选地，对于第一图像填补模块800被配置为：获取由每一读控制器300输出的数据，响应于检测模块700确定输入至写控制器200的目标帧相对应图像块的输入数据为异常数据，将所述目标帧相对应图像块的数据以预设填补图像数据输出的情形，第一图像填补模块800还与写控制器200连接，写控制器200还被配置为向第一图像填补模块800输出目标帧相对应图像块在存储器100中的帧地址，第一图像填补模块800根据所述目标帧相对应图像块在存储器100中的帧地址，确定读控制器300输出的所述目标帧相对应图像块的数据。
采用上述方式，第一图像填补模块800根据写控制器200确定为异常数据的目标帧在存储器100中的帧地址，并依据读控制器300从存储器100中读取数据时跟随与之相关联的写控制器200写入数据的帧地址的形式，确定读控制器300输出的目标帧相对应图像块的数据，进行预设填补数据输出，如将目标帧相对应图像块的显示区域填充为黑色，以避免将错误格式的图像帧显示出来。
另一实施方式，第一图像填补模块800响应于检测模块700确定当前输入至写控制器200的输入数据为异常数据，使读控制器300在当前即停止获取存储器100中的数据，并输出预设填补图像数据，直至检测模块700确定输入至写控制器200的输入数据为正常数据。采用该方式，第一图像填补模块800能够通过简单地方式确定读控制器300进行数据输出时需要进行预设填补数据输出的数据，并能够达到有效地避免将错误格式的图像帧显示出来的效果。
因此，本发明实施例中，检测模块700可以检测目标帧相对应图像块的部分输入数据为异常数据，在检测到目标帧相对应图像块的部分输入数据为异常数据时，第一图像填补模块800可以将读控制器300输出画面对应图像块中，检测到错误数据的像素以预设填补数据输出，第一图像填补模块800根据检测模块700的检测结果可以将对应位置的图像填补为黑色画面，例如，结合图4和图5所示，在分割方式不变的情况下，当由图像块A输入的视频分辨率不符合预期，如分辨率或帧率异常时，第一图像填补模块800会将读控制器300输出画面对应图像块A’的位置(也即左上四分之一)填补为黑色画面。
本发明实施例所述图像数据处理装置，另一实施方式，写控制器200还被配置为在向存储器100发送输入数据时，若确定输入数据为异常数据，则根据所确定的帧地址，以预设填补图像数据代替所述输入数据发送至所述存储器，或者向所述存储器发送预设字符。
采用该实施方式，在输入数据为异常数据时，通过写控制器200向存储器100中写入预设填补图像数据，使读控制器300直接读取并输出该预设填补图像数据，在输出图像时进行预设图像填补；可选地，在输入数据为异常数据时，写控制器200也可以向存储器100中写入预设字符，使读控制器300根据所读取的预设字符，将目标帧相对应图像块的数据以预设填补图像数据输出，同样能够达到有效地避免将错误格式的图像帧显示出来的效果。
基于上述实施方式，可选地，所述图像数据处理装置还包括：
第二图像填补模块(图中未显示)，与所述读控制器连接，被配置为响应于所述读控制器输出的目标帧相对应图像块的输出数据为所述预设字符，将所述目标帧相对应图像块的数据以预设填补图像数据输出。根据以上，采用本发明实施例所述图像数据处理装置，利用写控制器和读控制器，能够控制输入图像帧和输出图像帧在存储器中的存取地址、存取时机和存取速度，实现多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式之间的变换以及帧率变换。
以下对采用本发明实施例所述图像数据处理装置，能够实现多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式之间的变换以及帧率变换的具体实施过程进行详细说明。
结合图3所示，该实施方式中，不同的写控制器200将属于同一帧输入图像的输入数据，写入存储器100的同一帧地址中，且写控制器200向存储器100写入输入数据的输入图像帧的过程，与读控制器300从存储器100读出输出数据的输出图像帧的过程相互没有关联，也即图像数据在存储器100中的写入过程和读取过程相互分离。
具体地，如图6a和图6b所示，存储器100的存储空间被划分为n个子存储空间，也即为子存储空间S1、S2，¨¨¨，Sn，每个子存储空间存放一帧的图像，每个子存储空间对应一个帧地址；可选地，每一子存储空间内的每一行地址分别对应一个像素行的行地址；可选地，每一像素行内的每个像素分别对应一个地址，为像素地址。可选地，帧地址、行地址和像素地址与存储器100的物理地址存在一定的映射关系，且帧地址、行地址和像素地址分别与存储器100的映射关系不同，比如帧地址可以映射为存储器100的Bank地址，行地址可以映射为存储器100的Line地址等。
该实施方式中，图像数据在存储器100中的写入过程和读取过程相互分离，也即不同的写控制器200将属于同一帧输入图像不同图像块的输入数据，写入存储器100的同一帧地址中，即同一帧地址对应的空间；在此基础上，多个读控制器300将属于同一帧输出图像的不同图像块由存储器100的同一帧地址中读出。
写控制器200以帧地址依次递增的方式，依次向存储器100写入每一帧输入图像的输入数据；读控制器300以帧地址依次递增的方式，依次从存储器100读出每一帧输出图像的输出数据，且写控制器200触发写入的时钟频率与读控制器300触发读取的时钟频率同步。
如图6a所示为写控制器200写入到存储器100中的图像帧的结构形式图，以输入图像依据“田”字型分割方式被划分为四个图像块为例，n个子存储空间S1、S2，¨¨¨，Sn中，每一子存储空间对应一帧地址，用于存储一帧图像的输入数据，且所存储一帧图像的输入数据依据像素行排列，使每一帧地址内分别包括与四个图像块A、B、C和D对应的输入数据。其中，四个写控制器200与四个图像块一一对应，每一写控制器200对应分别读取其中一图像块的输入数据，将相应图像块的输入数据写入存储器100的相对应图像块的存储空间中。具体地，帧地址为N内所存储对应图像块A、B、C和D的输入数据分别表示为I(x)-A、I(x)-B、I(x)-C和I(x)-D。其中，x为1至n中的任一整数，n为所存储图像的最大帧数。
图6b所示为读控制器300从存储器100读取图像帧的结构形式图，以输出图像依据“川”字型分割方式被划分为四个图像块为例，四个读控制器300与四个图像块一一对应，该四个读控制器300分别对应依据图6b所示划分的图像块，由相应的图像块内读出存储数据；其中，四个读控制器300所分别读取的帧地址为N内的输出数据分别表示为O(x)-A’、O(x)-B’、O(x)-C’和O(x)-D’。其中，x为1至n中的任一整数，n为所存储图像的最大帧数。
具体地，每一写控制器200向存储器100写入输入数据的帧地址以1递增，以像素行为单位进行数据突发，向存储器100写入一帧输入图像的每一像素行的输入数据后，对应的帧地址加一，进行下一帧输入图像的数据写入；同理，读控制器300从存储器100读取输出数据的帧地址以1递增，以像素行为单位进行数据突发，从存储器100读取一帧输出图像的输出数据后，对应的帧地址加一，进行下一帧输出图像的数据读出。
基于上述的图像数据的存储方式，能够实现输入数据的图像分割方式与所需要输出数据的图像分割方式之间的变换，具体为：
该实施方式中，如图3所示，每一视频输入模块400对应一个写控制器200，每一写控制器400负责将相对应的视频输入模块400输入的输入数据写入到存储模块100的存储空间中，如图6a所示并结合图3，第一写控制器201可以将对应的视频输入模块400输入的输入数据存储在I(x)-A位置上，第二写控制器202将对应的视频输入模块400输入的输入数据存储在I(x)-B位置上，第三写控制器203将对应的视频输入模块400输入的输入数据存储在I(x)-C位置上，第四写控制器204将对应的视频输入模块400输入的输入数据存储在I(x)-D位置上，以此类推，其中，x为1至n中的任一整数，n为所存储图像的最大帧数。
可选地，写控制器200使用数据突发的方式将输入图像的输入数据写入存储器中，每次突发传输一行像素的数据，每次突发的地址为像素行第一个像素的地址，比如输入图像块B第p帧第q行突发的地址为：帧地址p+行地址q+像素地址L/2，其中L为像素地址；完成一个像素行的突发后，进行下一个像素行的突发，所以行地址加一，直到所有的像素行都被写入存储器100中。
图像帧写入存储器100中后，再由读控制器300从存储器100中读出，如图6b所示，每一读控制器300对应读取一个图像块，例如第一读控制器301读取O(x)-A’位置的图像块，第二读控制器302读取O(x)-B’位置的图像块，第三读控制器303读取O(x)-C’位置的图像块，第四读控制器304读取O(x)-D’位置的图像块，以此类推。因此，实现输出图像的图像分割方式与输入图像的图像分割方式相比发生改变。
同样，读控制器300使用数据突发的方式将图像帧由存储器100中读出，每次突发传输一像素行的输出数据，每次突发的地址为像素行第一个像素的地址，比如输出图像块D第p帧第q行突发的地址为：帧地址p+行地址q+像素地址L*3/4，完成一行像素的突发后，便进行下一个像素行的突发，所以行地址加一，直到所有的像素行都被从存储器中读出。
上述实施方式中，能够实现写入图像块和读取图像块不同时的图像数据的写入和读取，从而能够完成图像分割方式的变换。
该实施方式中，能够实现多接口视频数据输入时的帧率变换，具体为：
在输入图像的帧率大于输出图像的帧率时，所述写控制器在目标时钟周期内依次向所述存储器写入n帧输入图像的输入数据时，所述读控制器在所述目标时钟周期内对应依次从所述存储器读出m帧输出图像的输出数据，之后所述读控制器放弃读取第m帧输出图像之后的n-m帧的输出图像；
其中，n为输入图像的帧率与目标公约数相除所获得数值；m为输出图像的帧率与所述目标公约数相除所获得数值；所述目标公约数为输入图像的帧率与输出图像的帧率之间的公约数。需要说明的是，公约数也即为能够被输入图像的帧率与输出图像的帧率同时均整除的整数值。可选地，目标公约数可以为输入图像的帧率与输出图像的帧率之间的最大公约数。
具体地，帧率变换是通过读写帧的次数控制来实现的，该实施方式中，保持写控制器200的数据写入和读控制器300的数据读出的时钟为同源时钟，并且两者之间的时钟频率和帧率保持为同样的比例关系。
根据上述的实施方式，需要确定输入图像的帧率和输出图像的帧率的目标公约数，将输入图像的帧率除以该目标公约数，获得对应输入图像的帧率的数值n；将输出图像的帧率除以该目标公约数，获得对应输出图像的帧率的数值m。将n与m进行比较，也即将输入图像的帧率与输出图像的帧率进行比较，在n大于m时，写控制器200在目标时钟周期内依次向存储器100写入m帧输入图像的输入数据时，读控制器300在目标时钟周期内对应依次从存储器100读出m帧输出图像的输出数据，之后写控制器200丢弃第m帧输入图像之后的n-m帧的输入图像。
具体地，也即为写控制器200每写入n帧的输入图像，读控制器300对应读出m帧的输出图像，丢弃第m帧输入图像之后的n-m帧的输入图像。举例说明，在输入图像的帧率为60fps，输出图像的帧率为50fps时，这两者的公约数包括1、2、5、10，如确定目标公约数为10，则确定目标公约数为最大公约数10，确定n为6，m为5，相应的写控制器200向存储器100写入图像帧的顺序为1、2、3、4、5、6，读控制器300从存储器200读取图像帧的顺序为1、2、3、4、5，放弃读取第6帧的输出图像。
另一实施方式中，在输入图像的帧率小于输出图像的帧率时，所述写控制器在目标时钟周期内依次向所述存储器写入n帧输入图像的输入数据时，所述读控制器在所述目标时钟周期内对应依次从所述存储器读出n帧输出图像的输出数据，之后对于所读取的n帧输出图像中的最后m-n帧输出图像，所述读控制器在所述目标时钟周期内分别重复读取一次；
其中，n为输入图像的帧率与目标公约数相除所获得数值；m为输出图像的帧率与所述目标公约数相除所获得数值；所述目标公约数为输入图像的帧率与输出图像的帧率之间的公约数。
该实施方式中，写控制器200每写入n帧的输入图像，读控制器300对应读出m帧的输出图像，除了依次读取写控制器200所写入的n帧的输入图像外，还需要在读取第n帧输出图像后，重复读取后面的m-n帧输出图像一次。举例说明，在输入图像的帧率为50fps，输出图像的帧率为60fps时，这两者的公约数包括1、2、5、10，如确定目标公约数为最大公约数10，则确定n为5，m为6，m-n为1；则相应的写控制器200向存储器100写入图像帧的顺序为1、2、3、4、5，共5帧，读控制器300从存储器200读取图像帧的顺序为1、2、3、4、5、5，共6帧，重复读取第5帧的输出图像一次。
根据以上，采用上述图像数据写入和读取的方式，能够实现多接口视频数据输入时的帧率变换。
该实施方式中，能够实现多接口视频数据输入时的数据同步，具体为：
为了保障帧同步，多个写控制器200将输入的同一帧的多个图像块的输入数量同时写入存储器100的同一子存储空间，即具有相同帧地址的地址空间；同时必须要求多个读控制器300同时在存储器100的同一个子存储空间读出一幅图像帧的多个图像块，且读控制器300使用相同的视频时序进行驱动，以保证像素级的同步。
由于写控制器200与视频输入模块400直接连接，所以受外部输入的影响，可能存在某一视频输入模块400的线缆被拔掉，或全部的视频输入模块400突然停止输入等情况发生，必须使用一定的方法和机制来对应这些情况。
本发明实施例中，多个所述写控制器200中，其中一写控制器200间隔预设时长未接收到输入数据时，在重新接收输入数据后，确定其他所述写控制器在所述存储器中存储所述输入数据的下一帧地址，将当前所接收的所述输入数据，写入所述存储器的相应下一帧地址。
具体地，当某一或某几个视频输入模块400的视频线缆被拔掉或停止输入视频信号时，对应的写控制器200停止了对存储器100的写入操作，存储器100内当前的数据写入地址也停止更新，停止在某一地址空间上，而其他正常连接的视频输入模块400对应的写控制器200还在正常的向存储器100写入数据，写地址也在不停的更新，这样不同的视频输入模块400也即输入接口对应的输入数据写入帧地址就会不同，当视频线缆再次插上恢复视频的输入后，不同输入接口的图像块就会写入不同子存储空间，造成帧的不同步，为了避免出现这种情况发生，当停止输入的接口重新恢复输入时，其对应的写控制器200必须跟随正在正常输入的视频输入模块对应的写控制器200使用的帧地址，比如视频输入模块A和C停止视频输入，而视频输入模块B和D正常输入，则相对应的写控制器A和C停止对存储器的图像数据写入，帧地址停留在a，而相对应的写控制器B和D继续对存储器进行图像数据写入，帧地址在不停的更新累加，当帧地址更新到b时，视频输入模块A和C的视频输入恢复，此时写控制器A和C不可以再使用帧地址a，而要使用帧地址c开始进行视频数据的写入。此时，写控制器B和D输入的帧地址也是帧地址c，因此，实现各接口视频数据输入的数据同步。
可选地，若全部的视频输入模块都停止输入，且全部的视频输入模块同时恢复输入，则所有写控制器使用其中任一个写控制器对应的帧地址；而当全部的视频输入模块的输入逐次恢复时，则第一个恢复的视频输入模块相对应的写控制器使用上一次停止时帧地址的下一个帧地址进行数据写入，后面恢复的写控制器跟随前面恢复的写控制器的帧地址。
因此，通过上述方式，能够实现多接口视频数据输入时的数据同步，但是写控制器200必须将属于同一帧输入图像的输入数据，写入存储器100的同一帧地址。
本发明实施例所述图像数据处理装置，除采用上述读控制器300从存储器100读取数据的过程与写控制器200向存储器100的数据写入过程相互不关联方式外，还可以采用多个读控制器的数据输出与相关联的多个写控制器的数据输入，保持相差预设固定数量个帧地址的方式，同样能够实现多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式之间的变换以及帧率变换的效果。
该实施方式中，存储器100的存储空间被划分为n个子存储空间，每个子存储空间存放一帧的图像，每个子存储空间对应一个帧地址；可选地，每一像素行内的每个像素分别对应一个地址，为像素地址。
在该实施方式中，不同的写控制器200可以将属于同一帧输入图像的输入数据，写入存储器100的同一帧地址，也可以写入不同的帧地址。
该实施方式中，每一读控制器300与至少一写控制器200相关联，每一读控制器300被配置为确定第一帧地址，根据第一帧地址获取存储器100中为第二帧地址的数据，并输出所获取的为第二帧地址的数据，其中，第一帧地址是与每一读控制器300相关联的写控制器200当前获取的输入数据在存储器100中的帧地址，第二帧地址与第一帧地址之间相差预设固定数量个帧地址。采用该实施方式，读控制器300相关联的写控制器200在向存储器100写入为第一帧地址的输入数据后，读控制器300从存储器100读取为第二帧地址的输出数据；
其中，所述第一帧地址与所述第二帧地址相差预设固定数量个帧地址。
基于该实施方式，读控制器300从存储器100所读取的帧地址跟随写控制器200向存储器100所写入数据的帧地址。因此，只需要确定读控制器300所跟随的写控制器200，也即确定与读控制器300所关联的写控制器200，确定相关联的写控制器200当前向存储器100写入输入数据时的帧地址，即能够确定读控制器300从存储器100读取输出数据时的帧地址。因此，不要求不同的写控制器200将属于同一帧输入图像的输入数据，写入存储器100的同一帧地址，对同一帧输入图像在存储器中的存储帧地址没有限制，通过读控制器300从存储器100中读取数据时跟随与之相关联的写控制器200写入数据的帧地址，便可实现从多个读处理器300输出的各图像块属于同一图像帧，即简单地实现输出图像帧同步。
如图7所示，举例说明，存储器100的存储空间被划分为n个子存储空间，也即为子存储空间S1、S2，¨¨¨，Sn时，采用该实施方式，对于图像帧4，图像块I(4)-A被写入帧地址为4的子存储空间、图像块I(4)-B和图像块I(4)-C分别被写入帧地址为3的子存储空间、图像块I(4)-D被写入帧地址为5的子存储空间中。
其中，读控制器300从存储器100中读取图像帧的帧地址跟随写控制器200的写入存储器100的帧地址，根据图像跨度选择所跟随的写控制器200。
具体地，每一读控制器300与至少两个写控制器200相关联，读控制器300所获取的数据相对应的图像块，包括第一子图像块和第二子图像块，且不包括第三子图像块和第四子图像块，其中，与读控制器300相关联的第一写控制器所获取的输入数据相对应的图像块包括所述第一子图像块和第三子图像块，与读控制器相关联的第二写控制器所获取的输入数据相对应的图像块包括第二子图像块和第四子图像块。
举例说明，如图4所示，读控制器300所获取的数据相对应的图像块为A’时，图像块A’包括输入数据的图像块A的左部分图像块(第一子图像块)和输入数据的图像块C的左部分图像块(第二子图像块)，不包括图像块A的右部分图像块(第三子图像块)和图像块C的右部分图像块(第四子图像块)；而与该读控制器300相关联的第一写控制器所获取的输入数据相对应的图像块A包括该第一子图像块和第三子图像块，与该读控制器相关联的第二写控制器所获取的输入数据相对应的图像块C包括第二子图像块和第四子图像块。
因此，对应用于读取图像块A’的读控制器300与两个写控制器(对应输入数据图像块A的写控制器和对应输入数据图像块C的写控制器)相关联。
根据以上原理，结合图2和图4的输入数据图像块的划分方式和输出数据图像块的划分方式，可以确定每一读控制器所关联的写控制器，在此不再一一举例说明。
具体地，根据读控制器300所对应图像帧的图像块和写控制器200所对应图像帧的图像块之间的对应关系，确定读控制器300相关联的写控制器200。其中，读控制器300所对应的图像块分布于不同的写控制器200的图像块中时，包括读控制器300所对应的图像块的每一部分的写控制器200属于该读控制器300所关联的写控制器200。
举例说明，如图7所示，比如读控制器300的输出数据对应的图像块A’分布于写控制器200的输入的图像块A和图像块C中，所以对应图像块A’的读控制器300的读取帧地址分别跟随图像块A和图像块C所对应的写控制器200的写入帧地址，图像块不同部分所跟随的写控制器200不同，比如在读取图像块A’的上半部分时，读控制器300的帧地址跟随图像块A所对应的写控制器200的帧地址，在读取图像块A’的下半部分时，读控制器的帧地址跟随图像块C所对应写控制器的帧地址。
具体地，跟随方式为使读控制器300所读取存储器100的第二帧地址与写控制器200向存储器100所写入的第一帧地址，两个帧地址之间相差预设固定数量个帧地址。也即，读控制器300所读取的帧地址为写控制器200所写入的帧地址减去预设固定数量个帧地址值s(s为1，2，……n-1中的其中之一，n为子存储空间的总数量)确定，其中s优选的选择2。
上述的图像数据的存储方式，能够实现输入数据的图像分割方式与所需要数据的图像分割方式之间的变换，具体为：
每一视频输入模块400对应一个写控制器200，每一写控制器200对应输入图像的一个图像块，负责将相对应的视频输入模块400输入的输入数据写入到存储模块100的存储空间中。每一读控制器300对应输出图像的一个图像块，依据上述的跟随方式，从存储空间100的存储空间中读取输出数据。
具体地，写控制器200使用数据突发的方式将输入图像的输入数据写入存储器中，每次突发传输一行像素的数据；同样，读控制器300使用数据突发的方式将图像帧由存储器100中读出，每次突发传输一像素行的输出数据。其中，具体地数据写入和数据读出的具体方式与实施方式一相同，在此不再详细说明。
采用该实施方式，举例说明，如图7所示，以写入第4帧图像为例，写控制器将图像块A写入帧地址为4的子存储空间，将图像块B和图像块C写入帧地址为3的子存储空间，将图像块D写入帧地址为5的子存储空间。读控制器300跟随写控制器的帧地址，假设跟随地址所相差的预设固定数量个帧地址值s为2，则读控制器A’和B’在读取上半部分图像时跟随写控制器A的帧地址为4-2＝2，读取下半部分图像时跟随写控制器C的帧地址为3-2＝1；则读控制器C’和D’在读取上半部分图像时跟随写控制器B的帧地址为3-2＝1，读取下半部分图像时跟随写控制器D的帧地址为5-2＝3。读写都是使用突发的方式，每次突发对应写入或读取一行的像素数据，每完成一行的突发，突发的行地址加一，直到整帧图像读写完成。因此，读控制器300读取的图像帧比对应写控制器200输入图像的图像帧少2帧，即输出图像帧的各图像块对应输入的第2帧图像，且同时实现了图像帧分割方式的变换。
该实施方式中，能够实现多接口视频数据输入时的帧率变换，具体为：
该实施方式中，因为采用读控制器300从存储器100中读取图像帧的帧地址跟随写直接存储器存取模块200的写入存储器100的帧地址的方式，进行数据写入和读取，因此能够实现帧率变换的自动完成。
本发明实施例中，读控制器300还被配置为：获取存储器100中为第二帧地址的数据后，再次从存储器100获取数据时，若与读控制器300相关联的写控制器200当前获取的输入数据在存储器100中的帧地址仍保持为第一帧地址，则重复获取为第二帧地址的数据。
具体地，跟随地址所相差的预设固定数量个帧地址值为s，当写入图像的帧率小于读取图像的帧率时，读控制器300完成一帧图像读取后，如果写控制器200写入的帧地址还没有发生变化，所以读控制器300所读取的下一帧的帧地址保持不变，以此能够完成帧的重复读取。
另一实施方式，当写入图像的帧率大于读取图像的帧率时，在读控制器300读取一帧图像的过程中，写控制器200所写入的帧地址可能已经更新多次(如为两次)；基于此，当读控制器300读取下一帧时，所读取的帧地址需要为增加预设固定数量个帧地址值s，位于中间的帧地址的输出数据被丢弃。例如，s为2时，当读控制器300读取下一帧时，所读取的帧地址增加2个帧地址，中间一帧被丢弃。
因此，根据以上原理，读控制器300从存储器100读取为第二帧地址的输出数据后，再次从存储器100读取输出数据时，若读控制器300相关联的写控制器200向存储器100所写入的输入数据的帧地址仍保持为第一帧地址时，则重复读取为第二帧地址的输出图像的输出数据。
读控制器300从存储器100读取为第二帧地址的输出数据之前，若存储器100内还包括第三帧地址的输出数据未被读取，同丢弃也即放弃获取所述第三帧地址的输出数据；其中，与读控制器300相关联的写控制器200发送第三帧地址对应的输入数据的时间在发送所述第二帧地址对应的输入数据的时间之前；也即，第三帧地址与所述第一帧地址之间帧地址的差别大于所述预设数量。
采用该实施方式，不要求写控制器200和读控制器300两端的时钟为同步，也不需要两端的时钟频率比例和帧率的比例相同。
该实施方式中，能够实现多接口视频数据输入时的数据同步，具体为：
由于读控制器300按照图像块跟随写控制器200的帧地址，所以不要求写控制器200将同一帧的不同图像块写入相同的子存储空间，因此写入的同一帧的多个图像块的帧地址可以各不相同。这样就不需要不同视频输入模块间的帧地址同步，当某一视频输入模块的视频输入停止后，帧地址也停止更新，当再次恢复时，继续在停止时的帧地址开始即可。
由于写控制器200的帧地址很可能在读控制器300读取某一帧图像期间发生变化和更新，所以读控制器300端需要在每帧图像读取开始的时候将对应写控制器200的帧地址进行锁存，然后在进行减去预设固定数量个帧地址值s的处理，根据写控制器200当前所写入的帧地址，确定所需要读取的帧地址，在整帧的图像块读取的过程中统一使用锁存后的地址，这样即使写控制器200的帧地址发生了变化，也不会影响读控制器300的帧地址。
因此，读控制器300在从存储器100读取第二帧地址的输出数据的过程中，若读控制器300相关联的写控制器200当前向存储器100所写入输入数据的帧地址由第一帧地址变更为第四帧地址，读控制器300保持读取第二帧地址的输出数据，直至所述第二帧地址的输出数据读取完毕。
本发明实施例所述图像数据处理装置，利用多个写控制器和多个读控制器，分别进行每一帧输入数据在存储器中的写入和读取，能够保证多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式的变换以及帧率变换。
本发明实施例还提供一种显示装置，所述显示装置包括上述任一实施结构的图像数据处理装置。
其中，所述显示装置还包括显示模组，与图像数据处理装置连接，图像数据处理装置的读控制器300所读取的输出数据能够输入至显示模组，用于显示由视频输入模块所输入的视频图像。
采用本发明实施例所述图像数据处理装置的显示装置，图像数据处理装置将由视频输入模块所输入的数据转换为能够输入至显示模组的数据，并保证多接口视频数据输入时的数据同步、输入数据的图像分割方式与所需要数据的图像分割方式的变换以及帧率变换。
本发明实施例另一方面还提供一种图像数据处理方法，如图8所示，包括：
S810，多个写控制器分别获取多帧输入图像被划分的多个图像块的输入数据，其中，每一写控制器获取每一帧输入图像被划分的多个图像块中的一个图像块的输入数据，并确定所述输入数据在存储器中存储的帧地址，根据所确定的帧地址向所述存储器发送所述输入数据；
S820，多个读控制器分别确定第一帧地址，根据所述第一帧地址获取所述存储器中为第二帧地址的数据，并输出所获取的为第二帧地址的数据，其中，所述第一帧地址是与每一读控制器相关联的所述写控制器当前获取的输入数据的帧地址，所述第二帧地址与所述第一帧地址之间相差预设固定数量个帧地址；其中，每一所述读控制器与至少一所述写控制器相关联。
采用本发明实施例所述图像数据处理方法，多个写控制器的数据输入与多个读控制器的数据输出的过程中，读控制器从存储器中读取数据时跟随与之相关联的写控制器写入数据的帧地址，便可使从多个读控制器输出的各图像块属于同一图像帧，即简单地实现输出图像帧同步，并能够实现输入数据的图像分割方式与所需要数据的图像分割方式的变换以及帧率的变换。
以上所述的是本发明的优选实施方式，应当指出对于本技术领域的普通人员来说，在不脱离本发明所述原理前提下，还可以作出若干改进和润饰，这些改进和润饰也应视为本发明的保护范围。

Claims (16)

1.一种图像数据处理装置，其特征在于，包括：
多个写控制器，被配置为分别获取多帧输入图像被划分的多个图像块的输入数据，其中，每一所述写控制器被配置为获取每一帧输入图像被划分的多个图像块中的一个图像块的输入数据，并确定所述输入数据在存储器中存储的帧地址，根据所确定的帧地址向所述存储器发送所述输入数据；
多个读控制器，其中，每一所述读控制器与至少一所述写控制器相关联，每一所述读控制器被配置为确定第一帧地址，根据所述第一帧地址获取所述存储器中为第二帧地址的数据，并输出所获取的为第二帧地址的数据，其中，所述第一帧地址是与每一所述读控制器相关联的所述写控制器当前获取的输入数据在所述存储器中的帧地址，所述第二帧地址与所述第一帧地址之间相差预设固定数量个帧地址。
2.根据权利要求1所述的图像数据处理装置，其特征在于，每一所述读控制器与至少两个所述写控制器相关联，所述读控制器所获取的数据相对应的图像块，包括第一子图像块和第二子图像块，且不包括第三子图像块和第四子图像块，其中，与所述读控制器相关联的第一写控制器所获取的输入数据相对应的图像块包括所述第一子图像块和第三子图像块，与所述读控制器相关联的第二写控制器所获取的输入数据相对应的图像块包括所述第二子图像块和第四子图像块。
3.根据权利要求1所述的图像数据处理装置，其特征在于，所述读控制器被配置为：获取所述存储器中为第二帧地址的数据后，再次从所述存储器获取数据时，若与所述读控制器相关联的所述写控制器当前获取的输入数据在所述存储器中的帧地址仍保持为所述第一帧地址，则重复获取为所述第二帧地址的数据。
4.根据权利要求1所述的图像数据处理装置，其特征在于，所述读控制器被配置为：从所述存储器获取为第二帧地址的数据之前，若所述存储器内还包括为第三帧地址的数据未被获取，则放弃获取为所述第三帧地址的数据，其中，与所述读控制器相关联的所述写控制器发送所述第三帧地址对应的输入数据的时间在发送所述第二帧地址对应的输入数据的时间之前。
5.根据权利要求1所述的图像数据处理装置，其特征在于，所述图像数据处理装置还包括：
检测模块，被配置为检测输入至每一所述写控制器的输入数据是否为异常数据；
第一图像填补模块，与所述检测模块和所述读控制器连接，所述第一图像填补模块被配置为：获取由每一所述读控制器输出的数据，响应于所述检测模块确定输入至所述写控制器的目标帧相对应图像块的输入数据为异常数据，将所述目标帧相对应图像块的数据以预设填补图像数据输出；或者，所述第一图像填补模块被配置为：
响应于所述检测模块确定当前输入至所述写控制器的输入数据为异常数据，所述读控制器停止获取所述存储器中的数据，所述第一图像填补模块输出预设填补图像数据。
6.根据权利要求5所述的图像数据处理装置，其特征在于，对于所述第一图像填补模块被配置为：获取由每一所述读控制器输出的数据，响应于所述检测模块确定输入至所述写控制器的目标帧相对应图像块的输入数据为异常数据，将所述目标帧相对应图像块的数据以预设填补图像数据输出的情形，
所述第一图像填补模块还与所述写控制器连接，所述写控制器还被配置为向所述第一图像填补模块输出所述目标帧相对应图像块在所述存储器中的帧地址，所述第一图像填补模块根据所述目标帧相对应图像块在所述存储器中的帧地址，确定所述读控制器输出的所述目标帧相对应图像块的数据。
7.根据权利要求1所述的图像数据处理装置，其特征在于，所述写控制器还被配置为在向所述存储器发送所述输入数据时，若确定所述输入数据为异常数据，则根据所确定的帧地址，以预设填补图像数据代替所述输入数据发送至所述存储器，或者向所述存储器发送预设字符。
8.根据权利要求7所述的图像数据处理装置，其特征在于，所述图像数据处理装置还包括：
第二图像填补模块，与所述读控制器连接，被配置为响应于所述读控制器输出的目标帧相对应图像块的输出数据为所述预设字符，将所述目标帧相对应图像块的数据以预设填补图像数据输出。
9.根据权利要求1所述的图像数据处理装置，其特征在于，多个所述写控制器中，其中一所述写控制器在向所述存储器的目标帧地址发送所述输入数据后，若间隔预设时长未接收到所述输入数据，则在重新接收所述输入数据后，从所述存储器的所述目标帧地址的下一个帧地址开始向所述存储器发送所述输入数据。
10.根据权利要求1所述的图像数据处理装置，其特征在于，所述读控制器在从所述存储器获取所述第二帧地址的数据的过程中，若与所述读控制器相关联的所述写控制器当前向所述存储器所发送输入数据的帧地址变更为第四帧地址，所述读控制器保持获取所述第二帧地址的数据，直至所述第二帧地址的数据获取完毕，其中，所述第四帧地址和所述第一帧地址不同。
11.根据权利要求1至10任一项所述的图像数据处理装置，其特征在于，所述图像数据处理装置还包括：
仲裁器，与所述存储器、所述写控制器和所述读控制器分别连接，所述仲裁器用于配置每一所述写控制器向所述存储器发送所述输入数据的传输权限，以及配置每一所述读控制器从所述存储器读出数据的传输权限。
12.根据权利要求11所述的图像数据处理装置，其特征在于，所述图像数据处理装置还包括所述存储器，所述存储器为双倍速率存储器，且所述双倍速率存储器通过存储器控制器与所述仲裁器连接；
所述仲裁器还被配置为，当所述写控制器和所述读控制器被配置传输权限时，控制所述写控制器和所述读控制器与所述存储器控制器之间的数据传输通路连通，当所述写控制器和所述读控制器未被配置传输权限时，控制所述写控制器和所述读控制器与所述存储器控制器之间的数据传输通路断开。
13.根据权利要求1-10任一项所述的图像数据处理装置，其特征在于，所述图像数据处理装置还包括：
至少两个图像数据输入接口，每一所述图像数据输入接口与至少一所述写控制器连接；所述图像数据输入接口被配置为接收每一帧输入图像的部分待处理数据，并对所述部分待处理数据进行格式转换，获得发送至与其相连接的所述写控制器的所述输入数据。
14.根据权利要求1至10任一项所述的图像数据处理装置，其特征在于，不同的所述写控制器将属于同一帧输入图像的输入数据，发送至所述存储器的同一帧地址中，或者发送至所述存储器的不同帧地址中。
15.一种显示装置，其特征在于，包括显示模组和权利要求1至14任一项所述的图像数据处理装置。
16.一种图像数据处理方法，其特征在于，包括：
多个写控制器分别获取多帧输入图像被划分的多个图像块的输入数据，其中，每一写控制器获取每一帧输入图像被划分的多个图像块中的一个图像块的输入数据，并确定所述输入数据在存储器中存储的帧地址，根据所确定的帧地址向所述存储器发送所述输入数据；
多个读控制器分别确定第一帧地址，根据所述第一帧地址获取所述存储器中为第二帧地址的数据，并输出所获取的为第二帧地址的数据，其中，所述第一帧地址是与每一读控制器相关联的所述写控制器当前获取的输入数据的帧地址，所述第二帧地址与所述第一帧地址之间相差预设固定数量个帧地址；其中，每一所述读控制器与至少一所述写控制器相关联。
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